JP3111277B2 - サーマルヘッド駆動用ｉｃ - Google Patents
サーマルヘッド駆動用ｉｃInfo
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- JP3111277B2 JP3111277B2 JP6365998A JP6365998A JP3111277B2 JP 3111277 B2 JP3111277 B2 JP 3111277B2 JP 6365998 A JP6365998 A JP 6365998A JP 6365998 A JP6365998 A JP 6365998A JP 3111277 B2 JP3111277 B2 JP 3111277B2
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Description
【０００１】
【発明の属する技術分野】本発明は、主としてサーマル
ヘッド駆動用ＩＣの信号配線に関する。
ヘッド駆動用ＩＣの信号配線に関する。
【０００２】
【従来の技術】従来、図２に示すようにサーマルヘッド
駆動用ＩＣには、クロックライン８、ラッチライン１
０、イネーブルライン１１がともに入力側しかなく出力
側にはなかったので、２段目以降のサーマルヘッド駆動
用ＩＣ（図示せず。）のクロックライン、ラッチライ
ン、イネーブルラインには、複数個のサーマルヘッド駆
動用ＩＣが直線上に配置されるヘッド基板を介して、ク
ロック信号ＣＬ、ラッチ信号Ｂ、イネーブル信号Ａ等が
それぞれ入力されていた。なお、図２のＣは印字データ
信号であり、ＤＯ１、ＤＯ２・・・ＤＯｎは、サーマル
ヘッド駆動用ＩＣのドライバを示している。シフトレジ
スタ２６は、シリアルデータをクロック信号に同期して
順次シフトする機能を備え、ラッチ回路２７は、シフト
レジスタの内容を保持する機能を備えるものである。
駆動用ＩＣには、クロックライン８、ラッチライン１
０、イネーブルライン１１がともに入力側しかなく出力
側にはなかったので、２段目以降のサーマルヘッド駆動
用ＩＣ（図示せず。）のクロックライン、ラッチライ
ン、イネーブルラインには、複数個のサーマルヘッド駆
動用ＩＣが直線上に配置されるヘッド基板を介して、ク
ロック信号ＣＬ、ラッチ信号Ｂ、イネーブル信号Ａ等が
それぞれ入力されていた。なお、図２のＣは印字データ
信号であり、ＤＯ１、ＤＯ２・・・ＤＯｎは、サーマル
ヘッド駆動用ＩＣのドライバを示している。シフトレジ
スタ２６は、シリアルデータをクロック信号に同期して
順次シフトする機能を備え、ラッチ回路２７は、シフト
レジスタの内容を保持する機能を備えるものである。
【０００３】
【発明が解決しようとする課題】従来サーマルヘッド
は、ヘッド用基板の信号入力端子から、各々の段数のサ
ーマルヘッド駆動用ＩＣのクロックライン８、ラッチラ
イン１０、イネーブルライン１１に信号配線をヘッド用
の基板に設けていたため、ヘッド用の基板に無駄な信号
配線を通さなければならず、ヘッドを大型化していた。
また、ヘッド用の基板に信号配線を引き回すことによっ
て、ノイズに影響されやすく、また信号配線距離もヘッ
ド用基板によって異なるため各々の信号配線を通る波形
が同期し難いという問題点があった。
は、ヘッド用基板の信号入力端子から、各々の段数のサ
ーマルヘッド駆動用ＩＣのクロックライン８、ラッチラ
イン１０、イネーブルライン１１に信号配線をヘッド用
の基板に設けていたため、ヘッド用の基板に無駄な信号
配線を通さなければならず、ヘッドを大型化していた。
また、ヘッド用の基板に信号配線を引き回すことによっ
て、ノイズに影響されやすく、また信号配線距離もヘッ
ド用基板によって異なるため各々の信号配線を通る波形
が同期し難いという問題点があった。
【０００４】そこで、この発明の目的は、従来のこのよ
うな問題点を解決するため、サーマルヘッド駆動用ＩＣ
中に設けた信号配線から出力をおこなって次段のサーマ
ルヘッド駆動用ＩＣに信号配線を設けると共に、信号系
入力ラインに接続されるローパスフィルターもサーマル
ヘッド駆動用ＩＣ中に設けることにより、ヘッド用基板
側の信号配線を最小限にし、ノイズに強く、誤動作のな
いサーマルヘッド駆動用ＩＣを提供することを目的とす
る。
うな問題点を解決するため、サーマルヘッド駆動用ＩＣ
中に設けた信号配線から出力をおこなって次段のサーマ
ルヘッド駆動用ＩＣに信号配線を設けると共に、信号系
入力ラインに接続されるローパスフィルターもサーマル
ヘッド駆動用ＩＣ中に設けることにより、ヘッド用基板
側の信号配線を最小限にし、ノイズに強く、誤動作のな
いサーマルヘッド駆動用ＩＣを提供することを目的とす
る。
【０００５】
【課題を解決するための手段】上記問題点を解決するた
めに、この発明は、サーマルヘッド駆動用ＩＣにおい
て、たとえば、クロック信号ライン、シフトレジスタの
データをラッチするための信号を入力するラッチライ
ン、出力を制御するイネーブルライン等の信号系入力側
のパッドと出力側のパッドを電気的に接続するための導
体をサーマルヘッド駆動用ＩＣ中に形成した。このと
き、入力側、出力側を電気的に接続するための導体を形
成した信号系の種類は問わない。
めに、この発明は、サーマルヘッド駆動用ＩＣにおい
て、たとえば、クロック信号ライン、シフトレジスタの
データをラッチするための信号を入力するラッチライ
ン、出力を制御するイネーブルライン等の信号系入力側
のパッドと出力側のパッドを電気的に接続するための導
体をサーマルヘッド駆動用ＩＣ中に形成した。このと
き、入力側、出力側を電気的に接続するための導体を形
成した信号系の種類は問わない。
【０００６】また前記サーマルヘッド駆動用ＩＣにおい
て、信号系入力側のパッドと、出力側のパッドとを電気
的に接続するための導体にバッファを設けた。たとえば
最終段シフトレジスタの入力側のクロックラインから導
体を介して、出力側にもクロックラインを設けてクロッ
ク信号を出力し、最終段ラッチ回路の入力側のラッチラ
インから導体を介して、出力側にもラッチラインを設け
てラッチ信号を出力し、最終段イネーブル回路の入力側
のイネーブルラインから導体を介して、出力側にもイネ
ーブルラインを設けてイネーブル信号を設けて出力する
ようにした。このとき、バッファを設け出力する信号系
の種類は問わない。
て、信号系入力側のパッドと、出力側のパッドとを電気
的に接続するための導体にバッファを設けた。たとえば
最終段シフトレジスタの入力側のクロックラインから導
体を介して、出力側にもクロックラインを設けてクロッ
ク信号を出力し、最終段ラッチ回路の入力側のラッチラ
インから導体を介して、出力側にもラッチラインを設け
てラッチ信号を出力し、最終段イネーブル回路の入力側
のイネーブルラインから導体を介して、出力側にもイネ
ーブルラインを設けてイネーブル信号を設けて出力する
ようにした。このとき、バッファを設け出力する信号系
の種類は問わない。
【０００７】また信号系入力側のパッドと、出力側のパ
ッドとの間を電気的に接続するための導体に、ローパス
フィルターを設けた。サーマルヘッド駆動用ＩＣにおい
て、信号系入力側より入力された波形のデューティー比
と出力側より出力された波形のデューティー比とを比較
して変化の少ないローパスフィルターを前述の導体に設
けた。
ッドとの間を電気的に接続するための導体に、ローパス
フィルターを設けた。サーマルヘッド駆動用ＩＣにおい
て、信号系入力側より入力された波形のデューティー比
と出力側より出力された波形のデューティー比とを比較
して変化の少ないローパスフィルターを前述の導体に設
けた。
【０００８】
【発明の実施の形態】本発明のように構成されたサーマ
ルヘッド駆動用ＩＣにおいては、信号系入力側のパッド
と出力側のパッドを電気的に接続するための導体を形成
し、信号系入力側のパッドと出力側のパッドとを接続す
るための導体にバッファを設け、信号系入力側のパッド
と出力側のパッドとを接続するための導体にローパスフ
ィルターを設け、信号系入力側より入力された波形のデ
ューティー比と、出力側より出力された波形のデューテ
ィー比の変化の少ないローパスフィルターを設けるた
め、基板側に無駄な配線の引き回しをすることなく、信
号系入力側より入力された波形のデューティー比、出力
側より出力された波形のデューティー比の変化のなく、
または少なく、信号も同期し、ノイズの軽減をおこなえ
ることとなる。
ルヘッド駆動用ＩＣにおいては、信号系入力側のパッド
と出力側のパッドを電気的に接続するための導体を形成
し、信号系入力側のパッドと出力側のパッドとを接続す
るための導体にバッファを設け、信号系入力側のパッド
と出力側のパッドとを接続するための導体にローパスフ
ィルターを設け、信号系入力側より入力された波形のデ
ューティー比と、出力側より出力された波形のデューテ
ィー比の変化の少ないローパスフィルターを設けるた
め、基板側に無駄な配線の引き回しをすることなく、信
号系入力側より入力された波形のデューティー比、出力
側より出力された波形のデューティー比の変化のなく、
または少なく、信号も同期し、ノイズの軽減をおこなえ
ることとなる。
【０００９】
【実施例】以下に、この発明の実施例を図に基づいて説
明する。図１は、本発明にかかるサーマルヘッド駆動用
ＩＣ（以下単にＩＣという）の電気的構成を示す回路ブ
ロック図である。なお、１はクロック入力端子、３はラ
ッチ入力端子、４はイネーブル入力端子である。
明する。図１は、本発明にかかるサーマルヘッド駆動用
ＩＣ（以下単にＩＣという）の電気的構成を示す回路ブ
ロック図である。なお、１はクロック入力端子、３はラ
ッチ入力端子、４はイネーブル入力端子である。
【００１０】図１は、本発明の第１実施例であり、サー
マルヘッド駆動用ＩＣの信号系入力側に存在するクロッ
ク入力端子１、ラッチ入力端子３、イネーブル入力端子
４から、出力側とのパッドに電気的に接続するための導
体ａ，ｂ，ｃをＩＣ内に設けて、クロック出力端子５、
ラッチ出力端子６、イネーブル出力端子７の各出力端子
から、それぞれクロック信号ＣＬ、ラッチ信号Ｂ、イネ
ーブル信号Ａを出力する。なお、Ｃは印字データ信号で
ある。そのため、サーマルヘッド駆動用ＩＣを複数個直
列に接続する場合、接続するＩＣはヘッド用基板に配線
を引き回すことなく隣接するＩＣまでの最短の距離の配
線を行う（たとえば、ＩＣのクロック出力端子と隣のＩ
Ｃに接続するＩＣのクロック入力端子を接続する。同様
にラッチ出力端子とラッチ入力端子、イネーブル出力端
子とイネーブル入力端子とを接続する。）だけで、隣接
するＩＣから、クロック信号、ラッチ信号、イネーブル
信号を得ることができて簡単にヘッドを作成できる。故
に、ＩＣ間での信号系配線が最短であるため、ノイズに
対して強くなる。また、上記信号系配線距離の差がほと
んどなくなるため同期がずれる可能性はなくなる。なお
ＤＯ１、ＤＯ２、・・・ＤＯｎはそれぞれサーマルヘッ
ド駆動用ＩＣのドライバである。
マルヘッド駆動用ＩＣの信号系入力側に存在するクロッ
ク入力端子１、ラッチ入力端子３、イネーブル入力端子
４から、出力側とのパッドに電気的に接続するための導
体ａ，ｂ，ｃをＩＣ内に設けて、クロック出力端子５、
ラッチ出力端子６、イネーブル出力端子７の各出力端子
から、それぞれクロック信号ＣＬ、ラッチ信号Ｂ、イネ
ーブル信号Ａを出力する。なお、Ｃは印字データ信号で
ある。そのため、サーマルヘッド駆動用ＩＣを複数個直
列に接続する場合、接続するＩＣはヘッド用基板に配線
を引き回すことなく隣接するＩＣまでの最短の距離の配
線を行う（たとえば、ＩＣのクロック出力端子と隣のＩ
Ｃに接続するＩＣのクロック入力端子を接続する。同様
にラッチ出力端子とラッチ入力端子、イネーブル出力端
子とイネーブル入力端子とを接続する。）だけで、隣接
するＩＣから、クロック信号、ラッチ信号、イネーブル
信号を得ることができて簡単にヘッドを作成できる。故
に、ＩＣ間での信号系配線が最短であるため、ノイズに
対して強くなる。また、上記信号系配線距離の差がほと
んどなくなるため同期がずれる可能性はなくなる。なお
ＤＯ１、ＤＯ２、・・・ＤＯｎはそれぞれサーマルヘッ
ド駆動用ＩＣのドライバである。
【００１１】また、図１は、本発明の第１実施例であ
り、サーマルヘッド駆動用ＩＣの信号系入力側に存在す
るクロック入力端子１、ラッチ入力端子３、イネーブル
入力端子４から、出力側とのパッドに電気的に接続する
ための導体ａ，ｂ，ｃをＩＣ内に設けるとき、導体の抵
抗が大きいと、導体ａ，ｂ，ｃをＩＣ内に通した場合、
配線抵抗、配線容量などから波形の減衰がおこる。ま
た、導体ａ，ｂ，ｃの信号配線を太くするとサーマルヘ
ッド駆動用ＩＣが大きくなり、サーマルヘッド駆動用Ｉ
Ｃ単価が高くなる等の弊害がでてくる。そのため、導体
ａ，ｂ，ｃの信号配線の抵抗を１００Ωから３ｋΩと
し、導体ａ，ｂ，ｃの線幅を１から４μｍとすることに
より、導体ａ，ｂ，ｃをＩＣ内に設け信号を通しても、
波形減衰の少ないまま信号波形を出力することができ
る。
り、サーマルヘッド駆動用ＩＣの信号系入力側に存在す
るクロック入力端子１、ラッチ入力端子３、イネーブル
入力端子４から、出力側とのパッドに電気的に接続する
ための導体ａ，ｂ，ｃをＩＣ内に設けるとき、導体の抵
抗が大きいと、導体ａ，ｂ，ｃをＩＣ内に通した場合、
配線抵抗、配線容量などから波形の減衰がおこる。ま
た、導体ａ，ｂ，ｃの信号配線を太くするとサーマルヘ
ッド駆動用ＩＣが大きくなり、サーマルヘッド駆動用Ｉ
Ｃ単価が高くなる等の弊害がでてくる。そのため、導体
ａ，ｂ，ｃの信号配線の抵抗を１００Ωから３ｋΩと
し、導体ａ，ｂ，ｃの線幅を１から４μｍとすることに
より、導体ａ，ｂ，ｃをＩＣ内に設け信号を通しても、
波形減衰の少ないまま信号波形を出力することができ
る。
【００１２】また、図１のサーマルヘッド駆動用ＩＣに
おいて、クロック入力端子１、ラッチ入力端子３、イネ
ーブル入力端子４、クロック出力端子５、ラッチ出力端
子６、イネーブル出力端子７としているが、クロック出
力端子５、ラッチ出力端子６、イネーブル出力端子７、
クロック入力端子１、ラッチ入力端子３、イネーブル入
力端子４と、信号系の入出力端子を区別することなくサ
ーマルヘッド駆動用ＩＣを使用することができる。故
に、スルーラインは導体であるため信号系入出力端子を
区別することなく、入力端子を出力端子として、出力端
子を入力端子として使用できるサーマルヘッド駆動用Ｉ
Ｃとなる。
おいて、クロック入力端子１、ラッチ入力端子３、イネ
ーブル入力端子４、クロック出力端子５、ラッチ出力端
子６、イネーブル出力端子７としているが、クロック出
力端子５、ラッチ出力端子６、イネーブル出力端子７、
クロック入力端子１、ラッチ入力端子３、イネーブル入
力端子４と、信号系の入出力端子を区別することなくサ
ーマルヘッド駆動用ＩＣを使用することができる。故
に、スルーラインは導体であるため信号系入出力端子を
区別することなく、入力端子を出力端子として、出力端
子を入力端子として使用できるサーマルヘッド駆動用Ｉ
Ｃとなる。
【００１３】図３は、本発明の第２実施例であり、図１
において、信号系入力側と、出力側とのパッドに電気的
に接続するための導体ａ，ｂ，ｃ及びバッファとをＩＣ
内に有するものである。バッファを有することで、信号
系入力側、出力側をパッドに電気的に接続するための導
体を通る際におこる波形の減衰をなくすことができる。
そのため、サーマルヘッド駆動用ＩＣの接続を基板上で
限りなく接続することが可能となる。
において、信号系入力側と、出力側とのパッドに電気的
に接続するための導体ａ，ｂ，ｃ及びバッファとをＩＣ
内に有するものである。バッファを有することで、信号
系入力側、出力側をパッドに電気的に接続するための導
体を通る際におこる波形の減衰をなくすことができる。
そのため、サーマルヘッド駆動用ＩＣの接続を基板上で
限りなく接続することが可能となる。
【００１４】例えば、図３のサーマルヘッド駆動用ＩＣ
において、スルーライン（導体ａ，ｂ，ｃ）に設けられ
たバッファのサイズにより、クロック入力端子１２から
入力された信号が、クロック出力端子１６へ出力された
際、バッファの能力に依存して、入力された波形のデュ
ーティー比と出力された波形のデューティー比が異なっ
て出力される場合がある。そういった場合、クロック出
力端子１６から出力された波形を、次ＩＣチップ（次の
ＩＣ）のクロック入力端子１２から入力する際、逆位相
で入力し、出力を再度位相を反転させることにより、前
チップで変化した分のデューティー比がＩＣ内で再度前
チップ入力と同デューティー比で出力される。上記方法
でＩＣの入力を交互におこなうことにより、ほぼ一定の
まま限りなくサーマルヘッド駆動用ＩＣをつなげサーマ
ルヘッドを作成することができる。
において、スルーライン（導体ａ，ｂ，ｃ）に設けられ
たバッファのサイズにより、クロック入力端子１２から
入力された信号が、クロック出力端子１６へ出力された
際、バッファの能力に依存して、入力された波形のデュ
ーティー比と出力された波形のデューティー比が異なっ
て出力される場合がある。そういった場合、クロック出
力端子１６から出力された波形を、次ＩＣチップ（次の
ＩＣ）のクロック入力端子１２から入力する際、逆位相
で入力し、出力を再度位相を反転させることにより、前
チップで変化した分のデューティー比がＩＣ内で再度前
チップ入力と同デューティー比で出力される。上記方法
でＩＣの入力を交互におこなうことにより、ほぼ一定の
まま限りなくサーマルヘッド駆動用ＩＣをつなげサーマ
ルヘッドを作成することができる。
【００１５】図４は、本発明の第３実施例であり、最終
段イネーブル回路２８へ入力するイネーブルラインｆ
が、イネーブル端子２５へと出力をおこなう。同様に最
終段シフトレジスタ２６に入力するクロックラインｄ
が、クロック出力端子２３に出力を行い、最終ラッチ回
路２７へ入力するラッチラインｅがラッチ出力端子２４
へと出力を行う。そのため、クロック信号ＣＬが最終段
シフトレジスタに入力されると、最終段シフトレジスタ
より印字データが出力される。クロック信号と共に順次
印字データが出力されるため、ノイズによるデータ転送
ミスがおこらない。
段イネーブル回路２８へ入力するイネーブルラインｆ
が、イネーブル端子２５へと出力をおこなう。同様に最
終段シフトレジスタ２６に入力するクロックラインｄ
が、クロック出力端子２３に出力を行い、最終ラッチ回
路２７へ入力するラッチラインｅがラッチ出力端子２４
へと出力を行う。そのため、クロック信号ＣＬが最終段
シフトレジスタに入力されると、最終段シフトレジスタ
より印字データが出力される。クロック信号と共に順次
印字データが出力されるため、ノイズによるデータ転送
ミスがおこらない。
【００１６】図５は、本発明の第４実施例であり、図
１、図３、図４のサーマルヘッド駆動用ＩＣの信号系入
力ラインにローパスフィルター２８を設け、信号系入力
端子２９よりノイズが入った場合除去することにより、
ノイズが入力信号として入力されることを防ぐこととな
る。そして、信号系出力端子３０より、ローパスフィル
ターにおいてノイズを除去された信号を出力することと
なる。サーマルヘッド駆動用ＩＣの中を信号配線が通る
場合、あるＩＣチップの入力端子でノイズの影響をうけ
ると、以降のＩＣチップに、ノイズであったものが入力
波形として次ＩＣチップ入力端子に入力されてしまうた
め、信号系入力ライン上にローパスフィルターを設ける
ことによりノイズに強いサーマルヘッド駆動用ＩＣとな
る。
１、図３、図４のサーマルヘッド駆動用ＩＣの信号系入
力ラインにローパスフィルター２８を設け、信号系入力
端子２９よりノイズが入った場合除去することにより、
ノイズが入力信号として入力されることを防ぐこととな
る。そして、信号系出力端子３０より、ローパスフィル
ターにおいてノイズを除去された信号を出力することと
なる。サーマルヘッド駆動用ＩＣの中を信号配線が通る
場合、あるＩＣチップの入力端子でノイズの影響をうけ
ると、以降のＩＣチップに、ノイズであったものが入力
波形として次ＩＣチップ入力端子に入力されてしまうた
め、信号系入力ライン上にローパスフィルターを設ける
ことによりノイズに強いサーマルヘッド駆動用ＩＣとな
る。
【００１７】図６は、本発明の第５実施例であり、ロー
パスフィルターの電気的回路構成であり、少なくともイ
ンバータ２段であり、インバータ３４、インバータ３５
の間に容量３７（電源と接続されている容量）と容量３
８（ＧＮＤと接続されている容量）で構成されている。
このとき、容量は、導体もしくは半導体ー絶縁体ー導体
もしくは半導体の構成であり、絶縁体を導体もしくは半
導体において挟んで作成されたものである。容量を信号
系入力ラインにつけることでノイズの影響がすくなくな
り、ノイズに強いサーマルヘッド駆動用ＩＣとなる。
パスフィルターの電気的回路構成であり、少なくともイ
ンバータ２段であり、インバータ３４、インバータ３５
の間に容量３７（電源と接続されている容量）と容量３
８（ＧＮＤと接続されている容量）で構成されている。
このとき、容量は、導体もしくは半導体ー絶縁体ー導体
もしくは半導体の構成であり、絶縁体を導体もしくは半
導体において挟んで作成されたものである。容量を信号
系入力ラインにつけることでノイズの影響がすくなくな
り、ノイズに強いサーマルヘッド駆動用ＩＣとなる。
【００１８】図７は、本発明の第５実施例であり、信号
系入力端子３２、信号系出力端子３３においてのローパ
スフィルターの電気的回路構成であり、少なくともイン
バータ３段であり、インバータ４２、インバータ４３ま
たは、インバータ４３、インバータ４４のあいだにＰｃ
ｈトランジスタ容量４５、Ｎｃｈトランジスタ容量４６
で構成されている。また、インバータ４２、インバータ
４３、インバータ４４のトランジスタサイズを同じに
し、Ｐｃｈトランジスタ容量４５とＮｃｈトランジスタ
容量４６のサイズを同じとすることにより、インバータ
４０の入力パルス幅、インバータ４１の出力パルス幅の
変化を少なくすることができるため、信号系入力端子４
０より入力されたパルス幅と信号系出力端子４１におい
て、パルス幅の変化が少ない信号系ラインができる。パ
ルス幅の変化が少ないのでパルスの変化もなく次段のサ
ーマルヘッド駆動用ＩＣに伝えることができるため、サ
ーマルヘッド駆動用ＩＣをできるだけ多くつなげサーマ
ルヘッドを作成することができる。
系入力端子３２、信号系出力端子３３においてのローパ
スフィルターの電気的回路構成であり、少なくともイン
バータ３段であり、インバータ４２、インバータ４３ま
たは、インバータ４３、インバータ４４のあいだにＰｃ
ｈトランジスタ容量４５、Ｎｃｈトランジスタ容量４６
で構成されている。また、インバータ４２、インバータ
４３、インバータ４４のトランジスタサイズを同じに
し、Ｐｃｈトランジスタ容量４５とＮｃｈトランジスタ
容量４６のサイズを同じとすることにより、インバータ
４０の入力パルス幅、インバータ４１の出力パルス幅の
変化を少なくすることができるため、信号系入力端子４
０より入力されたパルス幅と信号系出力端子４１におい
て、パルス幅の変化が少ない信号系ラインができる。パ
ルス幅の変化が少ないのでパルスの変化もなく次段のサ
ーマルヘッド駆動用ＩＣに伝えることができるため、サ
ーマルヘッド駆動用ＩＣをできるだけ多くつなげサーマ
ルヘッドを作成することができる。
【００１９】図７の容量として使用しているＰｃｈトラ
ンジスタ容量４５、Ｎｃｈトランジスタ容量４６は、容
量端子としているトランジスタのゲート、ソース、ドレ
イン端子は電源ライン（ＶＤＤ、ＧＮＤライン）に接続
されていないため、電源ラインにノイズがのったとして
もノイズの影響をうけにくい回路構成となっている。ま
た、図６、図７はローパスフィルターの回路構成の１例
であり、Ｐｃｈトランジスタ容量４５、Ｎｃｈトランジ
スタ容量４６を、トランジスタ容量が、Ｐｃｈのみまた
はＮｃｈのみの構成、ゲート端子、ソース、ドレイン端
子の接続が逆になる、いわゆるゲート端子がインバータ
４３、４４の間に、ソース、ドレイン端子がインバータ
４２、４３の間に接続されても同様であり、または単に
トランジスタ容量を容量とおきかえても良い。また、イ
ンバータの段数が異なる（インバータの回路構成が増え
または減る。）構成とすることもできる。
ンジスタ容量４５、Ｎｃｈトランジスタ容量４６は、容
量端子としているトランジスタのゲート、ソース、ドレ
イン端子は電源ライン（ＶＤＤ、ＧＮＤライン）に接続
されていないため、電源ラインにノイズがのったとして
もノイズの影響をうけにくい回路構成となっている。ま
た、図６、図７はローパスフィルターの回路構成の１例
であり、Ｐｃｈトランジスタ容量４５、Ｎｃｈトランジ
スタ容量４６を、トランジスタ容量が、Ｐｃｈのみまた
はＮｃｈのみの構成、ゲート端子、ソース、ドレイン端
子の接続が逆になる、いわゆるゲート端子がインバータ
４３、４４の間に、ソース、ドレイン端子がインバータ
４２、４３の間に接続されても同様であり、または単に
トランジスタ容量を容量とおきかえても良い。また、イ
ンバータの段数が異なる（インバータの回路構成が増え
または減る。）構成とすることもできる。
【００２０】ここで、インバータ３段をＮＡＮＤ、ＮＯ
Ｒ、またはバッファなどにして構成されたローパスフィ
ルターをも本発明は含み、インバータ３段のＰｃｈ、Ｎ
ｃｈトランジスタのサイズを等しい、または同程度、ま
たは同比率で構成される場合パルス幅の変化の少ないロ
ーパスフィルターとなり、サーマルヘッド駆動用ＩＣを
できるだけ多くつなげサーマルヘッドを作成することが
できる。
Ｒ、またはバッファなどにして構成されたローパスフィ
ルターをも本発明は含み、インバータ３段のＰｃｈ、Ｎ
ｃｈトランジスタのサイズを等しい、または同程度、ま
たは同比率で構成される場合パルス幅の変化の少ないロ
ーパスフィルターとなり、サーマルヘッド駆動用ＩＣを
できるだけ多くつなげサーマルヘッドを作成することが
できる。
【００２１】
【発明の効果】本発明は、以上説明したように、サーマ
ルヘッド駆動用ＩＣ接続時の信号配線の引き回しをなく
すことにより、入力パルス幅と出力パルス幅の変化が少
なく、ノイズに強い、信号の同期づれがなく、誤動作の
ないサーマルヘッドを得る効果がある。更に又、ヘッド
用基板上の信号系配線が最短となることでヘッドの大型
化を抑制する効果がある。
ルヘッド駆動用ＩＣ接続時の信号配線の引き回しをなく
すことにより、入力パルス幅と出力パルス幅の変化が少
なく、ノイズに強い、信号の同期づれがなく、誤動作の
ないサーマルヘッドを得る効果がある。更に又、ヘッド
用基板上の信号系配線が最短となることでヘッドの大型
化を抑制する効果がある。
【図１】本発明の第１の実施例のサーマルヘッド駆動用
ＩＣの電気的構成を示す回路ブロック図である。
ＩＣの電気的構成を示す回路ブロック図である。
【図２】従来のサーマルヘッド駆動用ＩＣの電気的構成
を示す回路ブロック図である。
を示す回路ブロック図である。
【図３】本発明の第２の実施例のサーマルヘッド駆動用
ＩＣの電気的構成を示す回路ブロック図である。
ＩＣの電気的構成を示す回路ブロック図である。
【図４】本発明の第３の実施例のサーマルヘッド駆動用
ＩＣの電気的構成を示す回路ブロック図である。
ＩＣの電気的構成を示す回路ブロック図である。
【図５】本発明の第４の実施例のサーマルヘッド駆動用
ＩＣ信号系ラインのローパスフィルターを示す回路ブロ
ック図である。
ＩＣ信号系ラインのローパスフィルターを示す回路ブロ
ック図である。
【図６】本発明の第５の実施例のサーマルヘッド駆動用
ＩＣ信号系ラインのローパスフィルターの電気的構成を
示す回路ブロック図である。
ＩＣ信号系ラインのローパスフィルターの電気的構成を
示す回路ブロック図である。
【図７】本発明の第６の実施例のサーマルヘッド駆動用
ＩＣ信号系ラインのローパスフィルターの電気的構成を
示す回路ブロック図である。
ＩＣ信号系ラインのローパスフィルターの電気的構成を
示す回路ブロック図である。
１ クロック入力端子 ２ 印字データ入力端子 ３ ラッチ入力端子 ４ イネーブル入力端子 ５ クロック入力出力端子 ６ ラッチ出力端子 ７ イネーブル出力端子 ８ クロック入力端子 ９ 印字データ入力端子 １０ ラッチ入力端子 １１ イネーブル入力端子 １２ クロック入力端子 １３ 印字データ入力端子 １４ ラッチ入力端子 １５ イネーブル入力端子 １６ クロック出力端子 １７ ラッチ出力端子 １８ イネーブル出力端子 １９ クロック入力端子 ２０ 印字データ入力端子 ２１ ラッチ入力端子 ２２ イネーブル入力端子 ２３ クロック出力端子 ２４ ラッチ出力端子 ２５ イネーブル出力端子 ２６ シフトレジスタ ２７ ラッチ回路 ２８ ローパスフィルター ２９ 信号系入力端子 ３０ 信号系出力端子 ３１ ローパスフィルター ３２ 信号系入力端子 ３３ 信号系出力端子 ３４ インバータ ３５ インバータ ３６ インバータ ３７ 容量 ３８ 容量 ３９ ローパスフィルター ４０ 信号系入力端子 ４１ 信号系出力端子 ４２ インバータ ４３ インバータ ４４ インバータ ４５ Ｐｃｈトランジスタ容量 ４６ Ｎｃｈトランジスタ容量
フロントページの続き (72)発明者 石井 和敏 千葉県千葉市美浜区中瀬１丁目８番地 セイコーインスツルメンツ株式会社内 (72)発明者 五島 澄隆 千葉県千葉市美浜区中瀬１丁目８番地 セイコーインスツルメンツ株式会社内 (56)参考文献 特開 平９−24635（ＪＰ，Ａ) 特開 平８−250686（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) B41J 2/335 - 2/345
Claims (3)
- 【請求項１】 少なくともシリアルデータをクロック信
号に同期して順次シフトするシフトレジスタと、前記シ
フトレジスタの内容を保持するラッチ回路と、前記ラッ
チ回路に保持された内容をイネーブル回路により制御す
るイネーブル回路とからなるサーマルヘッド駆動用ＩＣ
に於いて、前記クロック信号を伝送するクロックライン
と、ラッチ信号を伝送するラッチラインと、イネーブル
信号を伝送するイネーブルラインとに、ＩＣの一方の端
辺にそれぞれの入力端子を配列して設け、ＩＣの他方の
端辺にそれぞれの出力端子を配列して設け、それぞれに
入力側から出力側へのスルーラインを有し、前記各スル
ーラインには、少なくとも複数のインバータと、一対の
容量にて構成されているローパスフィルターが設けられ
ていることを特徴とするサーマルヘッド駆動用ＩＣ。 - 【請求項２】 前記一対の容量はサイズの等しいＰｃ
ｈ、Ｎｃｈトランジスタである請求項１記載のサーマル
ヘッド駆動用ＩＣ。 - 【請求項３】 前記スルーラインの抵抗を１００Ωから
３ｋΩ、前記スルーラインの線幅を１から４μｍとした
請求項１記載のサーマルヘッド駆動用ＩＣ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6365998A JP3111277B2 (ja) | 1997-05-20 | 1998-03-13 | サーマルヘッド駆動用ｉｃ |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9-130132 | 1997-05-20 | ||
| JP13013297 | 1997-05-20 | ||
| JP6365998A JP3111277B2 (ja) | 1997-05-20 | 1998-03-13 | サーマルヘッド駆動用ｉｃ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH1134379A JPH1134379A (ja) | 1999-02-09 |
| JP3111277B2 true JP3111277B2 (ja) | 2000-11-20 |
Family
ID=26404800
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6365998A Expired - Lifetime JP3111277B2 (ja) | 1997-05-20 | 1998-03-13 | サーマルヘッド駆動用ｉｃ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3111277B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008068442A (ja) * | 2006-09-12 | 2008-03-27 | Shinko Electric Co Ltd | サーマルヘッド及びプリンタ |
-
1998
- 1998-03-13 JP JP6365998A patent/JP3111277B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH1134379A (ja) | 1999-02-09 |
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