JP3071284B2 - 半導体素子の製造方法 - Google Patents
半導体素子の製造方法Info
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Description
Random Accesa Memory)のキャパシタ容量増加が期待で
きる半導体素子の製造方法に関するものである。
をDRAMのキャパシタ下部電極に使用することによ
り、キャパシタ表面積が増加して、通常のポリシリコン
膜を使用したときに比較して約2.5倍の容量が得られ
る。
リシリコン膜を形成することにより、キャパシタ電極と
しての抵抗および周波数特性を改善することができる。
凹凸を有する粗面ポリシリコン膜は結晶粒が点在するた
め、膜として隙間のある粗な膜である。したがって、後
洗浄のHF処理により、この隙間より、HFが侵入し、
粗面ポリシリコン膜下の下地酸化膜がエッチングされ、
粗面ポリシリコン膜が剥がれてしまうという問題があっ
た。
ャンバ内で連続的に膜として隙間のないアモルファスシ
リコン膜あるいはポリシリコン膜を成膜後、粗面ポリシ
リコン膜を成膜すると、上層膜にあたる粗面ポリシリコ
ン膜が下層膜に当たるアモルファスシリコン膜あるいは
ポリシリコン膜の結晶性の影響を受け、十分に凹凸のあ
る粗面ポリシリコン膜が成膜出来ができない。したがっ
て、キャパシタの容量増加が十分に行えない。
のないポリシリコン膜あるいは、アモルファスシリコン
膜を成膜し、一度チャンバから取り出し、次に、この上
に凹凸のある粗面ポリシリコン膜を成膜することによ
り、隙間もなく、表面の凹凸の大きいキャパシタ電極を
形成することができる。
取り出し、二度成膜しなければならないので、スループ
ットが悪くなる。
点のうち、HF洗浄による下地酸化膜が剥離するという
点と、スループットが悪くなる点について解決した半導
体素子の製造方法を提供するものである。
解決するために、半導体素子の製造方法において、シリ
コン基板上に酸化膜を形成した後に隙間のない密なポリ
シリコン膜またはアモルファスシリコン酸化膜を堆積し
てキャパシタ下部電極の下層膜を形成する工程と、同一
チャンバ内に酸素を導入して前記下層膜上に酸化膜を形
成する工程と、減圧CVD法により前記下層膜上に表面
に凹凸の大きい粗面ポリシリコンを堆積させてキャパシ
タ下部電極の上層膜を形成する工程とを導入したもので
ある。
いて、以上のような工程を導入したので、シリコン基板
上に酸化膜を介して形成したキャパシタ下部電極の下層
膜が隙間がなく、耐HF性に優れ、同一チャンバ内に酸
素を導入して下層膜上に形成した酸化膜は炉内から出な
いから、パーティクルの付着や汚染がなくなり、しかも
キャパシタ下部電極の上層膜は熱処理により表面に凹凸
の大きい粗面を形成しているから、キャパシタ容量が増
加することになり、したがって前記問題点が除去でき
る。
施例について図面に基づき説明する。図1(a)ないし
図1(d)はその一実施例を説明するための工程断面図
である。まず、図1(a)に示すように、シリコン基板
1を950℃、ウエットO2で熱処理してその表面上に酸
化膜2を1000Åの厚さに形成する。
用いた減圧CVD法にて、反応温度620℃、反応圧力
0.2Torrでポリシリコン膜3を堆積する。これはアモ
ルファスシリコン膜でもよい。
し、15〜40Å程度の厚さの酸化膜4をポリシリコン
膜3上に形成する。
ガスを用いて、反応温度570℃、反応圧力0.2Torr
でアモルファスシリコン膜5を酸化膜4上に1000Å
程度の厚さに堆積する。このとき、酸化膜4が存在する
ので、酸化膜4上に堆積したアモルファスシリコン膜5
が下地の結晶性の悪影響を受けることはない。また、こ
の酸化膜4はアモルファスシリコン膜5の成膜中に図1
(b)から明らかなように、このアモルファスシリコン
膜5中に取り込まれる。
SiH4 ガスパージに当たる真空引きを熱処理を利用す
ることによって、熱処理温度570℃、処理雰囲気は真
空熱処理時間20分の条件で行う。この熱処理により、
アモルファスシリコン膜5に結晶粒が形成され、このア
モルファスシリコン膜5の表面が凹凸な粗面ポリシリコ
ン膜6が図1(c)に示すように形成される。このポリ
シリコン膜3と粗面ポリシリコン膜6とにより、キャパ
シタ下部電極を形成する。
%HFで1分以上あり、十分である。また、従来のチャ
ンバから一度取り出す方法に比べて、約3時間の製造時
間の短縮が可能となる。
圧40KeVで8×1015個/cm2 注入し、850℃、
ドライN2 雰囲気で拡散する。キャパシタ絶縁膜とし
て、SiH4 Cl2 ガスとNH3 ガスを用いた減圧CVD
法により、反応温度650℃、反応圧力0.1Torrで窒
化シリコン膜7を50Å程度の厚さに堆積する。
した後、キャパシタ上部電極として、SiH4 ガスを用
いた減圧CVD法により、反応温度620℃、反応圧力
0.2Torrでポリシリコン膜8を図1(d)に示すよう
に、1000Å程度の膜圧に形成する。次に、850℃
でリン拡散を行い、パターニングを行い、キャパシタを
形成する。
によれば、減圧CVD法により隙間のないアモルファス
シリコン膜またはポリシリコン膜を成膜し、同一チャン
バ内でO2 を導入し、このアモルファスシリコン膜また
はポリシリコン膜の表面に自然酸化膜程度の酸化膜を形
成し、この酸化膜の上に表面に凹凸を有する粗面ポリシ
リコン膜を形成するようにしたので、電極として隙間が
なく、表面に凹凸のある電極が形成され、キャパシタ容
量が増すことが期待できるとともに、従来の製造方法に
比べて、スループットの向上が期待できる。
シリコン膜の膜圧が一様ではなく、凹凸を有するように
形成しているから、上部粗面ポリシリコン膜形成条件に
依存せず、望の膜圧の下部電極の形成が可能となる。
の付着や汚染がなく、高品質な膜が形成でき、歩留りの
向上が期待できる。
工程断面図である。
Claims (1)
- 【請求項1】 シリコン基板上に酸化膜を形成した後に
表面の平滑なポリシリコン膜またはアモルファスシリコ
ン膜を堆積してキャパシタ下部電極の下層膜を形成する
工程と、 同一チャンバー内に酸素を導入して前記下層膜上に酸化
膜を形成する工程と、 減圧CVD法により前記下層膜上に表面に凹凸のある租
面ポリシリコンを堆積させてキャパシタ下部電極の上層
膜を形成する工程と、 よりなる半導体素子の製造方法。
Priority Applications (1)
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JP3354316A JP3071284B2 (ja) | 1991-12-20 | 1991-12-20 | 半導体素子の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP3354316A JP3071284B2 (ja) | 1991-12-20 | 1991-12-20 | 半導体素子の製造方法 |
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Family Applications (1)
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JP3354316A Expired - Fee Related JP3071284B2 (ja) | 1991-12-20 | 1991-12-20 | 半導体素子の製造方法 |
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TW455935B (en) * | 1998-09-21 | 2001-09-21 | Mosel Vitelic Inc | Manufacture method of hemi-spherical grain structure on surface of semiconductor substrate |
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- 1991-12-20 JP JP3354316A patent/JP3071284B2/ja not_active Expired - Fee Related
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