JP2987983B2 - 文字表示装置 - Google Patents
文字表示装置Info
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- JP2987983B2 JP2987983B2 JP3080272A JP8027291A JP2987983B2 JP 2987983 B2 JP2987983 B2 JP 2987983B2 JP 3080272 A JP3080272 A JP 3080272A JP 8027291 A JP8027291 A JP 8027291A JP 2987983 B2 JP2987983 B2 JP 2987983B2
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Description
【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は例えば超音波断層画像に
患者名，診断日時等の文字および断層画像のスケール等
の図形を付加して表示する超音波診断装置等において、
特に文字メモリを図形メモリと同様な構成とし、かつ文
字表示回路を簡単化し得るようにした文字構成方法およ
び文字表示装置に関する。なお以下各図において同一の
符号は同一もしくは相当部分を示す。
患者名，診断日時等の文字および断層画像のスケール等
の図形を付加して表示する超音波診断装置等において、
特に文字メモリを図形メモリと同様な構成とし、かつ文
字表示回路を簡単化し得るようにした文字構成方法およ
び文字表示装置に関する。なお以下各図において同一の
符号は同一もしくは相当部分を示す。
【０００２】
【従来の技術】超音波診断装置では超音波による断層像
以外に ａ．図形（断層像の大きさを示すスケール等） ｂ．文字（患者名，診断日時等を示す数字・アルファベ
ット・記号） を０、１の２値画像として表示する。このため、通常は
ＴＶ画面に対応するデジタルメモリを持ち、それをＴＶ
同期信号に合わせて走査して画像データを出力させ、断
層像に重ねて文字，図形をＴＶに表示している。ＴＶ画
面の縦横比は３：４であり、ＮＴＳＣでは片フィールド
の走査が２４０本であり、インタレース走査により４８
０本にしている。ＴＶ表示の最小単位の縦横を一致させ
るには、ＴＶの分解能を３２０×２４０か６４０×４８
０にする。ａ．の図形についてはこれに対応したＴＶ上
で３２０×２４０で十分なことが多い。超音波診断装置
では様々なモードに対応するために複数の図形表示プレ
ーンが必要で、３２０×２４０×１のメモリを複数持
ち、それぞれのプレーンの表示・非表示を制御できる様
にしている。しかしｂ．の文字の表示には３２０×２４
０の分解能では文字が大きくなりすぎるので、６４０×
４８０の分解能が必要になる場合が多い。
以外に ａ．図形（断層像の大きさを示すスケール等） ｂ．文字（患者名，診断日時等を示す数字・アルファベ
ット・記号） を０、１の２値画像として表示する。このため、通常は
ＴＶ画面に対応するデジタルメモリを持ち、それをＴＶ
同期信号に合わせて走査して画像データを出力させ、断
層像に重ねて文字，図形をＴＶに表示している。ＴＶ画
面の縦横比は３：４であり、ＮＴＳＣでは片フィールド
の走査が２４０本であり、インタレース走査により４８
０本にしている。ＴＶ表示の最小単位の縦横を一致させ
るには、ＴＶの分解能を３２０×２４０か６４０×４８
０にする。ａ．の図形についてはこれに対応したＴＶ上
で３２０×２４０で十分なことが多い。超音波診断装置
では様々なモードに対応するために複数の図形表示プレ
ーンが必要で、３２０×２４０×１のメモリを複数持
ち、それぞれのプレーンの表示・非表示を制御できる様
にしている。しかしｂ．の文字の表示には３２０×２４
０の分解能では文字が大きくなりすぎるので、６４０×
４８０の分解能が必要になる場合が多い。
【０００３】文字の表示に従来良く使われている方法は
キャラクタジェネレータを用いる方法である。図４は従
来の文字・図形出力回路の構成例を示す。同図におい
て、１はＴＶ同期信号発生回路、２は文字座標発生回
路、３は文字フォント座標発生回路、４は文字プレーン
メモリ（文字メモリとも略す）、５は文字フォントＲＯ
Ｍ、６は並直列変換器、７はＴＶ座標発生回路、８と図
形プレーンメモリ（図形メモリとも略す）である。横６
４文字、縦４０文字を表示する場合、６４×４０×８ｂ
ｉｔの文字プレーンメモリ４を持ち、表示する文字のコ
ードを８ｂｉｔで文字プレーンメモリ４に書き込んでお
く。
キャラクタジェネレータを用いる方法である。図４は従
来の文字・図形出力回路の構成例を示す。同図におい
て、１はＴＶ同期信号発生回路、２は文字座標発生回
路、３は文字フォント座標発生回路、４は文字プレーン
メモリ（文字メモリとも略す）、５は文字フォントＲＯ
Ｍ、６は並直列変換器、７はＴＶ座標発生回路、８と図
形プレーンメモリ（図形メモリとも略す）である。横６
４文字、縦４０文字を表示する場合、６４×４０×８ｂ
ｉｔの文字プレーンメモリ４を持ち、表示する文字のコ
ードを８ｂｉｔで文字プレーンメモリ４に書き込んでお
く。
【０００４】図５はこの場合のＴＶ画面上の文字座標を
示し、図６は１文字領域内の文字フォント座標を示す。
即ちＴＶ表示には、図５のようにＴＶ画面上に横６４文
字，縦４０文字の文字座標（ＣＸ，ＣＹ）を設定し、か
つ図６のように１文字領域の中に横８ビット，縦１２ビ
ットの文字フォント座標（ＦＸ，ＦＹ）を設定する。Ｔ
Ｖに文字を表示するために文字座標発生回路２と文字フ
ォント座標発生回路３を持つ。文字座標ＣＸ，ＣＹは文
字メモリ４に与えられる。文字の形は文字フォントＲＯ
Ｍ５に記憶され、文字フォントＲＯＭ５のアドレスには
文字メモリ４から出力される文字コード４ａと文字フォ
ント座標発生回路３からの文字フォント座標ＦＹの値と
を入れ、さらに（通常は８ｂｉｔの）文字フォントＲＯ
Ｍ５の出力５ａを並直列変換器６を介し文字フォント座
標ＦＸにより並直列変換して文字出力ＣＯにより文字の
形をＴＶに表示していた。これは（通常は８ｂｉｔの）
ＲＯＭ５の容量を効率良く使うためである。また８は図
形のビットパターンを記憶する図形メモリでＴＶ座標発
生回路７から出力されるＴＶ画面の座標Ｘ，Ｙをアドレ
スとして入力し図形表示用の信号ＦＯを出力する。
示し、図６は１文字領域内の文字フォント座標を示す。
即ちＴＶ表示には、図５のようにＴＶ画面上に横６４文
字，縦４０文字の文字座標（ＣＸ，ＣＹ）を設定し、か
つ図６のように１文字領域の中に横８ビット，縦１２ビ
ットの文字フォント座標（ＦＸ，ＦＹ）を設定する。Ｔ
Ｖに文字を表示するために文字座標発生回路２と文字フ
ォント座標発生回路３を持つ。文字座標ＣＸ，ＣＹは文
字メモリ４に与えられる。文字の形は文字フォントＲＯ
Ｍ５に記憶され、文字フォントＲＯＭ５のアドレスには
文字メモリ４から出力される文字コード４ａと文字フォ
ント座標発生回路３からの文字フォント座標ＦＹの値と
を入れ、さらに（通常は８ｂｉｔの）文字フォントＲＯ
Ｍ５の出力５ａを並直列変換器６を介し文字フォント座
標ＦＸにより並直列変換して文字出力ＣＯにより文字の
形をＴＶに表示していた。これは（通常は８ｂｉｔの）
ＲＯＭ５の容量を効率良く使うためである。また８は図
形のビットパターンを記憶する図形メモリでＴＶ座標発
生回路７から出力されるＴＶ画面の座標Ｘ，Ｙをアドレ
スとして入力し図形表示用の信号ＦＯを出力する。
【０００５】
【発明が解決しようとする課題】しかしながら上述した
キャラクタジェネレータ方式では、図形の表示と文字の
表示とでメモリの構成が異なり、メモリのアドレスに与
える座標の発生の回路を文字と図形とで別々に持つ必要
があり、また８ｂｉｔの文字プレーンメモリでは２５６
種類以上の文字を表示できなかった。そこで本発明は図
形プレーンメモリを２〜４枚で１つの文字プレーンを構
成し、図形を表示する回路とほとんど同じ回路で、文字
の表示に十分な分解能を持つ、文字プレーンを得ること
ができる文字表示装置を提供することを課題とする。
キャラクタジェネレータ方式では、図形の表示と文字の
表示とでメモリの構成が異なり、メモリのアドレスに与
える座標の発生の回路を文字と図形とで別々に持つ必要
があり、また８ｂｉｔの文字プレーンメモリでは２５６
種類以上の文字を表示できなかった。そこで本発明は図
形プレーンメモリを２〜４枚で１つの文字プレーンを構
成し、図形を表示する回路とほとんど同じ回路で、文字
の表示に十分な分解能を持つ、文字プレーンを得ること
ができる文字表示装置を提供することを課題とする。
【０００６】
【課題を解決するための手段】前記の課題を解決するた
めに、本発明に係る文字表示装置においては、
めに、本発明に係る文字表示装置においては、
【０００７】各種の文字パターンを構成するための、２
×２の画素領域（２１など、以下基本パターン領域とい
う）で作られた所定の複数（８個など）の基本パターン
を記憶し、この基本パターンを指定するコード（１２な
ど）と、この基本パターンの走査信号（２×ＣＬＫ，Ｅ
ＶＥＮ／ＯＤＤなど）を入力して、指定された基本パタ
ーンの表示用信号（文字出力ＣＯなど）を出力する基本
パターン発生回路（１３など）と、前記コードを表すビ
ット数（３など）に等しい枚数の、かつ前記基本パター
ン領域を最小領域とするメモリであって、この最小領域
を走査する走査信号（Ｘ，Ｙなど）を各メモリ共通に入
力して表示されるべき文字についての各走査座標点に位
する前記基本パターンのコードを一団となって発生し、
前記基本パターン発生回路に与える文字メモリ（サブ文
字メモリ１１など）とを備えたものとする。
×２の画素領域（２１など、以下基本パターン領域とい
う）で作られた所定の複数（８個など）の基本パターン
を記憶し、この基本パターンを指定するコード（１２な
ど）と、この基本パターンの走査信号（２×ＣＬＫ，Ｅ
ＶＥＮ／ＯＤＤなど）を入力して、指定された基本パタ
ーンの表示用信号（文字出力ＣＯなど）を出力する基本
パターン発生回路（１３など）と、前記コードを表すビ
ット数（３など）に等しい枚数の、かつ前記基本パター
ン領域を最小領域とするメモリであって、この最小領域
を走査する走査信号（Ｘ，Ｙなど）を各メモリ共通に入
力して表示されるべき文字についての各走査座標点に位
する前記基本パターンのコードを一団となって発生し、
前記基本パターン発生回路に与える文字メモリ（サブ文
字メモリ１１など）とを備えたものとする。
【０００８】
【作 用】図２の実線の４角の領域２１（便宜上基本パ
ターン領域という）は図形メモリ８の最小のＴＶ表示の
領域であるものとすると、この４角２１は、ＴＶの捜査
の奇数，偶数フィールドを示す信号で破線２１ａを境と
して上下に分けられる。また、ＴＶ表示のためのメモリ
読み出しクロック信号ＣＬＫの２倍のクロック信号（２
×ＣＬＫ）を用いれば、最小のＴＶ表示の４角２１を破
線２１ｂを境に左右に分けることができる。本発明では
この四角領域としての基本パターン領域２１に対して図
３の番号（１０進コード）“０”〜“７”で示されるよ
うな、文字を表現するに必要な８つの基本パターンを設
定するものとする。なお図３において斜線部はＴＶ上で
光る部分であるものとする。そして図１のようにこの図
３の基本パターンを発生する回路１３と、図形メモリ８
と同構成でこの基本パターン発生回路１３に対する基本
パターン指定コード（この場合３ビット）１２を発生す
る３つのサブ文字メモリ１１（１１−１，１１−２，１
１−３）とを設け、ＴＶの走査の奇数，偶数フィールド
を示す信号ＥＶＥＮ／ＯＤＤとメモリ読み出しクロック
信号の２倍のクロック信号２×ＣＬＫを用いることで図
形表示より細かい文字表示を行う。
ターン領域という）は図形メモリ８の最小のＴＶ表示の
領域であるものとすると、この４角２１は、ＴＶの捜査
の奇数，偶数フィールドを示す信号で破線２１ａを境と
して上下に分けられる。また、ＴＶ表示のためのメモリ
読み出しクロック信号ＣＬＫの２倍のクロック信号（２
×ＣＬＫ）を用いれば、最小のＴＶ表示の４角２１を破
線２１ｂを境に左右に分けることができる。本発明では
この四角領域としての基本パターン領域２１に対して図
３の番号（１０進コード）“０”〜“７”で示されるよ
うな、文字を表現するに必要な８つの基本パターンを設
定するものとする。なお図３において斜線部はＴＶ上で
光る部分であるものとする。そして図１のようにこの図
３の基本パターンを発生する回路１３と、図形メモリ８
と同構成でこの基本パターン発生回路１３に対する基本
パターン指定コード（この場合３ビット）１２を発生す
る３つのサブ文字メモリ１１（１１−１，１１−２，１
１−３）とを設け、ＴＶの走査の奇数，偶数フィールド
を示す信号ＥＶＥＮ／ＯＤＤとメモリ読み出しクロック
信号の２倍のクロック信号２×ＣＬＫを用いることで図
形表示より細かい文字表示を行う。
【０００９】
【実施例】次に図１ないし図３を用いて本発明の実施例
を説明する。図１は本発明の一実施例としての文字・図
形発生回路の構成を示し、この図は図３に対応してい
る。図１において１１（１１−１，１１−２，１１−
３）は図形メモリ８と同構成のサブ文字メモリ、１２は
このサブ文字メモリ１１−１，１１−２，１１−３が一
団となって出力する基本パターン指定コード（２進）、
１３は文字表現に必要な基本パターンを作る回路、１４
はラッチである。ＣＬＫはサブ文字メモリ１１および図
形メモリ８を読み出すクロック信号、ＥＶＥＮ／ＯＤＤ
はＴＶの走査の奇数フィールドか、偶数フィールドかを
示す信号、２×ＣＬＫはクロック信号ＣＬＫの２倍の周
波数のクロック信号である。この例では基本パターン発
生回路１３へは、文字を表現する基本パターンとして図
３の８つのパターンを設定するものとする。
を説明する。図１は本発明の一実施例としての文字・図
形発生回路の構成を示し、この図は図３に対応してい
る。図１において１１（１１−１，１１−２，１１−
３）は図形メモリ８と同構成のサブ文字メモリ、１２は
このサブ文字メモリ１１−１，１１−２，１１−３が一
団となって出力する基本パターン指定コード（２進）、
１３は文字表現に必要な基本パターンを作る回路、１４
はラッチである。ＣＬＫはサブ文字メモリ１１および図
形メモリ８を読み出すクロック信号、ＥＶＥＮ／ＯＤＤ
はＴＶの走査の奇数フィールドか、偶数フィールドかを
示す信号、２×ＣＬＫはクロック信号ＣＬＫの２倍の周
波数のクロック信号である。この例では基本パターン発
生回路１３へは、文字を表現する基本パターンとして図
３の８つのパターンを設定するものとする。
【００１０】今、ＴＶ画面の或る座標Ｘ，Ｙのドット位
置に図３のパターンの“２”を使用する時は、サブ文字
メモリ１１−１，１１−２，１１−３の相当する座標点
Ｘ，Ｙにパターン“２”を指定するコード０１０を夫々
１ビットづつ順番に書き込む。つまりサブ文字メモリ１
１−１にはこのコードの最上位ビット“０”を、サブ文
字メモリ１１−２には同じく次位のビット“１”を、サ
ブ文字メモリ１１−３には同じく最下位ビット“０”を
夫々書き込む。するとＴＶの走査がパターンの“２”を
表示する位置Ｘ，Ｙに来た時には１つの文字メモリを構
成する３つのサブ文字メモリ１１−１，１１−２，１１
−３から夫々“０”“１”“０”が読み出される。基本
パターン発生回路１３はサブ文字メモリ１１−１，〜，
１１−３から出力されるこのパターン指定コードと、Ｅ
ＶＥＮ／ＯＤＤ、２×ＣＬＫの２つの信号との組み合わ
せにより、パターンの“２”をＴＶに表示するような文
字出力を出す。１４のラッチは図形と文字の時相をそろ
えるためにある。
置に図３のパターンの“２”を使用する時は、サブ文字
メモリ１１−１，１１−２，１１−３の相当する座標点
Ｘ，Ｙにパターン“２”を指定するコード０１０を夫々
１ビットづつ順番に書き込む。つまりサブ文字メモリ１
１−１にはこのコードの最上位ビット“０”を、サブ文
字メモリ１１−２には同じく次位のビット“１”を、サ
ブ文字メモリ１１−３には同じく最下位ビット“０”を
夫々書き込む。するとＴＶの走査がパターンの“２”を
表示する位置Ｘ，Ｙに来た時には１つの文字メモリを構
成する３つのサブ文字メモリ１１−１，１１−２，１１
−３から夫々“０”“１”“０”が読み出される。基本
パターン発生回路１３はサブ文字メモリ１１−１，〜，
１１−３から出力されるこのパターン指定コードと、Ｅ
ＶＥＮ／ＯＤＤ、２×ＣＬＫの２つの信号との組み合わ
せにより、パターンの“２”をＴＶに表示するような文
字出力を出す。１４のラッチは図形と文字の時相をそろ
えるためにある。
【００１１】
【発明の効果】上述の説明から明らかなように、本発明
に係る文字表示装置によれば、
に係る文字表示装置によれば、
【００１２】各種の文字パターンを構成するための、２
×２の画素領域（２１以下基本パターン領域という）で
作られた所定の複数（８個など）の基本パターンを記憶
し、この基本パターンを指定するコード１２と、この基
本パターンの走査信号（２×ＣＬＫ，ＥＶＥＮ／ＯＤ
Ｄ）を入力して、指定された基本パターンの表示用信号
（文字出力ＣＯ）を出力する基本パターン発生回路１３
と、前記コードを表すビット数（３など）に等しい枚数
の、かつ前記基本パターン領域２１を最小領域とするメ
モリであって、この最小領域を走査する走査信号（Ｘ，
Ｙ）を各メモリ共通に入力して表示されるべき文字につ
いての各走査座標点に位する前記基本パターンのコード
１２を一団となって発生し、前記基本パターン発生回路
に与える文字メモリサブ文字メモリ１１−１，〜，１１
−３とを備えたものとしたので、サブ文字メモリ１１−
１，〜，１１−３を図形メモリ８と同構成とすること
で、文字と図形のＴＶ表示をほとんど共通の回路で、文
字側に基本パターン発生回路１３を設けるだけで細かい
文字の表現ができる。この基本パターン発生回路の入力
条件はＣＬＫ，２×ＣＬＫ，基本パターン指定コード
（２〜４ｂｉｔ）１２，ＥＶＥＮ／ＯＤＤ，だけなので
小容量のＲＯＭか簡単な組み合わせ回路で実現できる。
また従来のキャラクタジェネレータ方式に比べて、文字
の種類が２５６をこえても問題にならない。
×２の画素領域（２１以下基本パターン領域という）で
作られた所定の複数（８個など）の基本パターンを記憶
し、この基本パターンを指定するコード１２と、この基
本パターンの走査信号（２×ＣＬＫ，ＥＶＥＮ／ＯＤ
Ｄ）を入力して、指定された基本パターンの表示用信号
（文字出力ＣＯ）を出力する基本パターン発生回路１３
と、前記コードを表すビット数（３など）に等しい枚数
の、かつ前記基本パターン領域２１を最小領域とするメ
モリであって、この最小領域を走査する走査信号（Ｘ，
Ｙ）を各メモリ共通に入力して表示されるべき文字につ
いての各走査座標点に位する前記基本パターンのコード
１２を一団となって発生し、前記基本パターン発生回路
に与える文字メモリサブ文字メモリ１１−１，〜，１１
−３とを備えたものとしたので、サブ文字メモリ１１−
１，〜，１１−３を図形メモリ８と同構成とすること
で、文字と図形のＴＶ表示をほとんど共通の回路で、文
字側に基本パターン発生回路１３を設けるだけで細かい
文字の表現ができる。この基本パターン発生回路の入力
条件はＣＬＫ，２×ＣＬＫ，基本パターン指定コード
（２〜４ｂｉｔ）１２，ＥＶＥＮ／ＯＤＤ，だけなので
小容量のＲＯＭか簡単な組み合わせ回路で実現できる。
また従来のキャラクタジェネレータ方式に比べて、文字
の種類が２５６をこえても問題にならない。
【図１】本発明の一実施例としての文字・図形発生回路
の構成を示すブロック図
の構成を示すブロック図
【図２】基本パターン領域の構成と表示方法の説明図
【図３】文字表示用基本パターンの例を示す図
【図４】図１に対応する従来のブロック図
【図５】文字アドレスの説明図
【図６】文字フォントアドレスの説明図
１ ＴＶ同期発生回路 ７ ＴＶ座標発生回路 ８ 図形メモリ １１（１１−１，１１−２，１１−３） サブ文字メモ
リ １２ 基本パターン指定コード １３ パターン発生回路 １４ ラッチ ２１ 基本パターン領域
リ １２ 基本パターン指定コード １３ パターン発生回路 １４ ラッチ ２１ 基本パターン領域
Claims (1)
- 【請求項１】各種の文字パターンを構成するための２×
２の画素領域（以下基本パターン領域という）で作られ
た所定の複数の基本パターンを記憶し、この基本パター
ンを指定するコードと、この基本パターンの走査信号を
入力して、指定された基本パターンの表示用信号を出力
する基本パターン発生回路と、前記コードを表すビット
数に等しい枚数の、かつ前記基本パターン領域を最小領
域とするメモリであって、この最小領域を走査する走査
信号を各メモリ共通に入力して表示されるべき文字につ
いての各走査座標点に位する前記基本パターンのコード
を一団となって発生し、前記基本パターン発生回路に与
える文字メモリとを備えたことを特徴とする文字表示装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3080272A JP2987983B2 (ja) | 1991-04-15 | 1991-04-15 | 文字表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3080272A JP2987983B2 (ja) | 1991-04-15 | 1991-04-15 | 文字表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04315200A JPH04315200A (ja) | 1992-11-06 |
| JP2987983B2 true JP2987983B2 (ja) | 1999-12-06 |
Family
ID=13713651
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3080272A Expired - Fee Related JP2987983B2 (ja) | 1991-04-15 | 1991-04-15 | 文字表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2987983B2 (ja) |
-
1991
- 1991-04-15 JP JP3080272A patent/JP2987983B2/ja not_active Expired - Fee Related
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| Publication number | Publication date |
|---|---|
| JPH04315200A (ja) | 1992-11-06 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |