JP2898814B2 - 印刷インダクタ付き多層配線板 - Google Patents

印刷インダクタ付き多層配線板

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Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は印刷インダクタ付き多層
配線板に係り、特に、移動無線端末装置や衛星放送関連
装置等の高周波回路の周波数特性の向上、小型化に好適
な印刷インダクタ付き多層配線板に関する。
【0002】
【従来の技術】従来、多層配線板に印刷インダクタを構
成する場合、図4に示すように、印刷インダクタ1は、
アース層又は電源層2上に誘電体層4を挾んで構成され
ていた。しかし、図4の構成では、特に誘電体層4が薄
くなった場合に、印刷インダクタ1とアース層又は電源
層2との距離dも小さくなるため、印刷インダクタ1と
アース層又は電源層2との間に介在する浮遊容量Cpが
増加する。印刷インダクタ1の自己共振周波数ftと浮
遊容量Cpの間には、
【0003】
【数1】
【0004】の関係があるので、Cpの増加に伴って、
印刷インダクタ1の自己共振周波数ftが低下し、周波
数特性が悪化するという問題があった。また、配線層上
に誘電体層を挾んで印刷インダクタを構成する場合に
も、同様の問題が発生する。
【0005】一方、印刷配線板上に構成した印刷インダ
クタの浮遊容量Cpを低減する方法としては、例えば特
開昭60‐170911号公報に記載のように、印刷イ
ンダクタ直下の誘電体層に空隙を設ける方法がある。し
かしながら、この従来技術は化学エッチングや研削等に
より誘電体に空隙部を形成するものであるため、製造工
程が複雑になり、印刷インダクタが高価になる恐れがあ
った。
【0006】
【発明が解決しようとする課題】上述のように、従来の
印刷インダクタ付き多層配線板では、印刷インダクタと
アース層又は電源層(あるいは配線層)との間の浮遊容
量が増加し、印刷インダクタの自己共振周波数が低下し
て、周波数特性が悪化するという問題があり、また、こ
れを解決するための前記従来技術では、製造工程が複雑
になって、印刷インダクタが高価になりやすいという問
題があった。
【0007】本発明の目的は、多層印刷配線板上に形成
される印刷インダクタの浮遊容量を低減して自己共振周
波数の低下を防止した、周波数特性の良い印刷インダク
タ付き多層配線板を安価に提供することにある。
【0008】
【課題を解決するための手段】上記目的は、アース層、
配線層又は電源層上に、誘電体層を挾んで形成される印
刷インダクタについて、該印刷インダクタの直下又は直
上に位置するアース層、配線層又は電源層の一部又は全
部を切り欠くことにより、達成される。
【0009】
【作用】上記構成により、等価的に印刷インダクタとア
ース層、配線層又は電源層との距離を広げることになる
ため、印刷インダクタとアース層、配線層又は電源層と
の間に介在する浮遊容量を低減して、前記印刷インダク
タの自己共振周波数の低下を防止し、周波数特性を向上
させることができる。
【0010】また、アース層、配線層又は電源層の一部
又は全部を切り欠く工程は、通常のパターン作成工程
(パターン印刷、パターンエッチング等)の中で行われ
るので、工程数は一切増加せず、安価に実施することが
できる。
【0011】
【実施例】以下、本発明の実施例を図を用いて説明す
る。
【0012】図1は本発明の一実施例の多層配線板の斜
視図、図2は図1のA‐A′断面を示した斜視図であ
る。両図において、1は印刷インダクタ、2はアース層
又は電源層、3は電源層又はアース層、4は誘電体層、
5は切り欠き部、6は印刷インダクタ1を回路パターン
と接続するためのスルーホール、7は上記各部を含む、
例えばエポキシと銅の組合せを主体とする多層配線板で
ある。
【0013】本実施例では、図1,図2に示すように、
誘電体層4を挾んで印刷インダクタ1の直下のアース層
又は電源層2に切り欠き部5を設けてあり、これによっ
て、図2に示すように、印刷インダクタ1と対向するア
ース層、電源層との距離は、実質的に印刷インダクタ1
と電源層又はアース層3との距離d′となる。図2と従
来例を示した図4とを比較すると、各層の厚みを両者ほ
ぼ同じとすれば、d<d′であるため、Cp>Cp′とな
り、浮遊容量が低減されることは自明である。この浮遊
容量の低減により、前出の式(1)で求まる印刷インダ
クタ1の自己共振周波数ftはより大となり、本実施例
の構成が、自己共振周波数ftの低下防止に有効である
ことがわかる。
【0014】図3は本発明の他の実施例の多層配線板の
断面図である。本実施例は、多層配線板の内層の配線層
8に印刷インダクタ1を形成した例である。図示のよう
に、印刷インダクタ1の直上及び直下のアース層又は電
源層2、電源層又はアース層3とを切り欠いて、印刷イ
ンダクタ1とアース層又は電源層2、電源層又はアース
層3それぞれとの間に介在する浮遊容量を低減してい
る。本実施例では、多層配線板の表層に近いアース層又
は電源層2、電源層又はアース層3は切り欠かない構造
としてシールド効果をもたせ、内層配線層の印刷インダ
クタの安定化を図っている。しかし、回路構成によって
は、切り欠くことも有効である。
【0015】上記実施例では、印刷インダクタ1は単一
層として示したが、印刷インダクタを複数層重ねてビア
ホール又はスルーホールで接続し、さらに大きなインダ
クタンスを得ることも可能である。また、誘電体層4の
誘電体材料として、フッソ樹脂等の誘電率の低い材料を
使用すれば、浮遊容量を低減するのに有効である。な
お、アース層と電源層については、両者の順番が入れ替
わっても、効果に対する影響は少ない。
【0016】また、上記実施例では、印刷インダクタ1
と回路パターンの接続にスルーホール6を用いている
が、ワイヤボンディングやクロスオーバ配線等によって
印刷インダクタ1と回路パターンの接続を行っても、同
様の効果が得られる。
【0017】また、上記実施例では、印刷インダクタと
してスパイラルインダクタを用いて説明したが、リボン
インダクタやメアンダタイプインダクタを用いても、同
様の効果が得られることは言うまでもない。
【0018】
【発明の効果】本発明によれば、印刷インダクタ付き多
層配線板において、誘電体層を挾んで印刷インダクタの
直下又は直上のアース層、配線層又は電源層に切り欠き
部を設けることにより、等価的にアース層、配線層又は
電源層と印刷インダクタとの距離を広げ、印刷インダク
タの浮遊容量を低減し、印刷インダクタの自己共振周波
数の低下を防止することができる。しかも、上記したア
ース層、配線層又は電源層を切り欠く工程は、通常のパ
ターン作成工程の中で行われるので、工程数は一切増加
しない。従って、周波数特性の良い印刷インダクタ付き
多層配線板を安価に得ることができる。
【図面の簡単な説明】
【図1】本発明の一実施例の多層配線板の斜視図であ
る。
【図2】図1のA‐A′断面を示した斜視図である。
【図3】本発明の他の実施例の多層配線板の断面図であ
る。
【図4】従来技術による多層配線板の斜視図である。
【符号の説明】
1…印刷インダクタ 2…アース層又は電源層 3…電源層又はアース層 4…誘電体層 5…切り欠き部 6…スルーホール 7…多層配線板 8…配線層
フロントページの続き (58)調査した分野(Int.Cl.6,DB名) H05K 3/46 H05K 1/16

Claims (3)

    (57)【特許請求の範囲】
  1. 【請求項1】アース層、配線層又は電源層上に、誘電体
    層を挾んで印刷インダクタを構成してなる印刷インダク
    タ付き多層配線板において、印刷インダクタの直下又は
    直上に位置するアース層、配線層又は電源層の一部又は
    全部を切り欠いたことを特徴とする印刷インダクタ付き
    多層配線板。
  2. 【請求項2】請求項1に記載の印刷インダクタ付き多層
    配線板において、印刷インダクタが、多層配線板の内部
    に形成したものであることを特徴とする印刷インダクタ
    付き多層配線板。
  3. 【請求項3】請求項1又は2に記載の印刷インダクタ付
    き多層配線板において、切り欠いたアース層、配線層又
    は電源層のさらに下層又は上層に位置する電源層又はア
    ース層を切り欠かない構造とし、印刷インダクタに対し
    てシールド効果をもたせたことを特徴とする印刷インダ
    クタ付き多層配線板。
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