JP2859111B2 - クロック同期方法と装置 - Google Patents

クロック同期方法と装置

Info

Publication number
JP2859111B2
JP2859111B2 JP5295426A JP29542693A JP2859111B2 JP 2859111 B2 JP2859111 B2 JP 2859111B2 JP 5295426 A JP5295426 A JP 5295426A JP 29542693 A JP29542693 A JP 29542693A JP 2859111 B2 JP2859111 B2 JP 2859111B2
Authority
JP
Japan
Prior art keywords
clock signal
signal
reception
transmission
synchronization
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP5295426A
Other languages
English (en)
Other versions
JPH06244772A (ja
Inventor
文男 中野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP5295426A priority Critical patent/JP2859111B2/ja
Publication of JPH06244772A publication Critical patent/JPH06244772A/ja
Application granted granted Critical
Publication of JP2859111B2 publication Critical patent/JP2859111B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Landscapes

  • Time-Division Multiplex Systems (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)
  • Mobile Radio Communication Systems (AREA)

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、クロック同期装置に関
し、特にディジタル式の自動車電話装置に使用されるク
ロック同期装置に関する。
【0002】
【従来の技術】従来のディジタル自動車電話装置のクロ
ック同期装置は、図2に示すように、受信部1、クロッ
ク同期回路2、時分割多重接続(TDMA)方式の多重
分離回路4、およびタイミング制御回路5とからなる。
【0003】受信部1は、図3のAのような電波を受信
して、時分割多重化されたデータを再生し、クロック信
号Bを同期抽出する。クロック同期回路2は、同期クロ
ック信号として、受信部1で抽出されたクロック信号B
に位相を同期させた再生同期クロック信号Cか、または
位相を受信部1から出力されたクロック信号に同期させ
て生成した自走クロック信号のいずれかを出力する。タ
イミング制御回路5は、同期クロック信号の数をカウン
トし、そのカウント数によりタイミング制御信号を出力
して送受信のタイミングを制御する。多重分離回路4
は、受信電波中の時分割多重化されたデータを同期クロ
ック信号とタイミング信号により多重分離して出力す
る。
【0004】すなわち、中間周波数Fに変換されたア
ナログの受信電波信号は、図4に示すように、受信部1
の遅延検波復調部11により遅延検波されて、デジタル
信号の受信データとして再生、出力されるとともに、位
相データが受信部1のクロック抽出回路12に送られ
る。クロック抽出回路12においては、送られた位相デ
ータにより受信クロック信号に同期したシンボル同期ク
ロック(例えば21kbit/s)が受信同期クロック
信号として、また、発振分周回路13の出力信号からシ
ンボル同期クロックの2倍の周波数のビット同期クロッ
ク(42kbit/s)が自走同期クロック信号として
生成される。(なお、ビット同期クロックは、復調部の
位相データによらなくとも、自走クロックにより、シン
ボル同期クロックの2倍のクロック周波数に極めて近い
周波数で生成することが可能である。)この2つの同期
クロックは、図5の上段のように、標準送受信タイミン
グとして送受信期間のタイムスロットが受信、アイド
ル、送信の順に繰り返して配列されている場合は、図5
の中、下段のように、受信区間中は受信レベルがしきい
値以下の期間にも、受信電波から抽出された同期クロッ
ク信号が出力され、アイドルおよび送信区間には、発振
分周回路13から生成され、受信区間中に受信クロック
の位相に同期状態を保持された自走クロック信号が出力
される。
【0005】多重分離回路4は、クロック同期回路2か
ら出力された同期クロック信号と、タイミング制御回路
5の出力のタイミング信号とにより、データの送受信タ
イミングを制御して、受信部1で再生されたデータ信号
の中から受信区間または送信区間のいずれかの区間のデ
ータを分離して出力する。
【0006】この動作を図6のようにデータの伝送速度
が42kbit/sで、840bit、20msの1フ
レーム中に受信データと送信データが280bit、
6.6msずつ、アイドル区間を挟んで配列された場合
を例として説明する。図7は、この送信、受信の各区間
を分離するための窓を生成する回路の1例で、カウンタ
51、デコーダ52および2つのアンド回路53、54
からなる。カウンタ51は、伝送データの立ち上がりに
同期した連続クロックを入力し、データ列の受信区間と
アイドル区間の境を起算の基準点0として1ビットずつ
839までクロック数をカウントしながらその値をデコ
ーダ52に出力する。デコーダ52は、受信区間に対し
ては入力したカウント値が560から839までの間、
また送信区間に対しては238から518までの間、そ
れぞれゲートのオープンを指示する論理値1を連続して
2つのアンド回路53、54のいずれかに出力する。各
アンド回路は、デコーダ52の出力と連続した同期クロ
ック信号とを入力してその論理積を出力することによっ
て、それぞれ受信区間または送信区間のいずれか一方の
みに対する窓が出力される。
【0007】
【発明が解決しようとする課題】しかし、従来のクロッ
ク同期装置は、上述のように、クロック同期回路から出
力されるクロック数をカウントすることにより送受信の
分離用窓のタイミングを制御していたので、図3および
図5のa−a´区間に示すように、受信区間の電界レベ
ル低下などのために再生クロック信号の位相が乱れる
と、送受信のタイミングがずれたり、受信データが脱落
してしまうという欠点があった。
【0008】本発明の目的は、上述の欠点を解消し、受
信電界レベルが低下したときなどに発生する多重分離回
路の送受信タイミングのずれを防止できるクロック同期
装置を提供することにある。
【0009】
【課題を解決するための手段】本発明のクロック同期装
置は、送受信期間のタイムスロットが受信、アイドル、
送信の順に繰り返して配列された時分割多重接続方式の
クロック同期装置であって、受信信号の電界レベルを検
出し、検出した電界レベルと所定のしきい値と比較する
レベル比較回路と、前記受信信号から再生した再生クロ
ック信号と、前記再生クロック信号に同期して生成した
自走クロック信号とのいずれか一方を同期クロック信号
として出力するクロック同期回路と、前記同期クロック
信号に基づいて送受信の切替のタイミング信号を出力す
るタイミング制御回路と、前記タイミング信号および前
記同期クロック信号により、送信と受信の各区間を分離
する多重分離回路と、を有し、前記クロック同期回路
は、前記アイドルおよび送信区間で、前記自走クロック
信号を前記同期クロック信号として出力し、前記受信区
間で、前記再生クロック信号を前記同期クロック信号と
して出力し、前記受信区間中に前記電界レベルが前記所
定のしきい値以下となると、前記レベル比較回路からの
出力信号により前記自走クロック信号を前記同期クロッ
ク信号とし、前記電界レベルが前記所定のしきい値を越
えると、前記再生クロック信号を前記同期クロック信号
として出力する。
【0010】
【0011】
【作用】受信した電波のデータを分離する同期クロック
信号は、受信電界レベルが所定のしきい値より低い場合
は、自走クロック信号から生成された同期クロック信号
に、また、受信電界レベルがしきい値以上の場合は、受
信電波から再生された同期クロック信号に、それぞれ切
替えられる。
【0012】
【実施例】本実施例は、図1に示すように、従来例と同
様な機能を有する受信部1、クロック同期回路2、タイ
ミング制御回路5、多重分離回路4を有する外に、受信
部1とクロック同期回路2との間に受信電波の電界レベ
ルを検出するレベル比較回路3が追加接続された構成と
なっている。
【0013】受信部1は、受信電波を変換した中間周波
数IFの信号からデータ信号とクロック信号を抽出する
外に、IFを平滑化して受信電界のレベル情報とし、こ
れをレベル比較回路3に出力する。レベル比較回路3
は、受信部1から出力された電界レベル情報を予め設定
されたしきい値と比較し、電界レベルの値の方が高けれ
ば同期クロック信号を、また、しきい値の方が高ければ
自走クロック信号を、それぞれ出力するようにクロック
同期回路2に対してクロック切替え信号を送る。タイミ
ング制御回路5は、クロック同期回路2から出力された
クロック信号を入力して受信部1と多重分離回路4に対
するデータの送受信タイミング制御信号を出力する。
【0014】したがって、受信電界レベルが図5の中段
のように受信区間内で変化する場合は、受信区間内でも
クロック同期回路2の出力するクロック信号が、図5の
下段のように、電界レベルの高低に応じて電波の変動分
から同期抽出された同期クロック信号かまたは同期状態
を保持する自走クロック信号のいずれかに切替えられ、
多重分離回路4には、受信電界レベルに関係のない一定
期クロック信号とタイミング信号が入力され、受信
電波から変換されたデータ信号の中から送信区間と受信
区間が誤りなく分離される。
【0015】
【発明の効果】以上説明したように本発明は、クロック
同期回路から多重分離回路に供給される同期クロック信
号が、レベル比較回路により、受信電界レベルに応じて
自走クロックと受信電波から再生されたクロックのいず
れかに切替えられるので、ディジタル自動車電話装置の
受信電波の電界レベルが低下してクロック信号の位相が
乱されても、多重分離回路の動作のタイミングのずれを
確実に防止することができる効果がある。
【図面の簡単な説明】
【図1】本発明の1実施例のブロック図である。
【図2】従来のクロック同期装置のブロック図である。
【図3】受信電界と再生クロックの関係を示すタイミン
グ図である。
【図4】受信部1のクロック再生回路のブロック図であ
る。
【図5】タイムスロットの1例である。
【図6】送受信ゲートのタイミング図である。
【図7】タイミング制御回路5の1例の回路図である。
【符号の説明】
1 受信部 2 クロック同期回路 3 レベル比較回路 4 多重分離回路 5 タイミング制御回路 11 遅延検波復調部 12 クロック抽出回路 13 発振分周回路 51 カウンタ 52 デコーダ 53、54 アンド回路

Claims (2)

    (57)【特許請求の範囲】
  1. 【請求項1】 送受信期間のタイムスロットが受信、ア
    イドル、送信の順に繰り返して配列された時分割多重接
    続方式のクロック同期方法であって、 受信信号の電界レベルを検出し、検出した電界レベルと
    所定のしきい値と比較し、 前記受信信号から再生した再生クロック信号と、前記再
    生クロック信号に同期して生成した自走クロック信号と
    のいずれか一方を同期クロック信号とし、 前記同期クロック信号に基づいて送受信の切替のタイミ
    ング信号を生成し、 前記タイミング信号および前記同期クロック信号によ
    り、送信と受信の各区間を多重分離回路にて分離し、 前記アイドルおよび送信区間で、前記自走クロック信号
    を前記同期クロック信号として出力し、前記受信区間
    で、前記再生クロック信号を前記同期クロック信号とし
    て出力し、前記受信区間中に前記電界レベルが前記所定
    のしきい値以下となると、前記レベル比較回路からの出
    力信号により前記自走クロック信号を前記同期クロック
    信号とし、前記電界レベルが前記所定のしきい値を越え
    ると、前記再生クロック信号を前記同期クロック信号と
    して出力することを特徴とするクロック同期方法。
  2. 【請求項2】 送受信期間のタイムスロットが受信、ア
    イドル、送信の順に繰り返して配列された時分割多重接
    続方式のクロック同期装置であって、 受信信号の電界レベルを検出し、検出した電界レベルと
    所定のしきい値と比較するレベル比較回路と、 前記受信信号から再生した再生クロック信号と、前記再
    生クロック信号に同期して生成した自走クロック信号と
    のいずれか一方を同期クロック信号として出力するクロ
    ック同期回路と、 前記同期クロック信号に基づいて送受信の切替のタイミ
    ング信号を出力するタイミング制御回路と、 前記タイミング信号および前記同期クロック信号によ
    り、送信と受信の各区間を分離する多重分離回路と、を
    有し、 前記クロック同期回路は、前記アイドルおよび送信区間
    で、前記自走クロック信号を前記同期クロック信号とし
    て出力し、前記受信区間で、前記再生クロック信号を前
    記同期クロック信号として出力し、前記受信区間中に前
    記電界レベルが前記所定のしきい値以下となると、前記
    レベル比較回路からの出力信号により前記自走クロック
    信号を前記同期クロック信号とし、前記電界レベルが前
    記所定のしきい値を越えると、前記再生クロック信号を
    前記同期クロック信号として出力することを特徴とする
    クロック同期装置。
JP5295426A 1992-11-30 1993-11-25 クロック同期方法と装置 Expired - Fee Related JP2859111B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP5295426A JP2859111B2 (ja) 1992-11-30 1993-11-25 クロック同期方法と装置

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
JP4-319567 1992-11-30
JP31956792 1992-11-30
JP5295426A JP2859111B2 (ja) 1992-11-30 1993-11-25 クロック同期方法と装置

Publications (2)

Publication Number Publication Date
JPH06244772A JPH06244772A (ja) 1994-09-02
JP2859111B2 true JP2859111B2 (ja) 1999-02-17

Family

ID=26560263

Family Applications (1)

Application Number Title Priority Date Filing Date
JP5295426A Expired - Fee Related JP2859111B2 (ja) 1992-11-30 1993-11-25 クロック同期方法と装置

Country Status (1)

Country Link
JP (1) JP2859111B2 (ja)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2852240B2 (ja) * 1996-05-30 1999-01-27 埼玉日本電気株式会社 間欠受信装置

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5851455B2 (ja) * 1975-01-24 1983-11-16 日本電信電話株式会社 ジブンカツタジユウツウシンホウシキ
JPS62278838A (ja) * 1986-05-28 1987-12-03 Sharp Corp クロツク信号再生回路

Also Published As

Publication number Publication date
JPH06244772A (ja) 1994-09-02

Similar Documents

Publication Publication Date Title
CA1155932A (en) Arrangement for synchronizing the phase of a local clock signal with an input signal
US7734000B2 (en) Clock and data recovery circuits
JPH07336342A (ja) クロック再生回路
JP2001197049A (ja) クロック再生回路及びこれを用いた光信号受信器
EP0878911B1 (en) Clock extraction circuit
EP0488225B1 (en) Clock information transmitting device and clock information receiving device
JP2597239B2 (ja) ディジタル位相同期ループ及び該ディジタル位相同期ループを具える受信機及びその制御方法
JP2859111B2 (ja) クロック同期方法と装置
US5822326A (en) Synchronizing digital audio signals
EP0600408B1 (en) Method and apparatus for clock synchronization
JPS6166433A (ja) クロツク同期回路
JP2720189B2 (ja) 文字放送信号発生装置および文字放送信号受信機
JP2840569B2 (ja) 局間クロック同期回路
JP2613507B2 (ja) クロック再生回路
JPH0231553B2 (ja)
JPS60139082A (ja) サンプリングクロツク再生回路
JPH0124992Y2 (ja)
JPH08331189A (ja) クロック位相同期回路
JP2713009B2 (ja) 遅延時間差吸収装置
JPH10308082A (ja) データセパレータ
JP2000101554A (ja) サンプリングクロック再生回路
JPH08275023A (ja) 同期信号検出回路
JPH1098459A (ja) クロック同期方式
JPH0732465B2 (ja) 同期信号検出回路
JPH098787A (ja) クロック再生装置

Legal Events

Date Code Title Description
A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 19970311

LAPS Cancellation because of no payment of annual fees