JP2840155B2 - 等化方法 - Google Patents
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B3/00—Line transmission systems
- H04B3/02—Details
- H04B3/04—Control of transmission; Equalising
- H04B3/14—Control of transmission; Equalising characterised by the equalising network used
- H04B3/142—Control of transmission; Equalising characterised by the equalising network used using echo-equalisers, e.g. transversal
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
- H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
- H04L25/03—Shaping networks in transmitter or receiver, e.g. adaptive shaping networks
- H04L25/03006—Arrangements for removing intersymbol interference
- H04L25/03012—Arrangements for removing intersymbol interference operating in the time domain
- H04L25/03114—Arrangements for removing intersymbol interference operating in the time domain non-adaptive, i.e. not adjustable, manually adjustable, or adjustable only during the reception of special signals
- H04L25/03146—Arrangements for removing intersymbol interference operating in the time domain non-adaptive, i.e. not adjustable, manually adjustable, or adjustable only during the reception of special signals with a recursive structure
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Power Engineering (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Description
【０００１】（目次） 産業上の利用分野 従来の技術（図５乃至図６） 発明が解決しようとする課題 課題を解決するための手段（図１） 作用 実施例 (a) 一実施例の説明（図２乃至図４） (b) 他の実施例の説明 発明の効果
【０００２】
【産業上の利用分野】本発明は、モデム等において、入
力信号を等化処理する等化方法に関する。
力信号を等化処理する等化方法に関する。
【０００３】近年、電話回線を用いたデータ通信の普及
に伴い、モデム（変復調装置）の高速化、高性能化が進
められている。モデム内の信号処理は、デジタル処理に
より行われているが、演算量の増加、演算量の増加に伴
う演算誤差による性能劣化等が問題となってきた。
に伴い、モデム（変復調装置）の高速化、高性能化が進
められている。モデム内の信号処理は、デジタル処理に
より行われているが、演算量の増加、演算量の増加に伴
う演算誤差による性能劣化等が問題となってきた。
【０００４】このため、固定等化処理においても、性能
向上が要求される。
向上が要求される。
【０００５】
【従来の技術】図５、図６は従来技術の説明図（その
１）、（その２）である。図５（Ａ）に示すように、モ
デム１０は、加入者線を介し局１１に接続され、相手局
１１を介し加入者線により、相手側モデム１０に接続さ
れる。
１）、（その２）である。図５（Ａ）に示すように、モ
デム１０は、加入者線を介し局１１に接続され、相手局
１１を介し加入者線により、相手側モデム１０に接続さ
れる。
【０００６】ここで、局間は、搬送区間であり、信号の
振幅変動、遅延が発生し、加入者線では、ライン（線
路）変動が生じるため、モデム１０では、振幅等化、遅
延等化、線路等化という固定等化処理を行う必要があ
る。
振幅変動、遅延が発生し、加入者線では、ライン（線
路）変動が生じるため、モデム１０では、振幅等化、遅
延等化、線路等化という固定等化処理を行う必要があ
る。
【０００７】このため、図５（Ｂ）に示すように、モデ
ム１０の受信部では、受信信号をバンドパスフィルタ１
２で帯域制限して、Ａ／Ｄ（アナログ／デジタル）コン
バータ１３でデジタル信号に変換した後、プロセッサ
（処理部）１４に入力し、かかる固定等化処理１５を行
って信号補正した後、復調処理以下を行っている。
ム１０の受信部では、受信信号をバンドパスフィルタ１
２で帯域制限して、Ａ／Ｄ（アナログ／デジタル）コン
バータ１３でデジタル信号に変換した後、プロセッサ
（処理部）１４に入力し、かかる固定等化処理１５を行
って信号補正した後、復調処理以下を行っている。
【０００８】同様に、図５（Ｃ）に示すように、モデム
１０の送信部でも、プロセッサ１６で、符号化信号をロ
ールオフフィルタ処理１７して、帯域制限し、変調処理
１８した後、かかる固定等化処理１９して、Ｄ／Ａ（デ
ジタル／アナログ）コンバータ２０でアナログ信号に変
換して、送信している。
１０の送信部でも、プロセッサ１６で、符号化信号をロ
ールオフフィルタ処理１７して、帯域制限し、変調処理
１８した後、かかる固定等化処理１９して、Ｄ／Ａ（デ
ジタル／アナログ）コンバータ２０でアナログ信号に変
換して、送信している。
【０００９】この固定等化部１５は、図６（Ａ）に示す
ように、遅延等化器（ＤＥＱ）２１、振幅等化器（ＣＥ
Ｑ）２２、線路等化器（ＬＥＱ）２３を縦列に並べて、
これらを組み合わせることにより、所望の固定等化特性
を実現している。
ように、遅延等化器（ＤＥＱ）２１、振幅等化器（ＣＥ
Ｑ）２２、線路等化器（ＬＥＱ）２３を縦列に並べて、
これらを組み合わせることにより、所望の固定等化特性
を実現している。
【００１０】この各々の遅延等化器２１、振幅等化器２
２、線路等化器２３をＩＩＲフィルタで構成でき、ＩＩ
Ｒフィルタは、パラメータの変更により、フィルタの特
性（ハイパスフィルタ、ローパスフィルタ、バンドパス
フィルタ、ノッチフィルタ等）の変更が可能であり、１
種類のフィルタで遅延等化器、振幅等化器、線路等化器
として動作でき、例えば、２次ＩＩＲフィルタは、図６
（Ｂ）の構成をとり、パラメータＣ＝Ｆ＝０、Ｄ＝１と
設定すると、線路等化器として動作する。
２、線路等化器２３をＩＩＲフィルタで構成でき、ＩＩ
Ｒフィルタは、パラメータの変更により、フィルタの特
性（ハイパスフィルタ、ローパスフィルタ、バンドパス
フィルタ、ノッチフィルタ等）の変更が可能であり、１
種類のフィルタで遅延等化器、振幅等化器、線路等化器
として動作でき、例えば、２次ＩＩＲフィルタは、図６
（Ｂ）の構成をとり、パラメータＣ＝Ｆ＝０、Ｄ＝１と
設定すると、線路等化器として動作する。
【００１１】このため、従来は、かかるＩＩＲフィルタ
処理のパラメータを変更して、縦列に実行して、設定さ
れた各等化処理を実行していた。
処理のパラメータを変更して、縦列に実行して、設定さ
れた各等化処理を実行していた。
【００１２】
【発明が解決しようとする課題】しかしながら、従来技
術では、次の問題があった。 フィルタによる各等化処理を個別に行うため、プロセ
ッサの演算量が増加し、実時間処理するには、多数のプ
ロセッサを必要とする。
術では、次の問題があった。 フィルタによる各等化処理を個別に行うため、プロセ
ッサの演算量が増加し、実時間処理するには、多数のプ
ロセッサを必要とする。
【００１３】演算量の増大により、演算誤差による等
化性能が劣化する。 従って、本発明は、プロセッサの演算量を減少させ、等
化性能の劣化を防止することができる等化方法を提供す
ることを目的とする。
化性能が劣化する。 従って、本発明は、プロセッサの演算量を減少させ、等
化性能の劣化を防止することができる等化方法を提供す
ることを目的とする。
【００１４】
【課題を解決するための手段】図１は本発明の原理図で
ある。本発明の請求項１は、設定するパラメータによ
り、フィルタ特性を変化しうるフィルタ処理を実行する
処理部４と、各フィルタ特性に応じたパラメータを格納
したメモリ５とを有し、入力信号に対し、パラメータを
変更して、該フィルタ処理を縦列に実行して、振幅等化
のローパスフィルタ、振幅等化のハイパスフィルタ、線
路等化のフィルタの各フィルタ特性の実行による固定等
化を行う固定等化方法において、前記線路等化のフィル
タとハイパスフィルタとローパスフィルタとの機能を、
該ローパスフィルタのフィルタ処理により実行すること
を特徴とする。
ある。本発明の請求項１は、設定するパラメータによ
り、フィルタ特性を変化しうるフィルタ処理を実行する
処理部４と、各フィルタ特性に応じたパラメータを格納
したメモリ５とを有し、入力信号に対し、パラメータを
変更して、該フィルタ処理を縦列に実行して、振幅等化
のローパスフィルタ、振幅等化のハイパスフィルタ、線
路等化のフィルタの各フィルタ特性の実行による固定等
化を行う固定等化方法において、前記線路等化のフィル
タとハイパスフィルタとローパスフィルタとの機能を、
該ローパスフィルタのフィルタ処理により実行すること
を特徴とする。
【００１５】本発明の請求項２は、設定するパラメータ
により、フィルタ特性を変化しうるフィルタ処理を実行
しうる処理部４と、フィルタ特性に応じたパラメータを
格納したメモリ５とを有し、入力信号に対し、パラメー
タを変更して、該フィルタ処理を実行して等化を行う等
化方法において、Ｎ種類のフィルタ処理のオン／オフを
指示する信号を前記メモリに入力し、入力したオン／オ
フ指示信号に対応したパラメータを前記メモリから前記
処理部４に転送し、前記処理部４は、転送されたパラメ
ータに基づいてフィルタ処理を実行することにより、Ｎ
種類のフィルタ処理を１つのフィルタ処理により同時に
実行することを特徴とする。
により、フィルタ特性を変化しうるフィルタ処理を実行
しうる処理部４と、フィルタ特性に応じたパラメータを
格納したメモリ５とを有し、入力信号に対し、パラメー
タを変更して、該フィルタ処理を実行して等化を行う等
化方法において、Ｎ種類のフィルタ処理のオン／オフを
指示する信号を前記メモリに入力し、入力したオン／オ
フ指示信号に対応したパラメータを前記メモリから前記
処理部４に転送し、前記処理部４は、転送されたパラメ
ータに基づいてフィルタ処理を実行することにより、Ｎ
種類のフィルタ処理を１つのフィルタ処理により同時に
実行することを特徴とする。
【００１６】本発明の請求項３は、請求項１又は２にお
いて、前記フィルタ処理が、２次ＩＩＲフィルタ処理で
あることを特徴とする。
いて、前記フィルタ処理が、２次ＩＩＲフィルタ処理で
あることを特徴とする。
【００１７】
【作用】本発明では、複数のフィルタ処理を縦列で実行
する場合に、複数（Ｎ種類）のフィルタ処理を、パラメ
ータを変更するだけで１つのフィルタ処理で実行できる
ものがあることを見出し、複数の縦列フィルタ処理を１
のフィルタ処理により実行して、演算量の減少を図り、
演算誤差による等化性能の低下を防止するものである。
する場合に、複数（Ｎ種類）のフィルタ処理を、パラメ
ータを変更するだけで１つのフィルタ処理で実行できる
ものがあることを見出し、複数の縦列フィルタ処理を１
のフィルタ処理により実行して、演算量の減少を図り、
演算誤差による等化性能の低下を防止するものである。
【００１８】また、固定等化処理の内、線路等化のフィ
ルタと振幅等化のハイパスフィルタと振幅等化のローパ
スフィルタが、ローパスフィルタのフィルタ処理により
実行できるため、１のローパスフィルタ処理により実行
して、３つの処理を１つの処理として、演算量を大幅に
削減し、等化性能の低下を防止するものである。
ルタと振幅等化のハイパスフィルタと振幅等化のローパ
スフィルタが、ローパスフィルタのフィルタ処理により
実行できるため、１のローパスフィルタ処理により実行
して、３つの処理を１つの処理として、演算量を大幅に
削減し、等化性能の低下を防止するものである。
【００１９】さらに、２次ＩＩＲフィルタ処理による
と、簡単なパラメータの変更で実行でき、容易に演算量
を大幅に削減し、等化性能の低下を防止するものであ
る。
と、簡単なパラメータの変更で実行でき、容易に演算量
を大幅に削減し、等化性能の低下を防止するものであ
る。
【００２０】
【実施例】(a) 一実施例の説明 図２は本発明の一実施例構成図、図３は本発明の一実施
例パラメータＲＯＭ説明図、図４は本発明の一実施例説
明図である。
例パラメータＲＯＭ説明図、図４は本発明の一実施例説
明図である。
【００２１】図２において、１、２、３は２次ＩＩＲフ
ィルタ処理部（プログラム）であり、図６（Ｂ）の等価
回路で示したもの、４はプロセッサ（ＣＰＵ）であり、
処理プログラムを実行するもの、５はパラメータＲＯＭ
（リード・オンリー・メモリ）であり、図３に示すよう
に、ＤＥＱ ＯＮ／ＯＦＦ信号、ＣＥＱ ＯＮ／ＯＦＦ
信号、ＬＥＱ １／２信号に応じた各２次ＩＩＲフィル
タ処理部１、２、３のパラメータを格納してあるもので
あり、１５は固定等化部であり、２次ＩＩＲフィルタ処
理部１、２、３で構成されているものである。
ィルタ処理部（プログラム）であり、図６（Ｂ）の等価
回路で示したもの、４はプロセッサ（ＣＰＵ）であり、
処理プログラムを実行するもの、５はパラメータＲＯＭ
（リード・オンリー・メモリ）であり、図３に示すよう
に、ＤＥＱ ＯＮ／ＯＦＦ信号、ＣＥＱ ＯＮ／ＯＦＦ
信号、ＬＥＱ １／２信号に応じた各２次ＩＩＲフィル
タ処理部１、２、３のパラメータを格納してあるもので
あり、１５は固定等化部であり、２次ＩＩＲフィルタ処
理部１、２、３で構成されているものである。
【００２２】パラメータＲＯＭ５は、図３に示すよう
に、各ＤＥＱ ＯＮ／ＯＦＦ信号、ＣＥＱ ＯＮ／ＯＦ
Ｆ信号、ＬＥＱ １／２信号に応じた各２次ＩＩＲフィ
ルタ処理部１、２、３のパラメータを格納してあるもの
であり、例えば、ＤＥＱ ＯＮ／ＯＦＦ信号が「０」
（オフ）、ＣＥＱ ＯＮ／ＯＦＦ信号が「０」（オ
フ）、ＬＥＱ １／２信号が「０１」（ＬＥＱ１指定）
では、２次ＩＩＲフィルタ処理１のみが実行され、ＬＥ
Ｑ１（線路等化）のパラメータが出力される。
に、各ＤＥＱ ＯＮ／ＯＦＦ信号、ＣＥＱ ＯＮ／ＯＦ
Ｆ信号、ＬＥＱ １／２信号に応じた各２次ＩＩＲフィ
ルタ処理部１、２、３のパラメータを格納してあるもの
であり、例えば、ＤＥＱ ＯＮ／ＯＦＦ信号が「０」
（オフ）、ＣＥＱ ＯＮ／ＯＦＦ信号が「０」（オ
フ）、ＬＥＱ １／２信号が「０１」（ＬＥＱ１指定）
では、２次ＩＩＲフィルタ処理１のみが実行され、ＬＥ
Ｑ１（線路等化）のパラメータが出力される。
【００２３】尚、ＬＥＱ１／２信号は、「００」でＬＥ
Ｑなし、「１０」でＬＥＱ２、「１１」でＬＥＱ３を指
定する。次に、この実施例の動作を説明する。
Ｑなし、「１０」でＬＥＱ２、「１１」でＬＥＱ３を指
定する。次に、この実施例の動作を説明する。
【００２４】図４に示すように、振幅等化器（ＣＥＱ）
は、ハイパスフィルタ（ＨＰＦ）とローパスフィルタ
（ＬＰＦ）とで実現でき、線路等化器（ＬＥＱ）は、図
のようなフィルタ特性で実現できる。
は、ハイパスフィルタ（ＨＰＦ）とローパスフィルタ
（ＬＰＦ）とで実現でき、線路等化器（ＬＥＱ）は、図
のようなフィルタ特性で実現できる。
【００２５】この振幅等化器の周波数特性と、線路等化
器の周波数特性とを合わせると、ローパスフィルタの特
性となり、振幅等化器のローパスフィルタで置き換える
ことができる。
器の周波数特性とを合わせると、ローパスフィルタの特
性となり、振幅等化器のローパスフィルタで置き換える
ことができる。
【００２６】従って、ハイパスフィルタ、ローパスフィ
ルタ、線路等化のフィルタの３つの２次ＩＩＲフィルタ
処理を、１つの２次ＩＩＲフィルタ処理のローパスフィ
ルタ処理で実行できる。
ルタ、線路等化のフィルタの３つの２次ＩＩＲフィルタ
処理を、１つの２次ＩＩＲフィルタ処理のローパスフィ
ルタ処理で実行できる。
【００２７】即ち、図２、図３において、振幅等化（Ｃ
ＥＱ）がオン（「１」）で、線路等化（ＬＥＱ１／２）
がオン（「１」）の時は、３回の２次ＩＩＲフィルタ処
理１、２、３のそれぞれに、それぞれの処理のためのパ
ラメータを出力して、３回の２次ＩＩＲフィルタ処理を
行う代わりに、パラメータＲＯＭ５から１つの２次ＩＩ
Ｒフィルタ処理１に、ローパスフィルタ（ＬＰＦ）のパ
ラメータを出力して、１回の２次ＩＩＲフィルタ処理１
により、これらの動作を実現する。
ＥＱ）がオン（「１」）で、線路等化（ＬＥＱ１／２）
がオン（「１」）の時は、３回の２次ＩＩＲフィルタ処
理１、２、３のそれぞれに、それぞれの処理のためのパ
ラメータを出力して、３回の２次ＩＩＲフィルタ処理を
行う代わりに、パラメータＲＯＭ５から１つの２次ＩＩ
Ｒフィルタ処理１に、ローパスフィルタ（ＬＰＦ）のパ
ラメータを出力して、１回の２次ＩＩＲフィルタ処理１
により、これらの動作を実現する。
【００２８】同様に、遅延等化（ＤＥＱ）がオン
（「１」）で、振幅等化（ＣＥＱ）がオン（「１」）
で、線路等化（ＬＥＱ１／２）がオン（「１」）の時
は、４回の２次ＩＩＲフィルタ処理のそれぞれに、それ
ぞれの処理のためのパラメータを出力して、４回の２次
ＩＩＲフィルタ処理を行う代わりに、パラメータＲＯＭ
５から１つの２次ＩＩＲフィルタ処理１に、ローパスフ
ィルタ（ＬＰＦ）のパラメータを出力して、２次ＩＩＲ
フィルタ処理２に、遅延等化のフィルタ処理のパラメー
タを出力して、２回の２次ＩＩＲフィルタ処理１、２に
より、これらの動作を実現する。
（「１」）で、振幅等化（ＣＥＱ）がオン（「１」）
で、線路等化（ＬＥＱ１／２）がオン（「１」）の時
は、４回の２次ＩＩＲフィルタ処理のそれぞれに、それ
ぞれの処理のためのパラメータを出力して、４回の２次
ＩＩＲフィルタ処理を行う代わりに、パラメータＲＯＭ
５から１つの２次ＩＩＲフィルタ処理１に、ローパスフ
ィルタ（ＬＰＦ）のパラメータを出力して、２次ＩＩＲ
フィルタ処理２に、遅延等化のフィルタ処理のパラメー
タを出力して、２回の２次ＩＩＲフィルタ処理１、２に
より、これらの動作を実現する。
【００２９】このように、各２回のフィルタ処理が削減
できるので、演算量が半分となり、プロセッサ４の負担
を大幅に低減し、演算量が減ることにより、演算誤差が
少なくなるため、固定等化器の性能が向上する。
できるので、演算量が半分となり、プロセッサ４の負担
を大幅に低減し、演算量が減ることにより、演算誤差が
少なくなるため、固定等化器の性能が向上する。
【００３０】又、２次ＩＩＲフィルタ処理の段数も、最
大３段で済み、固定等化器として、従来の４段に比し、
１段低減できる。尚、図３のその他の場合は、従来と相
違がない。
大３段で済み、固定等化器として、従来の４段に比し、
１段低減できる。尚、図３のその他の場合は、従来と相
違がない。
【００３１】又、遅延等化（ＤＥＱ）のオン／オフ、振
幅等化（ＣＥＱ）のオン／オフ、線路等化（ＬＥＱ１／
２）のオン／オフは、モデムの現地調整時に、アイパタ
ーンが最適となるように設定する。
幅等化（ＣＥＱ）のオン／オフ、線路等化（ＬＥＱ１／
２）のオン／オフは、モデムの現地調整時に、アイパタ
ーンが最適となるように設定する。
【００３２】(b) 他の実施例の説明 上述の実施例の他に、本発明は、次のような変形が可能
である。 パラメータにより、フィルタ特性を変更できるフィル
タとして、２次ＩＩＲフィルタで説明したが、トランス
バーサルフィルタ、他のＩＩＲフィルタ等を用いても良
い。
である。 パラメータにより、フィルタ特性を変更できるフィル
タとして、２次ＩＩＲフィルタで説明したが、トランス
バーサルフィルタ、他のＩＩＲフィルタ等を用いても良
い。
【００３３】固定等化を、遅延等化、振幅等化、線路
等化の例で説明したが、この内の２つ又は他の信号等化
に適用しても良い。以上、本発明を実施例により説明し
たが、本発明の主旨の範囲内で種々の変形が可能であ
り、これらを本発明の範囲から排除するものではない。
等化の例で説明したが、この内の２つ又は他の信号等化
に適用しても良い。以上、本発明を実施例により説明し
たが、本発明の主旨の範囲内で種々の変形が可能であ
り、これらを本発明の範囲から排除するものではない。
【００３４】
【発明の効果】以上説明したように、本発明によれば、
次の効果を奏する。 複数のフィルタ特性の内、１のフィルタ特性で等価で
きるものは、１のフィルタ特性のパラメータでフィルタ
処理するので、固定等化処理の演算量を大幅に削減でき
る。
次の効果を奏する。 複数のフィルタ特性の内、１のフィルタ特性で等価で
きるものは、１のフィルタ特性のパラメータでフィルタ
処理するので、固定等化処理の演算量を大幅に削減でき
る。
【００３５】演算量が減少するので、演算誤差による
等化性能の低下を防止できる。
等化性能の低下を防止できる。
【図１】本発明の原理図である。
【図２】本発明の一実施例構成図である。
【図３】本発明の一実施例パラメータＲＯＭ説明図であ
る。
る。
【図４】本発明の一実施例説明図である。
【図５】従来技術の説明図（その１）である。
【図６】従来技術の説明図（その２）である。
１、２、３ ２次ＩＩＲフィルタ ４ プロセッサ ５ パラメータＲＯＭ １０ モデム １１ 局 １５ 固定等化部 ２１ 遅延等化部 ２２ 振幅等化部 ２３ 線路等化部
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭59−161133（ＪＰ，Ａ) 特開 平２−101829（ＪＰ，Ａ) 特開 平３−284025（ＪＰ，Ａ) 特開 平４−40067（ＪＰ，Ａ) (58)調査した分野(Int.Cl.6，ＤＢ名) H04B 3/00 - 3/18 H04B 7/005 H03H 15/00 - 21/00
Claims (3)
- 【請求項１】設定するパラメータにより、フィルタ特性
を変化しうるフィルタ処理を実行する処理部と、各フィ
ルタ特性に応じたパラメータを格納したメモリとを有
し、入力信号に対し、パラメータを変更して、該フィル
タ処理を縦列に実行して、振幅等化のローパスフィル
タ、振幅等化のハイパスフィルタ、線路等化のフィルタ
の各フィルタ特性の実行による固定等化を行う固定等化
方法において、前記線路等化のフィルタとハイパスフィルタとローパス
フィルタとの機能を、該ローパスフィルタのフィルタ処
理により 実行することを特徴とする固定等化方法。 - 【請求項２】設定するパラメータにより、フィルタ特性
を変化しうるフィルタ処理を実行しうる処理部と、フィ
ルタ特性に応じたパラメータを格納したメモリとを有
し、入力信号に対し、パラメータを変更して、該フィル
タ処理を実行して等化を行う等化方法において、 Ｎ種類のフィルタ処理のオン／オフを指示する信号を前
記メモリに入力し、入力したオン／オフ指示信号に対応
したパラメータを前記メモリから前記処理部に転送し、 前記処理部は、転送されたパラメータに基づいてフィル
タ処理を実行することにより、Ｎ種類のフィルタ処理を
１つのフィルタ処理により同時に実行することを特徴と
する 等価方法。 - 【請求項３】前記フィルタ処理が、２次ＩＩＲフィルタ
処理であることを特徴とする請求項１又は２の等化方
法。
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Applications Claiming Priority (1)
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| JP4062887A JP2840155B2 (ja) | 1992-03-19 | 1992-03-19 | 等化方法 |
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ID=13213217
Family Applications (1)
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