JP2795906B2 - 選局装置 - Google Patents

選局装置

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JP2795906B2 JP1158488A JP15848889A JP2795906B2 JP 2795906 B2 JP2795906 B2 JP 2795906B2 JP 1158488 A JP1158488 A JP 1158488A JP 15848889 A JP15848889 A JP 15848889A JP 2795906 B2 JP2795906 B2 JP 2795906B2
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    • H03—ELECTRONIC CIRCUITRY
    • H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
    • H03J7/00—Automatic frequency control; Automatic scanning over a band of frequencies
    • H03J7/02—Automatic frequency control
    • H03J7/04—Automatic frequency control where the frequency control is accomplished by varying the electrical characteristics of a non-mechanically adjustable element or where the nature of the frequency controlling element is not significant
    • H03J7/06—Automatic frequency control where the frequency control is accomplished by varying the electrical characteristics of a non-mechanically adjustable element or where the nature of the frequency controlling element is not significant using counters or frequency dividers
    • H03J7/065—Automatic frequency control where the frequency control is accomplished by varying the electrical characteristics of a non-mechanically adjustable element or where the nature of the frequency controlling element is not significant using counters or frequency dividers the counter or frequency divider being used in a phase locked loop
    • H—ELECTRICITY
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    • H03J1/00—Details of adjusting, driving, indicating, or mechanical control arrangements for resonant circuits in general
    • H03J1/0008—Details of adjusting, driving, indicating, or mechanical control arrangements for resonant circuits in general using a central processing unit, e.g. a microprocessor
    • H03J1/0041—Details of adjusting, driving, indicating, or mechanical control arrangements for resonant circuits in general using a central processing unit, e.g. a microprocessor for frequency synthesis with counters or frequency dividers
    • H03J1/005—Details of adjusting, driving, indicating, or mechanical control arrangements for resonant circuits in general using a central processing unit, e.g. a microprocessor for frequency synthesis with counters or frequency dividers in a loop

Description

【発明の詳細な説明】 ［発明の目的］ （産業上の利用分野） 本発明はアップダウン選局が可能なテレビジョン受像
機の選局装置に関する。
（従来の技術） 従来、テレビジョン受像機の選局装置においては、受
信チャンネルを指定する選局操作の方式として、受信チ
ャンネルの各々に対応したキーで操作するワンタッチ選
局、10キーボードを利用してキー操作するダイレクト選
局、一般に２個の選局ボタンを使用し、チャンネル番号
の小さい方から大きい方へ（アップ）、或いはその逆方
向へ（ダウン）順次に切替えて操作するアップダウン選
局等を採用している。
CATV等のように多チャンネル化されている場合、ま
た、深夜等のように放送局によっては放送を終了してい
る場合等においては、いずれのチャンネルで放送が行わ
れているかをユーザーが把握していないことが多く、こ
のような場合には、有信号サーチアップダウン選局を採
用すると便利である。
第３図は従来の選局装置における有信号サーチアップ
ダウン選局の動作を説明するためのフローチャートであ
る。
いま、例えば、アップボタンが操作されると、ステッ
プS1,S2において受信チャンネルよりチャンネル番号が
１つ大きい次のチャンネルをチューナが選局する。次い
で、ステップS3において、受信チャンネルが現在放送中
のチャンネル（以下、有信号チャンネルという）である
か否かが判断される。有信号チャンネルではない場合に
は、処理をステップS1に移行し、次のチャンネルを選局
する。有信号チャンネルである場合には、このチャンネ
ルを選局する。したがって、ユーザーは現在放送が行わ
れているチャンネルを把握しておく必要はなく、アップ
ボタン又はダウンボタンを操作することにより、容易に
有信号チャンネルの受信が可能である。
また、従来の選局装置においては、所定のチャンネル
をRAMに記憶させ、この記憶したチャンネル（以下、メ
モリチャンネルという）のみについてアップダウンサー
チする機能（以下、メモリチャンネルアップダウン選局
という）を有したものもある。この機能は、多チャンネ
ル化された場合等において有効である。
しかしながら、メモリチャンネルをRAMに記憶させる
ようになっており、長時間メイン電源がオフとなってい
る場合には、メモリチャンネルのデータが消去されてし
まう。そうすると、メモリチャンネルアップダウン選局
をユーザーが指定しても、選局動作は行われない。した
がって、ユーザーはRAMにメモリチャンネルが記憶され
ているか否かを判断してアップダウン選局の指示を行わ
なければならないという問題があった。
（発明が解決しようとする課題） このように、上述した従来の選局装置においては、長
時間メイン電源がオフになった場合には、アップダウン
ボタンによるメモリチャンネルアップダウン選局を指定
すると、選局動作が全く行われないという問題点があっ
た。
本発明はかかる問題点に鑑みてなされたものであっ
て、RAMにメモリチャンネルが格納されているか否かを
判断して有信号サーチアップダウン選局動作とメモリチ
ャンネルアップダウン選局動作とを自動的に切替えて選
局することができる選局装置を提供することを目的とす
る。
［発明の構成］ （課題を解決するための手段） 本発明に係る選局装置は、入力されるRF信号から選局
制御信号に基づいたチャンネルの信号を選局するチュー
ナと、このチューナが選局した信号に放送信号が含まれ
ているか否かを判定して判定信号を出力する判定回路
と、所定のチャンネルを示すデータを記憶するメモリ
と、このメモリに格納されたデータに基づいた選局制御
信号を前記チューナに順次与えてこれらのチャンネルの
信号を選局させる第１の選局指示手段と、前記メモリに
チャンネルを示すデータが格納されていない場合には前
記チューナに各チャンネルを受信させるための選局制御
信号を順次与えると共に前記判定信号により受信チャン
ネルに放送信号が含まれていることが示された場合には
そのチャンネルを受信させる第２の選局指示手段とを具
備したものである。
（作用） 本発明において、チューナは第１及び第２の選局指示
手段からの選局制御信号に基づいたチャンネルの信号を
選局する。メモリにチャンネルを示すデータが格納され
ている場合には、第１の選局指示手段によって、メモリ
に格納されているデータに基づいた選局が行われる。メ
モリにチャンネルを示すデータが格納されていない場合
には、第２の選局指示手段がチューナに選局制御信号を
与える。この場合には、第２の選局指示手段は各チャン
ネルを受信させるための選局制御信号を順次チューナに
与える。第２の選局指示手段は判定回路から受信チャン
ネルに放送信号が含まれていることを示す判定信号を入
力して受信チャンネルを決定する。
（実施例） 以下、図面に基づいて本発明の実施例を詳細に説明す
る。第１図は本発明に係る選局装置の一実施例を示すブ
ロック図である。
アンテナ１にはテレビジョン高周波信号（以下、RF信
号という）が誘起する。このRF信号はチューナ２に供給
される。チューナ２は、選局マイクロコンピュータ（以
下、選局マイコンという）３からの選局制御信号によっ
て制御され、所定周波数のRF信号を選局し中間周波信号
（IF信号）に変換して映像受信回路４に出力する。映像
受信回路４は受信したIF信号を表示用の映像信号に変換
してブラウン管５に与え、映像を表示させる。
AFT回路６はIF信号の周波数のずれを検出し検出信号
（AFT信号）を選局マイコン３に出力する。周期回路７
は受信信号の周期分離を行い、水平同期信号が含まれて
いるか否かを示す判定信号を選局マイコン３に出力する
ようになっている。入力装置８は、図示しないチャンネ
ルアップダウンキー、ADD/ERASEキー、AUTO PROGRAMキ
ー及びキー等を有し、これらのキー操作に基づいた制御
データを選局マイコン３に出力する。
選局マイコン３は、入力装置８に配設されたアップダ
ウンキー等のユーザー操作に基づく制御データによって
制御され、この制御データに基づく選局制御信号をチュ
ーナ２に出力して、受信周波数を決定する。また、選局
マイコン３は同期回路からの判定信号によって受信チャ
ンネルが有信号チャンネルであるか否かの判定を行う。
なお、選局マイコン３の選局制御信号はAFT信号によっ
て調整されており、受信周波数の自動微調整が行われる
ようになっている。
選局マイコン３はメモリチャンネルを記憶するための
RAM9を有している。メモリチャンネルの記憶は入力装置
８のADD/ERASEキー又はAUTO PROGRAMキーによって行わ
れる。すなわち、10キーによりチャンネル番号が指定さ
れた後にADD/ERASEキーが操作されると、選局マイコン
３は10キーで指定されたチャンネル番号を示すデータRA
M9に記憶させるようになっている。AUTO PROGRAMキーが
操作された場合には、選局マイコン３はチューナ２に選
局制御信号を出力して各チャンネルを順次選局させる。
選局マイコン３は同期回路７からの判定信号によって有
信号チャンネルか無信号チャンネルかを判断し、有信号
チャンネルのチャンネル番号を示すデータをRAM9に記憶
させるようになっている。なお、サブ電源がオンである
場合には、RAM9に格納されたデータは保持されるように
なっている。
次に、このように構成された選局装置の動作について
第２図のフローチャートを参照して説明する。
ユーザーが入力装置８のアップダウンキーを操作する
と、選局マイコン３は、ステップS4,S5において、例え
ば、現在受信中のチャンネル（開始チャンネル）よりも
１つ大きいチャンネル番号を示すデータがRAM9に格納さ
れているか否かを判断する。このデータがRAM9に格納さ
れている場合には、処理ステップS6に移行してこのチャ
ンネル番号に基づく選局制御信号をチューナ２に出力す
る。チューナ２は、アンテナからのRF信号からこのチャ
ンネルの信号をIF信号に変換して映像受信回路４に与え
る。なお、IF信号の周波数のずれがある場合には、AFT
回路６から出力されるAFT信号によって、選局マイコン
３の選局制御信号が調整され、チューナ２の受信周波数
が調整されてIF信号の周波数は一定値となる。
一方、開始チャンネルの次のチャンネルがRAM9に格納
されていない場合には、ステップS7においてこのチャン
ネルが開始チャンネルであるか否かが判断され、開始チ
ャンネルでない場合には、処理をステップS4に移行す
る。以後、ステップS4,S5,S7のループが繰返され、RAM9
にメモリチャンネルが記憶されていない場合には、ステ
ップS7から処理をステップS8に移行する。
ステップS8においては、選局マイコン３は開始チャン
ネルよりも１つ大きいチャンネル番号に基づく選局制御
信号をチューナ２に出力する。ステップS9においてチュ
ーナ２は選局動作を行う。同期回路７はチューナ２が選
局したRF信号に水平同期信号が含まれているか否かを示
す判定信号を選局マイコン３に出力する。選局マイコン
３はステップS10において、判定信号により受信チャン
ネルが有信号チャンネルであるか否かを判断する。受信
チャンネルが有信号チャンネルでない場合には、処理を
ステップS8に移行し、選局マイコン３は次のチャンネル
を受信するための選局制御信号を出力する。こうして、
ステップS8,S9,S10のループにより有信号サーチが行わ
れる。受信チャンネルが有信号チャンネルである場合に
は、そのチャンネルを受信する。
このように、本実施例においては、ステップS4乃至S7
においてメモリチャンネルアップダウン選局を行うと共
に、メモリチャンネルがRAM9に格納されていない場合に
は，処理をステップS8乃至S10のループに移行して有信
号サーチアップダウン選局を行っている。したがって、
RAM9にメモリチャンネルが記憶されているか否かに拘ら
ず、ユーザーがアップダウンボタンを操作することによ
り、容易に選局が可能である。
［発明の効果］ 以上説明したように本発明によれば、第１及び第２の
選局指示手段によって、メモリにメモリチャンネルが格
納されている場合には、メモリチャンネルアップダウン
選局が行われ、メモリにメモリチャンネルが格納されて
いない場合には、有信号サーチアップダウン選局が行わ
れる。
【図面の簡単な説明】
第１図は本発明に係る選局装置の一実施例を示すブロッ
ク図、第２図は実施例の動作を説明するためのフローチ
ャート、第３図は従来の選局装置の動作を説明するため
のフローチャートである。 １……アンテナ、 ２……チューナ、 ３……選局マイコン、 ４……映像受信回路、 ７……同期回路、 ８……入力装置、 ９……RAM。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭64−12612（ＪＰ，Ａ) 特開 昭62−102615（ＪＰ，Ａ) 実開 昭60−57222（ＪＰ，Ｕ) 実開 平１−107222（ＪＰ，Ｕ) (58)調査した分野(Int.Cl.6，ＤＢ名) H03J 5/00 - 5/02 H03J 7/18 H04N 5/44

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項１】入力されるRF信号から選局制御信号に基づ
    いたチャンネルの信号を選局するチューナと、 このチューナが選局した信号に放送信号が含まれている
    か否かを判定して判定信号を出力する判定回路と、 所定のチャンネルを示すデータを記憶するメモリと、 このメモリに格納されたデータに基づいた選局制御信号
    を前記チューナに順次与えてこれらのチャンネルの信号
    を選局させる第１の選局指示手段と、 前記メモリにチャンネルを示すデータが格納されていな
    い場合には前記チューナに各チャンネルを受信させるた
    めの選局制御信号を順次与えると共に前記判定信号によ
    り受信チャンネルに放送信号が含まれていることが示さ
    れた場合にはそのチャンネルを受信させる第２の選局指
    示手段とを具備したことを特徴とする選局装置。
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