JP2766662B2 - 楽音発生装置の波形データ読み出し装置及び波形データ読み出し方法 - Google Patents
楽音発生装置の波形データ読み出し装置及び波形データ読み出し方法Info
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- G10H—ELECTROPHONIC MUSICAL INSTRUMENTS; INSTRUMENTS IN WHICH THE TONES ARE GENERATED BY ELECTROMECHANICAL MEANS OR ELECTRONIC GENERATORS, OR IN WHICH THE TONES ARE SYNTHESISED FROM A DATA STORE
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- G10H7/08—Instruments in which the tones are synthesised from a data store, e.g. computer organs by calculating functions or polynomial approximations to evaluate amplitudes at successive sample points of a tone waveform
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- G10H2250/00—Aspects of algorithms or signal processing methods without intrinsic musical character, yet specifically adapted for or used in electrophonic musical processing
- G10H2250/541—Details of musical waveform synthesis, i.e. audio waveshape processing from individual wavetable samples, independently of their origin or of the sound they represent
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Description
【発明の詳細な説明】 ［産業上の利用分野］ 本発明は、楽音発生装置の波形データの読み出し装置
及び読み出し方法に関する。
及び読み出し方法に関する。
［発明の概要］ 本発明は、複数の指示手段それぞれに応じた、一定間
隔の異なる波形データ読み出し速度の情報につき、この
指示手段より細かい分解能について補間することによ
り、読み出し速度の情報の記憶量を減らしたものであ
る。
隔の異なる波形データ読み出し速度の情報につき、この
指示手段より細かい分解能について補間することによ
り、読み出し速度の情報の記憶量を減らしたものであ
る。
［従来技術］ 従来、波形データの読み出しについては、例えば楽音
波形データの読み出しを例にとると、１波長分又は半波
長分の波形データを波形データメモリに記憶されてお
き、読み出し速度を変えることで、指定された音高に応
じた楽音を実現していた。波形データの読み出しについ
ては、指定音高に応じたデータ（周波数ナンバデータ又
は位相角ステップデータ）を順次一定周期で累算し、こ
の累算データを読み出しアドレスデータとして、上記波
形データメモリに与えている。この場合、位相角ステッ
プデータを指定音高に応じて変化させることにより、波
形データの読み出し速度を変えることができる。
波形データの読み出しを例にとると、１波長分又は半波
長分の波形データを波形データメモリに記憶されてお
き、読み出し速度を変えることで、指定された音高に応
じた楽音を実現していた。波形データの読み出しについ
ては、指定音高に応じたデータ（周波数ナンバデータ又
は位相角ステップデータ）を順次一定周期で累算し、こ
の累算データを読み出しアドレスデータとして、上記波
形データメモリに与えている。この場合、位相角ステッ
プデータを指定音高に応じて変化させることにより、波
形データの読み出し速度を変えることができる。
第13図〜第15図は、このような従来の波形データの読
み出し速度変更装置を示すもので、キースイッチマトリ
クス部92の中のキーオン、キーオフのあったスイッチ
は、キーアサイナ部91によりスキャン検出され、チャン
ネル割り当て制御が行われるとともに、キーオンスイッ
チに応じたキーコードの鍵情報Ｉが位相角ステップデー
タメモリ93に与えられる。位相角ステップデータメモリ
93からは、キーコードの音高に応じた位相角ステップデ
ータSDが読み出され、累算器94で一定周期のクロック信
号Acの印加ごとに累算され、この累算データの上位ビッ
トデータが波形データメモリ95に与えられる。波形デー
タメモリ95からは、上記位相角ステップデータSDの大き
さに応じた速度で、楽音波形データWDが順次読み出さ
れ、乗算器96でエンベロープデータEDが乗算され、Ｄ−
Ａ変換器97を介して音響装置98より放音出力される。ま
た、上記キーアサイナ部91から、エンベロープ発生器99
には、キーオン、キーオフのタイミングを示す鍵情報II
が与えられ、エンベロープデータEDのアタック、ディケ
イ、サスティン、リリースの各データの生成が実行さ
れ、上記乗算器96に与えられる。
み出し速度変更装置を示すもので、キースイッチマトリ
クス部92の中のキーオン、キーオフのあったスイッチ
は、キーアサイナ部91によりスキャン検出され、チャン
ネル割り当て制御が行われるとともに、キーオンスイッ
チに応じたキーコードの鍵情報Ｉが位相角ステップデー
タメモリ93に与えられる。位相角ステップデータメモリ
93からは、キーコードの音高に応じた位相角ステップデ
ータSDが読み出され、累算器94で一定周期のクロック信
号Acの印加ごとに累算され、この累算データの上位ビッ
トデータが波形データメモリ95に与えられる。波形デー
タメモリ95からは、上記位相角ステップデータSDの大き
さに応じた速度で、楽音波形データWDが順次読み出さ
れ、乗算器96でエンベロープデータEDが乗算され、Ｄ−
Ａ変換器97を介して音響装置98より放音出力される。ま
た、上記キーアサイナ部91から、エンベロープ発生器99
には、キーオン、キーオフのタイミングを示す鍵情報II
が与えられ、エンベロープデータEDのアタック、ディケ
イ、サスティン、リリースの各データの生成が実行さ
れ、上記乗算器96に与えられる。
第14図及び第15図は、別の従来例を示すもので、位相
角ステップデータメモリ93に１オクターブ分だけの位相
角ステップデータSDを記憶させ、キーコードのノートデ
ータを読み出しアドレスデータとして、位相角ステップ
データSDを読み出す。そして、読み出した位相角ステッ
プデータSDを、キーコードのオクターブデータにより、
シフト回路90においてデータシフトして、他のオクター
ブの位相角ステップデータSDaも作成するようにしたも
のである。第14図は、位相角ステップデータSDをオクタ
ーブデータによってデータシフトした後に、累算器94で
累算するものであり、第15図は、累算器94で位相角ステ
ップデータSDを累算した後に、累算位相角ステップデー
タSDAをオクターブデータによってデータシフトするも
のである。
角ステップデータメモリ93に１オクターブ分だけの位相
角ステップデータSDを記憶させ、キーコードのノートデ
ータを読み出しアドレスデータとして、位相角ステップ
データSDを読み出す。そして、読み出した位相角ステッ
プデータSDを、キーコードのオクターブデータにより、
シフト回路90においてデータシフトして、他のオクター
ブの位相角ステップデータSDaも作成するようにしたも
のである。第14図は、位相角ステップデータSDをオクタ
ーブデータによってデータシフトした後に、累算器94で
累算するものであり、第15図は、累算器94で位相角ステ
ップデータSDを累算した後に、累算位相角ステップデー
タSDAをオクターブデータによってデータシフトするも
のである。
［発明が解決しようとする課題］ しかしながら、各位相角ステップデータのより細いス
テップ分が必要な時には、上記位相角ステップデータメ
モリ93に記憶されている位相角ステップデータSDは、非
常に膨大なものである。例えば、半音差の100セントに
つき１セントごとに８オクターブ分であると、１オクタ
ーブで12個分必要となるから、100×12×８＝9600個分
のデータが必要になる。第14図、第15図のケースでも、
100×12＝1200個分必要となり、やはり記憶データが膨
大なものとなる。
テップ分が必要な時には、上記位相角ステップデータメ
モリ93に記憶されている位相角ステップデータSDは、非
常に膨大なものである。例えば、半音差の100セントに
つき１セントごとに８オクターブ分であると、１オクタ
ーブで12個分必要となるから、100×12×８＝9600個分
のデータが必要になる。第14図、第15図のケースでも、
100×12＝1200個分必要となり、やはり記憶データが膨
大なものとなる。
本発明に、上述した課題を解決するためになされたも
のであり、位相角ステップデータSDの記憶量を非常に少
なくできる、波形データ読み出し速度変更装置を提供す
ることを目的としている。
のであり、位相角ステップデータSDの記憶量を非常に少
なくできる、波形データ読み出し速度変更装置を提供す
ることを目的としている。
［課題を解決するための手段］ 上記目的を達成するために、本発明において、複数の
指示手段にそれぞれ応じた、一定間隔の異なる読み出し
速度の情報を、各指示手段の指示に対応して発生し、こ
の複数の指示手段のそれぞれより細かい分解能を示すパ
ラメータに基づいて、各読み出し速度の情報の各ステッ
プより細かいステップ分の補間情報を発生し、波形デー
タの読み出し速度を決定した。
指示手段にそれぞれ応じた、一定間隔の異なる読み出し
速度の情報を、各指示手段の指示に対応して発生し、こ
の複数の指示手段のそれぞれより細かい分解能を示すパ
ラメータに基づいて、各読み出し速度の情報の各ステッ
プより細かいステップ分の補間情報を発生し、波形デー
タの読み出し速度を決定した。
［作用］ これにより、補間を行う分については、読み出し速度
の情報を記憶しなくとも済み、それだけ読み出し速度の
情報の記憶量を少なくすることができる。
の情報を記憶しなくとも済み、それだけ読み出し速度の
情報の記憶量を少なくすることができる。
補間の形式としては、比例換算、指数換算等、種々あ
り、補間を行う波形データとしては、楽音波形データの
ほか、グライド、ビブラート等の周波数変調、振幅変調
といったエフェクトについての波形データ等々も含まれ
る。
り、補間を行う波形データとしては、楽音波形データの
ほか、グライド、ビブラート等の周波数変調、振幅変調
といったエフェクトについての波形データ等々も含まれ
る。
［実施例］ 以下、本発明を具体化した一実施例を図面を参照して
説明する。なお、図中の矢印はすべて一本線であるが、
複数ビットのデータもある。
説明する。なお、図中の矢印はすべて一本線であるが、
複数ビットのデータもある。
第２図は、波形データの読み出し速度変更装置を備え
た電子楽器の全体回路を示すもので、キースイッチマト
リックス部２の中のキーオン、キーオフのあったスイッ
チは、キーアサイナ部１によりスキャンが検出され、チ
ャンネル割り当て制御が行われるとともに、キーオンス
イッチに応じた鍵情報Ｉが鍵情報変更回路11に与えられ
る。鍵情報変更回路11では、鍵情報Ｉのキーコードの中
のノートナンバデータＮに対し、変更パラメータ発生回
路12からのチューニングコントロールに応じたセントの
分解能を持つパラメータであるセントデータCDが付加さ
れる。このセントデータCDとノートナンバデータＮは、
ビブラートやグライド等のエフェクト付加に応じて変動
するようにしてもよい。
た電子楽器の全体回路を示すもので、キースイッチマト
リックス部２の中のキーオン、キーオフのあったスイッ
チは、キーアサイナ部１によりスキャンが検出され、チ
ャンネル割り当て制御が行われるとともに、キーオンス
イッチに応じた鍵情報Ｉが鍵情報変更回路11に与えられ
る。鍵情報変更回路11では、鍵情報Ｉのキーコードの中
のノートナンバデータＮに対し、変更パラメータ発生回
路12からのチューニングコントロールに応じたセントの
分解能を持つパラメータであるセントデータCDが付加さ
れる。このセントデータCDとノートナンバデータＮは、
ビブラートやグライド等のエフェクト付加に応じて変動
するようにしてもよい。
鍵情報変更回路11からの変更鍵情報は、波形データ読
み出し回路21の中の位相角ステップデータメモリ３に与
えられる。位相角ステップデータメモリ３からは、キー
コードの音高に応じた位相角ステップデータSDが読み出
され、累算器４で一定周期のクロック信号Acの印加ごと
に累算され、この累算データの上位ビットデータが波形
データメモリ５に与えられる。波形データメモリ５から
は、上記位相角ステップデータSDの大きさに応じた速度
で、楽音波形データWDが順次読み出され、乗算器６でエ
ンベロープデータEDが乗算され、Ｄ−Ａ変換器７を介し
て音響装置８より放音出力される。また、上記キーアナ
イサ部１から、エンベロープ発生器９には、キーオン、
キーオフのタイミングを示す鍵情報IIが与えられ、エン
ベロープデータEDのアタック、ディケイ、サスティン、
リリースの各データの生成が実行され、上記乗算器６に
与えられる。
み出し回路21の中の位相角ステップデータメモリ３に与
えられる。位相角ステップデータメモリ３からは、キー
コードの音高に応じた位相角ステップデータSDが読み出
され、累算器４で一定周期のクロック信号Acの印加ごと
に累算され、この累算データの上位ビットデータが波形
データメモリ５に与えられる。波形データメモリ５から
は、上記位相角ステップデータSDの大きさに応じた速度
で、楽音波形データWDが順次読み出され、乗算器６でエ
ンベロープデータEDが乗算され、Ｄ−Ａ変換器７を介し
て音響装置８より放音出力される。また、上記キーアナ
イサ部１から、エンベロープ発生器９には、キーオン、
キーオフのタイミングを示す鍵情報IIが与えられ、エン
ベロープデータEDのアタック、ディケイ、サスティン、
リリースの各データの生成が実行され、上記乗算器６に
与えられる。
上記波形データ読み出し回路21は、位相角ステップデ
ータメモリ３、累算器４ばかりでなく、実際には、第3A
図に示すように構成されている。すなわち、鍵情報変更
回路11からの変更鍵情報の中のノートナンバデータＮ
は、加算器13を介して位相角ステップデータメモリ３に
与えられる。加算器13のCin（キャリイン）端子には、
第3B図（３）に示すような、１チャンネル分の時間を一
周期とするクロック信号が与えられており、加算器13か
らは、ノートナンバデータＮと＋１されたノートナンバ
データＮ＋１とが、第3B図（２）に示すように、時分割
的に交互に出力される。
ータメモリ３、累算器４ばかりでなく、実際には、第3A
図に示すように構成されている。すなわち、鍵情報変更
回路11からの変更鍵情報の中のノートナンバデータＮ
は、加算器13を介して位相角ステップデータメモリ３に
与えられる。加算器13のCin（キャリイン）端子には、
第3B図（３）に示すような、１チャンネル分の時間を一
周期とするクロック信号が与えられており、加算器13か
らは、ノートナンバデータＮと＋１されたノートナンバ
データＮ＋１とが、第3B図（２）に示すように、時分割
的に交互に出力される。
第７図及び第11図は、位相角ステップデータメモリ３
の記憶内容を示すもので、ノートナンバデータＮをアド
レスデータとして、各番地には対応する位相角ステップ
データSDが記憶されている。第11図には、対応する実際
の周波数値とが示されている。
の記憶内容を示すもので、ノートナンバデータＮをアド
レスデータとして、各番地には対応する位相角ステップ
データSDが記憶されている。第11図には、対応する実際
の周波数値とが示されている。
位相角ステップデータメモリ３より、ノートナンバデ
ータＮによって読み出された位相角ステップデータNSD
は、クロック信号Lcaのアップエッジタイミングで、ラ
ッチ回路14にラッチされ、また、位相角ステップデータ
メモリ３より、＋１されたノートナンバデータＮ＋１に
よって読み出された位相角ステップデータ（Ｎ＋１）SD
は、クロック信号Lcbのアップエッジタイミングで、ラ
ッチ回路15にラッチされる。
ータＮによって読み出された位相角ステップデータNSD
は、クロック信号Lcaのアップエッジタイミングで、ラ
ッチ回路14にラッチされ、また、位相角ステップデータ
メモリ３より、＋１されたノートナンバデータＮ＋１に
よって読み出された位相角ステップデータ（Ｎ＋１）SD
は、クロック信号Lcbのアップエッジタイミングで、ラ
ッチ回路15にラッチされる。
これら、位相角ステップデータNSDと位相角ステップ
データ（Ｎ＋１）SDとは、補間回路16に入力され、鍵情
報変更回路11からの上述の変更鍵情報の中のセントデー
タCDに基づいて補間が行われる。この補間は後述すると
おり、位相角ステップデータNSDと１つ先の位相角ステ
ップデータ（Ｎ＋１）SDとの差に対して、セントデータ
CDの分だけ比例換算補間が行われる。この補間位相角ス
テップデータNSDSは、上記累算器４で累積されて、波形
データメモリ５に読み出しアドレスデータとして出力さ
れる。第1A図及び第1B図は、上記補間回路16の２つの具
体例を示すものであり、補間処理工程は異なるが、補間
処理結果は全く同じである。
データ（Ｎ＋１）SDとは、補間回路16に入力され、鍵情
報変更回路11からの上述の変更鍵情報の中のセントデー
タCDに基づいて補間が行われる。この補間は後述すると
おり、位相角ステップデータNSDと１つ先の位相角ステ
ップデータ（Ｎ＋１）SDとの差に対して、セントデータ
CDの分だけ比例換算補間が行われる。この補間位相角ス
テップデータNSDSは、上記累算器４で累積されて、波形
データメモリ５に読み出しアドレスデータとして出力さ
れる。第1A図及び第1B図は、上記補間回路16の２つの具
体例を示すものであり、補間処理工程は異なるが、補間
処理結果は全く同じである。
第1A図において、上記位相角ステップデータNSDは複
数器51で「２」の複数値に反転され、加算器52で１つ先
のステップの位相角ステップデータ（Ｎ＋１）SDと加算
される。これにより、位相角ステップデータ（Ｎ＋１）
SDより位相角ステップデータNSDが減算されて、１つ先
の位相角ステップデータ（Ｎ＋１）SDと位相角ステップ
データNSDの差｛（Ｎ＋１）SD−NSD｝が求められる。次
いでこの差データに対し、乗算器53で、セントデータCD
が乗算されて、比例換算補間値｛（Ｎ＋１）SD−NSD｝
×CDが求められ、これが加算器54で、位相角ステップデ
ータNSDに加算されて、補間が行われ、補間位相角ステ
ップデータNSDSが求められる。
数器51で「２」の複数値に反転され、加算器52で１つ先
のステップの位相角ステップデータ（Ｎ＋１）SDと加算
される。これにより、位相角ステップデータ（Ｎ＋１）
SDより位相角ステップデータNSDが減算されて、１つ先
の位相角ステップデータ（Ｎ＋１）SDと位相角ステップ
データNSDの差｛（Ｎ＋１）SD−NSD｝が求められる。次
いでこの差データに対し、乗算器53で、セントデータCD
が乗算されて、比例換算補間値｛（Ｎ＋１）SD−NSD｝
×CDが求められ、これが加算器54で、位相角ステップデ
ータNSDに加算されて、補間が行われ、補間位相角ステ
ップデータNSDSが求められる。
補数器51はインバータ群より構成され、位相角ステッ
プデータNSDの各ビットデータが反転出力されて、＋１
される。この＋１は、補数器52のCin（キャリイン）端
子に、ハイレベル信号が与えられることで実行される。
プデータNSDの各ビットデータが反転出力されて、＋１
される。この＋１は、補数器52のCin（キャリイン）端
子に、ハイレベル信号が与えられることで実行される。
また、第1B図において、上記位相角ステップデータNS
Dは、乗算器55で、セントデータCDの「２」の補数値が
乗算され、１つ先の位相角ステップデータ（Ｎ＋１）SD
は、乗算器57でセントデータCDが乗算され、これら両乗
算データNSD×（１−CD）、（Ｎ＋１）SD×CDは、加算
器58で加算されて、補間が行われ、補間位相角ステップ
データNSDSが求められる。上記セントデータCDの「２」
の補数値は、セントデータCDを補数器56に対して入力さ
せることで求められる。この補数器56もインバータ群よ
り構成され、セントデータCDの各ビットデータが反転出
力されて＋１される。この＋１は、補数器56内の加算器
（図示せず）を通じて行われる。
Dは、乗算器55で、セントデータCDの「２」の補数値が
乗算され、１つ先の位相角ステップデータ（Ｎ＋１）SD
は、乗算器57でセントデータCDが乗算され、これら両乗
算データNSD×（１−CD）、（Ｎ＋１）SD×CDは、加算
器58で加算されて、補間が行われ、補間位相角ステップ
データNSDSが求められる。上記セントデータCDの「２」
の補数値は、セントデータCDを補数器56に対して入力さ
せることで求められる。この補数器56もインバータ群よ
り構成され、セントデータCDの各ビットデータが反転出
力されて＋１される。この＋１は、補数器56内の加算器
（図示せず）を通じて行われる。
この第1B図の補間回路16においては、１つ先の位相角
ステップデータ（Ｎ＋１）SDに対して乗算器57でセント
データCDの重み付けが行われ、位相角ステップデータNS
Dに対して、乗算器55でセントデータCDの補数値（１−C
D）の重み付けが行われ、この後、両データを加算する
ことで、位相角ステップデータNSDと１つ先の位相角ス
テップデータ（Ｎ＋１）SDとの間の、セントデータCDに
応じた補間処理が行われる。この場合も比例換算補間で
あり、補間処理工程は異っても、補間処理結果は、第1A
図の場合と全く同じである。
ステップデータ（Ｎ＋１）SDに対して乗算器57でセント
データCDの重み付けが行われ、位相角ステップデータNS
Dに対して、乗算器55でセントデータCDの補数値（１−C
D）の重み付けが行われ、この後、両データを加算する
ことで、位相角ステップデータNSDと１つ先の位相角ス
テップデータ（Ｎ＋１）SDとの間の、セントデータCDに
応じた補間処理が行われる。この場合も比例換算補間で
あり、補間処理工程は異っても、補間処理結果は、第1A
図の場合と全く同じである。
上記NSD×（１−CD）の「１」は、２進値で表わす
と、「100…０（「０」の数はセントデータCDのビット
数と同じ）」となっており、これに対しセントデータを
４ビット（16ステップ）とすると、「0000（０）」から
「1111（15）」の値をとるセントデータCDが差し引かれ
る。
と、「100…０（「０」の数はセントデータCDのビット
数と同じ）」となっており、これに対しセントデータを
４ビット（16ステップ）とすると、「0000（０）」から
「1111（15）」の値をとるセントデータCDが差し引かれ
る。
第12図は、上述の補間内容を示すもので、半音分100
セントの間を16ステップ分補間して、補間位相角ステッ
プデータNSDSを求めた例である。これによれば、補間位
相角ステップデータNSDSの値の比率は、２0/1200＋（２
100/1200−２0/1200）×（CD×16）で表わされる。むろ
ん、補間ステップは16ステップに限られるものではな
い。第12図に示す補間位相角ステップデータNSDSは、位
相角ステップデータNSDに対する比率を示しており、こ
の比率を上記第11図の真中の列の位相角ステップデータ
SDの値に乗算したものが、実際の補間位相角ステップデ
ータNSDSとなる。
セントの間を16ステップ分補間して、補間位相角ステッ
プデータNSDSを求めた例である。これによれば、補間位
相角ステップデータNSDSの値の比率は、２0/1200＋（２
100/1200−２0/1200）×（CD×16）で表わされる。むろ
ん、補間ステップは16ステップに限られるものではな
い。第12図に示す補間位相角ステップデータNSDSは、位
相角ステップデータNSDに対する比率を示しており、こ
の比率を上記第11図の真中の列の位相角ステップデータ
SDの値に乗算したものが、実際の補間位相角ステップデ
ータNSDSとなる。
こうして、補間を行えば、位相角ステップデータメモ
リ３に記憶する位相角ステップデータSDは、第11図に示
す半音ごとのものだけで済むようになり、それだけ記憶
量を減らすことができる。
リ３に記憶する位相角ステップデータSDは、第11図に示
す半音ごとのものだけで済むようになり、それだけ記憶
量を減らすことができる。
このような比例換算補間は、第８図の斜めの直線に沿
って行われることになる。しかし実線の音高は２
CD/1200の値をとり、１点鎖線に示すように、イクスポ
ーネンシャルな特性となる。従って補間位相角ステップ
データNSDSと実際の音高との差は、第８図２点鎖線に示
すようになり、この分を補正データとして、補正してや
れば、実際の音高と一致することになる。
って行われることになる。しかし実線の音高は２
CD/1200の値をとり、１点鎖線に示すように、イクスポ
ーネンシャルな特性となる。従って補間位相角ステップ
データNSDSと実際の音高との差は、第８図２点鎖線に示
すようになり、この分を補正データとして、補正してや
れば、実際の音高と一致することになる。
第４図は、そのような補正を行うための回路を示して
いる。ここで補間回路16は、上述した第3A図のものと全
く同じである。そして、セントデータCDを読み出しアド
レスデータとして、補正データメモリ62より、補正デー
タが読み出され、乗算器61で、上記補間回路16からの補
間位相角ステップデータNSDSに乗算される。上記補正デ
ータは、第12図に示すとおりで、グラフに示すと、第９
図のとおりとなる。
いる。ここで補間回路16は、上述した第3A図のものと全
く同じである。そして、セントデータCDを読み出しアド
レスデータとして、補正データメモリ62より、補正デー
タが読み出され、乗算器61で、上記補間回路16からの補
間位相角ステップデータNSDSに乗算される。上記補正デ
ータは、第12図に示すとおりで、グラフに示すと、第９
図のとおりとなる。
これにより、本来の音高に応じた補正補間位相角ステ
ップデータNSDSSが得られる。
ップデータNSDSSが得られる。
第５図は、補正を行うための回路の別の実施例を示す
ものである。この回路は、第1A図の回路に補正補間デー
タメモリ64を付加したもので、加算器52からの、１つ先
の位相角ステップデータ（Ｎ＋１）SDと位相角ステップ
データNSDの差｛（Ｎ＋１）SD−NSD｝に対し、乗算器で
補正補間データメモリ64からの補正補間データが乗算さ
れ、この乗算データが加算器54で位相角ステップデータ
NSDに加算される。上記補正補間データは、セントデー
タCDを読み出しアドレスデータとして、補正補間データ
メモリ64より読み出され、その値は第12図に示すとおり
で、グラフに示すと第10図のとおりである。第12図の補
正補間データは、同じく第12図の補正データに対し、同
じ第12図のセント値（CENT）で示す値を乗算して桁をそ
ろえたものである。
ものである。この回路は、第1A図の回路に補正補間デー
タメモリ64を付加したもので、加算器52からの、１つ先
の位相角ステップデータ（Ｎ＋１）SDと位相角ステップ
データNSDの差｛（Ｎ＋１）SD−NSD｝に対し、乗算器で
補正補間データメモリ64からの補正補間データが乗算さ
れ、この乗算データが加算器54で位相角ステップデータ
NSDに加算される。上記補正補間データは、セントデー
タCDを読み出しアドレスデータとして、補正補間データ
メモリ64より読み出され、その値は第12図に示すとおり
で、グラフに示すと第10図のとおりである。第12図の補
正補間データは、同じく第12図の補正データに対し、同
じ第12図のセント値（CENT）で示す値を乗算して桁をそ
ろえたものである。
このようにしても、本来の音高に応じた補正補間位相
角ステップデータNSDSSが得られる。
角ステップデータNSDSSが得られる。
第６図は、位相角ステップデータSDが、指数部を示す
パワーデータＰと、仮数部を示すマンティッサデータＭ
とよりなっている場合の補間回路16を示すものである。
位相角ステップデータSDが、パワーデータＰとマンティ
ッサデータＭとよりなっている場合の値は、第11図右覧
に示すとおりである。補数器72、加算器73、乗算器74、
加算器77は、第1A図の補数器51、加算器52、乗算器53、
加算器54と同じであり、位相角ステップデータNSDのマ
ッティッサデータMNは、補数器72で「２」の補数値に反
転され、加算器73で、シフト回路71を経た１つ先の位相
角ステップデータ（Ｎ＋１）SDのマッティッサデータM
N+1と加算される。これにより、１つ先の位相角ステッ
プデータ（Ｎ＋１）SDのマッティッサデータMN+1より、
位相角ステップデータNSDのマッティッサデータMNが減
算されて、両者の差（MN+1−MN）が求められる。
パワーデータＰと、仮数部を示すマンティッサデータＭ
とよりなっている場合の補間回路16を示すものである。
位相角ステップデータSDが、パワーデータＰとマンティ
ッサデータＭとよりなっている場合の値は、第11図右覧
に示すとおりである。補数器72、加算器73、乗算器74、
加算器77は、第1A図の補数器51、加算器52、乗算器53、
加算器54と同じであり、位相角ステップデータNSDのマ
ッティッサデータMNは、補数器72で「２」の補数値に反
転され、加算器73で、シフト回路71を経た１つ先の位相
角ステップデータ（Ｎ＋１）SDのマッティッサデータM
N+1と加算される。これにより、１つ先の位相角ステッ
プデータ（Ｎ＋１）SDのマッティッサデータMN+1より、
位相角ステップデータNSDのマッティッサデータMNが減
算されて、両者の差（MN+1−MN）が求められる。
次いで、この差データに対し、乗算器74で、セントデ
ータCDが乗算されて、比例換算値（MN+1−MN）×CDが求
められ、これが加算器77で、位相角ステップデータNSD
のマッティッサデータMNに加算される。これにより、マ
ッティッサデータMNとマッティッサデータMN＋１とにつ
き、補間が行われ、補間位相角ステップデータNSDSのマ
ンティッサデータMSが求められ、シフト回路78を介して
出力される。上記乗算器74に与えるデータは、セントデ
ータCDではなく、第５図における補正補間データメモリ
64からの補正補間データとしてもよい。
ータCDが乗算されて、比例換算値（MN+1−MN）×CDが求
められ、これが加算器77で、位相角ステップデータNSD
のマッティッサデータMNに加算される。これにより、マ
ッティッサデータMNとマッティッサデータMN＋１とにつ
き、補間が行われ、補間位相角ステップデータNSDSのマ
ンティッサデータMSが求められ、シフト回路78を介して
出力される。上記乗算器74に与えるデータは、セントデ
ータCDではなく、第５図における補正補間データメモリ
64からの補正補間データとしてもよい。
また、位相角ステップデータNSDのパワーデータPNと
１つ先の位相角ステップデータ（Ｎ＋１）SDのパワーデ
ータPN+1とは、選択器75を介して、いずれかが選択さ
れ、補間位相角ステップデータNSDSのパワーデータPSと
して出力される。
１つ先の位相角ステップデータ（Ｎ＋１）SDのパワーデ
ータPN+1とは、選択器75を介して、いずれかが選択さ
れ、補間位相角ステップデータNSDSのパワーデータPSと
して出力される。
このパワーデータPNとパワーデータPN+1とは、比較器
70で比較され、パワーデータPN+1の方が大きいとき、コ
ンパレート信号が出力され、アンドゲート76を開成され
るとともに、シフト回路71に与えられて、位相角ステッ
プデータ（Ｎ＋１）SDのマッティッサデータMN+1が上位
に１ビットシフトされて、２倍の値とされ、位相角ステ
ップデータNSDのマッティッサデータMNとの桁位置合せ
が行われる。
70で比較され、パワーデータPN+1の方が大きいとき、コ
ンパレート信号が出力され、アンドゲート76を開成され
るとともに、シフト回路71に与えられて、位相角ステッ
プデータ（Ｎ＋１）SDのマッティッサデータMN+1が上位
に１ビットシフトされて、２倍の値とされ、位相角ステ
ップデータNSDのマッティッサデータMNとの桁位置合せ
が行われる。
また、上記加算器77で、補間位相角ステップデータNS
DSのマンティッサデータMSが求められたとき、桁上げキ
ャリ信号があると、このキャリ信号は、アンドゲート76
を介して、選択器75に与えられ、桁値の大きい位相角ス
テップデータ（Ｎ＋１）SDのパワーデータPN+1の方が選
択される。上記キャリ信号は、シフト回路78にも与えら
れ、補間位相角ステップデータNSDSのマンティッサデー
タMSが下位に１ビットシフトされて、1/2の値とされ、
桁上げに応じた修正が行われる。
DSのマンティッサデータMSが求められたとき、桁上げキ
ャリ信号があると、このキャリ信号は、アンドゲート76
を介して、選択器75に与えられ、桁値の大きい位相角ス
テップデータ（Ｎ＋１）SDのパワーデータPN+1の方が選
択される。上記キャリ信号は、シフト回路78にも与えら
れ、補間位相角ステップデータNSDSのマンティッサデー
タMSが下位に１ビットシフトされて、1/2の値とされ、
桁上げに応じた修正が行われる。
こうして、位相角ステップデータSDがパワーデータＰ
とマンティッサデータＭとよりなる形式のものでも、補
間を行うことができる。
とマンティッサデータＭとよりなる形式のものでも、補
間を行うことができる。
なお、補数器72、加算器73、乗算器74、加算器77は、
第1B図に示す、乗算器55、57、補数器56、加算器58の回
路で置き換えることもできる。
第1B図に示す、乗算器55、57、補数器56、加算器58の回
路で置き換えることもできる。
本発明は上記実施例に限定されず、本発明の趣旨を逸
脱しない範囲で種々変更可能である。例えば、第14図及
び第15図に示すようなシフト回路90を、第3A図の累算器
４の前段又は後段に設けて、オクターブデータに基づい
て、補間位相角ステップデータNSDS又は補正補間位相角
ステップデータNSDSSをシフト修正するようにしてもよ
い。これにより、位相角ステップデータメモリ３に記憶
しておく位相角ステップデータSDは、１オクターブ分で
済むことになる。また、セントデータCDは16ステップ分
以上でも、もちろん良く、第４図の補正データメモリ62
や第５図の補正補間データメモリ64に記憶される補正デ
ータ、補正補間データは、本来の音高値に対する比例換
算値の比率ではなく、両データの差データとし、これを
オクターブデータに応じて、1/2倍、1/4倍…、２倍、４
倍…のデータシフトを行ったものを、補間位相角ステッ
プデータNSDSに加算するようにしてもよい。さらに、波
形データメモリ５に記憶する波形データは、楽音波形デ
ータのほか、グライド、ビブラート等の変調のエフェク
トの波形データ、複数の楽音波形をミキシングする場合
のミキシング比率の時間変化波形等、どのような波形で
もよい。
脱しない範囲で種々変更可能である。例えば、第14図及
び第15図に示すようなシフト回路90を、第3A図の累算器
４の前段又は後段に設けて、オクターブデータに基づい
て、補間位相角ステップデータNSDS又は補正補間位相角
ステップデータNSDSSをシフト修正するようにしてもよ
い。これにより、位相角ステップデータメモリ３に記憶
しておく位相角ステップデータSDは、１オクターブ分で
済むことになる。また、セントデータCDは16ステップ分
以上でも、もちろん良く、第４図の補正データメモリ62
や第５図の補正補間データメモリ64に記憶される補正デ
ータ、補正補間データは、本来の音高値に対する比例換
算値の比率ではなく、両データの差データとし、これを
オクターブデータに応じて、1/2倍、1/4倍…、２倍、４
倍…のデータシフトを行ったものを、補間位相角ステッ
プデータNSDSに加算するようにしてもよい。さらに、波
形データメモリ５に記憶する波形データは、楽音波形デ
ータのほか、グライド、ビブラート等の変調のエフェク
トの波形データ、複数の楽音波形をミキシングする場合
のミキシング比率の時間変化波形等、どのような波形で
もよい。
［発明の効果］ 以上詳述したように、本発明によれば、複数の指示手
段それぞれに応じた、一定間隔の異なる読み出し速度の
情報を、各指示手段の指示に対応して発生し、この複数
の指示手段のそれぞれより細かい分解能を示すパラメー
タに基づいて、各読み出し速度の情報の各ステップより
細かいステップ分の補間情報を発生して補間を行い、波
形データの読み出し速度を決定した。したがって、補間
を行う分については、読み出し速度の情報を記憶しなく
とも済み、それだけ読み出し速度の情報の記憶量を少な
くすることができる等の効果を奏する。
段それぞれに応じた、一定間隔の異なる読み出し速度の
情報を、各指示手段の指示に対応して発生し、この複数
の指示手段のそれぞれより細かい分解能を示すパラメー
タに基づいて、各読み出し速度の情報の各ステップより
細かいステップ分の補間情報を発生して補間を行い、波
形データの読み出し速度を決定した。したがって、補間
を行う分については、読み出し速度の情報を記憶しなく
とも済み、それだけ読み出し速度の情報の記憶量を少な
くすることができる等の効果を奏する。
第１図乃至第12図は本発明の実施例を示すもので、第1A
図及び第1B図は補間回路16の回路図であり、第２図は波
形データ読み出し速度変更装置を備えた電子楽器の全体
回路図であり、第3A図は第２図の波形データ読み出し回
路21の回路図であり、第3B図は第3A図における各信号の
タイムチャート図であり、第４図及び第５図は補正補間
のための回路図であり、第６図は位相角ステップデータ
SDがパワーデータＰとマンティッサデータＭとからなる
場合の補間回路16の回路図であり、第７図は各音高に応
じた位相角ステップデータSDの値を示す図であり、第８
図はセントデータCDに応じた位相角ステップデータSDの
補間及び補正補間の状態を示す図であり、第９図は補正
データメモリ62の記憶内容を示す図であり、第10図は補
正補間データメモリ64の記憶内容を示す図であり、第11
図は位相角ステップデータSDの値を示す図であり、第12
図はセントデータCDと対応する補間位相角ステップデー
タNSDSの比率、補正データ、補正補間データ等を示す図
であり、第13図乃至第15図は従来例を示す図である。 ３……位相角ステップデータメモリ、５……波形データ
メモリ、16……補間回路、21……波形データ読み出し回
路、62……補正データメモリ、64……補正補間データメ
モリ。
図及び第1B図は補間回路16の回路図であり、第２図は波
形データ読み出し速度変更装置を備えた電子楽器の全体
回路図であり、第3A図は第２図の波形データ読み出し回
路21の回路図であり、第3B図は第3A図における各信号の
タイムチャート図であり、第４図及び第５図は補正補間
のための回路図であり、第６図は位相角ステップデータ
SDがパワーデータＰとマンティッサデータＭとからなる
場合の補間回路16の回路図であり、第７図は各音高に応
じた位相角ステップデータSDの値を示す図であり、第８
図はセントデータCDに応じた位相角ステップデータSDの
補間及び補正補間の状態を示す図であり、第９図は補正
データメモリ62の記憶内容を示す図であり、第10図は補
正補間データメモリ64の記憶内容を示す図であり、第11
図は位相角ステップデータSDの値を示す図であり、第12
図はセントデータCDと対応する補間位相角ステップデー
タNSDSの比率、補正データ、補正補間データ等を示す図
であり、第13図乃至第15図は従来例を示す図である。 ３……位相角ステップデータメモリ、５……波形データ
メモリ、16……補間回路、21……波形データ読み出し回
路、62……補正データメモリ、64……補正補間データメ
モリ。
Claims (4)
- 【請求項１】記憶された波形データを読み出す手段と、 複数の指示手段のそれぞれの指示によって、それぞれ異
なる読み出し速度で、この波形データの読み出しを指示
する手段と、 この複数の指示手段それぞれに応じた異なる読み出し速
度の情報を、各指示手段の指示に対応して発生する手段
であって、このそれぞれの読み出し速度の情報の値は、
一定間隔ごととなっており、 上記複数の指示手段のそれぞれより細かい分解能を示す
パラメータを発生する手段と、 この発生された細かい分解能を示すパラメータに基づい
て、上記各読み出し速度の情報の各ステップより細かい
ステップ分の補間情報を発生する手段と、 これら読み出し速度の情報と、この補間情報とに基づい
て、上記波形データの読み出し速度を決定する手段とを
備えたことを特徴とする楽音発生装置の波形データ読み
出し装置。 - 【請求項２】上記読み出し速度の情報は、読み出し速度
の一定比ごとに発生され、上記補間情報は、各読み出し
速度の情報の隣合うステップ間についての情報であるこ
とを特徴とする請求項１記載の楽音発生装置の波形デー
タ読み出し装置。 - 【請求項３】上記補間情報は、各読み出し速度の情報の
隣合うステップ間について、近似的に比例換算を行う補
間情報である、または上記補間情報は、各読み出し速度
の情報の隣合うステップ間について、近似的に比例換算
補間を行い、さらに本来の値との差を補正する情報であ
ることを特徴とする請求項１又は２記載の楽音発生装置
の波形データ読み出し装置。 - 【請求項４】記憶された波形データを読み出しさせ、 複数の指示手段のそれぞれの指示によって、それぞれ異
なる読み出し速度で、この波形データの読み出しを指示
させ、 この複数の指示手段それぞれに応じた異なる読み出し速
度の情報を、各指示手段の指示に対応して発生させるこ
とであって、このそれぞれの読み出し速度の情報の値
は、一定間隔ごととなっており、 上記複数の指示手段のそれぞれより細かい分解能を示す
パラメータを発生させ、 この発生された細かい分解能を示すパラメータに基づい
て、上記各読み出し速度の情報の各ステップより細かい
ステップ分の補間情報を発生させ、 これら読み出し速度の情報と、この補間情報とに基づい
て、上記波形データの読み出し速度を決定させることを
特徴とする楽音発生装置の波形データ読み出し方法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1062558A JP2766662B2 (ja) | 1989-03-15 | 1989-03-15 | 楽音発生装置の波形データ読み出し装置及び波形データ読み出し方法 |
| US07/492,986 US5117725A (en) | 1989-03-15 | 1990-03-13 | Device for changing and controlling the rate of generating waveform data |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1062558A JP2766662B2 (ja) | 1989-03-15 | 1989-03-15 | 楽音発生装置の波形データ読み出し装置及び波形データ読み出し方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02240697A JPH02240697A (ja) | 1990-09-25 |
| JP2766662B2 true JP2766662B2 (ja) | 1998-06-18 |
Family
ID=13203724
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1062558A Expired - Lifetime JP2766662B2 (ja) | 1989-03-15 | 1989-03-15 | 楽音発生装置の波形データ読み出し装置及び波形データ読み出し方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5117725A (ja) |
| JP (1) | JP2766662B2 (ja) |
Families Citing this family (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2623942B2 (ja) * | 1990-09-05 | 1997-06-25 | ヤマハ株式会社 | 楽音信号発生装置 |
| US5691496A (en) * | 1995-02-14 | 1997-11-25 | Kawai Musical Inst. Mfg. Co., Ltd. | Musical tone control apparatus for filter processing a musical tone waveform ONLY in a transient band between a pass-band and a stop-band |
| US5900570A (en) * | 1995-04-07 | 1999-05-04 | Creative Technology, Ltd. | Method and apparatus for synthesizing musical sounds by frequency modulation using a filter |
| AU5344796A (en) * | 1995-04-07 | 1996-10-23 | Creative Technology Ltd | Method and apparatus for creating different waveforms when s ynthesizing musical sounds |
| US5694345A (en) * | 1995-06-29 | 1997-12-02 | Thomson Consumer Electronics | Hardware efficient interpolation filter |
| JP3658826B2 (ja) * | 1995-12-21 | 2005-06-08 | ヤマハ株式会社 | 楽音生成方法 |
| KR100656370B1 (ko) * | 2005-12-05 | 2006-12-11 | 한국전자통신연구원 | 위상 보간 클럭을 이용한 데이터 복원 장치 및 방법 |
| JP6528752B2 (ja) * | 2016-10-07 | 2019-06-12 | カシオ計算機株式会社 | 楽音再生装置、楽音再生方法、プログラムおよび電子楽器 |
Family Cites Families (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4348928A (en) * | 1976-09-24 | 1982-09-14 | Kabushiki Kaishi Kawai Gakki Seisakusho | Electronic musical instrument |
| JPH0631990B2 (ja) * | 1984-01-07 | 1994-04-27 | カシオ計算機株式会社 | 波形の補間装置 |
| JPH0782336B2 (ja) * | 1985-03-14 | 1995-09-06 | ヤマハ株式会社 | 電子楽器 |
| JPH0656555B2 (ja) * | 1986-09-05 | 1994-07-27 | ヤマハ株式会社 | 音発生装置 |
| JPH0740195B2 (ja) * | 1986-10-04 | 1995-05-01 | 株式会社河合楽器製作所 | 電子楽器 |
-
1989
- 1989-03-15 JP JP1062558A patent/JP2766662B2/ja not_active Expired - Lifetime
-
1990
- 1990-03-13 US US07/492,986 patent/US5117725A/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH02240697A (ja) | 1990-09-25 |
| US5117725A (en) | 1992-06-02 |
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