JP2746224B2 - 半導体装置およびその製造方法 - Google Patents

半導体装置およびその製造方法

Info

Publication number
JP2746224B2
JP2746224B2 JP26309795A JP26309795A JP2746224B2 JP 2746224 B2 JP2746224 B2 JP 2746224B2 JP 26309795 A JP26309795 A JP 26309795A JP 26309795 A JP26309795 A JP 26309795A JP 2746224 B2 JP2746224 B2 JP 2746224B2
Authority
JP
Japan
Prior art keywords
lead
semiconductor chip
semiconductor device
lead frame
leads
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP26309795A
Other languages
English (en)
Other versions
JPH09107062A (ja
Inventor
和宏 飯野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP26309795A priority Critical patent/JP2746224B2/ja
Priority to US08/730,464 priority patent/US5945731A/en
Priority to KR1019960045455A priority patent/KR100206082B1/ko
Publication of JPH09107062A publication Critical patent/JPH09107062A/ja
Application granted granted Critical
Publication of JP2746224B2 publication Critical patent/JP2746224B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49503Lead-frames or other flat leads characterised by the die pad
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32245Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/4501Shape
    • H01L2224/45012Cross-sectional shape
    • H01L2224/45015Cross-sectional shape being circular
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/45144Gold (Au) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/4826Connecting between the body and an opposite side of the item with respect to the body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73265Layer and wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L24/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/0105Tin [Sn]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01079Gold [Au]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation

Landscapes

  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Lead Frames For Integrated Circuits (AREA)
  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、半導体装置、特に
薄型化に適した樹脂封止型半導体装置およびその製造方
法に関するものである。
【0002】
【従来の技術】図3は従来の半導体装置用リードフレー
ムの一例を示すものである。図に示すように、このリー
ドフレーム1は半導体チップ(図示せず)を搭載するア
イランド2が矩形に形成され、その4隅が吊りリード3
によりリードフレーム本体に支持されている。そして、
半導体チップ上の電極と電気的に接続される多数のイン
ナーリード4、4、…がアイランド2の周辺に延びてい
る。
【0003】従来のリードフレームは、半導体チップは
アイランド上にべたに置かなければならないという前提
で設計されていたため、アイランドの最小のサイズは搭
載する半導体チップのサイズにより制約を受けていた。
すなわち、 アイランドのサイズ > 半導体チップのサイズ …(1) 一方、アイランドの最大のサイズは、半導体チップの情
報を半導体装置の外部に伝達するために半導体チップの
電極とインナーリードをボンディングする必要性から自
ずと制約を受け、 アイランドのサイズ < 半導体チップのサイズ+ボンディング可能長×2 …(2) に適合するものに限定されていた。
【0004】そこで、これら(1)、(2)式を同時に
満足させようとすると、たとえアウターリードの形状が
同一のものであっても、半導体チップのサイズが異なる
と、それに合わせてアイランドサイズを変える必要が生
じていた。したがって、アウターリードの形状が同一
で、かつ、半導体チップのサイズが異なる半導体装置を
製造するような場合には、必然的に複数種のリードフレ
ームを準備しておく必要があった。
【0005】そして、この種のリードフレーム1を用い
て半導体装置を組み立てる際には、半導体チップをリー
ドフレーム1のアイランド2上に搭載し、半導体チップ
の電極とインナーリード4間のワイヤボンディングを行
ない、その後、半導体チップ、アイランド2、吊りリー
ド3、インナーリード4、ボンディングワイヤを覆うよ
うに樹脂で封止し、最後に樹脂の外側に延びたリードフ
レーム部分を切断するという方法を採っていた。
【0006】
【発明が解決しようとする課題】ところで、近年、高密
度実装化等に伴って半導体装置の小型化、薄型化が重要
となっているが、例えば半導体装置を薄型化する場合、
当然ながらリードフレームを変えることなくパッケージ
(樹脂部分)のみを薄型化するわけであるから、パッケ
ージ中のリードフレームからなる金属部分に対する樹脂
部分の占める割合が自ずと小さくなる。すると、完成し
た半導体装置を温度サイクル試験にかけた場合等に、樹
脂と金属の熱膨張係数の差から生じる熱応力が大きくな
るため、パッケージクラック不良が発生する確率が高く
なる、という問題が生じていた。
【0007】一方、前述したように、半導体装置の製造
時には半導体チップのサイズによって異なるリードフレ
ームを準備しておく必要があったため、半導体チップの
設計変更等によりチップサイズが急遽変更になった場
合、その変更に対応することが極めて困難であった。ま
た、その対応策として、予め生産予測をした上でリード
フレームを前倒し発注したような場合には、需要の急増
や急減に機敏に対応することができず、リードフレーム
の在庫量の増加を招く、という問題があった。
【0008】本発明は、上記の事情に鑑みてなされたも
のであって、パッケージクラック不良を発生させること
なく薄型化が図れ、かつ、異なるチップサイズにも容易
に対応し得る半導体装置、特に樹脂封止型半導体装置、
およびその製造方法を提供することを目的とする。
【0009】
【課題を解決するための手段】上記の目的を達成するた
めに、本発明の半導体装置は、中心から放射状に延びる
とともにその途中に切断部を有する複数のインナーリー
ドを有し、切断部より中心側にあたるインナーリードの
中心部が吊りリードに支持されるとともにインナーリー
ドの中心部上に半導体チップが搭載され、この半導体チ
ップ上の電極とインナーリードの切断部より周辺部側が
電気的に接続されるとともに、それらインナーリード、
吊りリード、半導体チップが樹脂で封止されたことを特
徴とするものである。
【0010】また、本発明の半導体装置の製造方法は、
中心から放射状に延びた複数のインナーリードと吊りリ
ードを有するリードフレームを用い、吊りリードを除い
て各インナーリードを半導体チップを前記中心上に配置
したときにそのサイズに合うように切断した後、この切
断部より中心側にあたるインナーリードの中心部上に半
導体チップを搭載し、半導体チップ上の電極とインナー
リードの切断部より周辺部側との間のワイヤボンディン
グを行ない、その後、樹脂封止を行なうことを特徴とす
るものである。また、リードフレームに位置決め部を設
けておき、インナーリードを切断する際に用いる金型の
リードフレームに対する位置決めを、前記位置決め部を
用いて行なうようにするとよい。
【0011】本発明においては、中心から放射状に延び
た複数のインナーリードを有するリードフレームにおい
て、吊りリードを除いて各インナーリードをその途中で
切断することにより、従来のリードフレームのアイラン
ドに相当する部分、いわばチップ搭載部を作り上げよう
とするものである。そして、そのチップ搭載部は複数の
インナーリードが放射状に延びた形状で各インナーリー
ド間が間隙となり、この間隙にも樹脂が入り込むため、
同サイズの従来の半導体装置のパッケージに比べてパッ
ケージに占める樹脂部分の割合が大きくなる。
【0012】
【発明の実施の形態】以下、本発明の実施の形態の一例
を図1および図2を参照して説明する。図1は本実施の
形態の半導体装置5を示す縦断面図、図2は同横断面図
であって、図中符号6は半導体用リードフレーム、7は
半導体チップ、8は樹脂、9は金線、10はチップ搭載
、11はインナーリード、12は吊りリード、13は
アウターリードである。
【0013】図1に示すように、半導体用リードフレー
ム6(以下、単にリードフレームと称する)の樹脂封止
範囲Mより0.2mm内側にあたる部分の上面に5μm
厚の銀による内装めっき14が施され、半導体チップ7
がそのリードフレーム中央のチップ搭載部10上に銀ペ
ースト15によって固着されている。
【0014】そして、半導体チップ7上面の周辺部に形
成された外部出力用電極16とリードフレーム6のイン
ナーリード11が30μm径の金線9を介して電気的に
接続され、これらインナーリード11、金線9、チップ
搭載部10上の半導体チップ7、後述する吊りリード1
2が樹脂8によって封止されて、半導体装置5が構成さ
れている。そして、パッケージ17の外側に延びるアウ
ターリード13には2箇所の折り曲げ加工部13a、1
3bが形成されている。
【0015】また、リードフレーム6は、図2に示すよ
うに、矩形のパッケージ17の各辺に直交して2本ず
つ、計8本のインナーリード11が中心からほぼ一定の
幅で放射状に延び、途中に切断部11aを有する形状と
なっている。そして、これら8本のインナーリード11
の切断部11aより中心側がチップ搭載部10を構成し
ている。また、4本の吊りリード12がパッケージ17
の対角線上に延びている。
【0016】インナーリード11は、半導体チップ7内
と外部との情報伝達のために半導体チップ7周辺部にあ
る外部出力用電極16と接続されるもので、樹脂封止範
囲Mより外側に延びる部分はアウターリード13となっ
ている。吊りリード12は、リードフレーム外枠(図示
せず)に対してチップ搭載部10を支持するためのもの
である。
【0017】また、リードフレーム6中心のチップ搭載
10上には半導体チップ7が搭載され、インナーリー
ド11の切断部11aは半導体チップ7の縁から外側2
mmの箇所に位置している。そして、金線9は半導体チ
ップ7の外部出力用電極16とインナーリード11の切
断部11aより周辺部側を接続している。
【0018】上記構成の半導体装置5を製造する際に
は、まず、内装めっき14を施したリードフレーム6を
予め用意しておく。ただし、この際、リードフレーム6
のアウターリード13は折り曲げ加工部13a、13b
を除いて完成品と同様の形状に仕上げておく。一方、ウ
エハの状態から半導体チップ7をペレッタイズし、その
裏面に銀ペースト15を塗り付けておく。
【0019】その後、リードフレーム6の中心に半導体
チップ7を配置した際に、半導体チップ7の縁から外側
2mmにあたる位置で各インナーリード11を切断す
る。この際には、吊りリード12は切断せず、8本のイ
ンナーリード11のみを金型を用いて4方向同時に切り
離すことによって、吊りリード12に支持された中心
のインナーリード11により半導体チップ7を搭載する
ためのチップ搭載部10が形成される。なお、ここで用
いる金型は、圧力5Kg/cm2のプレス機械で駆動されてお
り、金型の交換に要する時間は5分程度であった。
【0020】また、リードフレーム6に対する金型の位
置決めに関しては、元来リードフレーム6を搬送する目
的で設けられているリードフレーム外枠の穴(図示せ
ず、位置決め部)を用いて行なう。この方法により、±
0.1mm以下の寸法精度で切断部11aが形成できる
ことを確認した。
【0021】その後、チップ搭載部10および吊りリー
ド12上に半導体チップ7をマウントし、250℃で3
時間加熱することにより銀ペースト15を硬化させ、つ
いで、下地温度200℃、荷重60g/wire、超音波パワ
ー25W/wire、超音波時間15msec/wire の条件で超音
波を印加することにより、外部出力電極16とインナー
リード11間に金線9をボンディングする。なお、金線
ボンディングの際に、荷重を500g/wire 以上、また
は超音波パワー100W/wire 以上の水準で行なうと、
半導体チップ7が破壊することを確認した。
【0022】ついで、金型温度175℃、射出圧力18
2Kg/cm2 の条件で金型にモールド樹脂8を充填した
後、175℃で8時間加熱することにより、樹脂8の完
全硬化を行なう。なお、モールド樹脂充填の際に、金型
温度150℃以下、または射出圧力150Kg/cm2 以下
の水準で行なうと、樹脂8中に空孔が残存することを確
認した。
【0023】最後に、アウターリード13に厚さ5〜2
0μmの70%Sn−Pbの半田をめっきし、リード折
り曲げ加工を施すことによって、本実施の形態の半導体
装置5が完成する。
【0024】本実施の形態の半導体装置5においては、
半導体チップ7を搭載するチップ搭載部10が放射状に
延びる8本のインナーリード11で構成され、各インナ
ーリード11間またはインナーリード11−吊りリード
12間が間隙となるため、この間隙に樹脂8が入り込
む、すなわちチップ搭載部10内に樹脂8が食い込むこ
とでアンカー効果が増す。
【0025】また、同一サイズのパッケージで比べた場
合、本実施の形態の半導体装置5は、従来の半導体装置
におけるべたのアイランドの場合に比べて、パッケージ
17中の金属部分に対する樹脂部分の占める割合が大き
くなる。したがって、パッケージの設計時に、ある樹脂
量でパッケージクラック不良が発生しない良品パッケー
ジができることがわかれば、従来に比べてチップ搭載部
下面からパッケージ底面までの寸法を小さくしても同じ
樹脂量を確保することができるため、パッケージ17の
薄型化を図ることができる。または、ある樹脂量で不良
品となることがわかれば、リードフレームの金属部分を
減らし、樹脂部分を増やして金属部分と樹脂部分のバラ
ンスを改善することでパッケージクラック不良に強い半
導体装置を製造することができる。
【0026】その結果、本実施の形態の半導体装置5の
場合、半導体装置を吸湿させた上で−55〜150℃の
温度サイクル試験にかけたところ、封止樹脂厚1.0m
mのパッケージで従来の半導体装置より強度が高くなる
ことが確認された。
【0027】一方、本実施の形態の製造方法において
は、半導体チップ7のサイズに合わせてインナーリード
11の切断位置を変えることで異なるサイズのチップ搭
載部10を形成することができるため、外形(アウター
リードの数、形状、配置等)が同じ半導体装置であれ
ば、1種類のリードフレームで対応することができる。
したがって、半導体チップの設計変更等によりチップサ
イズが急遽変更になった場合の対応も容易であるし、各
種半導体装置の需要の急増や急減に機敏に対応でき、リ
ードフレームの在庫量を削減することができる。
【0028】なお、本発明の技術範囲は上記実施の形態
に限定されるものではなく、本発明の趣旨を逸脱しない
範囲において種々の変更を加えることが可能である。例
えばリードフレームのインナーリード、アウターリー
ド、吊りリードの数、形状、配置等については適宜設計
変更が可能であり、種々の形態の樹脂封止型半導体装置
に本発明を適用することができる。また、リードフレー
ムに対する金型の位置決めを行なうための位置決め部に
ついては、本実施の形態における搬送用の穴に限ること
なく、例えば小突起等、金型に合わせて任意のものを用
いてよい。
【0029】
【発明の効果】以上、詳細に説明したように、本発明に
よれば、半導体チップを搭載するチップ搭載部が放射状
に延びるインナーリードで構成され、各インナーリード
間の間隙に樹脂が入り込み、従来の半導体装置に比べて
パッケージ中の金属部分に対する樹脂部分の占める割合
が大きくなるため、材料の熱膨張率の差に起因するパッ
ケージクラック耐性を向上させることができる。また、
従来に比べてチップ搭載部下面からパッケージ底面まで
の寸法を小さくしても同じ樹脂量を確保できるため、パ
ッケージの薄型化を図ることができる。そして、半導体
チップのサイズに合わせてインナーリードの切断位置を
変えることで異なるサイズのチップ搭載部を形成できる
ため、外形が同じ半導体装置であれば、1種類のリード
フレームで対応することができ、各種半導体装置の需要
の急増や急減に機敏に対応でき、リードフレームの在庫
量を削減することができる。
【図面の簡単な説明】
【図1】本発明の一実施の形態である半導体装置を示す
縦断面図である。
【図2】同、横断面図である。
【図3】従来の半導体装置用リードフレームの一例を示
す平面図である。
【符号の説明】
5 半導体装置 6 半導体用リードフレーム(リードフレーム) 7 半導体チップ 8 樹脂 9 金線 10 チップ搭載部 11 インナーリード 11a 切断部 12 吊りリード 13 アウターリード 13a,13b 折り曲げ加工部 14 内装めっき 15 銀ペースト 16 外部出力用電極 17 パッケージ M 樹脂封止範囲

Claims (3)

    (57)【特許請求の範囲】
  1. 【請求項1】 中心から放射状に延びるとともにその途
    中に切断部を有する複数のインナーリードを有し、前記
    切断部より前記中心側にあたる前記インナーリードの中
    心部が吊りリードに支持されるとともに該インナーリー
    ドの中心部上に半導体チップが搭載され、この半導体チ
    ップ上の電極と前記インナーリードの切断部より周辺部
    側が電気的に接続されるとともに、それらインナーリー
    ド、吊りリード、半導体チップが樹脂で封止されたこと
    を特徴とする半導体装置。
  2. 【請求項2】 中心から放射状に延びた複数のインナー
    リードと吊りリードを有するリードフレームを用い、前
    記吊りリードを除いて前記各インナーリードを半導体チ
    ップを前記中心上に配置したときにそのサイズに合うよ
    うに切断した後、この切断部より前記中心側にあたる前
    記インナーリードの中心部上に半導体チップを搭載し、
    前記半導体チップ上の電極と前記インナーリードの切断
    部より周辺部側との間のワイヤボンディングを行ない、
    その後、樹脂封止を行なうことを特徴とする半導体装置
    の製造方法。
  3. 【請求項3】 請求項2に記載の半導体装置の製造方法
    において、 前記リードフレームに位置決め部を設けておき、前記イ
    ンナーリードを切断する際に用いる金型の前記リードフ
    レームに対する位置決めを、前記位置決め部を用いて行
    なうことを特徴とする半導体装置の製造方法。
JP26309795A 1995-10-11 1995-10-11 半導体装置およびその製造方法 Expired - Fee Related JP2746224B2 (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP26309795A JP2746224B2 (ja) 1995-10-11 1995-10-11 半導体装置およびその製造方法
US08/730,464 US5945731A (en) 1995-10-11 1996-10-11 Resin encapsulated semiconductor device and method for manufacturing the same
KR1019960045455A KR100206082B1 (ko) 1995-10-11 1996-10-11 반도체 장치 및 그의 제조방법

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP26309795A JP2746224B2 (ja) 1995-10-11 1995-10-11 半導体装置およびその製造方法

Publications (2)

Publication Number Publication Date
JPH09107062A JPH09107062A (ja) 1997-04-22
JP2746224B2 true JP2746224B2 (ja) 1998-05-06

Family

ID=17384790

Family Applications (1)

Application Number Title Priority Date Filing Date
JP26309795A Expired - Fee Related JP2746224B2 (ja) 1995-10-11 1995-10-11 半導体装置およびその製造方法

Country Status (3)

Country Link
US (1) US5945731A (ja)
JP (1) JP2746224B2 (ja)
KR (1) KR100206082B1 (ja)

Families Citing this family (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5907769A (en) * 1996-12-30 1999-05-25 Micron Technology, Inc. Leads under chip in conventional IC package
JP3085278B2 (ja) * 1998-05-01 2000-09-04 日本電気株式会社 半導体装置の製造方法および半導体製造装置
US6075283A (en) 1998-07-06 2000-06-13 Micron Technology, Inc. Downset lead frame for semiconductor packages
US6218726B1 (en) * 1999-07-08 2001-04-17 Industrial Technology Research Institute Built-in stress pattern on IC dies and method of forming
SG112799A1 (en) 2000-10-09 2005-07-28 St Assembly Test Services Ltd Leaded semiconductor packages and method of trimming and singulating such packages
US6686258B2 (en) 2000-11-02 2004-02-03 St Assembly Test Services Ltd. Method of trimming and singulating leaded semiconductor packages
JP3402323B2 (ja) 2000-12-25 2003-05-06 松下電工株式会社 ヘアードライヤー
US6919620B1 (en) * 2002-09-17 2005-07-19 Amkor Technology, Inc. Compact flash memory card with clamshell leadframe

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4289922A (en) * 1979-09-04 1981-09-15 Plessey Incorporated Integrated circuit package and lead frame
JPS61216354A (ja) * 1985-03-20 1986-09-26 Shinko Electric Ind Co Ltd リ−ドフレ−ムの製造方法
JPH01120354U (ja) * 1988-02-10 1989-08-15
JPH04146658A (ja) * 1990-10-09 1992-05-20 Toshiba Corp リードフレーム
US5185653A (en) * 1990-11-08 1993-02-09 National Semiconductor Corporation O-ring package
JPH04317364A (ja) * 1991-04-16 1992-11-09 Sony Corp 樹脂封止型半導体装置とそれの製造に使用するリードフレーム
JPH05326815A (ja) * 1992-05-25 1993-12-10 Matsushita Electron Corp 半導体装置用リードフレーム
JP2772897B2 (ja) * 1992-11-30 1998-07-09 太陽誘電株式会社 リ−ドフレ−ム、およびリ−ドフレ−ムを用いた接続端子の作製方法
JPH07130938A (ja) * 1993-10-29 1995-05-19 Nec Corp 半導体集積回路用リードフレーム

Also Published As

Publication number Publication date
US5945731A (en) 1999-08-31
JPH09107062A (ja) 1997-04-22
KR100206082B1 (ko) 1999-07-01
KR970024110A (ko) 1997-05-30

Similar Documents

Publication Publication Date Title
KR100235308B1 (ko) 2중 굴곡된 타이바와 소형 다이패드를 갖는 반도체 칩 패키지
KR970011649B1 (ko) 반도체 장치의 제조방법
US5793108A (en) Semiconductor integrated circuit having a plurality of semiconductor chips
US5444301A (en) Semiconductor package and method for manufacturing the same
US6762079B2 (en) Methods for fabricating dual loc semiconductor die assembly employing floating lead finger structure
JP3205235B2 (ja) リードフレーム、樹脂封止型半導体装置、その製造方法及び該製造方法で用いる半導体装置製造用金型
US5021865A (en) Lead frame for semiconductor device
EP0680086A2 (en) Semiconductor device and method of producing said semiconductor device
US20030038348A1 (en) Dual die package
KR100636776B1 (ko) 반도체 장치 및 그 제조 방법
WO2001003186A1 (en) Semiconductor device, method of manufacturing the same, and structure for mounting semiconductor device
JP2000133767A (ja) 積層化半導体パッケ―ジ及びその製造方法
JPH06209069A (ja) 半導体パッケージおよびその製造方法
US7087986B1 (en) Solder pad configuration for use in a micro-array integrated circuit package
JPH05226562A (ja) 半導体パッケージおよびそのアセンブリ方法
US20070252284A1 (en) Stackable semiconductor package
US7186588B1 (en) Method of fabricating a micro-array integrated circuit package
JP2746224B2 (ja) 半導体装置およびその製造方法
US7064419B1 (en) Die attach region for use in a micro-array integrated circuit package
US20030102575A1 (en) Resin-encapsulated semiconductor device and method for manufacturing the same
JP2002198482A (ja) 半導体装置およびその製造方法
US5278101A (en) Semiconductor device and method for manufacturing the same
JPH01161743A (ja) 半導体装置
US5309016A (en) Semiconductor integrated circuit device having terminal members provided between semiconductor element and leads
US20080038872A1 (en) Method of manufacturing semiconductor device

Legal Events

Date Code Title Description
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 19980113

LAPS Cancellation because of no payment of annual fees