JP2734890B2 - 半導体装置 - Google Patents

半導体装置

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JP2734890B2
JP2734890B2 JP19799692A JP19799692A JP2734890B2 JP 2734890 B2 JP2734890 B2 JP 2734890B2 JP 19799692 A JP19799692 A JP 19799692A JP 19799692 A JP19799692 A JP 19799692A JP 2734890 B2 JP2734890 B2 JP 2734890B2
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package
pin
semiconductor device
pins
wiring
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正生 西村
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Nippon Electric Co Ltd
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Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明はピングリッドアレイパッ
ケージ半導体装置のピン配列に関する。
【0002】
【従来の技術】従来のピングリッドアレイ(PGA)パ
ッケージ半導体装置のリードピン配列は、図2の裏面図
に示すように、パッケージ1の裏面から垂直に引き出さ
れている多数のリードピン2は、中央の空白の領域を除
いた、正方形のパッケージ外形の四辺に沿った幅の広い
環状領域に、等しいピン間隔で植設されている。
【0003】
【発明が解決しようとする課題】上記のように、すべて
のピン間隔が同じであるために、このパッケージを実装
する配線基板の配線密度は、パッケージ中央部側のピン
と接続する配線は周辺部のピンと接続する配線の間を通
るので、周辺部では過密になる。そのため、周辺部の配
線の信頼度が中央部側の配線に比べて悪くなると言う問
題があった。そこでこの欠点を避けるために、実装基板
を多層化し、中央部側のピンと接続する配線を下層の配
線層に引き出していた。しかし、基板を多層化すると価
格が上がるという欠点があった。
【0004】
【課題を解決するための手段】上記課題に対して本発明
は、パッケージ裏面の中央部を除いた周辺に沿った幅の
広い環状領域に多数のリードピンが植設されたPGAパ
ッケージにおいて、中央部側から周辺にゆくにつれてピ
ン間隔を順次広くしている。
【0005】
【実施例】つぎに図面を参照して本発明を説明する。図
1は本発明の一実施例に係るパッケージの裏面図であ
る。図において、正方形のパッケージ1裏面の外周辺に
沿った幅の広い環状領域に、4重列に多数のリードピン
2が植設されている。中央の四角形空白の一つの角部分
に例外的に一つのリードピン3があるが、これはパッケ
ージの方向を規定するための指標となるインデックスピ
ンである。しかしてその他の多数のピンについては、中
央部側から周辺外側にゆくにつれて、列内のピン間隔d
1および列と列の間隔d2が順次広くされている。
【0006】
【発明の効果】以上説明したように本発明では、パッケ
ージ裏面のピン配列が内側の中央部側から外側の周辺に
ゆくにつれて隣り合うピン間隔が順次広くされているの
で、このパッケージを実装する配線基板の前記パッケー
ジのリードピンと接続する配線が、パッケージ周辺に相
当する部分ではピン間隔が広いため、周辺から内側にあ
るピンに接続する多くの配線も共に広いピンの間を十分
な間隔を保持して通すことができ、配線基板の実装半導
体装置周辺部のピンに接続する配線間隔が密になり過ぎ
ることによる信頼性低下を無くすことができる効果があ
る。
【図面の簡単な説明】
【図1】本発明の一実施例パッケージの裏面図である。
【図2】従来のPGAパッケージ半導体装置の裏面図で
ある。
【符号の説明】
1 パッケージ 2 リードピン 3 インデックスピン

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項1】 ピングリッドアレイパッケージの半導体
    装置において、パッケージ裏面から垂直に引き出されて
    いる多数のリードピンのピン間隔が、中央部側から周辺
    にゆくにつれて順次広くされていることを特徴とする半
    導体装置。
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