JP2712868B2 - 選択呼出受信機 - Google Patents
選択呼出受信機Info
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- JP2712868B2 JP2712868B2 JP3093372A JP9337291A JP2712868B2 JP 2712868 B2 JP2712868 B2 JP 2712868B2 JP 3093372 A JP3093372 A JP 3093372A JP 9337291 A JP9337291 A JP 9337291A JP 2712868 B2 JP2712868 B2 JP 2712868B2
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- signal
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- message
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
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- H04W52/02—Power saving arrangements
- H04W52/0209—Power saving arrangements in terminal devices
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-
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- H04L1/00—Arrangements for detecting or preventing errors in the information received
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- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
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- Y02D30/70—Reducing energy consumption in communication networks in wireless communication networks
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Mobile Radio Communication Systems (AREA)
Description
【０００１】
【産業上の利用分野】本発明は選択呼出受信機に関し、
特に受信メッセージの処理タイミング制御回路を有する
選択呼出受信機に関する。
特に受信メッセージの処理タイミング制御回路を有する
選択呼出受信機に関する。
【０００２】
【従来の技術】従来から選択呼出受信機は各種のタイプ
のものが提供されており、呼出しに使われる選択呼出信
号も多岐にわたるが、基本的な構成は殆ど同じである。
その基本的なフォーマットの一例を図５に示す。この選
択呼出信号（ＰＯＣＳＡＧ）は、文献“STANDARD MESSA
GE FORMATS FOR DIGITAL RADIO PAGING ”（Post Offic
e Code Standardisation Advisory Group (POCSAG),Aut
umn.1980）に示されている。同図（Ａ）はＰＯＣＳＡＧ
のフォーマット図、同図（Ｂ）はバッチのフォーマット
図、同図（Ｃ）はコードワードのフォーマット図であ
る。このＰＯＣＳＡＧは時分割のシステムであり、選択
呼出受信機側は自己の属するグループでのみ受信回路を
ＯＮにして、それ以外ではＯＦＦにする「バッテリーセ
ービング動作」を行い消費電流の低減を図っている。
のものが提供されており、呼出しに使われる選択呼出信
号も多岐にわたるが、基本的な構成は殆ど同じである。
その基本的なフォーマットの一例を図５に示す。この選
択呼出信号（ＰＯＣＳＡＧ）は、文献“STANDARD MESSA
GE FORMATS FOR DIGITAL RADIO PAGING ”（Post Offic
e Code Standardisation Advisory Group (POCSAG),Aut
umn.1980）に示されている。同図（Ａ）はＰＯＣＳＡＧ
のフォーマット図、同図（Ｂ）はバッチのフォーマット
図、同図（Ｃ）はコードワードのフォーマット図であ
る。このＰＯＣＳＡＧは時分割のシステムであり、選択
呼出受信機側は自己の属するグループでのみ受信回路を
ＯＮにして、それ以外ではＯＦＦにする「バッテリーセ
ービング動作」を行い消費電流の低減を図っている。
【０００３】一方、近年の選択呼出受信機は、高機能化
にともないマイクロプロセッサを使用するものが増加し
ている。しかしながら、データ受信中にマイクロプロセ
ッサがメッセージ処理を行うと、その動作ノイズにより
受信機の感度を劣化させるおそれがあるため、従来の選
択呼出受信機はデータ受信時にはマイクロプロセッサを
停止させ、或いは低速のクロックでの動作状態でバッフ
ァメモリに一時データを蓄え、受信終了後マイクロプロ
セッサで高速処理をする構成がとられている。
にともないマイクロプロセッサを使用するものが増加し
ている。しかしながら、データ受信中にマイクロプロセ
ッサがメッセージ処理を行うと、その動作ノイズにより
受信機の感度を劣化させるおそれがあるため、従来の選
択呼出受信機はデータ受信時にはマイクロプロセッサを
停止させ、或いは低速のクロックでの動作状態でバッフ
ァメモリに一時データを蓄え、受信終了後マイクロプロ
セッサで高速処理をする構成がとられている。
【０００４】
【発明が解決しようとする課題】このようにバッテリー
セービング方式をとる従来の選択呼出受信機では、デー
タ受信時にはマイクロプロセッサを停止し或いは低速の
クロックでの動作状態でバッファメモリに一時データを
蓄え、受信終了後マイクロプロセッサで高速処理を行な
う方式がとられている。しかしながら、図５に示したＰ
ＯＣＳＡＧのフォーマットではメッセージ長は任意でよ
いため、このような方式で長いメッセージ受信を行う際
にはデータ蓄積量が多くなることからバッファメモリを
大きくしなければならず、装置全体のメモリ容量を圧迫
していた。このようなメモリ使用量の増大は、小型化が
重要課題である選択呼出受信機においては非常に大きな
問題となる。本発明の目的はバッファメモリの容量を大
きくすることなく長いメッセージ受信を行うことができ
る選択呼出受信機を提供することにある。
セービング方式をとる従来の選択呼出受信機では、デー
タ受信時にはマイクロプロセッサを停止し或いは低速の
クロックでの動作状態でバッファメモリに一時データを
蓄え、受信終了後マイクロプロセッサで高速処理を行な
う方式がとられている。しかしながら、図５に示したＰ
ＯＣＳＡＧのフォーマットではメッセージ長は任意でよ
いため、このような方式で長いメッセージ受信を行う際
にはデータ蓄積量が多くなることからバッファメモリを
大きくしなければならず、装置全体のメモリ容量を圧迫
していた。このようなメモリ使用量の増大は、小型化が
重要課題である選択呼出受信機においては非常に大きな
問題となる。本発明の目的はバッファメモリの容量を大
きくすることなく長いメッセージ受信を行うことができ
る選択呼出受信機を提供することにある。
【０００５】
【課題を解決するための手段】本発明の選択呼出受信機
は、バッテリーセービング回路を有し、同期信号を含む
選択呼出信号を受信，処理する無線受信機に、選択呼出
信号中から自己の選択呼出符号を検出する検出手段と、
前記選択呼出符号に続くデータ情報を一時格納するバッ
ファメモリと、前記データ情報を処理するメッセージ処
理手段と、前記メッセージ処理手段により処理されたデ
ータを格納するメッセージメモリと、前記バッテリセー
ビング回路が前記選択呼出信号の同期信号に同期して発
生する信号のタイミングで前記データ情報を処理させる
ように前記メッセージ処理手段を制御するメッセージ処
理タイミング制御回路を設けている。
は、バッテリーセービング回路を有し、同期信号を含む
選択呼出信号を受信，処理する無線受信機に、選択呼出
信号中から自己の選択呼出符号を検出する検出手段と、
前記選択呼出符号に続くデータ情報を一時格納するバッ
ファメモリと、前記データ情報を処理するメッセージ処
理手段と、前記メッセージ処理手段により処理されたデ
ータを格納するメッセージメモリと、前記バッテリセー
ビング回路が前記選択呼出信号の同期信号に同期して発
生する信号のタイミングで前記データ情報を処理させる
ように前記メッセージ処理手段を制御するメッセージ処
理タイミング制御回路を設けている。
【０００６】
【作用】本発明によれば、バッテリーセービング回路で
発生される同期信号に同期された信号のタイミングでデ
ータ情報の１ワード毎にデータ情報を処理するため、バ
ッファメモリの容量が小さくても長いデータ情報の処理
が可能となる。
発生される同期信号に同期された信号のタイミングでデ
ータ情報の１ワード毎にデータ情報を処理するため、バ
ッファメモリの容量が小さくても長いデータ情報の処理
が可能となる。
【０００７】
【実施例】次に、本発明について図面を参照して説明す
る。図１は本発明の選択呼出受信機の一実施例のブロッ
ク図である。アンテナ１より得た変調信号ａは無線部２
で復調される。無線部２はデコーダ３のバッテリーセー
ビング制御信号ｂに従って間欠受信動作を行う。１チッ
プマイコンで構成されるＣＰＵ４はＩＤ−ＲＯＭ６に設
定された自受信機の選択呼出番号を読み出し、デコーダ
ー３に設定する。デコーダ３は自受信機の選択呼出番号
と無線部２で復調されたデータｃとの照合を行い一致す
れば、選択呼出番号検出の旨を割り込み信号ｄ、アドレ
スバスｅ、データバスｆ（以下ｄ，ｅ，ｆを合わせてＣ
ＰＵインターフェースと呼ぶ）を用いてＣＰＵ４に出力
する。その後、選択呼出信号に続いて送られるデータの
誤り訂正を行い、情報ピットのみを１コードワード毎
（図５参照）にＣＰＵインターフェースを用いてＣＰＵ
４に転送する。
る。図１は本発明の選択呼出受信機の一実施例のブロッ
ク図である。アンテナ１より得た変調信号ａは無線部２
で復調される。無線部２はデコーダ３のバッテリーセー
ビング制御信号ｂに従って間欠受信動作を行う。１チッ
プマイコンで構成されるＣＰＵ４はＩＤ−ＲＯＭ６に設
定された自受信機の選択呼出番号を読み出し、デコーダ
ー３に設定する。デコーダ３は自受信機の選択呼出番号
と無線部２で復調されたデータｃとの照合を行い一致す
れば、選択呼出番号検出の旨を割り込み信号ｄ、アドレ
スバスｅ、データバスｆ（以下ｄ，ｅ，ｆを合わせてＣ
ＰＵインターフェースと呼ぶ）を用いてＣＰＵ４に出力
する。その後、選択呼出信号に続いて送られるデータの
誤り訂正を行い、情報ピットのみを１コードワード毎
（図５参照）にＣＰＵインターフェースを用いてＣＰＵ
４に転送する。
【０００８】ＣＰＵ４はデコーダ３から選択呼出番号検
出情報を受け取り、ＣＰＵ４内のＲＡＭまたは外部のＲ
ＡＭ７に格納する。その後データがデコーダ３より続け
て送られてくれば、データがメッセージ情報か選択呼出
符号かを判断しメッセージ情報であればＣＰＵ４内のＲ
ＡＭまたは外部のＲＡＭ７内のバッファ領域に格納す
る。ＣＰＵ４はこの処理を基準発振器１３の基準クロッ
クｇを動作クロックとして処理する。データが選択呼出
符号であればその時点でデータの受取を中止すると共
に、ＣＰＵ動作発振器１４を起動させ、それまでバッフ
ァに蓄えておいたデータをＣＰＵ動作発振器１４のクロ
ックを用いて処理してメッセージ（文字データ）として
ＣＰＵ４内のＲＡＭまたは外部のＲＡＭ７内のメッセー
ジメモリー領域に格納する。またメッセージ情報が次バ
ッチに継続する場合には、デコーダ３のメッセージ処理
タイミング制御回路の出力に従いＳＣの位置でＣＰＵ動
作クロック１４を起動させ、それまでバッファにためて
おいたデータをＣＰＵ動作クロック１４を用いて処理し
てメッセージ（文字データ）としてＣＰＵ４内のＲＡＭ
または外部のＲＡＭ７内のメッセージメモリ領域に格納
する。
出情報を受け取り、ＣＰＵ４内のＲＡＭまたは外部のＲ
ＡＭ７に格納する。その後データがデコーダ３より続け
て送られてくれば、データがメッセージ情報か選択呼出
符号かを判断しメッセージ情報であればＣＰＵ４内のＲ
ＡＭまたは外部のＲＡＭ７内のバッファ領域に格納す
る。ＣＰＵ４はこの処理を基準発振器１３の基準クロッ
クｇを動作クロックとして処理する。データが選択呼出
符号であればその時点でデータの受取を中止すると共
に、ＣＰＵ動作発振器１４を起動させ、それまでバッフ
ァに蓄えておいたデータをＣＰＵ動作発振器１４のクロ
ックを用いて処理してメッセージ（文字データ）として
ＣＰＵ４内のＲＡＭまたは外部のＲＡＭ７内のメッセー
ジメモリー領域に格納する。またメッセージ情報が次バ
ッチに継続する場合には、デコーダ３のメッセージ処理
タイミング制御回路の出力に従いＳＣの位置でＣＰＵ動
作クロック１４を起動させ、それまでバッファにためて
おいたデータをＣＰＵ動作クロック１４を用いて処理し
てメッセージ（文字データ）としてＣＰＵ４内のＲＡＭ
または外部のＲＡＭ７内のメッセージメモリ領域に格納
する。
【０００９】メッセージ信号受信終了後、ＣＰＵ４はド
ライバ９を通してスピーカ１０、ＬＥＤ１１、バイブレ
ータ１２を駆動し携帯者に報知を行うと共にＬＣＤ５に
受信したメッセージ内容を表示する。報知時のスピーカ
１０、ＬＥＤ１１、バイブレータ１２の内、どれを用い
るかはＩＤ−ＲＯＭ６に予め設定されており、この情報
とファンクションスイッチ８の設定の組み合わせにより
決定される。ＣＰＵ４内のＲＡＭまたは外部のＲＡＭ７
に格納されたメッセージはファンクションスイッチ８に
より再度ＬＣＤ５に表示することができる。
ライバ９を通してスピーカ１０、ＬＥＤ１１、バイブレ
ータ１２を駆動し携帯者に報知を行うと共にＬＣＤ５に
受信したメッセージ内容を表示する。報知時のスピーカ
１０、ＬＥＤ１１、バイブレータ１２の内、どれを用い
るかはＩＤ−ＲＯＭ６に予め設定されており、この情報
とファンクションスイッチ８の設定の組み合わせにより
決定される。ＣＰＵ４内のＲＡＭまたは外部のＲＡＭ７
に格納されたメッセージはファンクションスイッチ８に
より再度ＬＣＤ５に表示することができる。
【００１０】図２は前記デコーダ３の詳細ブロック図で
ある。ビット同期回路３０１は発振回路３０９からの基
準クロックと復調データを用いて再生クロックｍを発生
する。プリアンブル及びＳＣ検出回路３０３は再生クロ
ックｇにより、復調データｃをサンプリングしてプリア
ンブル信号を検出すると検出信号ｉを発生する。そして
続くＳＣ（同期信号）を検出すると検出信号ｊを発生す
る。同期制御回路３０２はバッテリーセービング（間欠
受信）の制御を行う回路である。ＰＯＣＳＡＧ信号を受
信していない状態ではバッテリーセービングを行ってお
り、プリアンブルの検出信号ｉまたはボーレート検出信
号ｋを受けて連続受信状態となる。ＳＣの検出信号ｊに
より再びバッテリーセービング動作を開始して、自受信
機の属するグループのタイミングで受信を行う。また選
択呼出符号の一致検出信号ｏを受けて、後続するメッセ
ージ信号受信のために継続して無線部２を受信状態に保
つ。
ある。ビット同期回路３０１は発振回路３０９からの基
準クロックと復調データを用いて再生クロックｍを発生
する。プリアンブル及びＳＣ検出回路３０３は再生クロ
ックｇにより、復調データｃをサンプリングしてプリア
ンブル信号を検出すると検出信号ｉを発生する。そして
続くＳＣ（同期信号）を検出すると検出信号ｊを発生す
る。同期制御回路３０２はバッテリーセービング（間欠
受信）の制御を行う回路である。ＰＯＣＳＡＧ信号を受
信していない状態ではバッテリーセービングを行ってお
り、プリアンブルの検出信号ｉまたはボーレート検出信
号ｋを受けて連続受信状態となる。ＳＣの検出信号ｊに
より再びバッテリーセービング動作を開始して、自受信
機の属するグループのタイミングで受信を行う。また選
択呼出符号の一致検出信号ｏを受けて、後続するメッセ
ージ信号受信のために継続して無線部２を受信状態に保
つ。
【００１１】選択呼出符号検出回路３０５はプリアンブ
ル及びＳＣ検出回路３０２から出力されるバッテリーセ
ービング信号ｈのタイミングで選択呼出符号の照合を行
い一致すれば一致検出信号ｏを同期制御回路３０２及
び、ＣＰＵインターフェース回路３０７を通して１チッ
プマイコン４へ出力する。ＢＣＨ誤り訂正回路３０４は
復調データｃの誤り訂正を行いメッセージデータｐをＣ
ＰＵインターフェース回路３０７を通して１チップマイ
コン４へ出力する。
ル及びＳＣ検出回路３０２から出力されるバッテリーセ
ービング信号ｈのタイミングで選択呼出符号の照合を行
い一致すれば一致検出信号ｏを同期制御回路３０２及
び、ＣＰＵインターフェース回路３０７を通して１チッ
プマイコン４へ出力する。ＢＣＨ誤り訂正回路３０４は
復調データｃの誤り訂正を行いメッセージデータｐをＣ
ＰＵインターフェース回路３０７を通して１チップマイ
コン４へ出力する。
【００１２】ボーレート監視回路３０６は再生クロック
ｇと復調データｃの比較により受信すべきＰＯＣＳＡＧ
信号のボーレートかどうかを判定する回路である。ＰＯ
ＣＳＡＧ信号を受信していない状態でのバッテリーセー
ビング動作から、ＳＣを探しにくい動作への起動として
用いられ、プリアンブル信号以外でもバッテリーセービ
ング動作を解除するために用いられる。メッセージ処理
タイミング制御回路３１０は同期制御回路３０２の持つ
ワードカウンターのカウンター値ｑからＳＣの位置が判
別できるタイミング信号ｒを発生する。
ｇと復調データｃの比較により受信すべきＰＯＣＳＡＧ
信号のボーレートかどうかを判定する回路である。ＰＯ
ＣＳＡＧ信号を受信していない状態でのバッテリーセー
ビング動作から、ＳＣを探しにくい動作への起動として
用いられ、プリアンブル信号以外でもバッテリーセービ
ング動作を解除するために用いられる。メッセージ処理
タイミング制御回路３１０は同期制御回路３０２の持つ
ワードカウンターのカウンター値ｑからＳＣの位置が判
別できるタイミング信号ｒを発生する。
【００１３】図３はメッセージ処理手段を実現している
１チップマイコンのメッセージ処理フローである。この
メッセージ処理手段の動作フロー中、ＳＣの位置かどう
かの判定は、ＣＰＵ４がＣＰＵインターフェースを介在
して、メッセージ処理タイミング制御回路３１０の発生
するタイミング信号ｒを読み出すことにより行う。
１チップマイコンのメッセージ処理フローである。この
メッセージ処理手段の動作フロー中、ＳＣの位置かどう
かの判定は、ＣＰＵ４がＣＰＵインターフェースを介在
して、メッセージ処理タイミング制御回路３１０の発生
するタイミング信号ｒを読み出すことにより行う。
【００１４】図４に本発明の選択呼出受信機のデコーダ
ー及び１チップマイコンの動作タイミングのタイムチャ
ートを示す。 （Ａ）はＰＯＣＳＡＧの受信信号中に、自受信機の選択
呼出信号が無い場合のバッテリーセービング制御信号ｂ
のタイミングである。 （Ｂ）は選択呼出信号（図中Ａ）が自受信機のものであ
る場合のバッテリーセービング制御信号ｂのタイミング
である。 （Ｃ）は自受信機の選択呼出信号受信後の、割り込み信
号ｄのタイミングである。ＣＰＵ４はこのタイミングで
デコーダー３からメッセージデータを読み込みバッファ
メモリーに格納する。 （Ｄ）はＣＰＵ動作クロック１４の発振タイミングであ
る。タイムチャートでハイレベルになっているところで
クロックが発振していることを表している。ＣＰＵ４は
このタイミングでＣＰＵ動作クロック１４を動作クロッ
クとして用いてバッファメモリー内のデータを処理して
メッセージメモリーに文字データとして格納する。 （Ｅ）は同期制御回路３０２の持つワードカウンターの
カウンター値ｑのタイミングである。 （Ｆ）はメッセージ処理タイミング制御回路３１０は出
力される信号ｒのタイミングである。
ー及び１チップマイコンの動作タイミングのタイムチャ
ートを示す。 （Ａ）はＰＯＣＳＡＧの受信信号中に、自受信機の選択
呼出信号が無い場合のバッテリーセービング制御信号ｂ
のタイミングである。 （Ｂ）は選択呼出信号（図中Ａ）が自受信機のものであ
る場合のバッテリーセービング制御信号ｂのタイミング
である。 （Ｃ）は自受信機の選択呼出信号受信後の、割り込み信
号ｄのタイミングである。ＣＰＵ４はこのタイミングで
デコーダー３からメッセージデータを読み込みバッファ
メモリーに格納する。 （Ｄ）はＣＰＵ動作クロック１４の発振タイミングであ
る。タイムチャートでハイレベルになっているところで
クロックが発振していることを表している。ＣＰＵ４は
このタイミングでＣＰＵ動作クロック１４を動作クロッ
クとして用いてバッファメモリー内のデータを処理して
メッセージメモリーに文字データとして格納する。 （Ｅ）は同期制御回路３０２の持つワードカウンターの
カウンター値ｑのタイミングである。 （Ｆ）はメッセージ処理タイミング制御回路３１０は出
力される信号ｒのタイミングである。
【００１５】
【発明の効果】以上説明したように本発明は、バッファ
メモリに格納したデータ情報をバッテリーセービング回
路で発生される同期信号に同期された信号のタイミング
でメッセージ処理するように構成しているので、バッフ
ァメモリに一時的に格納するデータ情報量を低減するこ
とが可能となり、バッファメモリは最大１バッチ（１６
ワード）の容量で済むことになり、長いメッセージ受信
を行う場合でもバッファメモリを大きくしなくてもよ
く、装置全体のメモリ容量を圧迫する事がない。又、同
期確立後は毎回同期信号を受信する必要がないため、同
期信号のタイミングでＣＰＵが高速動作してもノイズに
よる感度劣化は起こらず、従来通りの受信機特性が確保
できる。
メモリに格納したデータ情報をバッテリーセービング回
路で発生される同期信号に同期された信号のタイミング
でメッセージ処理するように構成しているので、バッフ
ァメモリに一時的に格納するデータ情報量を低減するこ
とが可能となり、バッファメモリは最大１バッチ（１６
ワード）の容量で済むことになり、長いメッセージ受信
を行う場合でもバッファメモリを大きくしなくてもよ
く、装置全体のメモリ容量を圧迫する事がない。又、同
期確立後は毎回同期信号を受信する必要がないため、同
期信号のタイミングでＣＰＵが高速動作してもノイズに
よる感度劣化は起こらず、従来通りの受信機特性が確保
できる。
【図１】本発明の選択呼出受信機の一実施例のブロック
図である。
図である。
【図２】本発明の選択呼出受信機のデコーダのブロック
図である。
図である。
【図３】メッセージ処理手段としてのＣＰＵのメッセー
ジ処理フロー図である。
ジ処理フロー図である。
【図４】デコーダ及びＣＰＵの動作タイミングを示すタ
イムチャートである。
イムチャートである。
【図５】選択呼出信号の基本的なフォーマットの一例と
してＰＯＣＳＡＧの信号フォーマット図である。
してＰＯＣＳＡＧの信号フォーマット図である。
１ アンテナ ２ 無線部 ３ デコーダ ４ ＣＰＵ ５ ＬＣＤ ６ ＩＤ−ＲＯＭ ７ ＲＡＭ ８ ファンクションスイッチ ９ ドライバ １０ スピーカ １１ ＬＥＤ １２ バイブレータ １３ 基準発振器 １４ ＣＰＵ動作発振器
Claims (1)
- 【請求項１】 バッテリーセービング回路を有し、同期
信号を含む選択呼出信号を受信、処理する無線受信機に
おいて、前記選択呼出信号中から自己の選択呼出符号を
検出する検出手段と、前記選択呼出符号に続くデータ情
報を一時格納するバッファメモリと、前記データ情報を
処理するメッセージ処理手段と、前記メッセージ処理手
段により処理されたデータを格納するメッセージメモリ
と、前記バッテリセービング回路が前記選択呼出信号の
同期信号に同期して発生する信号のタイミングで前記デ
ータ情報を処理させるように前記メッセージ処理手段を
制御するメッセージ処理タイミング制御回路を備えるこ
とを特徴とする選択呼出受信機。
Priority Applications (11)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3093372A JP2712868B2 (ja) | 1991-03-30 | 1991-03-30 | 選択呼出受信機 |
| TW081101963A TW200623B (ja) | 1991-03-30 | 1992-03-16 | |
| ES92302438T ES2097279T3 (es) | 1991-03-30 | 1992-03-20 | Receptor de llamada selectiva. |
| EP92302438A EP0509649B1 (en) | 1991-03-30 | 1992-03-20 | Selective calling receiver |
| DE69217406T DE69217406T2 (de) | 1991-03-30 | 1992-03-20 | Selektiv-Rufempfänger |
| SG1996005332A SG50574A1 (en) | 1991-03-30 | 1992-03-20 | Selective calling receive |
| AU13825/92A AU647347B2 (en) | 1991-03-30 | 1992-03-26 | Selective calling receiver |
| CA002064315A CA2064315C (en) | 1991-03-30 | 1992-03-27 | Selective calling receiver |
| KR1019920005189A KR950011078B1 (ko) | 1991-03-30 | 1992-03-28 | 선택 호출 수신기 |
| US07/860,025 US5233345A (en) | 1991-03-30 | 1992-03-30 | Selective calling receiver with multiple clock frequencies for receiving long messages |
| HK98101369A HK1002423A1 (en) | 1991-03-30 | 1998-02-23 | Selective calling receiver |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3093372A JP2712868B2 (ja) | 1991-03-30 | 1991-03-30 | 選択呼出受信機 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04304042A JPH04304042A (ja) | 1992-10-27 |
| JP2712868B2 true JP2712868B2 (ja) | 1998-02-16 |
Family
ID=14080473
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3093372A Expired - Fee Related JP2712868B2 (ja) | 1991-03-30 | 1991-03-30 | 選択呼出受信機 |
Country Status (11)
| Country | Link |
|---|---|
| US (1) | US5233345A (ja) |
| EP (1) | EP0509649B1 (ja) |
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