JP2702225B2 - Integrated circuit with metal substrate - Google Patents

Integrated circuit with metal substrate

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JP2702225B2 JP1126717A JP12671789A JP2702225B2 JP 2702225 B2 JP2702225 B2 JP 2702225B2 JP 1126717 A JP1126717 A JP 1126717A JP 12671789 A JP12671789 A JP 12671789A JP 2702225 B2 JP2702225 B2 JP 2702225B2
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Description

【発明の詳細な説明】 [産業上の利用分野] この発明は、金属基板上に絶縁層を介して所望形状の
導電層が形成された回路基板と、前記絶縁層上に取り外
し不能に取り付けられ、外部からの操作により書き換え
可能な記憶内容を不揮発に有する回路素子とを具備する
集積回路に関する。
The present invention relates to a circuit board in which a conductive layer of a desired shape is formed on a metal substrate via an insulating layer, and is mounted on the insulating layer in a non-removable manner. And a circuit element having nonvolatile storage contents rewritable by an external operation.

[従来の技術] 従来より、絶縁層を介して導電層が夫々貼着され、各導
電層に回路素子が固定され、両導電層を接続基板を介し
て互いに接続した上で、両導電層を互いに対向した状態
で備えた所の一対の金属基板を有する集積回路として、
特公昭46-13234号公報に示される技術が知られている。
この従来技術に開示された集積回路の製造方法において
は、アルミニウム基板の少なくとも一主面を陽極酸化し
て該基板表面に酸化アルミニウム薄層を形成する工程
と、該酸化アルミニウム薄層上に抵抗体物質及び良導電
体物質を選択的に付着形成して複数個の回路素子を構成
する工程と、良導電体を選択的に付着して形成したリー
ド部上にトランジスタ・ペレツトを固着する工程と、少
なくとも前記回路素子の全てを絶縁性樹脂で封止する工
程を有することを特徴としている。
[Prior art] Conventionally, conductive layers are bonded to each other via an insulating layer, circuit elements are fixed to each conductive layer, and both conductive layers are connected to each other via a connection substrate. As an integrated circuit having a pair of metal substrates provided in a state facing each other,
A technique disclosed in Japanese Patent Publication No. 46-13234 is known.
In the method of manufacturing an integrated circuit disclosed in this prior art, a step of anodizing at least one main surface of an aluminum substrate to form an aluminum oxide thin layer on the substrate surface, and a step of forming a resistor on the aluminum oxide thin layer Forming a plurality of circuit elements by selectively forming a substance and a good conductor material; and fixing a transistor pellet on a lead portion formed by selectively attaching a good conductor. The method includes a step of sealing at least all of the circuit elements with an insulating resin.

このようにして形成された集積回路においては、金属
基板上に絶縁層を介して所望形状の導電層が形成された
回路基板において、この絶縁層上に少なくとも1つの記
憶素子が所謂ベアチツプとして取り外し不能に取り付け
られているものである。
In an integrated circuit formed in this manner, in a circuit board having a conductive layer of a desired shape formed on a metal substrate via an insulating layer, at least one storage element cannot be removed as a so-called bare chip on the insulating layer. It is attached to.

[発明が解決しようとする課題] 以上のように形成される集積回路は、その小型・低コ
ストの観点から、車載用として採用することが考えられ
る。しかしながら、このような金属基板を有する集積回
路を実際に車載用として用いる場合には、開発段階にお
いて、種々の試験を行ない、必要に応じて、この記憶素
子に記憶されたデータを書き換えたり、制御プログラム
の変更を行なわなければならないことになる。
[Problem to be Solved by the Invention] The integrated circuit formed as described above may be adopted for use in a vehicle from the viewpoint of its small size and low cost. However, when an integrated circuit having such a metal substrate is actually used for a vehicle, various tests are performed in a development stage, and data stored in the storage element is rewritten or controlled as necessary. You will have to make changes to the program.

しかしながら、この記憶素子は、上述したように、ベ
アチツプとして、回路に直接取り付けられるものであ
り、一旦取り付けられると取り外し作業が不可能である
ため、データの書き換え、制御プログラムの変更、記憶
内容のモニタ等の記憶内容の処理作業が困難であり、開
発における自由度が大幅に制限される問題点が指摘され
ている。
However, as described above, this storage element is directly attached to a circuit as a bare chip, and once attached, it is not possible to remove the storage element. It is pointed out that it is difficult to work on the stored contents such as, and the degree of freedom in development is greatly limited.

この発明は上述した課題に鑑みてなされたもので、こ
の発明の目的は、集積回路の開発段階において、外部か
らデータの書き換え、制御プログラムの変更、記憶内容
のモニタ等の記憶内容の処理作業を出来るようにして、
開発の自由度を大きくすることの出来る金属基板を有す
る集積回路を提供する事である。
The present invention has been made in view of the above-described problems, and an object of the present invention is to externally rewrite data, change control programs, monitor storage contents, and other processing operations on storage contents during the development stage of an integrated circuit. Make it possible
An object of the present invention is to provide an integrated circuit having a metal substrate capable of increasing the degree of freedom of development.

[課題を解決するための手段] 上述した課題を解決し、目的を達成するため、この発
明に係わる金属基板を有する集積回路は、金属基板上に
絶縁層を介して所望形状の導電層が形成された回路基板
と、前記絶縁層上に取り外し不能に取り付けられ、外部
からの操作により書き換え可能な記憶内容を不揮発に有
する回路素子と、少なくともこの回路素子と外部とを接
続する第1のコネクタ手段と、前記回路素子の記憶内容
を処理するために、前記第1のコネクタ手段と異なる経
路で、前記回路素子と外部処理装置とを接続する第2の
コネクタ手段とを具備することを特徴としている。
[Means for Solving the Problems] In order to solve the above problems and achieve the object, an integrated circuit having a metal substrate according to the present invention has a conductive layer of a desired shape formed on a metal substrate via an insulating layer. Circuit board, a circuit element which is non-removably mounted on the insulating layer and has nonvolatile storage contents which can be rewritten by an external operation, and first connector means for connecting at least the circuit element to the outside And second connector means for connecting the circuit element and an external processing device via a path different from that of the first connector means for processing the stored contents of the circuit element. .

また、この発明に係わる金属基板を有する集積回路に
おいて、前記導電層は、前記回路素子を他の回路素子と
接続する第1の信号線群と、第2のコネクタ手段とを結
ぶ第2の信号線群とを構成しており、この第1の信号線
群上であつて、前記回路素子に隣接する位置には、この
回路素子の記憶内容を書き換える際にデータの伝達を遮
断するように作動する信号遮断手段がされている事を特
徴としている。
Further, in the integrated circuit having the metal substrate according to the present invention, the conductive layer includes a second signal connecting a first signal line group connecting the circuit element to another circuit element and a second connector means. A line group, which is located on the first signal line group and adjacent to the circuit element so as to block data transmission when rewriting the storage contents of the circuit element. It is characterized in that there is provided a signal blocking means.

また、この発明に係わる金属基板を有する集積回路に
おいて、前記第2のコネクタ手段は、非使用状態が確定
した段階において、樹脂により充填可能に構成されてい
る事を特徴としている。
Further, in the integrated circuit having the metal substrate according to the present invention, the second connector means is configured to be filled with a resin when the non-use state is determined.

[作用] 以上のように構成される金属基板を有する集積回路に
おいては、データの書き換え、制御プログラムの変更、
データのモニタ等の記憶内容の処理作業に関しては、開
発の段階では、これらを担当する回路素子が取り外し不
能に実装された状態で、専用の第2のコネクタ手段を介
して外部処理装置に接続し、この外部処理装置により、
データの書き換え、制御プログラムの変更等の記憶内容
の処理作業が外部から出来るようにして、開発の上での
自由度を増すようにしている。
[Operation] In an integrated circuit having a metal substrate configured as described above, data rewriting, control program change,
Regarding the processing of storage contents such as data monitoring, at the stage of development, the circuit elements in charge of these are connected to an external processing device via dedicated second connector means in a state in which they are irremovably mounted. , With this external processing device,
Processing of stored contents such as rewriting of data and modification of control programs can be performed from the outside to increase the degree of freedom in development.

[実施例] 以下に、この発明に係わる金属基板を有する集積回路
の一実施例を、ケース状の混成集積回路に適用した場合
につき、添付図面の第1図乃至第11図を参照して、詳細
に説明する。
[Embodiment] Hereinafter, a case where an embodiment of an integrated circuit having a metal substrate according to the present invention is applied to a case-shaped hybrid integrated circuit will be described with reference to FIGS. 1 to 11 of the accompanying drawings. This will be described in detail.

第1図には、この一実施例の混成集積回路10が示され
ている。この混成集積回路10は、独立した車載用機能部
品としての制御ユニツトとして構成されているものであ
り、具体的には、例えば、エンジン制御ユニツトとして
の機能を独立して有する混成修正回路として構成されて
いる。
FIG. 1 shows a hybrid integrated circuit 10 of this embodiment. The hybrid integrated circuit 10 is configured as a control unit as an independent in-vehicle functional component. Specifically, for example, the hybrid integrated circuit 10 is configured as a hybrid correction circuit independently having a function as an engine control unit. ing.

この混成集積回路10は、図示するように、内部を閉塞
された箱型のケースとして形成されており、この混成集
積回路10には、互いに対向する一端部及び他端部に、第
1及び第2のコネクタ機構12,14が夫々接続されてい
る。即ち、第1のコネクタ機構12は、集積回路10を車両
ハーネスに接続するものであり、集積回路10の一端(後
方端)に一体的に形成された第1の雄型コネクタ12a
と、これに着脱自在に接続される第1の雌型コネクタ12
bとから構成されている。また、第2のコネクタ機構14
は、集積回路10に実装された記憶素子の記憶内容を処理
するための外部処理装置に接続するものであり、集積回
路10の他端(前方端)に一体的に形成された第2の雌型
コネクタ14aと、この第2の雌型コネクタ14aに着脱自在
に接続される第2の雄型コネクタ14bとから構成されて
いる。
As shown in the figure, the hybrid integrated circuit 10 is formed as a box-shaped case whose inside is closed. The hybrid integrated circuit 10 has first and second ends which are opposed to each other. Two connector mechanisms 12, 14 are connected respectively. That is, the first connector mechanism 12 connects the integrated circuit 10 to the vehicle harness, and the first male connector 12a formed integrally with one end (rear end) of the integrated circuit 10.
And a first female connector 12 detachably connected thereto.
b. Also, the second connector mechanism 14
Is connected to an external processing device for processing the storage content of the storage element mounted on the integrated circuit 10, and a second female integrated with the other end (front end) of the integrated circuit 10 The second connector 14a includes a second male connector 14b detachably connected to the second female connector 14a.

尚、この第1の雄型コネクタ12aに関しては後に後述
するが、通常使用されている形式の第1の雌型コネクタ
12bが車両ハーネスとして接続されるよう構成されてい
る。また、第2の雌型コネクタ14aには、通常使用され
ている形式の第2の雄型コネクタ14bが接続されるよう
構成されている。
Although the first male connector 12a will be described later, a first female connector 12a of a commonly used type is used.
12b is configured to be connected as a vehicle harness. The second female connector 14a is configured to be connected to a second male connector 14b of a commonly used type.

ここで、この混成集積回路10は、第2図乃至第3B図に
示すように、上下に離間された一対の第1及び第2の回
路基板16a,16bと、第1及び第2の回路基板16a、16bを
所定間隔だけ離間すると共に、側面を閉塞するための側
板18と、これら第1及び第2の回路基板16a,16bと側板1
8とを一体的に固定する枠体20とから構成されている。
Here, as shown in FIGS. 2 to 3B, the hybrid integrated circuit 10 includes a pair of first and second circuit boards 16a and 16b that are vertically separated from each other, and a first and second circuit board. 16a and 16b are separated by a predetermined distance and a side plate 18 for closing the side surface, and the first and second circuit boards 16a and 16b and the side plate 1
8 and a frame 20 for integrally fixing them.

具体的には、第1及び第2の回路基板16a,16bには、
エンジン制御ユニツトとしての機能を発揮するに必要な
CPUとして機能するICチップ、記憶素子、抵抗体、コン
デンサ等の回路素子が取り付けられている。詳細には、
下方に位置する第1の回路基板16aには、所謂ロジツク
用の回路素子が接続され、上方に位置する第2の回路基
板16bには、所謂パワー用の回路素子が接続されるよう
設定されている。
Specifically, the first and second circuit boards 16a and 16b include:
Necessary to demonstrate the function of the engine control unit.
A circuit element such as an IC chip, a storage element, a resistor, and a capacitor that functions as a CPU is mounted. For details,
A so-called logic circuit element is connected to the lower first circuit board 16a, and a so-called power circuit element is connected to the upper second circuit board 16b. I have.

尚、第1の回路基板16a上への回路素子の実装状態
は、この発明の要旨を構成するものであり、後に詳細に
説明する。
The mounting state of the circuit elements on the first circuit board 16a constitutes a gist of the present invention, and will be described later in detail.

ここで、第1及び第2の回路基板16a,16bは、第4A図
に示すように、1枚の共通基板22を2枚に分割すること
により形成されるよう設定されている。即ち、この共通
基板22は、第4B図に示すように、導電性材料、例えばア
ルミニウムから形成された基板本体22aと、この基板本
体22a上に前面に渡つて貼着された絶縁層22bと、この絶
縁層22b上に、所定の回路パターンで形成され、回路網
を規定する導電層22cと、この導電層22c上に固着され、
電気的に接続された回路素子22dとから形成されてい
る。
Here, the first and second circuit boards 16a and 16b are set to be formed by dividing one common board 22 into two, as shown in FIG. 4A. That is, as shown in FIG.4B, the common substrate 22 includes a substrate body 22a formed of a conductive material, for example, aluminum, and an insulating layer 22b adhered over the front surface of the substrate body 22a. On the insulating layer 22b, a conductive layer 22c formed in a predetermined circuit pattern and defining a circuit network, and fixed on the conductive layer 22c,
It is formed from a circuit element 22d that is electrically connected.

この共通基板22には、第4A図に示すように、その中央
部に、上下方向に沿つて延出する開口部22eが予め形成
されている。ここで、開口部22eを境として左右両部分
の回路網は、この開口部22eを渡つて設けられたフレキ
シブル基板22fを介して、互いに接続されている。尚、
このフレキシブル基板22fに近接する端部は、開口部22e
の対応する側縁よりも所定距離だけ内方に入り込んだ位
置に接続されている。即ち、この所定距離の範囲におい
て、両回路基板16a,16bの夫々の他端部において、突出
部16c,16dが規定されている。そして、この開口部22eの
上下両端を含む上下両端縁(符合X及びYで示す領域)
を切り取ることにより、上述した一対の回路基板16a,16
bがフレキシブル基板22fを介して互いに接続された状態
で形成されるよう設定されている。
As shown in FIG. 4A, an opening 22e extending in the vertical direction is formed in the center of the common substrate 22 in advance. Here, the circuit networks on both the left and right sides of the opening 22e are connected to each other via a flexible substrate 22f provided across the opening 22e. still,
The end adjacent to the flexible substrate 22f has an opening 22e.
Is connected to a position inward of the corresponding side edge by a predetermined distance. That is, in the range of the predetermined distance, the protruding portions 16c and 16d are defined at the other end of each of the circuit boards 16a and 16b. The upper and lower edges including the upper and lower ends of the opening 22e (regions indicated by reference numerals X and Y)
By cutting off the pair of circuit boards 16a, 16
The b is set so as to be connected to each other via the flexible substrate 22f.

尚、共通基板22において両方の回路基板16a,16bの互
いの外方端部に相当する部分の上面、即ち、上下に離間
して対向した状態で、ケースの一端を規定する端部の互
いに対向する内面には、複数の第1の接続端子22g,22h
が、端縁に沿つて横一列状に形成されている。また、こ
れら接続端子22g,22hには、後述する第1の雄型コネク
タ12の接続ピン24a,24bが、外方に向けて突出するよう
に夫々固着されると共に、電気的に接続されている。
In the common substrate 22, the upper surfaces of the portions corresponding to the outer ends of the two circuit boards 16a and 16b, that is, the upper and lower ends that define one end of the case are opposed to each other. On the inner surface, a plurality of first connection terminals 22g, 22h
Are formed in a horizontal line along the edge. In addition, connection pins 24a, 24b of the first male connector 12, which will be described later, are fixed to these connection terminals 22g, 22h so as to protrude outward, respectively, and are electrically connected. .

一方、両回路基板16a,16bが上下に離間して対向した
状態で、ケースの他端を規定する端部の互いに対向する
部分、即ち、突出部16c,16dの内面には、夫々に、複数
の第2の接続端子22i,22jが、端縁に沿つて横一列状に
形成されている。また、これら第2の接続端子22i,22j
には、後述する第2の雌型コネクタ14aの接続端子を構
成するように設定されている。
On the other hand, in a state where the two circuit boards 16a and 16b face each other vertically separated from each other, opposing portions of the ends defining the other end of the case, that is, the inner surfaces of the protruding portions 16c and 16d have a Are formed in a horizontal line along the edge. Also, these second connection terminals 22i, 22j
Is set so as to constitute a connection terminal of a second female connector 14a to be described later.

また、上述した側板18は、第2図に示すように、一側
が開放された上面コの字状に形成されており、この開放
された側部がケースの一端となるよう設定されている。
この側板18の上下両端面における内側縁には、対応する
回路基板16a,16bの3方の縁部を受けるための段部18a,1
8bが夫々形成されている。
As shown in FIG. 2, the above-mentioned side plate 18 is formed in a U-shape with one side open, and the open side is set to be one end of the case.
Stepped portions 18a, 1 for receiving the three edges of the corresponding circuit boards 16a, 16b are provided on the inner edges of the upper and lower end surfaces of the side plate 18.
8b are formed respectively.

ここで、各回路基板16a,16bは、第3A図に示すよう
に、対応する段部18a,18bに、シールラバー26を介して
嵌入されている。このシールラバー26を介設することに
より、これらの間から、ケース内に塵埃が侵入すること
が防止されている。
Here, the respective circuit boards 16a and 16b are fitted into the corresponding step portions 18a and 18b via the seal rubber 26 as shown in FIG. 3A. By providing the seal rubber 26, dust is prevented from entering the case from between them.

また、この側板18において集積回路10の他端部を閉塞
する部分は、図示するように、上述した突出部分16c,16
dと回路基板16a,16bとの境界部分に丁度位置するように
設定されている。この結果、この側板18よりも外方に位
置する突出部分により、第2の雌型コネクタ12bにおけ
るハウジングが規定されることになる。
In addition, as shown in the figure, the portion of the side plate 18 that closes the other end of the integrated circuit 10
It is set to be located exactly at the boundary between d and the circuit boards 16a and 16b. As a result, the housing of the second female connector 12b is defined by the projecting portion located outside the side plate 18.

一方、上述した枠体20は、第2図に示すように、絶縁
部材としての合成樹脂から形成され、側板18により閉塞
される側面を上下から挾持するようにして取り囲むよう
に構成されている。即ち、この枠体20は、側板18と対向
する本体20aと、この本体20aの上下両端から、所定距離
(具体的には、上下各回路基板16a,16bの開放されてい
ない3方の縁部を夫々挾持するに充分な距離)だけ内方
に延出したフランジ部20b,20cとから一体に形成されて
いる。
On the other hand, as shown in FIG. 2, the above-mentioned frame body 20 is formed of a synthetic resin as an insulating member, and is configured so as to surround the side surface closed by the side plate 18 from above and below. That is, the frame body 20 is provided with a main body 20a facing the side plate 18 and a predetermined distance from the upper and lower ends of the main body 20a (specifically, the three open edges of the upper and lower circuit boards 16a and 16b). Are formed integrally with the flange portions 20b and 20c extending inward by a distance sufficient to hold each of them.

尚、この枠体20の本体20aにおいて、集積回路10の他
端面(前端面)を規定する部分は、上述した第2の雌型
コネクタ14aへの第2の雄型コネクタ14bの接続を許容す
るため、全面に渡つて開口20dが形成されている。
In the main body 20a of the frame 20, a portion that defines the other end surface (front end surface) of the integrated circuit 10 allows connection of the second male connector 14b to the above-described second female connector 14a. Therefore, the opening 20d is formed over the entire surface.

この枠体20は、第3B図に示すように、側板18の上下両
段部18a,18bに夫々嵌入された上下第1及び第2の回路
基板16a,16bを、上下から挾持することにより、ケース
が一体的に構成されるよう形成されている。尚、図示す
るように、上下第1及び第2の回路基板16a,16bの回路
素子22dを互いに接続するフレキシブル基板22fは、側板
18の他端部分よりも内方に位置するよう設定されてい
る。
As shown in FIG. 3B, the frame body 20 holds the upper and lower first and second circuit boards 16a and 16b fitted respectively in the upper and lower step portions 18a and 18b of the side plate 18 from above and below. The case is formed so as to be integrally formed. As shown in the figure, a flexible board 22f for connecting the circuit elements 22d of the upper and lower first and second circuit boards 16a and 16b to each other is a side plate.
It is set so as to be located more inward than the other end of 18.

このように枠体20が形成されているので、間に側板18
を介在した状態で、第1及び第2の基板回路16a,16b
は、上下に所定距離離間しつつ、組み立てられた状態を
維持されることになる。
Since the frame body 20 is formed in this way, the side plate 18
And the first and second substrate circuits 16a, 16b
Will be maintained in an assembled state while being separated vertically by a predetermined distance.

即ち、この一実施例においては、混成集積回路10は、
ケース状に形成されると共に、このケースの上下両面
を、回路基板16a,16bから直接規定されることになる。
この結果、第1及び第2の回路基板16a,16bを、別途用
意したケース内に収納する場合と比較して、小型・軽量
化が達成されることになる。
That is, in this embodiment, the hybrid integrated circuit 10
The case is formed, and both upper and lower surfaces of the case are directly defined by the circuit boards 16a and 16b.
As a result, compared to a case where the first and second circuit boards 16a and 16b are housed in a separately prepared case, a reduction in size and weight is achieved.

次に、このように構成されたケース状の混成集積回路
10を、車両の被制御部分と車両ハーネスを介して接続す
るための、接続機器の構成を、第5図乃至第8図を参照
して説明する。
Next, the case-shaped hybrid integrated circuit thus configured
Referring to FIGS. 5 to 8, a description will be given of a configuration of a connection device for connecting the device 10 to a controlled portion of the vehicle via a vehicle harness.

この接続機器は、ケース状の混成集積回路10の一端開
口部に、所謂内付け状態で取り付けられた第1の雄型コ
ネクタ12aと、この第1の雄型コネクタ12aに着脱自在に
接続される第1の雌型コネクタ12bとから構成されてい
る。この第1の雄型コネクタ12aは、第5図に示すよう
に、前後両面が貫通された状態で開放された箱形筐体か
ら形成されたコネクタハウジング28と、上側の接続ピン
24a,24bが横一列状に配設された状態で取り付けられた
上側の接続ピン支持体30aと、下側の接続ピン24bが横一
列状に配設された状態で取り付けられた下側の接続ピン
支持体30bとから、所謂3ピース状に構成されている。
This connection device is connected to a first male connector 12a attached to an opening of one end of a case-shaped hybrid integrated circuit 10 in a so-called internal state, and is detachably connected to the first male connector 12a. And a first female connector 12b. As shown in FIG. 5, the first male connector 12a includes a connector housing 28 formed of a box-shaped housing that is opened with both front and rear surfaces penetrated, and an upper connection pin.
The upper connection pin support 30a attached with the 24a, 24b arranged in a horizontal line, and the lower connection attached with the lower connection pin 24b arranged in a horizontal line The pin support 30b forms a so-called three-piece shape.

ここで、上側の接続ピン支持体30aと下側の接続ピン
支持体30bとは、上下方向中央部を坂いにして上下対称
に形成されており、上側の接続ピン支持体30aは、略L
字状に、起立片30a1と、この起立片30a1の下端から外方
に突出する突出片30a2とから一体に形成されている。一
方、下型の接続ピン支持体30bは、略逆L字状に、起立
片30b1と、この起立片30b1の上端かた外方に突出する突
出片30b2とから一体に形成されている。
Here, the upper connection pin support 30a and the lower connection pin support 30b are formed symmetrically in the vertical direction with the center in the vertical direction being sloped, and the upper connection pin support 30a is substantially L-shaped.
The shape, the standing piece 30a 1, are integrally formed from the protruding piece 30a 2 Metropolitan projecting outwardly from the lower end of the upright pieces 30a 1. On the other hand, the lower mold of the connecting pin support 30b is in a substantially inverted L-shape, the standing piece 30b 1, is integrally formed from the protruding piece 30b 2 Metropolitan protruding upper end how outside of the standing piece 30b 1 I have.

そして、上側の接続ピン24aは、突出片30a2を水平に
貫通して前後に突出する水平部24a1と、この水平部24a1
の内方端から起立片30a1の内面に沿つて垂直に立ち上が
る垂直部24a2と、この垂直部24a2の上端から内方に折れ
曲がつた折曲部24a3とから一体に形成されている。この
折曲部24a3が、上述した上側の第2の回路基板16bに形
成された接続端子22hにハンダ付けにより接続される接
続部として規定されている。また、外方に突出する水平
部24a1の部分が、雌型コネクタ14に挿通・接続される接
続部として規定されている。
Then, the upper connecting pins 24a includes a horizontal portion 24a 1 projecting forward and backward protruding piece 30a 2 and extends horizontally through, the horizontal portion 24a 1
Are formed integrally from a vertical portion 24a 2 that rises vertically along the inner surface of the standing piece 30a 1 from the inner end of the vertical portion 24a, and a bent portion 24a 3 that is bent inward from the upper end of the vertical portion 24a 2. I have. The bent portion 24a 3, are defined as a connection portion to be connected by soldering to form connection terminals 22h to the second circuit board 16b of the upper described above. The portion of the horizontal portion 24a 1 projecting outward is defined as a connection portion to be inserted, connected to the female connector 14.

また、下側の接続ピン24bは、突出片30b2を水平に貫
通して前後に突出する水平部24b1と、この水平部24b1
内方端から起立片30b1の内面に沿つて垂直に立ち下がる
垂直部24b2と、この垂直部24b2の下端から内方に折れ曲
つた折曲部24b3とから一体に形成されている。この折曲
部24b3が、上述した下側の第1の回路基板16aに形成さ
れた接続端子22gにハンダ付けにより接続部として規定
されている。また、外方に突出する水平部24b1の部分
が、雌型コネクタ14に挿通・接続される接続部として規
定されている。
The lower connecting pin 24b is provided with a horizontal portion 24b 1 which projects back and forth projecting piece 30b 2 and extends horizontally through, along connexion perpendicularly from inner end of the horizontal portion 24b 1 on the inner surface of the standing piece 30b 1 are formed integrally falling vertical portion 24b 2, from the broken from the lower end of the vertical portion 24b 2 inwardly song ivy bent part 24b 3 Prefecture in. This bent portion 24b 3, and is defined as a connection portion by soldering to the first circuit connecting terminals 22g which is formed on a substrate 16a of the lower described above. The portion of the horizontal portion 24b 1 which projects outward, is defined as a connecting portion to be inserted, connected to the female connector 14.

尚、両接続ピン支持体30a,30bは、互いに上下に接合
された状態で、ケース状の混成集積回路10の一端開口部
内に丁度嵌入される大きさに設定されている。換言すれ
ば、上下に接合された状態で、両起立片30a1,30b1とに
渡る範囲(外周)が、丁度、混成集積回路10の一端開口
部の内周を規定するよう設定されている。
The two connection pin supports 30a and 30b are set to a size that can be just fitted into one end opening of the case-shaped hybrid integrated circuit 10 in a state where they are vertically joined to each other. In other words, the range (outer periphery) extending between the two upright pieces 30a 1 and 30b 1 in the state of being joined up and down is set to exactly define the inner periphery of one end opening of the hybrid integrated circuit 10. .

ここで、両接続ピン支持体30a,30bの上下両端縁の中
央部には、第6図に示すように、夫々凹所32a,32bが形
成されている。これら凹所32a,32bは、第1の雄型コネ
クタ12aが混成集積回路10に一体的に組み込まれた状態
で、後述するように、注入されるエポキシ樹脂の注入孔
として規定されている。
Here, as shown in FIG. 6, recesses 32a and 32b are formed in the center of both upper and lower edges of both connection pin supports 30a and 30b, respectively. These recesses 32a and 32b are defined as injection holes for the epoxy resin to be injected, as described later, in a state where the first male connector 12a is integrated into the hybrid integrated circuit 10.

また、上述した上下両接続ピン24a,24bは、上下対称
形状、即ち、同一形状に形成され、且つ、上下両接続ピ
ン支持体30a,30bも上下対称形状の同一形状に形成され
ている。このように、夫々接続ピン24a,24bが取り付け
られた接続ピン支持体30a,30bは、同一形状であるた
め、部品の共通化が図られ、コストの低廉化を達成する
ことが出来るものである。
The upper and lower connection pins 24a, 24b are formed in a vertically symmetric shape, that is, the same shape, and the upper and lower connection pin supports 30a, 30b are also formed in the same shape, which is vertically symmetric. As described above, since the connection pin supports 30a and 30b to which the connection pins 24a and 24b are respectively attached have the same shape, parts can be shared and cost can be reduced. .

一方、上述したコネクタハウジング28は、内部に前後
方向に沿つて貫通した状態で形成された嵌合穴34が形成
されている。この嵌合穴34は、第7図に示すように、上
下両接続ピン支持体30a,30bが接合された状態におい
て、互いに重ね合わされた両突出片30a2,30b2が丁度嵌
入されるに充分な大きさに設定されている。
On the other hand, the above-described connector housing 28 has a fitting hole 34 formed therein in a state penetrating along the front-rear direction. As shown in FIG. 7, this fitting hole 34 is sufficient for the two projecting pieces 30a 2 and 30b 2 that are overlapped with each other to be just fitted in the state where the upper and lower connection pin supports 30a and 30b are joined. Is set to a reasonable size.

また、コネクタハウジング28の両側部には、取り付け
用フランジ部40a,40bが一体的に形成されている。これ
らフランジ部40a,40bは、この第1の雄型コネクタ12aが
混成集積回路10に取り付け・固定されれた状態におい
て、図示しない車両の車体に固定するために設けられて
いる。このようにして、混成集積回路10を取り付けるた
めのフランジ部を混成集積回路10自体に設ける必要が無
いので、この混成集積回路10の構成を簡単化することが
出来るものである。
Further, mounting flange portions 40a and 40b are integrally formed on both side portions of the connector housing 28. The flange portions 40a and 40b are provided for fixing the first male connector 12a to a vehicle body (not shown) in a state where the first male connector 12a is attached and fixed to the hybrid integrated circuit 10. In this manner, since it is not necessary to provide a flange portion for mounting the hybrid integrated circuit 10 on the hybrid integrated circuit 10 itself, the configuration of the hybrid integrated circuit 10 can be simplified.

尚、この一実施例においては、これら接続ピン24a,24
bの上下離間距離l及び左右の配設ピツチpは、従来よ
り用いられているピン配列の仕様に基づいて規定されて
いる。この結果、この第1の雄型コネクタ12aに接続さ
れる第1の雌型コネクタ12bは、従来より通常使用され
ているタイプが採用され得ることになり、経済性が向上
する。
In this embodiment, these connection pins 24a, 24
The vertical distance l and the left and right pitches p of b are defined based on the specifications of the pin arrangement conventionally used. As a result, as the first female connector 12b connected to the first male connector 12a, a type conventionally used conventionally can be adopted, and the economy is improved.

また、雄型コネクタとして、従来より用いられている
タイプは重く、大型であるので、これを採用することな
く、この小型・軽量化されたケース状の混成集積回路10
に対応して、専用の第1の雄型コネクタ12aを形成して
いる。従つて、この一実施例によれば、上述した混成集
積回路10の小型・軽量化を損なうことが確実に防止され
ることになる。
Also, since the type conventionally used as a male connector is heavy and large, without adopting this type, the case-shaped hybrid integrated circuit 10 is reduced in size and weight.
, A first male connector 12a for exclusive use is formed. Therefore, according to this embodiment, it is possible to reliably prevent the above-described hybrid integrated circuit 10 from being reduced in size and weight.

次に、第8図を参照して、第5図に組み付け終了後の
状態を示す第1の雄型コネクタ12aの組み付け動作と共
に、混成集積回路10の組み立て動作を説明する。
Next, with reference to FIG. 8, the assembling operation of the first integrated connector 12a and the assembling operation of the hybrid integrated circuit 10 shown in FIG.

先ず、第4A図及び第4B図を参照して上述したように、
所定の回路素子22dが取り付けられた状態の共通基板22
から上下両端縁X,Yを切り取ることにより、第1及び第
2の回路基板16a,16bが同一平面上で開かれた状態で形
成されることになる。このような開かれた状態の第1及
び第2の回路基板16a,16bに、第5図に示すように、対
応する接続ピン支持体30a,30bが接着剤を介して夫々固
着される。
First, as described above with reference to FIGS. 4A and 4B,
Common board 22 with a predetermined circuit element 22d attached
The first and second circuit boards 16a, 16b are formed open on the same plane by cutting the upper and lower edges X, Y from the top. As shown in FIG. 5, the corresponding connection pin supports 30a and 30b are fixed to the first and second circuit boards 16a and 16b in the opened state via an adhesive, respectively.

ここで、上述したように、これら接続ピン支持体30a,
30bには、対応する接続ピン24a,24bが既に取り付けられ
ている。このようにして、これら接続ピン24a,24bは、
第1及び第2の回路基板16a,16bが開かれた状態におい
て、対応する接続端子22g,22hに夫々ハンダ付けされる
ことになる。特に、このハンダ付け作業は、接続端子22
g,22hの数が多いため、細かい作業が要求されるもので
あるが、この一実施例においては、このように、第1及
び第2の回路基板16a,16bが夫々同一平面上において開
かれているので、その作業は確実に実行され、作業性が
向上すると共に、その組立性が良好に維持されるもので
ある。
Here, as described above, these connection pin supports 30a,
The corresponding connection pins 24a and 24b are already attached to 30b. In this way, these connection pins 24a, 24b
When the first and second circuit boards 16a and 16b are opened, they are soldered to the corresponding connection terminals 22g and 22h, respectively. In particular, this soldering work requires the connection terminals 22
Since the numbers of g and 22h are large, fine work is required. In this embodiment, the first and second circuit boards 16a and 16b are respectively opened on the same plane. As a result, the work is reliably performed, the workability is improved, and the assemblability is well maintained.

この後、第1の回路基板16aをそのままの位置に保持
した状態で、第2の回路基板16bを持ち上げて、下方に
位置する第1の回路基板16aの上方で、これに平行とな
るように移動する。そして、第8図に示すように、両方
の接続ピン支持体30a,30bを互いに上下に接合させる。
ここで、このように両接続ピン支持体30a,30bが上下に
接合された時点で、第1及び第2の回路基板16a,16bは
互いに平行に設定されることになる。
Thereafter, with the first circuit board 16a held in the same position, the second circuit board 16b is lifted up so as to be parallel to and above the lower first circuit board 16a. Moving. Then, as shown in FIG. 8, both connection pin supports 30a and 30b are joined to each other up and down.
Here, the first and second circuit boards 16a and 16b are set to be parallel to each other when the two connection pin supports 30a and 30b are joined vertically.

一方、このような接合動作に先立ち、下方に位置する
第1の回路基板16aの前方部分及び後方部分上には、第
5図に示すように、第1及び第2の回路基板16a,16bの
間隔を所定の値に一定に保つと共に、混成集積回路10の
強度を担保しつつ、内部空間を外部から遮蔽するための
フレーム部材36a,36bが起立した状態で取り付けられ
る。ここで、一方のフレーム部材36aは、フレキシブル
基板22fよりも僅かに内方に位置するように、また、他
方のフレーム部材36bは、接続端子22g,22hよりも僅かに
内方に位置するよう、夫々の配設位置を設定されてい
る。
On the other hand, prior to such a bonding operation, as shown in FIG. 5, the first and second circuit boards 16a and 16b are provided on the front and rear portions of the first circuit board 16a located below. The frame members 36a and 36b for shielding the internal space from the outside are mounted while keeping the interval constant at a predetermined value and securing the strength of the hybrid integrated circuit 10. Here, one frame member 36a is located slightly inward of the flexible board 22f, and the other frame member 36b is located slightly inward of the connection terminals 22g and 22h. Each arrangement position is set.

そして、この接合した状態を維持したままで、これら
をコネクタハウジング28の嵌合穴34に嵌入させ、この嵌
入した状態において、第1の雄型コネクタ12aは混成集
積回路10に一体的に取り付けられることになる。この
後、上述したように、混成集積回路10に側板18を取り付
け、枠体20を嵌め込む。このようにして、第1図に示す
ような混成集積回路10が第1の雄型コネクタ12aを一体
に備えた状態で形成されることになる。
Then, while maintaining the joined state, they are fitted into the fitting holes 34 of the connector housing 28, and in this fitted state, the first male connector 12a is integrally attached to the hybrid integrated circuit 10. Will be. Thereafter, as described above, the side plate 18 is attached to the hybrid integrated circuit 10, and the frame 20 is fitted. Thus, the hybrid integrated circuit 10 as shown in FIG. 1 is formed with the first male connector 12a integrally provided.

このような組み立て動作が終了した後において、この
組み付けられた第1の雄型コネクタ12aを混成集積回路1
0に確実に接着すると共に、混成集積回路10の内部を完
全に遮蔽しつつ、各接続ピン24a,24bと対応する接続端
子22g,22hとのハンダ付け部を確実に固定するために、
第1の雄型コネクタ12aとフレーム部材36bとの間に、エ
ポキシ系樹脂38が、上述した凹所32a,32bを夫々介して
注入され、両者の間は、このエポキシ系樹脂38により満
杯状態となされる。
After such an assembling operation is completed, the assembled first male connector 12a is connected to the hybrid integrated circuit 1.
In order to securely fix the soldered portions of the respective connection pins 24a, 24b and the corresponding connection terminals 22g, 22h, while firmly adhering to 0, and completely shielding the inside of the hybrid integrated circuit 10,
An epoxy resin 38 is injected between the first male connector 12a and the frame member 36b via the recesses 32a and 32b described above, and the space between the two is filled with the epoxy resin 38. Done.

また、フレキシブル基板22fを保護すると共に、混成
集積回路10の内部を遮蔽するために、フレーム部材36a
と側壁18との間には、枠体20が装着される前の段階で、
同様なエポキシ系樹脂38により埋め尽されるよう設定さ
れている。
Further, in order to protect the flexible substrate 22f and shield the inside of the hybrid integrated circuit 10, the frame member 36a
And between the side wall 18 and before the frame body 20 is mounted,
It is set so as to be filled with a similar epoxy resin 38.

一方、ケース状の混成集積回路10の他端部に一体的に
形成される所の上述した第2の雌型コネクタ14aは、上
述した説明から明かなように、上下一対の回路基板16a,
16bにおける夫々の突出部16c,16dをハウジングとして規
定された上で、接続端子22i,22jを備えた形態で、ケー
ス状の集積回路10に一体的に接続されつつ構成されてい
る。
On the other hand, as described above, the second female connector 14a formed integrally with the other end of the case-shaped hybrid integrated circuit 10 has a pair of upper and lower circuit boards 16a,
Each of the protrusions 16c and 16d in 16b is defined as a housing, and is provided with connection terminals 22i and 22j, while being integrally connected to the case-shaped integrated circuit 10.

一方、この第2の雌型コネクタ14aに着脱自在に接続
される第2の雄型コネクタ14bは、第5図に示すよう
に、先端が両突出部16c,16dに挟まれた空間内に突出す
るように設定されたハウジング16b1と、このハウジング
16b1に、上述した接続端子22i,22jに夫々摺接可能に上
下において夫々一列状に取り付けられた複数の接続ピン
16b2,16b3とから構成されている。
On the other hand, as shown in FIG. 5, the second male connector 14b detachably connected to the second female connector 14a has a distal end projecting into a space sandwiched between both projecting portions 16c and 16d. Housing 16b 1 and this housing configured to
16b 1 , a plurality of connection pins attached to the connection terminals 22i and 22j in a row so as to be slidable respectively.
16b 2 and 16b 3 .

尚、この第2の雄型コネクタ14bは、外部バスケーブ
ルとしての接続コード42を介して、後述する外部処理装
置としてのチューニング装置44に接続されている。
The second male connector 14b is connected to a tuning device 44 as an external processing device described later via a connection cord 42 as an external bus cable.

一方、上述した所の、下方に位置する第1の回路基板
16aにおける、種々の電子部品の実装状態は、第9図に
示すように設定されている。
On the other hand, the first circuit board located below,
The mounting state of various electronic components in 16a is set as shown in FIG.

詳細には、先ず、第9図に示すように、第1の回路基
板16aにおける絶縁層22b上には、所定のパターンで、回
路網、換言すれば、導電層22cから形成される信号線群
としての複数のバスラインが形成されている。そして、
この第1の回路基板16aの絶縁層22b上には、エンジン制
御ユニツトとしての機能を発揮するに必要なCPUとして
機能するICパツケージ(例えば、モトローラ社製のMC68
01)と同等の機能を有するICチツプ22d1が、ベアチツプ
として直接に固着されている。そして、このCPU22d
1は、ボンデイングワイヤ22d3を介して、上述したバス
ラインの所定群に直に実装されている。尚、このICチツ
プ22d1には、図示していないが、所定の制御プログラム
が内蔵されたROMが接続されている。
Specifically, first, as shown in FIG. 9, a signal line group formed from a circuit network, in other words, a conductive layer 22c, is formed on the insulating layer 22b of the first circuit board 16a in a predetermined pattern. Are formed as a plurality of bus lines. And
On the insulating layer 22b of the first circuit board 16a, an IC package (for example, Motorola MC68) which functions as a CPU required to exhibit a function as an engine control unit is provided.
01) and an IC chip 22 d 1 having the same function are fixed directly as Beachitsupu. And this CPU22d
1, via a bonding wire 22 d 3, are directly mounted to a predetermined group of the above-mentioned bus line. Incidentally, this is IC chip 22 d 1, although not shown, a predetermined control program is built ROM is connected.

また、この第1の回路基板16aの絶縁層22b上には、こ
のCPU22d1が制御手順を実行する上で必要となる種々の
データが書き込まれるICパツケージ(例えば、NEC製の
μPD28C64)と同等の機能を有するICチツプ22d2が、ベ
アチツプとして直接に固着されている。尚、このICチツ
プ22d2は、不揮発性の書き換え可能な記憶素子として機
能するものであり、ICチツプ22d1と同様に、第10A図及
び第10B図に示すように、ボンデイングワイヤ22d3を介
して、上述したバスラインの中の所定群に直に実装され
ている。
Further, this first circuit board 16a of the insulating layer 22b, the IC CPU22d 1 Various data are written to be required to execute a control procedure bobbin (e.g., manufactured by NEC μPD28C64) equivalent of an IC chip 22 d 2 having the function, are fixed directly as Beachitsupu. Incidentally, the IC chip 22 d 2, which functions as a rewritable nonvolatile memory element, similarly to the IC chip 22 d 1, as shown in FIG. 10A and the second 10B view, through the bonding wire 22 d 3 Thus, it is directly mounted on a predetermined group in the bus line described above.

尚、この記憶素子22d2内には、所定のマツプや、デフ
オルト値や、閾値を規定する定数等が設定・記憶されて
いる。また、第2の回路基板16b上には、その他に、パ
ワートランジスタ、ゲート回路素子、電圧レギユレー
タ、コンデンサ、抵抗、ダイオード等の種々の回路素子
が実装されている。
Note that the storage element 22d 2, given and Matsupu, default values and constants or the like for defining the threshold value is set and stored. In addition, various circuit elements such as a power transistor, a gate circuit element, a voltage regulator, a capacitor, a resistor, and a diode are mounted on the second circuit board 16b.

そして、導電層22cから構成される回路網(回路パタ
ーン)は、上述したようにベアチツプとして実装された
記憶素子22d2とCPU22d1とを接続する第1のバスライン2
2c1と、記憶素子22d2と第2の雌型コネクタ12bにおける
複数の接続端子22i,22jとを接続する第2のバスライン2
2c2と、CPU22d1と種々の回路素子とを適宜接続した上
で、第1の雄型コネクタ12aにおける複数の接続端子22
g,22hとを接続する第3のバスライン22c3とを備えてい
る。
Then, the network (circuit pattern) formed from the conductive layer 22c has a first bus line for connecting the storage element 22 d 2 and CPU22d 1, implemented as Beachitsupu as described above 2
2c 1 and a second bus line 2 connecting the storage element 22d 2 and the plurality of connection terminals 22i and 22j in the second female connector 12b.
And 2c 2, on a suitably connecting CPU22d 1 and the various circuit elements, a plurality of connections in the first male connector 12a terminal 22
g, and a third bus line 22c 3 for connecting the 22h.

ここで、これら記憶素子22d2とCPU22d1とを互いに結
ぶ回路網としての導電層22c、即ち、第2のバスライン2
2c2上には、第11図に示すように、記憶素子22d2のデー
タを書き換える際に、書き換え上方が他の回路素子に伝
達され、これら他の回路素子での不要なデータの書き換
えを確実に阻止するために、信号遮断回路としてのバス
遮断回路22d4が介設されている。このバス遮断回路22d4
は、所謂トライステートバツフアとして機能するC−MO
Sタイプのアナログスイツチを用いる所の、従来から周
知の構成であり、その説明を省略する。
Here, the conductive layer 22c of the network connecting the these storage element 22 d 2 and CPU22d 1 together, i.e., the second bus line 2
On 2c 2, as shown in FIG. 11, when rewriting the data of the storage element 22 d 2, rewriting the upper is transmitted to other circuit elements, ensure rewriting of unnecessary data in these other circuit elements to prevent the, bus blocking circuit 22 d 4 as a signal cutoff circuit is interposed. This bus cutoff circuit 22d 4
Is a C-MO that functions as a so-called tri-state buffer.
This is a conventionally well-known configuration using an S-type analog switch, and a description thereof will be omitted.

以上のように構成される第1の回路基板16aの回路構
成において、開発途中の状態において、記憶素子22d2
記憶されたデータを書き換える必要が生じた場合には、
第5図に示すように第2の雄型コネクタ14bを対応する
第2の雌型コネクタ14aに接続し、チユーニング装置44
をデータ書き換えモードに設定することにより、記憶素
子22d2内のデータを書き換えることになる。
In the circuit configuration of the first circuit board 16a configured as described above, in the middle of development conditions, when the need to rewrite the data stored in the storage element 22 d 2 occurs,
As shown in FIG. 5, the second male connector 14b is connected to the corresponding second female connector 14a.
By setting the data rewriting mode, thereby rewriting the data in the storage element 22 d 2.

ここで、この第2の雌型のコネクタ14aは、上述した
ように、第2の雄型コネクタ14bの接続ピン24c,24dに対
応して接続端子22i,22jを備えており、第11に示すよう
に、これら接続端子22i,22jは、第2のバスライン22c2
を介して、記憶素子22d2のライトエナーブル端子▲
▼に連結されたボンデイングワイヤ22d3にインバータを
介して接続されたライトモード設定用接続端子と、チツ
プエナーブル端子▲▼とアウトプツトエナーブル端
子▲▼とに夫々連結されたボンデイングワイヤ22d3
に接続された一対のライト用接続端子とを有するように
構成されている。
Here, as described above, the second female connector 14a has connection terminals 22i and 22j corresponding to the connection pins 24c and 24d of the second male connector 14b, and is shown in FIG. As described above, these connection terminals 22i and 22j are connected to the second bus line 22c 2
Through the write enable terminal of the storage element 22d 2
And connected to the write mode setting connection terminal bonding wire 22 d 3 which is connected through an inverter to ▼, Chitsupuenaburu terminal ▲ ▼ and Autopu bract Zener Bull terminal ▲ ▼ and bonding wire 22 d 3 which are respectively connected to the
, And a pair of connection terminals for light connected to each other.

即ち、データの書き換えに際しては、上述した構成の
第2の雄型コネクタ14bを雌型コネクタ12bに接続し、接
続コード42を介して集積回路10と接続されたチユーニン
グ装置44を介して記憶素子22d2内に記憶されている記憶
内容としてのデータを、所望のデータに書き換えられる
ことになる。
That is, when rewriting data, the second male connector 14b having the above-described configuration is connected to the female connector 12b, and the storage element 22d is connected via the tuning device 44 connected to the integrated circuit 10 via the connection cord 42. The data as the storage content stored in 2 can be rewritten to desired data.

尚、この書き換え動作に際しては、チユーニング装置
44ライトモード設定用接続端子にハイレベル信号が送ら
れ、この結果、バス遮断回路22d4のコントロール端子が
ローレベルとなり、バス遮断回路22d4において、内部ス
イツチが開き、バスラインがオープン状態となる。この
ようにして、チユーニング装置44からの書き換え情報
は、これらバス遮断回路22d4において記憶素子22d2以外
に伝達されることが確実に阻止されることになる。
In this rewriting operation, a tuning device is used.
44 a high level signal to the connection terminal set write mode is sent, the result, the control terminal of the bus blocking circuit 22 d 4 becomes low level, the bus blocking circuit 22 d 4, opens an internal switch, the bus line is open . Thus, rewriting the information from Chiyuningu device 44 would be transmitted to the other memory element 22 d 2 in these buses cutoff circuit 22 d 4 is reliably prevented.

一方、このようなライトモード設定用接続端子へのハ
イレベル信号の出力により、記憶素子22d2におけるライ
トイネーブル端子▲▼がローレベルとなり、また、
チユーニング装置44から、一対のライト用接続端子を介
して、チツプイネーブル端子▲▼がハイレベルに、
また、出力イネーブル端子▲▼がローレベルに夫々
設定され、このようにして、記憶素子22d2への書き込み
可能状態が設定されることになる。
On the other hand, the high level output signal to such write mode setting connection terminal, a write enable terminal ▲ ▼ goes low in the storage element 22 d 2, also,
From the tuning device 44, the chip enable terminal ▲ ▼ becomes a high level via a pair of write connection terminals,
Further, the output enable terminal ▲ ▼ are respectively set to the low level, in this way, the write enable state to the memory element 22 d 2 is to be set.

以上詳述したように、この一実施例の混成集積回路10
においては、CPU22d1に所定のデータを供給する記憶素
子22d2として、不揮発性の書き込み可能なICチツプを採
用しており、この記憶素子22d2に記憶されたデータは、
任意に書き換えることが可能となる。このようにして、
開発の途中において、記憶素子22d2のデータを書き換え
る必要が生じた場合にも、この書き換え要求に容易に対
応することが出来、開発における自由度が大幅に向上す
ることになる。
As described in detail above, the hybrid integrated circuit 10 of this embodiment is
In, as a storage element 22 d 2 supplies predetermined data to CPU22d 1, uses nonvolatile writeable IC chip, the data stored in the storage element 22 d 2 is
It can be rewritten arbitrarily. In this way,
In the course of development, when the need to rewrite the data of the storage element 22 d 2 occurs also, it is possible to easily cope with this rewrite request, the degree of freedom in development will significantly improve.

また、データの書き換え動作時において、この記憶素
子22d2とCPU22d1とを接続するバスラインをバス遮断回
路22d4によりオープン状態に設定しているので、チユー
ニング装置44から出力されるデータの書き換え情報は、
記憶素子22d2以外には伝達されないことになり、CPU22d
2その他の回路素子における記憶データが、このデータ
書き換え情報により誤つて書き換えられることが確実に
防止されることになる。
Further, when the data rewriting operation, since the set open a bus line connecting the storage element 22 d 2 and CPU22d 1 by the bus blocking circuit 22 d 4, rewriting information of the data output from Chiyuningu device 44 Is
It will not be transmitted to anything other than the storage element 22d 2 and the CPU 22d
(2) Data stored in other circuit elements can be reliably prevented from being erroneously rewritten by the data rewrite information.

また、上述したように、この一実施例においては、デ
ータの書き換えが、単に第2の雌型コネクタに第2の雄
型コネクタ14bを接続することにより、集積回路10とチ
ユーニング装置44とを接続させることにより行なわれる
ように設定されているので、このデータ書き換え動作が
非常に簡単に且つ容易に行なわれることになる。
As described above, in this embodiment, the data rewriting is performed by simply connecting the integrated circuit 10 and the tuning device 44 by simply connecting the second male connector 14b to the second female connector. Therefore, the data rewriting operation can be performed very easily and easily.

そして、この一実施例においては、記憶素子22d2に記
憶されたデータを書き換えた状態で、集積回路10の制御
手順をシミユレートする場合には、チユーニング装置44
をシミユレーシヨンモードに設定し、記憶素子22d2に記
憶されたデータに基づき制御手順をシミユレートするこ
とになる。また、記憶素子22d2内に記憶されたデータを
モニタする場合には、同様に、チユーニング装置44をモ
ニタモードに設定して、モニタすることになる。このよ
うにして、開発段階における記憶素子22d2に記憶させる
べきデータの設定(確定)が大きな自由度を有した状態
で行なわれることになる。
Then, in this embodiment, in a state in which rewriting the data stored in the storage element 22 d 2, in the case of Shimiyureto the control procedure of the integrated circuit 10, Chiyuningu 44
Was set to stain Yoo rate Chillon mode, it will Shimiyureto a control procedure based on the data stored in the storage element 22 d 2. Further, in the case of monitoring the data stored in the storage element 22 d 2 is similarly set the Chiyuningu device 44 to the monitor mode, it will be monitored. In this way, the setting of data to be stored in the storage element 22 d 2 in the development stage (confirmation) is carried out in a state of having a large degree of freedom.

一方、このような開発段階が終了して、記憶素子22d3
内に記憶させておくデータが確定した場合には、このよ
うなデータを記憶素子22d2に別途書き込んだ状態におい
て、この記憶素子22d2はベアチツプとして、第1の回路
基板16aの絶縁層22b上に実装されることになる。この場
合、上述した第2の雌型コネクタ14aは、使用しない状
態が確定されているので、この第2の雌型コネクタ14a
内には、上述した合成樹脂が注入され、全体に埋め込ま
れることになる。このようにして、この混成集積回路10
は、製品として完成した状態においては、即ち、商品と
して出荷される際においては、外見上第2の雌型コネク
タ14aは存在しないかのように設定されている。この結
果、使用しない第2の雌型コネクタ14aが外見構成する
場合と比較して、商品価値の低下が阻止される効果が達
成されることになる。
On the other hand, when such a development stage is completed, the storage element 22d 3
If the data to be is stored within has been established, in such a separate written state data in the storage element 22 d 2, as the memory element 22 d 2 is Beachitsupu, on the insulating layer 22b of the first circuit board 16a Will be implemented. In this case, since the unused state of the second female connector 14a is determined, the second female connector 14a is not used.
The above-mentioned synthetic resin is injected into the inside and is embedded in the whole. Thus, the hybrid integrated circuit 10
Is set as if there is no second female connector 14a in appearance when the product is completed, that is, when it is shipped as a product. As a result, as compared with the case where the unused second female connector 14a has an external configuration, an effect of preventing a decrease in commercial value is achieved.

以上のようにこの一実施例の集積回路10は構成されて
いるので、開発段階においては、第2の雌型コネクタ14
aと第2の雄型コネクタ14bとを接続することにより、集
積回路10とチユーニング装置44とが互いに接続され、こ
のチユーニング装置44により、書き換え可能な記憶素子
22d2に記憶されたデータにもつづくCPU22d1における制
御手順のエミユレーシヨン動作を実行したり、書き換え
可能な記憶素子22d2に記憶されたデータを書き換えた
り、シミユレーシヨンしたりモニタするチユーニング動
作が容易に実施されることになる。
As described above, since the integrated circuit 10 of this embodiment is configured, at the development stage, the second female connector 14
By connecting the second male connector 14b to the integrated circuit 10, the integrated circuit 10 and the tuning device 44 are connected to each other.
And perform emulation operation of the control procedure in CPU22d 1 that follows in the data stored in the 22 d 2, or rewrites the data stored in a rewritable memory element 22 d 2, be easily Chiyuningu operation of monitoring or Shimiyureshiyon performed Will be done.

このようにして、この一実施例によれば、開発段階に
おける記憶素子22d2に記憶させるデータの書き換えが容
易に行なえると共に、この書き換えられたデータに基づ
いてCPU22d1を動作させた制御手順をシミユレートさせ
たりデータのモニタを容易に実施することが出来るの
で、開発段階における自由度が大幅に向上することとな
る。
Thus, according to this embodiment, the can easily rewrite the data stored in the storage element 22 d 2 in the development stage, the control procedure to operate the CPU22d 1 on the basis of the rewritten data Since the simulation and the data monitoring can be easily performed, the degree of freedom in the development stage is greatly improved.

また、この一実施例においては、開発段階において用
いたバスライン22c1,22c2,22c3の回路パターンを、その
ままの形状を採用して製品としての集積回路10を完成す
るように設定されている。この結果、回路パターンをエ
ツチング成形する費用が大幅に低減されると共に、開発
段階で実際に動作した回路パターンを、製品に適用して
いるので、この製品が開発段階と同様に間違え無く動作
することになり、製品の安定動作が確保、換言すれば、
信頼性が担保されることになる。
Further, in this embodiment, the circuit pattern of the bus lines 22c 1, 22c 2, 22c 3 using in the development stage, is set so as to complete the integrated circuit 10 as a product employs a raw shape I have. As a result, the cost of etching and forming the circuit pattern is greatly reduced, and since the circuit pattern that actually operated in the development stage is applied to the product, this product operates without mistake as in the development stage. And the stable operation of the product is secured, in other words,
Reliability will be ensured.

この発明は、上述した一実施例の構成に限定されるこ
となく、この発明の要旨を逸脱しない範囲で種々変形可
能であることは言うまでもない。
It is needless to say that the present invention is not limited to the configuration of the above-described embodiment, but can be variously modified without departing from the gist of the present invention.

例えば、上述した一実施例においては、混成集積回路
10として、エンジン制御ユニツトとして機能するよう説
明したが、これに限定されることなく、例えば、自動車
速制御装置、4輪操舵における制御装置、自動変速制御
装置等の各々の機能部品として作動するように構成され
得るものである。
For example, in one embodiment described above, a hybrid integrated circuit
Although described as functioning as an engine control unit as 10, the present invention is not limited to this. For example, it may operate as a functional component such as a vehicle speed control device, a control device for four-wheel steering, an automatic transmission control device, or the like. It can be configured as follows.

また、上述した一実施例においては、混成集積回路10
は、上下一対の回路基板16a,16bを備えるように説明し
たが、この発明はこのような構成に限定されることな
く、例えば、互いに平行になされた3枚の回路基板を有
するように構成しても良いことは言うまでもない。
Further, in one embodiment described above, the hybrid integrated circuit 10
Has been described as including a pair of upper and lower circuit boards 16a and 16b, but the present invention is not limited to such a configuration, and may be configured to have, for example, three circuit boards parallel to each other. Needless to say, this is acceptable.

更に、上述した一実施例においては、チユーニング装
置44によりシミユレーシヨン、モニタ、データ書き換え
される対象は、データが記憶された記憶素子22d2である
と説明したが、これに限定されることなく、CPU22d1
してのICチツプの制御プログラムを同様に外部より処理
する場合にも同様に適用することが出来るものである。
Further, in one embodiment described above, Shimiyureshiyon by Chiyuningu device 44, a monitor, a subject to be rewriting data, the data is described as a storage element 22 d 2 stored, without being limited thereto, CPU22d The same can be applied to the case where the control program of the IC chip 1 is externally processed.

また、接続コード42を介して接続される機器として、
上述した一実施例では、チユーニング装置44が接続され
るように説明したが、この発明は、このような構成に限
定されることなく、例えば、エミユレータが接続され、
このエミユレータにより、集積回路10の制御内容がエミ
ユレートされるように設定しても良い。
Also, as a device connected via the connection cord 42,
In the above-described embodiment, the description has been made such that the tuning device 44 is connected.However, the present invention is not limited to such a configuration.
The emulator may be set so that the control contents of the integrated circuit 10 are emulated.

更に、上述した一実施例においては、回路素子として
のCPU22d1や記憶素子22d2は、ベアチツプとして絶縁層2
2b上に直接実装されるように説明したが、この発明は、
このような構成に限定されることなく、回路素子として
のCPU22d1や記憶素子22d2は、パツケージタイプのICか
ら構成され、所定のバスラインに半田付けにより取り外
し不能な状態で実装される場合にも、同様に適用するこ
とが出来るものである。
Further, in one embodiment described above, CPU22d 1 and memory element 22 d 2 as circuit elements, insulating layer 2 as Beachitsupu
Although described as being implemented directly on 2b, the present invention
Such a configuration is not limited to, CPU22d 1 and memory element 22 d 2 as circuit elements, when composed of Patsu cage type IC, is mounted in a removable state by soldering to a predetermined bus line Can be similarly applied.

[発明の効果] 以上詳述したように、この発明に係わる金属基板を有
する集積回路は、金属基板上に絶縁層を介して所望形状
の導電層が形成された回路基板と、前記絶縁層上に取り
外し不能に取り付けられ、外部からの操作により書き換
え可能な記憶内容を不揮発に有する回路素子と、少なく
ともこの回路素子と外部とを接続する第1のコネクタ手
段と、前記回路素子の記憶内容を処理するために、前記
第1のコネクタ手段と異なる経路で、前記回路素子と外
部処理装置とを接続する第2のコネクタ手段とを具備す
ることを特徴としている。
[Effects of the Invention] As described in detail above, an integrated circuit having a metal substrate according to the present invention includes a circuit substrate having a conductive layer of a desired shape formed on a metal substrate via an insulating layer; A circuit element which is non-removably attached to the memory element and has a nonvolatile storage content which can be rewritten by an external operation, a first connector means for connecting at least the circuit element to the outside, and a processing means for processing the storage content of the circuit element. And a second connector means for connecting the circuit element and an external processing device through a path different from that of the first connector means.

また、この発明に係わる金属基板を有する集積回路に
おいて、前記導電層は、前記回路素子を他の回路素子と
接続する第1の信号線群と、第2のコネクタ手段とを結
ぶ第2の信号線群とを構成しており、この第1の信号線
群上であつて、前記回路素子に隣接する位置には、この
回路素子の記憶内容を書き換える際にデータの伝達を遮
断するように作動する信号遮断手段がされている事を特
徴としている。
Further, in the integrated circuit having the metal substrate according to the present invention, the conductive layer includes a second signal connecting a first signal line group connecting the circuit element to another circuit element and a second connector means. A line group, which is located on the first signal line group and adjacent to the circuit element so as to block data transmission when rewriting the storage contents of the circuit element. It is characterized in that there is provided a signal blocking means.

また、この発明に係わる金属基板を有する集積回路に
おいて、前記第2のコネクタ手段は、非使用状態が確定
した段階において、樹脂により重点可能に構成されてい
ること事を特徴としている。
Further, in the integrated circuit having the metal substrate according to the present invention, the second connector means is configured to be able to focus on the resin when the non-use state is determined.

従つて、この発明によれば、集積回路の開発段階にお
いて、外部からデータの書き換え、制御プログラムの変
更、記憶内容のモニタ等の記憶内容の処理作業を出来る
ようにして、開発の自由度を大きくすることの出来る金
属基板を有する集積回路が提供される事になる。
Therefore, according to the present invention, in the development stage of an integrated circuit, data rewriting, change of a control program, processing of storage contents such as monitoring of storage contents, and the like can be performed from the outside, thereby increasing the degree of freedom of development. Thus, an integrated circuit having a metal substrate that can be used is provided.

【図面の簡単な説明】[Brief description of the drawings]

第1図はこの発明に係わる金属基板を有する集積回路の
一実施例を示す斜視図; 第2図は第1図に示す集積回路の構成を示す分解斜視
図; 第3A図は第1図におけるA−A線に沿つて切断して示す
断面図; 第3B図は第1図におけるB−B線に沿つて切断して示す
断面図; 第4A図は共通基板の構成を示す平面図; 第4B図は共通基板の構成を示す断面図; 第5図は雄型コネクタが取り付けられた集積回路の構成
を示す断面図; 第6図は雄型コネクタの構成を具体的に示す分解斜視
図; 第7図は雄型コネクタを組み立てられた状態で示す正面
図; 第8図は両接続ピン支持体が、開かれた状態の回路基板
に夫々固定された状態を示す上面図; 第9図は第1の回路基板上の回路素子の配設状態を概略
的に示す斜視図; 第10図は第9図に示す第1の回路基板におけるECUのブ
ロツク構成を示すブロツク図;そして、 第11図は第9図に示す第1の回路基板上におけるCPUと
記憶素子との具体的な接続状態を示す結線図である。 図中、10……混成集積回路、12a……第1の雄型コネク
タ、12b……第1の雌型コネクタ、14a……第2の雌型コ
ネクタ、14b……第2の雄型コネクタ、16a……第1の回
路基板、16b……第2の回路基板、16c;16d……突出部、
18……側板、18a;18b……段部、20……枠体、20a……本
体、20b;20c……フランジ部、20d……開口、22……共通
基板、22a……基板本体、22b……絶縁層、22c……導電
層、22d……回路素子、22d1……CPU、22d2……記憶素
子、22d3……ボンデイングワイヤ、22d4……バス遮断回
路、22e……開口部、22f……フレキシブル基板、22g;22
h……接続端子、22i;22j……接続端子、24a,24b;24b…
…接続ピン、24a1;24b1……水平部、24a2;24b2……垂直
部、24a3;24b3……折曲部、26……シールラバー、28…
…コネクタハウジング、30a……上側の接続ピン支持
体、30a1……起立片、30a2……突出片、30b……下側の
接続ピン支持体、30b1……起立片、30b2……突出片、32
a;32b……凹所、34……嵌合穴、36a;36b……フレーム部
材、38……エポキシ系樹脂、40a;40b……フランジ部、4
2……接続コード、44……チユーニング装置である。
FIG. 1 is a perspective view showing an embodiment of an integrated circuit having a metal substrate according to the present invention; FIG. 2 is an exploded perspective view showing a configuration of the integrated circuit shown in FIG. 1; FIG. 3B is a cross-sectional view taken along line AA; FIG. 3B is a cross-sectional view taken along line BB in FIG. 1; FIG. 4A is a plan view showing a configuration of a common substrate; 4B is a cross-sectional view showing the configuration of the common board; FIG. 5 is a cross-sectional view showing the configuration of an integrated circuit to which the male connector is attached; FIG. 6 is an exploded perspective view specifically showing the configuration of the male connector; FIG. 7 is a front view showing the assembled state of the male connector; FIG. 8 is a top view showing a state in which both connection pin supports are fixed to the circuit board in an opened state, respectively; FIG. 10 is a perspective view schematically showing an arrangement state of circuit elements on a first circuit board; FIG. 10 is a first circuit shown in FIG. Block diagram showing a block configuration of an ECU in the plate; and FIG. 11 is a connection diagram showing a specific connection between the CPU and the memory element in the first circuit board illustrated in Figure 9. In the figure, 10 ... a hybrid integrated circuit, 12a ... a first male connector, 12b ... a first female connector, 14a ... a second female connector, 14b ... a second male connector, 16a first circuit board, 16b second circuit board, 16c; 16d projecting part,
18 ... side plate, 18a; 18b ... step, 20 ... frame, 20a ... body, 20b; 20c ... flange, 20d ... opening, 22 ... common board, 22a ... board body, 22b ...... insulating layer, 22c ...... conductive layer, 22 d ...... circuit elements, 22d 1 ...... CPU, 22d 2 ...... storage element, 22 d 3 ...... bonding wire, 22 d 4 ...... bus blocking circuit, 22e ...... opening , 22f …… Flexible board, 22g; 22
h …… Connection terminals, 22i; 22j …… Connection terminals, 24a, 24b; 24b…
… Connection pin, 24a 1 ; 24b 1 …… horizontal part, 24a 2 ; 24b 2 …… vertical part, 24a 3 ; 24b 3 …… bending part, 26 …… seal rubber, 28…
... connector housing, 30a ...... upper connecting pin support member, 30a 1 ...... standing pieces, 30a 2 ...... protruding piece, 30b ...... lower connecting pin support, 30b 1 ...... standing pieces, 30b 2 ...... Protruding piece, 32
a; 32b… recess, 34… fitting hole, 36a; 36b… frame member, 38… epoxy resin, 40a; 40b… flange portion, 4
2 ... connection cord, 44 ... a tuning device.

Claims (3)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】金属基板上に絶縁層を介して所望形状の導
電層が形成された回路基板と、 前記絶縁層上に取り外し不能に取り付けられ、外部から
の操作により書き換え可能な記憶内容を不揮発に有する
回路素子と、 少なくともこの回路素子と外部とを接続する第1のコネ
クタ手段と、 前記回路素子の記憶内容を処理するために、前記第1の
コネクタ手段と異なる経路で、前記回路素子と外部処理
装置とを接続する第2のコネクタ手段とを具備すること
を特徴とする金属基板を有する集積回路。
A circuit board having a conductive layer of a desired shape formed on a metal substrate via an insulating layer; and a non-removable storage content which is irremovably mounted on the insulating layer and which can be rewritten by an external operation. A first connector means for connecting at least the circuit element and the outside; and a circuit different from the first connector means for processing stored contents of the circuit element. An integrated circuit having a metal substrate, comprising: a second connector means for connecting to an external processing device.
【請求項2】前記導電層は、前記回路素子を他の回路素
子と接続する第1の信号線群と、第2のコネクタ手段と
を結ぶ第2の信号線群とを構成しており、 この第1の信号線群上であつて、前記回路素子に隣接す
る位置には、この回路素子の記憶内容を書き換える際に
データの伝達を遮断するように作動する信号遮断手段が
されている事を特徴とする請求項第1項に記載の金属基
板を有する集積回路。
2. The conductive layer comprises a first signal line group for connecting the circuit element to another circuit element and a second signal line group for connecting a second connector means. On the first signal line group, at a position adjacent to the circuit element, there is provided a signal cutoff means that operates to cut off data transmission when rewriting the stored content of the circuit element. An integrated circuit having the metal substrate according to claim 1.
【請求項3】前記第2のコネクタ手段は、非使用状態が
確定した段階において、樹脂により充填可能に構成され
ている事を特徴とする請求項第1項に記載の金属基板を
有する集積回路。
3. The integrated circuit having a metal substrate according to claim 1, wherein said second connector means is configured to be filled with a resin when a non-use state is determined. .
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