JP2696901B2 - サンプリング周波数変換回路 - Google Patents

サンプリング周波数変換回路

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    • H04N7/0102Conversion of standards, e.g. involving analogue television standards or digital television standards processed at pixel level involving the resampling of the incoming video signal

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、第1のサンプリング周波数のディジタル信
号を第2のサンプリング周波数のディジタル信号に変換
するサンプリング周波数変換回路に関し、特にディジタ
ル・カラー映像信号のサンプリング・レート変換等に用
いて好適なサンプリング周波数変換回路に関する。
〔発明の概要〕
本発明は、第1のサンプリング周波数の第1のディジ
タル信号のデータ列を第2のサンプリング周波数の第2
のディジタル信号のデータ列に変換するサンプリング周
波数(データ・レート)変換回路において、上記第1の
ディジタル信号のデータ列を所定の遅延量制御信号に応
じた遅延を持たせて第2のディジタル信号のデータ列に
変換することにより、サンプリング周波数変換時に高い
精度での群遅延補正を可能とするものである。
〔従来の技術〕 ディジタル・カラー・ビデオ信号の一規格としてのい
わゆる4:2:2規格は、D−1規格とも称され、輝度
(Y)信号のサンプリング周波数f1を13.5MHzとし、R
−Y及びB−Yの各色差信号のサンプリング周波数をそ
れぞれ上記f1の1/2の6.75MHzとするディジタル・コン
ポーネント信号を用いているのに対して、NTSC方式のコ
ンポジット・カラー信号をそのままディジタル化する場
合のサンプリング周波数f2は、色副搬送波周波数fSC
の整数倍、たとえば4fSC(≒14.318MHz)に設定され
る。従って、これらの間で信号変換を行う際には、サン
プリング周波数(サンプリング・レート)を上記f1
2との間で変換することが必要とされる。
すなわち、第4図は上記NTSC方式のディジタル・コン
ポジット信号から上記4:2:2規格(D−1規格)のディ
ジタル・コンポーネント信号に変換するための方式変換
回路の一例を示している。この第4図の入力端子101に
供給された上記NTSC方式のディジタル・コンポジット信
号(サンプリング周波数f2=4fSC)は、ディジタルY/C
分離回路102にてYNT信号とCNT信号(添え字のNTはNTS
C方式を示す)とに分離される。YNT信号は、第5図に
示すように上記周波数f2=4fSC、すなわち1/4fSC周期
のサンプル・データ列から成っており、このYNT信号は
サンプリング周波数変換回路(サンプリング・レート・
コンバータ)103に送られ、上記D−1規格のサンプリ
ング周波数f1(=13.5MHz)の輝度信号YD1に変換され
てY出力端子104から取り出される。Y/C分離回路102か
らのCNT信号は、デコード回路107に送られて復調され
ることにより、ディジタルのINT信号及びQNT信号が得
られる。このときのI、Q復調(デコード)について説
明すると、NTSC方式における元のアナログの搬送色信号
Cが、 C=Icos(ωSCt+φ)+Qsin(ωSCt+φ) ただし、ωSC=2πfSC と表され、上記f2=4fSCのサンプリング周波数でサン
プリングするときの位相(あるいは時間軸上の位置)が
0、π/2、π、……のように0からπ/2(=90°)単位
で増加するとき、上記ディジタル搬送色信号CNT自体が
1/4fSC毎にI、Q、−I、−Q、……を示すものとなっ
ているから、デコード回路107においては、例えば入力
された色信号CNTのデータ列に対して順次±1を乗算し
ながら1/4fSC毎にIとQとに(1/2fSC周期で)振り分け
ることにより第5図に示すような信号INT及び信号QNT
を得ることができる。これらの信号INT、QNTは、サン
プリング周波数が2fSCで互いに等しく、各信号のデータ
の間の時間差(オフセット)が1/4fSCとなっている。こ
のようにサンプリング時点のずれたI、Q信号データを
用いてR−Y、B−Y等を求めるためのマトリクス演算
を行うことはできないため、補間回路108、109によりそ
れぞれ他の信号のサンプリング時点(第5図の信号
NT、QNTの×印参照)でのデータを補間して、第5図
の信号If2、Qf2に示すように、周波数がいずれもf2
(=4fSC)で等しく、各サンプル・データのサンプリン
グ時点も等しい信号を得ている。これらの信号If2、Q
f2に基づいてマトリクス演算回路110にてマトリクス演
算を行うことにより、同じサンプリング周波数f2(=4
fSC)の信号(R−Y)f2及び信号(B−Y)f2を得て
いる。これらの信号(R−Y)f2(B−Y)f2は、それ
ぞれサンプリング周波数変換回路111、112により、第5
図に示すように互いに等しいサンプリング周波数f1/2
で同じサンプリング時点の信号(R−Y)D1及び信号
(B−Y)D1に変換され、出力端子113、114からそれぞ
れ取り出される。
次に、第6図は、上述の変換とは逆向きに、上記D−
1規格(4:2:2規格)からNTSC方式のディジタル・コン
ポジット信号に変換するための方式変換回路の一例を示
している。この場合、入力端子121に供給される信号Y
D1はそのままサンプリング周波数変換回路122に送られ
て上記周波数f1からf2に変換され、上記信号YNTとな
って加算器123に送られている。また、各入力端子131及
び132にそれぞれ供給される色差信号(R−Y)D1及び
色差信号(B−Y)D1は、それぞれサンプリング周波数
変換回路133及び134にて周波数f1/2からf2/2(=2
fSC)に変換された後、補間回路135、136によりそれぞ
れサンプリング周波数がf2(=4fSC)の信号(R−
Y)f2及び信号(B−Y)f2となるように補間処理され
る。これらのサンプリング周波数が4fSCの信号(R−
Y)f2及び信号(B−Y)f2は、マトリクス演算回路13
7に送られて演算されることにより、サンプリング周波
数がf2(=4fSC)の信号If2及び信号Qf2が求めら
れ、これらが変調回路138に送られて周波数fSCの信号
を搬送波とする変調処理が施されることによりディジタ
ル搬送色信号CNTとなる。この場合の具体的な変調動作
は、上述したアナログ搬送色信号の式 C=Icos(ωSCt+φ)+Qsin(ωSCt+φ) ただし、ωSC=2πfSC における各cos値及びsin値に、サンプリング周波数1/4f
SC毎に順次(1,0)、(0,1)、(−1,0)、(0,−1)
の値を、1/fSCを繰り返し周期として代入することに対
応し、これは上記1/4fSC毎にI信号データとQ信号デー
タとが交互に表れることに相当する。このようにして得
られたサンプリング周波数4fSCのディジタル搬送色信号
NTは、加算器123に送られて上記ディジタル輝度信号
NTと加算されて重畳され、サンプリング周波数4fSC
NTSC方式ディジタル・コンポジット信号が出力端子124
から取り出される。
〔発明が解決しようとする課題〕
ところで、これらの方式変換回路構成においては、例
えば第4図のNTSC方式のコンポジット信号から4:2:2規
格のコンポーネント信号に変換する場合に、輝度信号
(YNT)系とクロマ信号(CNT)系のそれぞれの周波数
特性が異なることにより、サンプリング周波数変換用の
フィルタの特性が異なり、輝度信号とクロマ信号間の群
遅延が異なり、輝度信号とクロマ信号間の群遅延が異な
ってくる。これらの両者の群遅延のずれの補正をサンプ
ル遅延等の通常の方法で行う場合の補正誤差は、出力側
(4:2:2規格)のサンプリング周期をT1(=1/f1、f1
=13.5KHzより約74ns)とするとき、最大±T1/2(=約
37ns)となる。このため、再生画像において色ずれ等の
悪影響が生ずる虞れがある。また、第6図のように、4:
2:2規格からNTSC方式に変換する場合においては、各種
映像信号処理特性や記録再生特性等の影響等により、入
力されるディジタル・コンポーネント信号の輝度信号と
色差信号との間で群遅延が生じていることがあるが、こ
の群遅延のずれについてもサンプリング周期単位で補正
を行うのみでは画像に悪影響を与える虞れがある。
本発明は、このような実情に鑑みてなされたものであ
り、サンプリング周波数変換出力のサンプリング周期単
位よりも細かい単位で群遅延補正が可能なサンプリング
周波数変換回路の提供を目的とする。
〔課題を解決するための手段〕
本発明に係るサンプリング周波数変換回路は、上述し
たような課題を解決するために、第1のサンプリング周
波数を有する第1のディジタル信号のデータ列を第2の
サンプリング周波数を有する第2のディジタル信号のデ
ータ列に変換するサンプリング周波数変換回路であっ
て、上記第1、第2のサンプリング周波数よりも高い第
3の周波数に対応する周期を単位とする補間処理により
上記第1のディジタル信号のデータ列を補間処理して上
記第2のサンプリング周波数のデータ列を得る構成を有
し、上記補間処理の際の遅延量を所定の遅延量制御信号
に応じて上記第3の周波数に対応する周期単位で制御す
ることを特徴としている。
具体的には、例えば、第1のディジタル信号のデータ
列を、第1、第2のサンプリング周波数の最小公倍数で
これらの第1、第2のサンプリング周波数よりも高い第
3の周波数でオーバ・サンプリングして、このオーバ・
サンプリングされたデータ列から第2のサンプリング周
波数のデータ列を抜き出す際の抜き出しタイミングを、
上記遅延量制御信号に応じて変化させることにより、群
遅延量を変化させることができる。
〔作用〕
第1のディジタル信号のサンプリング周波数の変換の
際のデータ列の出力タイミングが上記遅延量制御信号に
応じて所定の群遅延を生ずるように変換処理することに
より、高い精度で群遅延量の調整が行える。
〔実施例〕
以下、本発明に係る好ましい実施例について、図面を
参照しながら説明する。
先ず第1図は、本発明に係るサンプリング周波数変換
回路の一実施例を示すブロック回路図であり、入力端子
1には第1のサンプリング周波数faのディジタル入力信
号DINが供給されている。例えば前記第4図のNTSC方式
のコンポジット信号から4:2:2規格のコンポーネント信
号に変換する場合には、サンプリング周波数f2のディ
ジタル輝度信号YNTあるいは周波数f2/2のディジタル
色差信号INT、QNT等である。サンプリング周波数変換
回路は、上記サンプリング周波数fa(例えばf2=4
fSC)を第2のサンプリング周波数fb、例えば4:2:2規格
のサンプリング周波数f1のディジタル出力信号DOUT
変換して出力端子2より出力するものである。
このサンプリング周波数変換回路内には、各種タイミン
グ・パルスを発生するためのタイミング・パルス発生回
路11が設けられている。入力端子1に供給される上記デ
ィジタル入力信号DINは、Dフリップフロップ12を介し
て例えばオーバ・サンプリング・フィルタ13に送られる
ことにより、上記各サンプリング周波数fa,fbの最小公
倍数でこれらの周波数fa,fbよりも高い第3の周波数fS
のデータ列に変換される。この場合これらの周波数fa、
fb及びfSは、互いに素となる自然数na、nbにより、 naa=nbb=fS の関係を満足し、上記自然数na、nbは、 na:nb=fb:fa となっている。例えば入力側のサンプリング周波数fa
をNTSC方式のf2=4fSCとし、出力側のサンプリング周
波数fbをD−1(4:2:2)規格のf1とするとき、上記
自然数na、nbの具体的数値は、na=33、nb=35とな
る。このようなオーバ・サンプリング・フィルタ13から
のサンプリング周波数がfS(=33f2=35f1)の信号
は、選択ゲート14によりサンプリング周波数fb(=
1)のレートでデータが選択され、Dフリップフロッ
プ15を介して出力される。ここで入力側Dフリップフロ
ップ12のクロック周波数はfa(=f2)、出力側Dフリ
ップフロップ15にクロック周波数はfb(=f1)となっ
ており、これらのクロック信号やオーバ・サンプリング
・フィルタ13のクロック信号及び選択ゲート14への選択
信号等は、上記タイミング・パルス発生回路11から出力
される。
タイミング・パルス発生回路11には、遅延量制御信号
が入力端子3を介して供給されており、この遅延量制御
信号に応じて上記選択ゲート14への選択信号のタイミン
グ(位相あるいは群遅延量)が制御されるようになって
いる。
ここでオーバ・サンプリング・フィルタ13としては、
従来から知られている例えば第2図に示すような構成の
回路を用いればよい。この第2図の例においては、非巡
回型あるいはFIRディジタル・フィルタ構成のオーバ・
サンプリング・フィルタを示しており、複数個、例えば
N個(Nはna以上の整数)の遅延素子D,…,Dが直列接
続され、これらの遅延素子の各接続点(直列接続回路の
入力端及び出力端も含むN+1個の点)からの出力をN
+1個の係数乗算器M,…,Mにそれぞれ送って係数a0,
a1,…,aNをそれぞれ乗算し、これらの乗算出力を加算
器Σに送って加算している。上記遅延素子D,…,Dの各遅
延時間は互いに等しくTSとされ、この遅延時間TSは、
上記オーバ・サンプリング周波数fSの逆数である1/fS
(サンプリング周期)とされている。このオーバ・サン
プリング・フィルタ13への入力信号SINは、上記ディジ
タル入力信号DIN(サンプリング周波数fa)のDフリ
ップフロップ12を介した信号であり、第3図に示すよう
に各データ(図中の○印)の間隔が1/faとなっている。
このフィルタ入力信号SINがオーバ・サンプルされるこ
とによって、第3図のOVSに示すようなTS周期の各タイ
ミング毎に、すなわちオーバ・サンプリング周波数fS
の各サンプリング時点毎にオーバ・サンプル・フィルタ
出力が得られる。これらのデータのうちから、選択ゲー
ト14により周期1/fbのサンプリング時点毎のデータを抜
き出すことにより、信号SOUTを得ている。このときの
データ抜き出しタイミングが上記入力端子3からの遅延
量制御信号に応じて制御されることによって、信号の群
遅延量を制御することができる。これは、サンプリング
周波数変換回路からの最終的な出力信号DOUTの各デー
タの出力タイミングは、出力側Dフリップフロップ15に
より決定されており、上記信号SOUTの各データの出力
位相変化に応じて信号SOUTと信号DOUTとの間の遅延量
が変化するからである。この場合の遅延量の調整量は、
第3図からも明らかなように、オーバ・サンプリング周
期1/fS単位で制御でき、従来と比較して精度をnb
(上記具体例では35倍)にまで高めることができる。従
って、この実施例のようなサンプリング周波数変換回路
を前述した第4図の方式変換回路のサンプリング周波数
変換回路103、111及び112として用いることにより、前
述した輝度信号と色差信号との間の群遅延補正誤差を最
大約±1.05nsに制限することができ、この程度の群遅延
誤差では再生画像に対して何ら影響を及ぼさない。
なお、前記第4図の方式変換回路における色差信号I
NT、QNTのレート変換用に上記実施例のサンプリング周
波数変換回路を用いる場合には、上記選択ゲート14での
データ抜き出しタイミングをI信号とQ信号との間で前
記オフセット(時間差)の分の1/4fSCだけずらして信号
OUTを得るようにすることにより、前記第4図の補間
回路108及び109を省略することが可能であり、このよう
なサンプリング周波数変換回路は、デコード回路107と
マトリクス演算回路110との間の各I信号系、Q信号系
に挿入接続すればよい。このとき、これらのI信号系、
Q信号系の各サンプリング周波数変換回路からは、周波
数がf1/2で同じサンプリング時点のデータ列から成る
I信号、Q信号を得ることができる。
また、本発明の上記実施例を、前述した第6図の方式
変換回路のサンプリング周波数変換回路122、133及び13
4として用いることにより、群遅延誤差を大幅に低減す
ることができ、この場合も補間回路135、136を省略する
ことができる。
このように従来の補間回路を省略することにより、回
路構成が簡略化されてコスト・ダウンが図れると共に、
信号処理回路が少ないため信号劣化を少なくできる。
なお本発明は、上記実施例のみに限定されるものでは
ない。例えば、オーバ・サンプリング・フィルタの具体
的構成は第2図の例に限定されず、係数乗算器の各係数
値を1サンプル時間毎に変化させて構成を簡略化するも
のや、巡回型あるいはIIRディジタル・フィルタ構成の
もの等を用いることができる。また、サンプリング周波
数変換回路は、オーバ・サンプリング・フィルタを用い
なくとも例えば補間処理回路により構成することもで
き、この補間回路により変換周波数の各データ出力タイ
ミングに相当するデータを順次求めてゆき、フリップフ
ロップ等のラッチ・タイミングを変換周波数に一致させ
ることにより、サンプリング周波数(データ・レート)
変換を行わせてもよい。さらに、上述した輝度信号と色
差信号との間の群遅延補正のみならず、2つの色差信号
間の群遅延のずれの補正や、各種信号の遅延量制御に適
用可能である。この他本発明の要旨を逸脱しない範囲内
において種々の変更が可能であることは勿論である。
〔発明の効果〕
本発明に係るサンプリング周波数変換回路によれば、
第1のサンプリング周波数のディジタル信号を、第1、
第2のサンプリング周波数よりも高い第3の周波数の精
度で補間処理して第2のサンプリング周波数のディジタ
ル信号に変換する際、例えば、オーバ・サンプリングに
より第3の周波数のデータ列に変換した後に第2のサン
プリングのタイミングでデータを取り出す際に、出力デ
ータ列の群遅延量を遅延量制御信号に応じて制御するこ
とにより、第3の周波数に対応する周期の精度で群遅延
量の制御が行える。
また、2系列のディジタル信号の各データ間に所定の
オフセットが存在する場合でも、サンプリング周波数の
変換の際に、一方のディジタル信号の周波数変換の入出
力タイミングに対して、他方のディジタル信号の周波数
変換の入出力タイミングが上記オフセット分の時間ずれ
を生ずるように変換することにより、サンプリング周波
数変換と同時に補間処理を行うことができ、補間回路と
サンプリング周波数変換回路の両者を個別に設ける必要
がなくなり、信号劣化の防止や回路構成の簡略化が可能
となる。
【図面の簡単な説明】
第1図は本発明の一実施例となるサンプリング周波数変
換回路を示すブロック回路図、第2図はオーバ・サンプ
リング・フィルタの具体例を示すブロック回路図、第3
図は該実施例の動作を説明するためのタイミング・チャ
ート、第4図はNTSC方式のディジタル・コンポジット信
号から4:2:2規格(D−1規格)のディジタル・コンポ
ーネント信号に変換するための方式変換回路の一例を示
すブロック回路図、第5図はこの第4図の回路の動作を
説明するためのタイミング・チャート、第6図は4:2:2
規格(D−1規格)のディジタル・コンポーネント信号
からNTSC方式のディジタル・コンポジット信号に変換す
るための方式変換回路の一例を示すブロック回路図であ
る。 1……信号DIN入力端子 2……信号DOUT出力端子 3……遅延量制御信号入力端子 12、15……Dフリップフロップ 13……オーバ・サンプリング・フィルタ 14……選択ゲート
フロントページの続き (72)発明者 黒瀬 悦和 東京都品川区北品川6丁目7番35号 ソ ニー株式会社内 (72)発明者 稲場 義明 東京都品川区北品川6丁目7番35号 ソ ニー株式会社内 (56)参考文献 特開 平1−109813(JP,A) 特開 平1−126894(JP,A)

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項1】第1のサンプリング周波数を有する第1の
    ディジタル信号のデータ列を第2のサンプリング周波数
    を有する第2のディジタル信号のデータ列に変換するサ
    ンプリング周波数変換回路であって、 上記第1、第2のサンプリング周波数よりも高い第3の
    周波数に対応する周期を単位とする補間処理により上記
    第1のディジタル信号のデータ列を補間処理して上記第
    2のサンプリング周波数のデータ列を得る構成を有し、 上記補間処理の際の遅延量を所定の遅延量制御信号に応
    じて上記第3の周波数に対応する周期単位で制御するこ
    と を特徴とするサンプリング周波数変換回路。
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