JP2626684B2 - 音響データ出力回路 - Google Patents
音響データ出力回路Info
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- JP2626684B2 JP2626684B2 JP2045095A JP4509590A JP2626684B2 JP 2626684 B2 JP2626684 B2 JP 2626684B2 JP 2045095 A JP2045095 A JP 2045095A JP 4509590 A JP4509590 A JP 4509590A JP 2626684 B2 JP2626684 B2 JP 2626684B2
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- G10K—SOUND-PRODUCING DEVICES; METHODS OR DEVICES FOR PROTECTING AGAINST, OR FOR DAMPING, NOISE OR OTHER ACOUSTIC WAVES IN GENERAL; ACOUSTICS NOT OTHERWISE PROVIDED FOR
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- G10K5/02—Ultrasonic whistles
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- G—PHYSICS
- G10—MUSICAL INSTRUMENTS; ACOUSTICS
- G10K—SOUND-PRODUCING DEVICES; METHODS OR DEVICES FOR PROTECTING AGAINST, OR FOR DAMPING, NOISE OR OTHER ACOUSTIC WAVES IN GENERAL; ACOUSTICS NOT OTHERWISE PROVIDED FOR
- G10K15/00—Acoustics not otherwise provided for
- G10K15/02—Synthesis of acoustic waves
-
- G—PHYSICS
- G10—MUSICAL INSTRUMENTS; ACOUSTICS
- G10H—ELECTROPHONIC MUSICAL INSTRUMENTS; INSTRUMENTS IN WHICH THE TONES ARE GENERATED BY ELECTROMECHANICAL MEANS OR ELECTRONIC GENERATORS, OR IN WHICH THE TONES ARE SYNTHESISED FROM A DATA STORE
- G10H1/00—Details of electrophonic musical instruments
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-
- G—PHYSICS
- G10—MUSICAL INSTRUMENTS; ACOUSTICS
- G10H—ELECTROPHONIC MUSICAL INSTRUMENTS; INSTRUMENTS IN WHICH THE TONES ARE GENERATED BY ELECTROMECHANICAL MEANS OR ELECTRONIC GENERATORS, OR IN WHICH THE TONES ARE SYNTHESISED FROM A DATA STORE
- G10H2230/00—General physical, ergonomic or hardware implementation of electrophonic musical tools or instruments, e.g. shape or architecture
- G10H2230/045—Special instrument [spint], i.e. mimicking the ergonomy, shape, sound or other characteristic of a specific acoustic musical instrument category
- G10H2230/251—Spint percussion, i.e. mimicking percussion instruments; Electrophonic musical instruments with percussion instrument features; Electrophonic aspects of acoustic percussion instruments, MIDI-like control therefor
- G10H2230/351—Spint bell, i.e. mimicking bells, e.g. cow-bells
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- Reverberation, Karaoke And Other Acoustics (AREA)
- Electrophonic Musical Instruments (AREA)
Description
【発明の詳細な説明】 ［産業上の利用分野］ 本発明は音響データ出力回路に関するものである。
［従来の技術］ 例えば、報時時計において、15分毎に音響データ出力
回路からウェストミンスターチャイム等の音響データを
読み出してメロディを発生するものがある。この種のも
のでは、音響データの記憶回路の記憶容量を小さくする
ために、例えば、鐘の音の基本音波形のPCMデータを１
音分だけROMに記憶させておき、このデータを読み出す
クロック信号の周波数を変えることによって音階を変
え、１音分のデータだけでメロディを奏鳴するようにし
たものがある。
回路からウェストミンスターチャイム等の音響データを
読み出してメロディを発生するものがある。この種のも
のでは、音響データの記憶回路の記憶容量を小さくする
ために、例えば、鐘の音の基本音波形のPCMデータを１
音分だけROMに記憶させておき、このデータを読み出す
クロック信号の周波数を変えることによって音階を変
え、１音分のデータだけでメロディを奏鳴するようにし
たものがある。
［解決しようとする課題］ 上記のものでは、１つのデータを繰り返し読み出して
メロディを奏鳴するため、複数の音を同時に重ねて発生
させることができないものであった。つまり、１つの音
の奏鳴が終了した後につぎの音の奏鳴を開始するため、
各音がつながりをもって聞こえず、メロディの深みに欠
け、耳障りな感じさえ与えるものであった。
メロディを奏鳴するため、複数の音を同時に重ねて発生
させることができないものであった。つまり、１つの音
の奏鳴が終了した後につぎの音の奏鳴を開始するため、
各音がつながりをもって聞こえず、メロディの深みに欠
け、耳障りな感じさえ与えるものであった。
本発明は、１波形分の音響データのみで深みのある聞
き易い音響を発生しうる音響データ出力回路を提供する
ことを目的としている。
き易い音響を発生しうる音響データ出力回路を提供する
ことを目的としている。
［課題を解決するための手段］ 本発明は、複数の振幅データから構成された１波形分
の音響データを記憶してある音響データ記憶回路（１）
と、異なる周期のクロック信号が入力される複数のクロ
ック信号入力部と、上記複数のクロック信号のそれぞれ
に対応して設けられ、入力されるクロック信号を計数し
計数値を出力する複数のアドレスカウンタ（２）と、上
記複数のクロック信号のそれぞれに対応して設けられ、
上記音響データ記憶回路（１）から読み出される振幅デ
ータを一時的に記憶する一時記憶回路（14,15）と、上
記複数のクロック信号を入力とし、入力されるクロック
信号に対応するアドレスカウンタ（２）と一時記憶回路
（14,15）を選択するための選択信号出力回路（４）と
を具備し、上記選択信号出力回路（４）により選択され
たアドレスカウンタ（２）が出力する計数値に対応して
上記音響データ記憶回路（１）から振幅データを読み出
し、該振幅データを上記選択信号出力回路（４）により
選択された一時記憶回路（14,15）に記憶し、該一時記
憶回路（14,15）に対応するクロック信号に同期して出
力することにより、上記目的を達成している。
の音響データを記憶してある音響データ記憶回路（１）
と、異なる周期のクロック信号が入力される複数のクロ
ック信号入力部と、上記複数のクロック信号のそれぞれ
に対応して設けられ、入力されるクロック信号を計数し
計数値を出力する複数のアドレスカウンタ（２）と、上
記複数のクロック信号のそれぞれに対応して設けられ、
上記音響データ記憶回路（１）から読み出される振幅デ
ータを一時的に記憶する一時記憶回路（14,15）と、上
記複数のクロック信号を入力とし、入力されるクロック
信号に対応するアドレスカウンタ（２）と一時記憶回路
（14,15）を選択するための選択信号出力回路（４）と
を具備し、上記選択信号出力回路（４）により選択され
たアドレスカウンタ（２）が出力する計数値に対応して
上記音響データ記憶回路（１）から振幅データを読み出
し、該振幅データを上記選択信号出力回路（４）により
選択された一時記憶回路（14,15）に記憶し、該一時記
憶回路（14,15）に対応するクロック信号に同期して出
力することにより、上記目的を達成している。
［実施例］ 以下、本発明の一実施例を図面に基づいて説明する。
第１図において、１はメロディを発生するための音響
データを記憶してある音響データ記憶回路で、例えば、
鐘の音の基本音波形のPCMデータを１音分だけ記憶させ
てある。すなわち、鐘の音の鳴り始めから鳴り終わりま
での１波形を一定周期でサンプリングして得られた複数
の振幅データを音響データとして記憶させてある。2aお
よび2bは音響データ記憶回路１のアドレスを指定するた
めのアドレスカウンタ、３はアドレスカウンタ2aおよび
2bのいずれか一方を選択し、その計数値と対応したアド
レスを指定するアドレス指定手段、４は互いに周期の異
なるクロック信号ＡおよびＢを受けてアドレスカウンタ
2aおよび2bのどちらを選択するかを指示する選択信号を
出力する選択信号出力回路である。5a〜5cおよび6a〜6c
はＤ型のフリップフロップ回路、７および８はRS型のフ
リップフロップ回路、9a、9b、10aおよび10bはゲート回
路、11は遅延回路、12a、12bおよび13はインバータ回路
であり、これらによって選択信号出力回路４が構成され
る。14aはアドレスカウンタ2aの計数値と対応するアド
レスの音響データ、すなわち１振幅データを一時的に記
憶するラッチ回路、14bはアドレスカウンタ2bの計数値
と対応するアドレスの音響データを一時的に記憶するラ
ッチ回路、15aはラッチ回路14aにラッチされている音響
データをクロック信号Ａと同期させて出力する音響デー
タラッチ回路、15bはラッチ回路14bにラッチされている
音響データをクロック信号Ｂと同期させて出力する音響
データラッチ回路である。ラッチ回路14aと音響データ
ラッチ回路15aならびにラッチ回路14bと音響データラッ
チ回路15bによってそれぞれ一時記憶回路を構成する。
データを記憶してある音響データ記憶回路で、例えば、
鐘の音の基本音波形のPCMデータを１音分だけ記憶させ
てある。すなわち、鐘の音の鳴り始めから鳴り終わりま
での１波形を一定周期でサンプリングして得られた複数
の振幅データを音響データとして記憶させてある。2aお
よび2bは音響データ記憶回路１のアドレスを指定するた
めのアドレスカウンタ、３はアドレスカウンタ2aおよび
2bのいずれか一方を選択し、その計数値と対応したアド
レスを指定するアドレス指定手段、４は互いに周期の異
なるクロック信号ＡおよびＢを受けてアドレスカウンタ
2aおよび2bのどちらを選択するかを指示する選択信号を
出力する選択信号出力回路である。5a〜5cおよび6a〜6c
はＤ型のフリップフロップ回路、７および８はRS型のフ
リップフロップ回路、9a、9b、10aおよび10bはゲート回
路、11は遅延回路、12a、12bおよび13はインバータ回路
であり、これらによって選択信号出力回路４が構成され
る。14aはアドレスカウンタ2aの計数値と対応するアド
レスの音響データ、すなわち１振幅データを一時的に記
憶するラッチ回路、14bはアドレスカウンタ2bの計数値
と対応するアドレスの音響データを一時的に記憶するラ
ッチ回路、15aはラッチ回路14aにラッチされている音響
データをクロック信号Ａと同期させて出力する音響デー
タラッチ回路、15bはラッチ回路14bにラッチされている
音響データをクロック信号Ｂと同期させて出力する音響
データラッチ回路である。ラッチ回路14aと音響データ
ラッチ回路15aならびにラッチ回路14bと音響データラッ
チ回路15bによってそれぞれ一時記憶回路を構成する。
つぎに、第２図のタイムチャートを参照しながら動作
を説明する。端子ｃには第２図（ａ）に示す基準クロッ
ク信号Ｃが印加され、端子ａには同図（ｂ）に示すクロ
ック信号Ａが印加され、端子ｂには同図（ｃ）に示すク
ロック信号Ｂが印加される。クロック信号ＡとＢとは互
いに周期の異なるものである。
を説明する。端子ｃには第２図（ａ）に示す基準クロッ
ク信号Ｃが印加され、端子ａには同図（ｂ）に示すクロ
ック信号Ａが印加され、端子ｂには同図（ｃ）に示すク
ロック信号Ｂが印加される。クロック信号ＡとＢとは互
いに周期の異なるものである。
まず、クロック信号Ｂが入力されると、第２図（ｅ）
に示すように、クロック信号Ｂの立下りによってフリッ
プフロップ回路6aの出力すなわち端子ｅの信号が“1"と
なる。これにより、フリップフロップ回路７がセット状
態となり、端子ｆに“1"、端子ｇに“0"の信号が出力さ
れ、それぞれゲート回路9aおよび9bに供給される。これ
により、第２図（ｉ）のように、端子ｉの信号は“0"と
なり、これを受けてフリップフロップ回路6bの出力すな
わち端子ｋの信号が“1"となる。この端子ｋの信号はゲ
ート回路10bで基準クロック信号Ｃと同期がとられて第
２図（ｍ）のように端子ｍに出力される。端子ｍの信号
の立上りによってフリップフロップ回路８はセット状態
となり、端子ｐの信号が“1"となり、これがインバータ
回路13で“0"に反転されてアドレス指定手段３に供給さ
れる。
に示すように、クロック信号Ｂの立下りによってフリッ
プフロップ回路6aの出力すなわち端子ｅの信号が“1"と
なる。これにより、フリップフロップ回路７がセット状
態となり、端子ｆに“1"、端子ｇに“0"の信号が出力さ
れ、それぞれゲート回路9aおよび9bに供給される。これ
により、第２図（ｉ）のように、端子ｉの信号は“0"と
なり、これを受けてフリップフロップ回路6bの出力すな
わち端子ｋの信号が“1"となる。この端子ｋの信号はゲ
ート回路10bで基準クロック信号Ｃと同期がとられて第
２図（ｍ）のように端子ｍに出力される。端子ｍの信号
の立上りによってフリップフロップ回路８はセット状態
となり、端子ｐの信号が“1"となり、これがインバータ
回路13で“0"に反転されてアドレス指定手段３に供給さ
れる。
また、端子ｍの信号の立下りによってフリップフロッ
プ回路6cの出力すなわち端子ｏの信号が“1"となり、フ
リップフロップ回路6aおよび6bがリセットされる。
プ回路6cの出力すなわち端子ｏの信号が“1"となり、フ
リップフロップ回路6aおよび6bがリセットされる。
アドレス指定手段３は選択信号出力回路４からの出力
信号が“0"のときにはアドレスカウンタ2bを選択し、そ
の計数値と対応している音響データ記憶回路１のアドレ
スを指定する。第２図（ｑ）のように、いま音響データ
記憶回路１から読み出されている音響データすなわちア
ドレスカウンタ2bの計数値と対応している音響データを
B1とする。音響データ記憶回路１はアドレス指定手段３
によって指定されたアドレスの音響データを基準クロッ
ク信号Ｃに同期して出力する。この音響データB1はラッ
チ回路14aおよび14bに供給されるが、いま第２図（ｍ）
のように端子ｍの信号が“0"に立ち下がるので、第２図
（ｓ）のようにラッチ回路14bに音響データB1がラッチ
される。ラッチ回路14bにラッチされた音響データは音
響データラッチ回路15bに供給され、ここから第２図
（ｕ）のようにクロック信号Ｂと同期して出力される。
信号が“0"のときにはアドレスカウンタ2bを選択し、そ
の計数値と対応している音響データ記憶回路１のアドレ
スを指定する。第２図（ｑ）のように、いま音響データ
記憶回路１から読み出されている音響データすなわちア
ドレスカウンタ2bの計数値と対応している音響データを
B1とする。音響データ記憶回路１はアドレス指定手段３
によって指定されたアドレスの音響データを基準クロッ
ク信号Ｃに同期して出力する。この音響データB1はラッ
チ回路14aおよび14bに供給されるが、いま第２図（ｍ）
のように端子ｍの信号が“0"に立ち下がるので、第２図
（ｓ）のようにラッチ回路14bに音響データB1がラッチ
される。ラッチ回路14bにラッチされた音響データは音
響データラッチ回路15bに供給され、ここから第２図
（ｕ）のようにクロック信号Ｂと同期して出力される。
このように、クロック信号Ｂのパルス数を計数し、そ
の計数値と対応する音響データがクロック信号Ｂと同期
して出力される。
の計数値と対応する音響データがクロック信号Ｂと同期
して出力される。
つぎに、クロック信号Ａが入力されると、第２図
（ｄ）に示すように、クロック信号Ａの立下りによって
フリップフロップ回路5aの出力すなわち端子ｄの信号が
“1"となる。これにより、フリップフロップ回路７がリ
セット状態となり、端子ｆに“0"、端子ｇに“1"の信号
が出力され、それぞれゲート回路9aおよび9bに供給され
る。これにより、第２図（ｈ）のように、端子ｈの信号
が“0"となり、これを受けてフリップフロップ回路5bの
出力すなわち端子ｊの信号が“1"となる。この端子ｊの
信号はゲート回路10aで基準クロック信号Ｃと同期がと
られて第２図（ｌ）のように端子ｌに出力される。端子
ｌの信号の立上りによってフリップフロップ回路８はリ
セット状態となり、端子ｑの信号が“0"となり、これが
インバータ回路13で“1"に反転されてアドレス指定手段
３に供給される。
（ｄ）に示すように、クロック信号Ａの立下りによって
フリップフロップ回路5aの出力すなわち端子ｄの信号が
“1"となる。これにより、フリップフロップ回路７がリ
セット状態となり、端子ｆに“0"、端子ｇに“1"の信号
が出力され、それぞれゲート回路9aおよび9bに供給され
る。これにより、第２図（ｈ）のように、端子ｈの信号
が“0"となり、これを受けてフリップフロップ回路5bの
出力すなわち端子ｊの信号が“1"となる。この端子ｊの
信号はゲート回路10aで基準クロック信号Ｃと同期がと
られて第２図（ｌ）のように端子ｌに出力される。端子
ｌの信号の立上りによってフリップフロップ回路８はリ
セット状態となり、端子ｑの信号が“0"となり、これが
インバータ回路13で“1"に反転されてアドレス指定手段
３に供給される。
また、端子ｌの信号の立下りによってフリップフロッ
プ回路5cの出力すなわち端子ｎの信号が“1"となり、フ
リップフロップ回路5aおよび5bがリセットされる。
プ回路5cの出力すなわち端子ｎの信号が“1"となり、フ
リップフロップ回路5aおよび5bがリセットされる。
アドレス指定手段３は選択信号出力回路４からの出力
信号が“1"のときにはアドレスカウンタ2aを選択し、そ
の計数値と対応している音響データ記憶回路１のアドレ
スを指定する。第２図（ｑ）のように、いま音響データ
記憶回路１から読み出されている音響データすなわちア
ドレスカウンタ2aの計数値と対応している音響データを
A1とする。音響データ記憶回路１はアドレス指定手段３
によって指定されたアドレスの音響データを基準クロッ
ク信号Ｃに同期して出力する。この音響データA1はラッ
チ回路14aおよび14bに供給されるが、いま第２図（ｌ）
のように端子ｌの信号が“0"に立ち下がるので、第２図
（ｒ）のようにラッチ回路14aに音響データA1がラッチ
される。ラッチ回路14aにラッチされた音響データは音
響データラッチ回路15aに供給され、ここから第２図
（ｔ）のようにクロック信号Ａと同期して出力される。
信号が“1"のときにはアドレスカウンタ2aを選択し、そ
の計数値と対応している音響データ記憶回路１のアドレ
スを指定する。第２図（ｑ）のように、いま音響データ
記憶回路１から読み出されている音響データすなわちア
ドレスカウンタ2aの計数値と対応している音響データを
A1とする。音響データ記憶回路１はアドレス指定手段３
によって指定されたアドレスの音響データを基準クロッ
ク信号Ｃに同期して出力する。この音響データA1はラッ
チ回路14aおよび14bに供給されるが、いま第２図（ｌ）
のように端子ｌの信号が“0"に立ち下がるので、第２図
（ｒ）のようにラッチ回路14aに音響データA1がラッチ
される。ラッチ回路14aにラッチされた音響データは音
響データラッチ回路15aに供給され、ここから第２図
（ｔ）のようにクロック信号Ａと同期して出力される。
このように、クロック信号Ａのパルス数を計数し、そ
の計数値と対応する音響データがクロック信号Ａと同期
して出力される。
の計数値と対応する音響データがクロック信号Ａと同期
して出力される。
ラッチ回路15aおよび15bの出力はD/A変換されてメロ
ディとして奏鳴される。
ディとして奏鳴される。
ところで、クロック信号ＡとＢが同時に入力した場合
は、端子ｄおよび端子ｅの信号は同時に“1"となるが、
端子ｅの信号“1"は遅延回路11によって遅延されるた
め、端子ｄの信号“1"が先にフリップフロップ回路７に
入力され、リセット状態となる。このためクロック信号
Ａの読込みが終了するまで、クロック信号Ｂの読込みは
禁止される。すなわち、クロック信号Ａの方が優先され
て読み込まれるのである。
は、端子ｄおよび端子ｅの信号は同時に“1"となるが、
端子ｅの信号“1"は遅延回路11によって遅延されるた
め、端子ｄの信号“1"が先にフリップフロップ回路７に
入力され、リセット状態となる。このためクロック信号
Ａの読込みが終了するまで、クロック信号Ｂの読込みは
禁止される。すなわち、クロック信号Ａの方が優先され
て読み込まれるのである。
以上のようにして、クロック信号Ａによるアドレスカ
ウンタ2aのアドレス出力によって読み出された音響デー
タはラッチ回路15aに順次ラッチされ、クロック信号Ｂ
によるアドレスカウンタ2bのアドレス出力によって読み
出された音響データはラッチ回路15bに順次ラッチされ
ていく。したがって、互いに非同期のクロック信号Ａ、
Ｂによって単一の音響データをそれぞれ独立的に読み出
すことができ、例えば、クロック信号Ａの周波数を
“ラ”の音階の周波数に、クロック信号Ｂの周波数を
“ド”の音階の周波数に選べば、この両音階の鐘の音が
重なり合って聞こえることになる。
ウンタ2aのアドレス出力によって読み出された音響デー
タはラッチ回路15aに順次ラッチされ、クロック信号Ｂ
によるアドレスカウンタ2bのアドレス出力によって読み
出された音響データはラッチ回路15bに順次ラッチされ
ていく。したがって、互いに非同期のクロック信号Ａ、
Ｂによって単一の音響データをそれぞれ独立的に読み出
すことができ、例えば、クロック信号Ａの周波数を
“ラ”の音階の周波数に、クロック信号Ｂの周波数を
“ド”の音階の周波数に選べば、この両音階の鐘の音が
重なり合って聞こえることになる。
なお、上記実施例においてはクロック信号を２種類と
したが、これに限らず、３種類以上とし、かつその種類
に応じてアドレスカウンタ、ラッチ回路等を追加すれ
ば、３種類以上の音を同時に重ねて奏鳴することができ
る。
したが、これに限らず、３種類以上とし、かつその種類
に応じてアドレスカウンタ、ラッチ回路等を追加すれ
ば、３種類以上の音を同時に重ねて奏鳴することができ
る。
［効果］ 本発明によれば、１つの音響データ記憶回路に対して
複数系統のクロック信号によって同時に音響データの読
出しが行なえるので、回路規模を小型化して、複数の音
を重ね合わせて発生することができる。
複数系統のクロック信号によって同時に音響データの読
出しが行なえるので、回路規模を小型化して、複数の音
を重ね合わせて発生することができる。
第１図は本発明の一実施例を示した電気回路図、第２図
は第１図の動作を説明するためのタイムチャートであ
る。 １……音響データ記憶回路 2a、2b……アドレスカウンタ ３……アドレス指定手段 ４……選択信号出力回路 14a,15a……一時記憶回路 14b,15b……一時記憶回路
は第１図の動作を説明するためのタイムチャートであ
る。 １……音響データ記憶回路 2a、2b……アドレスカウンタ ３……アドレス指定手段 ４……選択信号出力回路 14a,15a……一時記憶回路 14b,15b……一時記憶回路
Claims (1)
- 【請求項１】複数の振幅データから構成された１波形分
の音響データを記憶してある音響データ記憶回路（１）
と、 異なる周期のクロック信号が入力される複数のクロック
信号入力部と、 上記複数のクロック信号のそれぞれに対応して設けら
れ、入力されるクロック信号を計数し計数値を出力する
複数のアドレスカウンタ（２）と、 上記複数のクロック信号のそれぞれに対応して設けら
れ、上記音響データ記憶回路（１）から読み出される振
幅データを一時的に記憶する一時記憶回路（14,15）
と、 上記複数のクロック信号を入力とし、入力されるクロッ
ク信号に対応するアドレスカウンタ（２）と一時記憶回
路（14,15）を選択するための選択信号出力回路（４）
とを具備し、 上記選択信号出力回路（４）により選択されたアドレス
カウンタ（２）が出力する計数値に対応して上記音響デ
ータ記憶回路（１）から振幅データを読み出し、該振幅
データを上記選択信号出力回路（４）により選択された
一時記憶回路（14,15）に記憶し、該一時記憶回路（14,
15）に対応するクロック信号に同期して出力することを
特徴とする音響データ出力回路。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2045095A JP2626684B2 (ja) | 1990-02-26 | 1990-02-26 | 音響データ出力回路 |
| KR1019910001645A KR940001091B1 (ko) | 1990-02-26 | 1991-01-31 | 음향 데이타 출력회로 |
| GB9102625A GB2242773B (en) | 1990-02-26 | 1991-02-07 | Acoustic data output device |
| DE4104589A DE4104589A1 (de) | 1990-02-26 | 1991-02-14 | Tondaten-ausgabevorrichtung |
| US07/661,729 US5303629A (en) | 1990-02-26 | 1991-02-26 | Acoustic data output device having single addressable memory |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2045095A JP2626684B2 (ja) | 1990-02-26 | 1990-02-26 | 音響データ出力回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03248196A JPH03248196A (ja) | 1991-11-06 |
| JP2626684B2 true JP2626684B2 (ja) | 1997-07-02 |
Family
ID=12709748
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2045095A Expired - Fee Related JP2626684B2 (ja) | 1990-02-26 | 1990-02-26 | 音響データ出力回路 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5303629A (ja) |
| JP (1) | JP2626684B2 (ja) |
| KR (1) | KR940001091B1 (ja) |
| DE (1) | DE4104589A1 (ja) |
| GB (1) | GB2242773B (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE19710334A1 (de) * | 1997-03-13 | 1998-09-17 | Kai Mann | Programmierbare und abrufbare Speicheranordnung |
Family Cites Families (11)
| Publication number | Priority date | Publication date | Assignee | Title |
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