JP2504292B2 - Ｍｕｓｅデコ―ダの子画面表示用回路 - Google Patents
Ｍｕｓｅデコ―ダの子画面表示用回路Info
- Publication number
- JP2504292B2 JP2504292B2 JP2133083A JP13308390A JP2504292B2 JP 2504292 B2 JP2504292 B2 JP 2504292B2 JP 2133083 A JP2133083 A JP 2133083A JP 13308390 A JP13308390 A JP 13308390A JP 2504292 B2 JP2504292 B2 JP 2504292B2
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- Japan
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- signal
- circuit
- input
- converter
- screen
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- Television Systems (AREA)
- Processing Of Color Television Signals (AREA)
- Studio Circuits (AREA)
- Color Television Systems (AREA)
- Transforming Electric Information Into Light Information (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、MUSEデコーダの子画面表示用回路に関し、
特に子画面表示用信号の入力信号処理回路に関する。
特に子画面表示用信号の入力信号処理回路に関する。
従来の子画面表示用回路においては、第２図に示すよ
うに入力端子10を介して入力される子画面用信号に対し
て専用のA/D変換器15を設けて、同A/D変換器15でデジタ
ル信号に変換して出力し子画面表示信号作成回路13に入
力して、同子画面表示信号作成回路13で信号処理を行い
子画面表示用信号を作成し出力して親画面・子画面合成
回路14に入力し、同親画面・子画面合成回路14でMUSEデ
コーダの信号再生回路により再生された親画面表示用信
号に合成して出力し、同出力に基づき親画面に子画面を
表示するようにしていた。
うに入力端子10を介して入力される子画面用信号に対し
て専用のA/D変換器15を設けて、同A/D変換器15でデジタ
ル信号に変換して出力し子画面表示信号作成回路13に入
力して、同子画面表示信号作成回路13で信号処理を行い
子画面表示用信号を作成し出力して親画面・子画面合成
回路14に入力し、同親画面・子画面合成回路14でMUSEデ
コーダの信号再生回路により再生された親画面表示用信
号に合成して出力し、同出力に基づき親画面に子画面を
表示するようにしていた。
MUSEデコーダでは8.1MHzの伝送ロールオフ特性を満足
させるため、MUSEデコーダの入力回路に直列に接続され
た波形等化用A/D変換器とデジタルフィルタが使用され
ているが、これらは画質には余り影響がなく、その上画
面上に子画面表示をした場合視聴者は表示された子画面
を注視するようになるため、子画面表示時はMUSE信号の
再生回路から波形等化用回路を切り離すことができ、さ
らに子画面は画面が小さいため表示画面に対して高い解
像度は要求されないため、量子化ビットは適当なビット
数があれば良いため、子画面用信号を波形等化用A/D変
換器でデジタル信号に変換して処理することにより、波
形等化用A/D変換器を合理的に活用した経済的なMUSEデ
コーダの子画面表示用信号を提供することを目的とす
る。
させるため、MUSEデコーダの入力回路に直列に接続され
た波形等化用A/D変換器とデジタルフィルタが使用され
ているが、これらは画質には余り影響がなく、その上画
面上に子画面表示をした場合視聴者は表示された子画面
を注視するようになるため、子画面表示時はMUSE信号の
再生回路から波形等化用回路を切り離すことができ、さ
らに子画面は画面が小さいため表示画面に対して高い解
像度は要求されないため、量子化ビットは適当なビット
数があれば良いため、子画面用信号を波形等化用A/D変
換器でデジタル信号に変換して処理することにより、波
形等化用A/D変換器を合理的に活用した経済的なMUSEデ
コーダの子画面表示用信号を提供することを目的とす
る。
第１図に示すように略8.15MHzのローパスフィルタ２
を介して入力されたMUSEのベースバンド信号の入力回路
を分岐させて一方を第1A/D変換器３に入力してデジタル
信号に変換して出力させて加算回路４に入力し、前記入
力回路の分岐させた他方を波形等化用の第2A/D変換器５
とデジタルフィルタ回路６との直列回路の第2A/D変換器
５に入力し、デジタルフィルタ回路６より出力を取り出
して前記加算回路４に入力して前記第1A/D変換器３から
出力されるデジタル信号に加算して入力信号処理を行い
同信号に基づきMUSE信号を再生している回路において、
子画面用の信号入力端子10と、子画面表示信号作成回路
13と、前記第2A/D変換器５の入力回路及び出力回路に各
々切換器11及び12を設けて、子画面作成時は、前記第2A
/D変換器５の入力回路に設けた切換器11を切り換えて同
第2A/D変換器５に入力端子10を介して子画面用信号が入
力されるようにして、さらに、同第2A/D変換器５の出力
回路に設けた切換器12を切り換えて同第A/D変換器５で
デジタル信号に変換された信号を前記子画面表示信号作
成回路13に入力し、同子画面表示信号作成回路13で子画
面表示用信号を作成して出力し、同信号に基づき子画面
を表示するようにしている。
を介して入力されたMUSEのベースバンド信号の入力回路
を分岐させて一方を第1A/D変換器３に入力してデジタル
信号に変換して出力させて加算回路４に入力し、前記入
力回路の分岐させた他方を波形等化用の第2A/D変換器５
とデジタルフィルタ回路６との直列回路の第2A/D変換器
５に入力し、デジタルフィルタ回路６より出力を取り出
して前記加算回路４に入力して前記第1A/D変換器３から
出力されるデジタル信号に加算して入力信号処理を行い
同信号に基づきMUSE信号を再生している回路において、
子画面用の信号入力端子10と、子画面表示信号作成回路
13と、前記第2A/D変換器５の入力回路及び出力回路に各
々切換器11及び12を設けて、子画面作成時は、前記第2A
/D変換器５の入力回路に設けた切換器11を切り換えて同
第2A/D変換器５に入力端子10を介して子画面用信号が入
力されるようにして、さらに、同第2A/D変換器５の出力
回路に設けた切換器12を切り換えて同第A/D変換器５で
デジタル信号に変換された信号を前記子画面表示信号作
成回路13に入力し、同子画面表示信号作成回路13で子画
面表示用信号を作成して出力し、同信号に基づき子画面
を表示するようにしている。
MUSEデコーダでは8.1MHzの伝送ロールオフ特性を満足
させるため、第１図に示すようにMUSEデコーダの入力回
路に直列に接続された波形等化用A/D変換器５とデジタ
ルフィルタ６が使用されているが、これらは画質には余
り影響がなく、その上画面上に子画面表示をした場合視
聴者は表示された子画面を注視するようになり、さらに
子画面は画面が小さいため表示画面に対して高い解像度
は要求されないため量子化ビットは適当なビット数であ
れば良く、従って本発明では、波形等化用A/D変換器５
の入力回路及び出力回路に切換器11及び12を設けて、子
画面表示時はMUSE信号の再生回路から波形等化用回路を
切換器11及び12で切り離して、子画面用信号が波形等化
用A/D変換器５に入力されるようにし、同A/D変換器５で
デジタル信号に変換して出力される信号が子画面表示信
号作成回路13に入力されるようにして、同子画面表示信
号作成回路13で子画面表示用信号を作成して出力し、同
信号に基づき子画面が表示されるようにしている。
させるため、第１図に示すようにMUSEデコーダの入力回
路に直列に接続された波形等化用A/D変換器５とデジタ
ルフィルタ６が使用されているが、これらは画質には余
り影響がなく、その上画面上に子画面表示をした場合視
聴者は表示された子画面を注視するようになり、さらに
子画面は画面が小さいため表示画面に対して高い解像度
は要求されないため量子化ビットは適当なビット数であ
れば良く、従って本発明では、波形等化用A/D変換器５
の入力回路及び出力回路に切換器11及び12を設けて、子
画面表示時はMUSE信号の再生回路から波形等化用回路を
切換器11及び12で切り離して、子画面用信号が波形等化
用A/D変換器５に入力されるようにし、同A/D変換器５で
デジタル信号に変換して出力される信号が子画面表示信
号作成回路13に入力されるようにして、同子画面表示信
号作成回路13で子画面表示用信号を作成して出力し、同
信号に基づき子画面が表示されるようにしている。
第１図は本発明の一実施例を示すMUSEデコーダの子画
面表示用回路の要部電気回路ブロック図であり、MUSE信
号を受信可能とした衛星放送受信機で復調されたMUSEベ
ースバンド信号が入力端子１を介してローパスフィルタ
２に加えられている。
面表示用回路の要部電気回路ブロック図であり、MUSE信
号を受信可能とした衛星放送受信機で復調されたMUSEベ
ースバンド信号が入力端子１を介してローパスフィルタ
２に加えられている。
前記ローパスフィルタ２で8.15MHzの帯域圧縮されたM
USE信号のみを通過させて出力回路を分岐させて、同分
岐させた一方をA/D変換器３に入力して同A/D変換器３で
周波数16MHzでサンプリングを行いデジタル信号に変換
して出力し加算回路４に入力している。
USE信号のみを通過させて出力回路を分岐させて、同分
岐させた一方をA/D変換器３に入力して同A/D変換器３で
周波数16MHzでサンプリングを行いデジタル信号に変換
して出力し加算回路４に入力している。
前記分岐させた他方を切換器11を介して波形等化用の
A/D変換器５とデジタルフィルタ回路として使用されて
いるトランスバーサルフィルタ６との直列回路のA/D変
換器５に入力し、同A/D変換器５で入力されたMUSE信号
を周波数32MHzでサンプリングを行いデジタル信号に変
換して出力して切換器12を介してトランスバーサルフィ
ルタ６に入力し、同トランスバーサルフィルタ６でMUSE
信号中に含まれている伝送路等化のための基準信号のVI
T信号のサンプル値を検出して、同検出値に対応した係
数を同トランスバーサルフィルタ６に入力されたデジタ
ル信号に乗算して出力し加算回路４に加えて、前記A/D
変換器３から入力されたデジタル信号に加算して波形等
化を行い加算回路４より出力される。
A/D変換器５とデジタルフィルタ回路として使用されて
いるトランスバーサルフィルタ６との直列回路のA/D変
換器５に入力し、同A/D変換器５で入力されたMUSE信号
を周波数32MHzでサンプリングを行いデジタル信号に変
換して出力して切換器12を介してトランスバーサルフィ
ルタ６に入力し、同トランスバーサルフィルタ６でMUSE
信号中に含まれている伝送路等化のための基準信号のVI
T信号のサンプル値を検出して、同検出値に対応した係
数を同トランスバーサルフィルタ６に入力されたデジタ
ル信号に乗算して出力し加算回路４に加えて、前記A/D
変換器３から入力されたデジタル信号に加算して波形等
化を行い加算回路４より出力される。
前記加算回路４よりの出力回路を分岐させて、同分岐
させた第１を音声信号処理回路７に入力して同音声信号
処理回路７で音声のデジタル信号を復元してD/A変換を
行って出力し、増幅器等に入力して音声信号を再生し、
前記分岐させた第２を同期信号及びコントロール信号分
離回路８に入力して同同期信号及びコントロール信号分
離回路８で同期信号及びコントロール信号を分離して、
同分離された信号に基づきデジタル回路の信号処理用の
リサンプリング・クロックパルス等を発生させている。
させた第１を音声信号処理回路７に入力して同音声信号
処理回路７で音声のデジタル信号を復元してD/A変換を
行って出力し、増幅器等に入力して音声信号を再生し、
前記分岐させた第２を同期信号及びコントロール信号分
離回路８に入力して同同期信号及びコントロール信号分
離回路８で同期信号及びコントロール信号を分離して、
同分離された信号に基づきデジタル回路の信号処理用の
リサンプリング・クロックパルス等を発生させている。
さらに、前記分岐させた第３を映像信号再生回路９に
入力し、同映像信号再生回路９では静止画領域と動画領
域とを分離して各々伝送されてこない画像信号を映像メ
モリーを使用して補間して両信号を混合して原画像信号
の復元を行い、さらに必要な信号処理を行って出力し親
画面・子画面合成回路14を介してMUSEデコーダより出力
して高品位デイスプレイに入力して親画面を再生するよ
うにしている。
入力し、同映像信号再生回路９では静止画領域と動画領
域とを分離して各々伝送されてこない画像信号を映像メ
モリーを使用して補間して両信号を混合して原画像信号
の復元を行い、さらに必要な信号処理を行って出力し親
画面・子画面合成回路14を介してMUSEデコーダより出力
して高品位デイスプレイに入力して親画面を再生するよ
うにしている。
子画面作成時は入力端子10を介して切換器11に子画面
用信号が入力され、同切換器11を切り換えて前記子画面
用信号がA/D変換器５に入力されるようにし、同A/D変換
器５で入力された子画面用信号を周波数32MHzでサンプ
リングを行いデジタル信号に変換して出力して切換器12
に入力し、同切換器12を切り換えて前記デジタル信号に
変換された子画面用信号を子画面表示信号作成回路13に
入力し、同子画面表示信号作成回路13ではデジタル化さ
れた映像データをメモリに書き込み、読み出しする過程
で映像信号を圧縮して子画面表示用信号を作成して出力
し親画面・子画面合成回路14に入力して、同親画面・子
画面合成回路14で親画面の信号に合成してMUSEデコーダ
より出力して高品位デイスプレイに入力して親画面に子
画面を再生表示するようにしている。
用信号が入力され、同切換器11を切り換えて前記子画面
用信号がA/D変換器５に入力されるようにし、同A/D変換
器５で入力された子画面用信号を周波数32MHzでサンプ
リングを行いデジタル信号に変換して出力して切換器12
に入力し、同切換器12を切り換えて前記デジタル信号に
変換された子画面用信号を子画面表示信号作成回路13に
入力し、同子画面表示信号作成回路13ではデジタル化さ
れた映像データをメモリに書き込み、読み出しする過程
で映像信号を圧縮して子画面表示用信号を作成して出力
し親画面・子画面合成回路14に入力して、同親画面・子
画面合成回路14で親画面の信号に合成してMUSEデコーダ
より出力して高品位デイスプレイに入力して親画面に子
画面を再生表示するようにしている。
以上説明したように、本発明によればMUSEデコーダで
8.1MHzの伝送ロールオフ特性を満足させるために使用さ
れている波形等化用A/D変換器を使用して、親画面のみ
を表示するときには波形等化用A/D変換器として使用
し、子画面を親画面に合わせて表示するときには子画面
用信号を波形等化用A/D変換器でデジタル信号に変換し
て処理することにより、波形等化用A/D変換器を合理的
に活用した経済的なMUSEデコーダの子画面表示用信号を
提供することができる。
8.1MHzの伝送ロールオフ特性を満足させるために使用さ
れている波形等化用A/D変換器を使用して、親画面のみ
を表示するときには波形等化用A/D変換器として使用
し、子画面を親画面に合わせて表示するときには子画面
用信号を波形等化用A/D変換器でデジタル信号に変換し
て処理することにより、波形等化用A/D変換器を合理的
に活用した経済的なMUSEデコーダの子画面表示用信号を
提供することができる。
第１図は本発明の一実施例を示すMUSEデコーダの子画面
表示回路の要部電気回路ブロック図、第２図は従来例の
MUSEデコーダの要部電気回路ブロック図である。 1,10……入力端子、２……ローパスフィルタ、3,5,15…
…A/D変換器、４……加算回路、６……トランスバーサ
ルフィルタ、７……音声信号処理回路、８……同期信号
及びコントロール信号分離回路、９……映像信号処理回
路、11,12……切換器、13……子画面表示信号作成回
路、14……親画面・子画面合成回路。
表示回路の要部電気回路ブロック図、第２図は従来例の
MUSEデコーダの要部電気回路ブロック図である。 1,10……入力端子、２……ローパスフィルタ、3,5,15…
…A/D変換器、４……加算回路、６……トランスバーサ
ルフィルタ、７……音声信号処理回路、８……同期信号
及びコントロール信号分離回路、９……映像信号処理回
路、11,12……切換器、13……子画面表示信号作成回
路、14……親画面・子画面合成回路。
Claims (1)
- 【請求項１】MUSE信号のみを通過させるローパスフィル
タを介して加えられたMUSEのベースバンド信号の入力回
路を分岐させて一方を第1A/D変換器に入力してデジタル
信号に変換して出力させ、前記入力回路の分岐させた他
方を波形等化用の第2A/D変換器とデジタルフィルタ回路
との直列回路の第2A/D変換器に入力し、デジタルフィル
タ回路より出力を取り出して、前記第1A/D変換器から出
力されるデジタル信号に加算して入力信号処理を行い同
信号に基づきMUSE信号を再生している回路において、子
画面用の信号入力端子と、子画面表示信号作成回路と、
前記第2A/D変換器の入力回路及び出力回路に各々切換器
を設けて、子画面作成時は、前記第2A/D変換器の入力回
路に設けた切換器を切り換えて同第2A/D変換器に子画面
用信号が入力されるようにして、さらに、同第2A/D変換
器の出力回路に設けた切換器を切り換えて同第2A/D変換
器でデジタル信号に変換された信号を前記子画面表示信
号作成回路に入力し、同子画面表示信号作成回路で子画
面表示用信号を作成して出力し、同信号に基づき子画面
を表示することを特徴とするMUSEデコーダの子画面表示
用回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2133083A JP2504292B2 (ja) | 1990-05-23 | 1990-05-23 | Ｍｕｓｅデコ―ダの子画面表示用回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2133083A JP2504292B2 (ja) | 1990-05-23 | 1990-05-23 | Ｍｕｓｅデコ―ダの子画面表示用回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0429487A JPH0429487A (ja) | 1992-01-31 |
| JP2504292B2 true JP2504292B2 (ja) | 1996-06-05 |
Family
ID=15096455
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2133083A Expired - Lifetime JP2504292B2 (ja) | 1990-05-23 | 1990-05-23 | Ｍｕｓｅデコ―ダの子画面表示用回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2504292B2 (ja) |
-
1990
- 1990-05-23 JP JP2133083A patent/JP2504292B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0429487A (ja) | 1992-01-31 |
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