JP2020532033A - シフトレジスター及びその駆動方法、ゲート駆動回路、並び表示装置 - Google Patents
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Abstract
Description
第1信号入力端、第2信号入力端、第1クロック信号端、第1電圧信号端及び第1ノードにそれぞれ接続され、前記第1入力信号端及び前記第2信号入力端に入力するパルス信号の少なくとも一方がオンパルス信号であるとき、前記第1クロック信号端が出力する第1クロック信号を前記第1ノードに提供し、前記第1入力信号端及び第2信号入力端に入力するパルス信号がそれぞれオフパルス信号であるとき、前記第1電圧信号端が出力する第1電圧信号を前記第1ノードに提供する、第1制御モジュールと、
第1信号入力端、第2信号入力端及び第2ノードにそれぞれ接続され、順方向走査するとき、前記第1信号入力端の信号を前記第2ノードに提供し、逆方向走査するとき第2信号入力端の信号を前記第2ノードに提供する、走査制御モジュールと、
前記第1ノード、前記第2ノード及び第1出力端にそれぞれ接続され、前記第1ノード電位の制御のもとで前記第2ノード電位を前記第1出力端に出力する、第1出力制御モジュールと、を備える。
前記第1出力端、第2クロック信号端、第3ノード及び第2電圧信号端にそれぞれ接続され、前記第1出力端の電位の制御のもとで前記第2クロック信号端が出力する第2クロック信号、又は前記第2電圧信号端が出力する第2電圧信号を前記第3ノードに提供する、第2制御モジュールと、
前記第3ノード、リセット信号端、N個第3クロック信号端及びN個第2出力端にそれぞれ接続され、前記第3ノード電位の制御のもとで前記リセット信号端が出力するリセット信号を前記N個第2出力端に提供し、又は、前記第3ノード電位の制御のもとで第n個前記第3クロック信号端が出力するクロック信号を第n個前記第2出力端に提供し、ただし、Nは1又は1より大きい正整数であり、第n個前記第2出力端は前記N個第2出力端に属する、第2出力制御モジュールと、
をさらに備え、
前記第1クロック信号と前記第2クロック信号は位相が逆であり、それぞれの前記第3クロック信号端が発送したクロック信号のクロック周期が前記第1クロック信号のクロック周期の1/2に等しく、前記第3クロック信号端が発送するクロック信号のデューティ比が1/Nであり、前記第1クロック信号がハイレベルパルス信号を出力し始めるとき、前記第1乃至第N個第3クロック信号端が出力するクロック信号の位相は順次2π/Nが遅延する。
入力端が前記第1信号入力端及び前記第2信号入力端にそれぞれ接続され、出力端が第1インバータの入力端、第1伝送ゲートの反転制御端及び第1スイッチングトランジスタのゲート電極にそれぞれ接続される、NORゲートと、
入力端が前記NORゲートの出力端に接続され、出力端が第1伝送ゲートの非反転制御端に接続される、第1インバータと、
入力端が前記第1クロック信号端に接続され、出力端が前記第1ノードに接続され、非反転制御端が前記第1インバータの出力端に接続され、反転制御端が前記NORゲートの出力端に接続される、第1伝送ゲートと、
ゲート電極が前記NORゲートの出力端に接続され、ソース電極が前記第1電圧信号端に接続され、ドレイン電極が前記第1ノードに接続される、N型トランジスタである、第1スイッチングトランジスタと、を備える。
反転制御端が第3電圧信号端に接続され、非反転制御端が第4電圧信号端に接続され、入力端が前記第1信号入力端に接続され、出力端が前記第2ノードに接続される、第2伝送ゲートと、
反転制御端が前記第4電圧信号端に接続され、非反転制御端が前記第3電圧信号端に接続され、入力端が前記第2信号入力端に接続され、出力端が前記第2ノードに接続される、第3伝送ゲートと、を備える。
ゲート電極が前記第1ノードに接続され、ソース電極が前記第2ノードに接続される、第2スイッチングトランジスタと、
入力端が前記第1ノードに接続される、第2インバータと、
ゲート電極が前記第2インバータの出力端に接続され、ドレイン電極が前記第2スイッチングトランジスタのドレイン電極に接続される、第3スイッチングトランジスタと、を備え、
前記第2スイッチングトランジスタ及び前記第3スイッチングトランジスタがN型トランジスタである。
入力端が前記第2スイッチングトランジスタのドレイン電極及び前記第3スイッチングトランジスタのドレイン電極にそれぞれ接続される、第3インバータと、
出力端が前記第3スイッチングトランジスタのソース電極に接続される、第4インバータと、
入力端が前記第3インバータの出力端及び前記第4インバータの入力端に接続され、出力端が前記第1出力端にそれぞれ接続される、第5インバータと、をさらに備える。
ゲート電極がリセット信号端に接続され、ソース電極が第5電圧信号端に接続され、ドレイン電極が前記第5インバータの入力端、第3インバータの出力端及び第4インバータの出力端にそれぞれ接続される、第4スイッチングトランジスタをさらに備え、
前記第4スイッチングトランジスタがN型トランジスタである。
入力端が前記第2クロック信号端に接続され、出力端が前記第3ノードに接続され、非反転制御端が前記第1出力端に接続され、反転制御端が前記第6インバータの出力端及び前記第5スイッチングトランジスタのゲート電極にそれぞれ接続される、第4伝送ゲートと、
入力端が前記第1出力端に接続され、出力端が前記第4伝送ゲートの反転制御端及び前記第5スイッチングトランジスタのゲート電極にそれぞれ接続される、第6インバータと、
ゲート電極が前記第6インバータの出力端及び前記第4伝送ゲートの反転制御端に接続され、ソース電極が前記第3ノードにそれぞれ接続され、ドレイン電極が第2電圧信号端に接続される、第5スイッチングトランジスタと、を備え、
前記第5スイッチングトランジスタがN型トランジスタである。
入力端が前記第3ノードに接続され、出力端がN個出力制御サーブモジュールの一端及び第8インバータの入力端にそれぞれ接続される、第7インバータと、
入力端がN個前記出力制御サーブモジュールの一端及び前記第7インバータの出力端にそれぞれ接続され、出力端がN個前記出力制御サーブモジュールの他端にそれぞれ接続される、第8インバータと、
それぞれは、前記第7インバータの出力端の電位及び前記第8インバータの出力端の電位の制御のもとで、前記リセット信号端が出力するリセット信号をそれぞれの前記出力制御サーブモジュールに対応するN個前記第2出力端に提供し、又は、前記第7インバータの出力端の電位及び前記第8インバータの出力端の電位の制御のもとで、第n個前記第3クロック信号端が発送するクロック信号をそれぞれの第n個前記第2出力端に提供する、N個出力制御サーブモジュールと、を備える。
入力端が前記リセット信号端に接続され、非反転制御端が前記第7インバータの出力端に接続され、反転制御端が前記第8インバータの出力端に接続される、第5伝送ゲートと、
入力端がN個前記第3クロック信号端の中の一方に接続され、反転制御端が前記第7インバータの出力端に接続され、非反転制御端が前記第8インバータの出力端に接続される、第6伝送ゲートと、を備える。
入力端が前記第5伝送ゲートの出力端及び前記第6伝送ゲートの出力端にそれぞれ接続され、出力端が第10インバータの入力端に接続される、第9インバータと、
入力端が前記第9インバータの出力端に接続され、出力端が前記第2出力端に接続される、第10インバータと、さらに備える。
第1信号入力端、第2信号入力端、第1クロック信号端、第1電圧信号端及び第1ノードにそれぞれ接続され、前記第1入力信号端及び前記第2信号入力端に入力するパルス信号の少なくとも一方がオンパルス信号であるとき、前記第1クロック信号端が出力する第1クロック信号を前記第1ノードに提供し、前記第1入力信号端及び第2信号入力端に入力するパルス信号がそれぞれオフパルス信号であるとき、前記第1電圧信号端が出力する第1電圧信号を前記第1ノードに提供する、第1制御モジュールと、
第1信号入力端、第2信号入力端及び第2ノードにそれぞれ接続され、順方向走査するとき、前記第1信号入力端の信号を前記第2ノードに提供し、逆方向走査するとき第2信号入力端の信号を前記第2ノードに提供する、走査制御モジュールと、
前記第1ノード、前記第2ノード及び第1出力端にそれぞれ接続され、前記第1ノード電位の制御のもとで前記第2ノード電位を前記第1出力端に出力する、第1出力制御モジュールと、
ゲート電極がリセット信号端に接続され、ソース電極が第5電圧信号端に接続され、ドレイン電極が第5インバータの入力端、第3インバータの出力端及び第4インバータの出力端にそれぞれ接続される、第4スイッチングトランジスタと、
前記第1出力端、第2クロック信号端、第3ノード及び第2電圧信号端にそれぞれ接続され、前記第1出力端の電位の制御のもとで前記第2クロック信号端が出力する第2クロック信号、又は前記第2電圧信号端が出力する第2電圧信号を前記第3ノードに提供する、第2制御モジュールと、
前記第3ノード、リセット信号端、N個第3クロック信号端及びN個第2出力端にそれぞれ接続され、前記第3ノード電位の制御のもとで前記リセット信号端が出力するリセット信号を前記N個第2出力端に提供し、又は、前記第3ノード電位の制御のもとで第n個前記第3クロック信号端が出力するクロック信号を第n個前記第2出力端に提供し、ただし、Nは1又は1より大きい正整数であり、第n個前記第2出力端は前記N個第2出力端に属する、第2出力制御モジュールと、
を備え、
前記第1クロック信号と前記第2クロック信号は位相が逆であり、それぞれの前記第3クロック信号端が発送したクロック信号のクロック周期が前記第1クロック信号のクロック周期の1/2に等しく、前記第3クロック信号端が発送するクロック信号のデューティ比が1/Nであり、前記第1クロック信号がハイレベルパルス信号を出力し始めるとき、前記第1乃至第N個第3クロック信号端が出力するクロック信号の位相は順次2π/Nが遅延し、
前記第1制御モジュールは、
入力端が前記第1信号入力端及び前記第2信号入力端にそれぞれ接続され、出力端が第1インバータの入力端、第1伝送ゲートの反転制御端及び第1スイッチングトランジスタのゲート電極にそれぞれ接続される、NORゲートと、
入力端が前記NORゲートの出力端に接続され、出力端が第1伝送ゲートの非反転制御端に接続される、第1インバータと、
入力端が前記第1クロック信号端に接続され、出力端が前記第1ノードに接続され、非反転制御端が前記第1インバータの出力端に接続され、反転制御端が前記NORゲートの出力端に接続される、第1伝送ゲートと、
ゲート電極が前記NORゲートの出力端に接続され、ソース電極が前記第1電圧信号端に接続され、ドレイン電極が前記第1ノードに接続される、第1スイッチングトランジスタと、
を備え、
前記走査制御モジュールは、
前記反転制御端が第3電圧信号端に接続され、非反転制御端が前記第4電圧信号端に接続され、入力端が前記第1信号入力端に接続され、出力端が前記第2ノードに接続される、第2伝送ゲートと、
反転制御端が前記第4電圧信号端に接続され、非反転制御端が前記第3電圧信号端に接続され、入力端が前記第2信号入力端に接続され、出力端が前記第2ノードに接続される、第3伝送ゲートと、
を備え、
前記第1出力制御モジュールは、
ゲート電極が前記第1ノードに接続され、ソース電極が前記第2ノードに接続される、第2スイッチングトランジスタと、
入力端が前記第1ノードに接続される、第2インバータと、
ゲート電極が前記第2インバータの出力端に接続され、ドレイン電極が前記第2スイッチングトランジスタのドレイン電極に接続される、第3スイッチングトランジスタと、
入力端が前記第2スイッチングトランジスタのドレイン電極及び前記第3スイッチングトランジスタのドレイン電極にそれぞれ接続される、第3インバータと、
出力端が前記第3スイッチングトランジスタのソース電極に接続される、第4インバータと、
入力端が前記第3インバータの出力端及び前記第4インバータの入力端に接続され、出力端が 前記第1出力端にそれぞれ接続される、第5インバータと、
を備え、
前記第2制御モジュールは、
入力端が前記第2クロック信号端に接続され、出力端が前記第3ノードに接続され、非反転制御端が前記第1出力端に接続され、反転制御端が前記第6インバータの出力端及び前記第5スイッチングトランジスタのゲート電極にそれぞれ接続される、第4伝送ゲートと、
入力端が前記第1出力端に接続され、出力端が前記第4伝送ゲートの反転制御端及び前記第5スイッチングトランジスタのゲート電極にそれぞれ接続される、第6インバータと、
ゲート電極が前記第6インバータの出力端及び前記第4伝送ゲートの反転制御端に接続され、ソース電極が前記第3ノードに接続され、ドレイン電極が第2電圧信号端に接続される、第5スイッチングトランジスタと、
を備え、
前記第2出力制御モジュールは、
入力端が前記第3ノードに接続され、出力端がN個出力制御サーブモジュールの一端及び第8インバータの入力端にそれぞれ接続される、第7インバータと、
入力端がN個前記出力制御サーブモジュールの一端及び前記第7インバータの出力端にそれぞれ接続され、出力端がN個前記出力制御サーブモジュールの他端にそれぞれ接続される、第8インバータと、
それぞれは、前記第7インバータの出力端の電位及び前記第8インバータの出力端の電位の制御のもとで、前記リセット信号端が出力するリセット信号をそれぞれの前記出力制御サーブモジュールに対応するN個前記第2出力端に提供し、又は、前記第7インバータの出力端の電位及び前記第8インバータの出力端の電位の制御のもとで、第n個前記第3クロック信号端が発送するクロック信号をそれぞれの第n個前記第2出力端に提供する、N個出力制御サーブモジュールと、
を備え、
前記出力制御サーブモジュールは、
入力端が前記リセット信号端に接続され、非反転制御端が前記第7インバータの出力端に接続され、反転制御端が前記第8インバータの出力端に接続される、第5伝送ゲートと、
入力端がN個前記第3クロック信号端に接続され、反転制御端が前記第7インバータの出力端に接続され、非反転制御端が前記第8インバータの出力端に接続される、第6伝送ゲートと、
入力端が前記第5伝送ゲートの出力端及び前記第6伝送ゲートの出力端にそれぞれ接続され、出力端が第10インバータの入力端に接続される、第9インバータと、
入力端が前記第9インバータの出力端に接続され、出力端が前記第2出力端に接続される、第10インバータと、
を備え、
前記第1スイッチングトランジスタ、第2スイッチングトランジスタ及び前記第3スイッチングトランジスタ、前記第4スイッチングトランジスタ及び前記第5スイッチングトランジスタがN型トランジスタである。
第1級シフトレジスターの以外に、他の各級シフトレジスターの第1信号入力端がそのカスケード接続された前級シフトレジスターの第1出力端に接続され、
最後1級シフトレジスターの以外に、他の各級シフトレジスターの第2信号入力端がそのカスケード接続された次級シフトレジスターの第1出力端に接続される。
第1級シフトレジスターの第1信号入力端がフレームトリガ信号端に接続され、
最後1級シフトレジスターの第2信号入力端がフレームエンド信号端に接続される。
前記第1信号入力端にハイレベル信号を提供し、前記第2信号入力端にローレベル信号を提供し、前記第1クロック信号端にローレベル信号を提供し、前記第1出力端に前記ローレベル信号を出力する、第1段階と、
前記第1信号入力端にハイレベル信号を提供し、前記第2信号入力端にローレベル信号を提供し、前記第1クロック信号端にハイレベル信号を提供し、前記第1出力端に前記ハイレベル信号を出力する、第2段階と、
前記第1信号入力端にローレベル信号を提供し、前記第2信号入力端にハイレベル信号を提供し、前記第1クロック信号端にローレベル信号を提供し、前記第1出力端に前記ハイレベル信号を出力する、第3段階と、
前記第1信号入力端にローレベル信号を提供し、前記第2信号入力端にハイレベル信号を提供し、前記第1クロック信号端にハイレベル信号を提供し、前記第1出力端に前記ローレベル信号を出力する、第4段階と、
前記第1信号入力端にローレベル信号を提供し、前記第2信号入力端にローレベル信号を提供し、前記第1クロック信号端にローレベル信号を提供し、前記第1出力端に前記ローレベル信号を出力する、第5段階と、を含む。
前記第2クロック信号にハイレベル信号を提供し、前記リセット信号端にローレベル信号を提供し、N個前記第2出力端のそれぞれがローレベル信号を出力する、第1段階と、
前記第2クロック信号にローレベル信号を提供し、前記リセット信号端にローレベル信号を提供し、N個前記第3クロック信号端に順次ハイレベル信号を提供し、N個前記第2出力端のそれぞれがローレベル信号を出力する、第2段階と、
前記第2クロック信号にハイレベル信号を提供し、前記リセット信号端にローレベル信号を提供し、N個前記第3クロック信号端に順次ハイレベル信号を提供し、N個前記第2出力端が順次N個前記第3クロック信号入力端が提供する信号と同じのハイレベル信号を出力する、第3段階と、
前記第2クロック信号にローレベル信号を提供し、前記リセット信号端にローレベル信号を提供し、N個前記第3クロック信号端に順次ハイレベル信号を提供し、N個前記第2出力端のそれぞれがローレベル信号を出力する、第4段階と、
前記第2クロック信号にハイレベル信号を提供し、前記リセット信号端にローレベル信号を提供し、N個前記第3クロック信号端に順次ハイレベル信号を提供し、N個前記第2出力端のそれぞれがローレベル信号を出力する、第5段階と、を含む。
第1級シフトレジスターSR(1)の以外に、たの各級シフトレジスターSR(2)乃至SR(N)の第1信号入力端STV1がそのカスケード接続された前の1級シフトレジスターの第1出力端OUT1に接続され、
最後1級シフトレジスターSR(N)の以外に、他の各級シフトレジスターSR(1)乃至SR(N-1)の第2信号入力端STV2がそのカスケード接続された次の1級シフトレジスターの第1出力端OUT1に接続される。
最後1級シフトレジスターSR(N)の第2信号入力端STV2がフレームエンド信号端Resに接続される。
第1段階:前記第1信号入力端にハイレベル信号を提供し、前記第2信号入力端にローレベル信号を提供し、前記第1クロック信号端にローレベル信号を提供し、前記第1出力端に前記ローレベル信号を出力する。
2 走査制御モジュール
3 第1出力制御モジュール
Claims (18)
- 第1信号入力端、第2信号入力端、第1クロック信号端、第1電圧信号端及び第1ノードにそれぞれ接続され、前記第1入力信号端及び前記第2信号入力端に入力するパルス信号の少なくとも一方がオンパルス信号であるとき、前記第1クロック信号端が出力する第1クロック信号を前記第1ノードに提供し、前記第1入力信号端及び第2信号入力端に入力するパルス信号がそれぞれオフパルス信号であるとき、前記第1電圧信号端が出力する第1電圧信号を前記第1ノードに提供する、第1制御モジュールと、
第1信号入力端、第2信号入力端及び第2ノードにそれぞれ接続され、順方向走査するとき、前記第1信号入力端の信号を前記第2ノードに提供し、逆方向走査するとき第2信号入力端の信号を前記第2ノードに提供する、走査制御モジュールと、
前記第1ノード、前記第2ノード及び第1出力端にそれぞれ接続され、前記第1ノード電位の制御のもとで前記第2ノード電位を前記第1出力端に出力する、第1出力制御モジュールと、
を備える、シフトレジスター。 - 請求項1に記載のシフトレジスターにおいて、
前記第1出力端、第2クロック信号端、第3ノード及び第2電圧信号端にそれぞれ接続され、前記第1出力端の電位の制御のもとで前記第2クロック信号端が出力する第2クロック信号、又は前記第2電圧信号端が出力する第2電圧信号を前記第3ノードに提供する、第2制御モジュールと、
前記第3ノード、リセット信号端、N個第3クロック信号端及びN個第2出力端にそれぞれ接続され、前記第3ノード電位の制御のもとで前記リセット信号端が出力するリセット信号を前記N個第2出力端に提供し、又は、前記第3ノード電位の制御のもとで第n個前記第3クロック信号端が出力するクロック信号を第n個前記第2出力端に提供し、ただし、Nは1又は1より大きい正整数であり、第n個前記第2出力端は前記N個第2出力端に属する、第2出力制御モジュールと、
をさらに備え、
前記第1クロック信号と前記第2クロック信号は位相が逆であり、それぞれの前記第3クロック信号端が発送したクロック信号のクロック周期が前記第1クロック信号のクロック周期の1/2に等しく、前記第3クロック信号端が発送するクロック信号のデューティ比が1/Nであり、前記第1クロック信号がハイレベルパルス信号を出力し始めるとき、前記第1乃至第N個第3クロック信号端が出力するクロック信号の位相は順次2π/Nが遅延する、シフトレジスター。 - 請求項1又は2に記載のシフトレジスターにおいて、
前記第1制御モジュールは、
入力端が前記第1信号入力端及び前記第2信号入力端にそれぞれ接続され、出力端が第1インバータの入力端、第1伝送ゲートの反転制御端及び第1スイッチングトランジスタのゲート電極にそれぞれ接続される、NORゲートと、
入力端が前記NORゲートの出力端に接続され、出力端が第1伝送ゲートの非反転制御端に接続される、第1インバータと、
入力端が前記第1クロック信号端に接続され、出力端が前記第1ノードに接続され、非反転制御端が前記第1インバータの出力端に接続され、反転制御端が前記NORゲートの出力端に接続される、第1伝送ゲートと、
ゲート電極が前記NORゲートの出力端に接続され、ソース電極が前記第1電圧信号端に接続され、ドレイン電極が前記第1ノードに接続される、N型トランジスタである、第1スイッチングトランジスタと、を備えるシフトレジスター。 - 請求項1に記載のシフトレジスターにおいて、
前記走査制御モジュールは、
反転制御端が第3電圧信号端に接続され、非反転制御端が第4電圧信号端に接続され、入力端が前記第1信号入力端に接続され、出力端が前記第2ノードに接続される、第2伝送ゲートと、
反転制御端が前記第4電圧信号端に接続され、非反転制御端が前記第3電圧信号端に接続され、入力端が前記第2信号入力端に接続され、出力端が前記第2ノードに接続される、第3伝送ゲートと、を備えるシフトレジスター。 - 請求項1に記載のシフトレジスターにおいて、
前記第1出力制御モジュールは、
ゲート電極が前記第1ノードに接続され、ソース電極が前記第2ノードに接続される、第2スイッチングトランジスタと、
入力端が前記第1ノードに接続される、第2インバータと、
ゲート電極が前記第2インバータの出力端に接続され、ドレイン電極が前記第2スイッチングトランジスタのドレイン電極に接続される、第3スイッチングトランジスタと、を備え、
前記第2スイッチングトランジスタ及び前記第3スイッチングトランジスタがN型トランジスタである、シフトレジスター。 - 請求項5に記載のシフトレジスターにおいて、
前記第1出力制御モジュールは、
入力端が前記第2スイッチングトランジスタのドレイン電極及び前記第3スイッチングトランジスタのドレイン電極にそれぞれ接続される、第3インバータと、
出力端が前記第3スイッチングトランジスタのソース電極に接続される、第4インバータと、
入力端が前記第3インバータの出力端及び前記第4インバータの入力端に接続され、出力端が前記第1出力端にそれぞれ接続される、第5インバータと、をさらに備える、シフトレジスター。 - 請求項6に記載のシフトレジスターにおいて、
ゲート電極がリセット信号端に接続され、ソース電極が第5電圧信号端に接続され、ドレイン電極が前記第5インバータの入力端、第3インバータの出力端及び第4インバータの出力端にそれぞれ接続される、第4スイッチングトランジスタをさらに備え、
前記第4スイッチングトランジスタがN型トランジスタである、シフトレジスター。 - 請求項2に記載のシフトレジスターにおいて、
前記第2制御モジュールは、
入力端が前記第2クロック信号端に接続され、出力端が前記第3ノードに接続され、非反転制御端が前記第1出力端に接続され、反転制御端が前記第6インバータの出力端及び前記第5スイッチングトランジスタのゲート電極にそれぞれ接続される、第4伝送ゲートと、
入力端が前記第1出力端に接続され、出力端が前記第4伝送ゲートの反転制御端及び前記第5スイッチングトランジスタのゲート電極にそれぞれ接続される、第6インバータと、
ゲート電極が前記第6インバータの出力端及び前記第4伝送ゲートの反転制御端に接続され、ソース電極が前記第3ノードにそれぞれ接続され、ドレイン電極が第2電圧信号端に接続される、第5スイッチングトランジスタと、を備え、
前記第5スイッチングトランジスタがN型トランジスタである、シフトレジスター。 - 請求項2に記載のシフトレジスターにおいて、
前記第2出力制御モジュールは、
入力端が前記第3ノードに接続され、出力端がN個出力制御サーブモジュールの一端及び第8インバータの入力端にそれぞれ接続される、第7インバータと、
入力端がN個前記出力制御サーブモジュールの一端及び前記第7インバータの出力端にそれぞれ接続され、出力端がN個前記出力制御サーブモジュールの他端にそれぞれ接続される、第8インバータと、
それぞれは、前記第7インバータの出力端の電位及び前記第8インバータの出力端の電位の制御のもとで、前記リセット信号端が出力するリセット信号をそれぞれの前記出力制御サーブモジュールに対応するN個前記第2出力端に提供し、又は、前記第7インバータの出力端の電位及び前記第8インバータの出力端の電位の制御のもとで、第n個前記第3クロック信号端が発送するクロック信号をそれぞれの第n個前記第2出力端に提供する、N個出力制御サーブモジュールと、を備えるシフトレジスター。 - 請求項9に記載のシフトレジスターにおいて、
前記出力制御サーブモジュールは、
入力端が前記リセット信号端に接続され、非反転制御端が前記第7インバータの出力端に接続され、反転制御端が前記第8インバータの出力端に接続される、第5伝送ゲートと、
入力端がN個前記第3クロック信号端に接続され、反転制御端が前記第7インバータの出力端に接続され、非反転制御端が前記第8インバータの出力端に接続される、第6伝送ゲートと、を備えるシフトレジスター。 - 請求項10に記載のシフトレジスターにおいて、
前記出力制御サーブモジュールは、
入力端が前記第5伝送ゲートの出力端及び前記第6伝送ゲートの出力端にそれぞれ接続され、出力端が第10インバータの入力端に接続される、第9インバータと、
入力端が前記第9インバータの出力端に接続され、出力端が前記第2出力端に接続される、第10インバータと、さらに備えるシフトレジスター。 - 請求項8〜11のいずれか一項に記載のシフトレジスターにおいて、
前記Nが4である、シフトレジスター。 - 第1信号入力端、第2信号入力端、第1クロック信号端、第1電圧信号端及び第1ノードにそれぞれ接続され、前記第1入力信号端及び前記第2信号入力端に入力するパルス信号の少なくとも一方がオンパルス信号であるとき、前記第1クロック信号端が出力する第1クロック信号を前記第1ノードに提供し、前記第1入力信号端及び第2信号入力端に入力するパルス信号がそれぞれオフパルス信号であるとき、前記第1電圧信号端が出力する第1電圧信号を前記第1ノードに提供する、第1制御モジュールと、
第1信号入力端、第2信号入力端及び第2ノードにそれぞれ接続され、順方向走査するとき、前記第1信号入力端の信号を前記第2ノードに提供し、逆方向走査するとき第2信号入力端の信号を前記第2ノードに提供する、走査制御モジュールと、
前記第1ノード、前記第2ノード及び第1出力端にそれぞれ接続され、前記第1ノード電位の制御のもとで前記第2ノード電位を前記第1出力端に出力する、第1出力制御モジュールと、
ゲート電極がリセット信号端に接続され、ソース電極が第5電圧信号端に接続され、ドレイン電極が第5インバータの入力端、第3インバータの出力端及び第4インバータの出力端にそれぞれ接続される、第4スイッチングトランジスタと、
前記第1出力端、第2クロック信号端、第3ノード及び第2電圧信号端にそれぞれ接続され、前記第1出力端の電位の制御のもとで前記第2クロック信号端が出力する第2クロック信号、又は前記第2電圧信号端が出力する第2電圧信号を前記第3ノードに提供する、第2制御モジュールと、
前記第3ノード、リセット信号端、N個第3クロック信号端及びN個第2出力端にそれぞれ接続され、前記第3ノード電位の制御のもとで前記リセット信号端が出力するリセット信号を前記N個第2出力端に提供し、又は、前記第3ノード電位の制御のもとで第n個前記第3クロック信号端が出力するクロック信号を第n個前記第2出力端に提供し、ただし、Nは1又は1より大きい正整数であり、第n個前記第2出力端は前記N個第2出力端に属する、第2出力制御モジュールと、
を備え、
前記第1クロック信号と前記第2クロック信号は位相が逆であり、それぞれの前記第3クロック信号端が発送したクロック信号のクロック周期が前記第1クロック信号のクロック周期の1/2に等しく、前記第3クロック信号端が発送するクロック信号のデューティ比が1/Nであり、前記第1クロック信号がハイレベルパルス信号を出力し始めるとき、前記第1乃至第N個第3クロック信号端が出力するクロック信号の位相は順次2π/Nが遅延し、
前記第1制御モジュールは、
入力端が前記第1信号入力端及び前記第2信号入力端にそれぞれ接続され、出力端が第1インバータの入力端、第1伝送ゲートの反転制御端及び第1スイッチングトランジスタのゲート電極にそれぞれ接続される、NORゲートと、
入力端が前記NORゲートの出力端に接続され、出力端が第1伝送ゲートの非反転制御端に接続される、第1インバータと、
入力端が前記第1クロック信号端に接続され、出力端が前記第1ノードに接続され、非反転制御端が前記第1インバータの出力端に接続され、反転制御端が前記NORゲートの出力端に接続される、第1伝送ゲートと、
ゲート電極が前記NORゲートの出力端に接続され、ソース電極が前記第1電圧信号端に接続され、ドレイン電極が前記第1ノードに接続される、第1スイッチングトランジスタと、
を備え、
前記走査制御モジュールは、
前記反転制御端が第3電圧信号端に接続され、非反転制御端が前記第4電圧信号端に接続され、入力端が前記第1信号入力端に接続され、出力端が前記第2ノードに接続される、第2伝送ゲートと、
反転制御端が前記第4電圧信号端に接続され、非反転制御端が前記第3電圧信号端に接続され、入力端が前記第2信号入力端に接続され、出力端が前記第2ノードに接続される、第3伝送ゲートと、
を備え、
前記第1出力制御モジュールは、
ゲート電極が前記第1ノードに接続され、ソース電極が前記第2ノードに接続される、第2スイッチングトランジスタと、
入力端が前記第1ノードに接続される、第2インバータと、
ゲート電極が前記第2インバータの出力端に接続され、ドレイン電極が前記第2スイッチングトランジスタのドレイン電極に接続される、第3スイッチングトランジスタと、
入力端が前記第2スイッチングトランジスタのドレイン電極及び前記第3スイッチングトランジスタのドレイン電極にそれぞれ接続される、第3インバータと、
出力端が前記第3スイッチングトランジスタのソース電極に接続される、第4インバータと、
入力端が前記第3インバータの出力端及び前記第4インバータの入力端に接続され、出力端が前記第1出力端にそれぞれ接続される、第5インバータと、
を備え、
前記第2制御モジュールは、
入力端が前記第2クロック信号端に接続され、出力端が前記第3ノードに接続され、非反転制御端が前記第1出力端に接続され、反転制御端が前記第6インバータの出力端及び前記第5スイッチングトランジスタのゲート電極にそれぞれ接続される、第4伝送ゲートと、
入力端が前記第1出力端に接続され、出力端が前記第4伝送ゲートの反転制御端及び前記第5スイッチングトランジスタのゲート電極にそれぞれ接続される、第6インバータと、
ゲート電極が前記第6インバータの出力端及び前記第4伝送ゲートの反転制御端に接続され、ソース電極が前記第3ノードにそれぞれ接続され、ドレイン電極が第2電圧信号端に接続される、第5スイッチングトランジスタと、
を備え、
前記第2出力制御モジュールは、
入力端が前記第3ノードに接続され、出力端がN個出力制御サーブモジュールの一端及び第8インバータの入力端にそれぞれ接続される、第7インバータと、
入力端がN個前記出力制御サーブモジュールの一端及び前記第7インバータの出力端にそれぞれ接続され、出力端がN個前記出力制御サーブモジュールの他端にそれぞれ接続される、第8インバータと、
それぞれは、前記第7インバータの出力端の電位及び前記第8インバータの出力端の電位の制御のもとで、前記リセット信号端が出力するリセット信号をそれぞれの前記出力制御サーブモジュールに対応するN個前記第2出力端に提供し、又は、前記第7インバータの出力端の電位及び前記第8インバータの出力端の電位の制御のもとで、第n個前記第3クロック信号端が発送するクロック信号をそれぞれの第n個前記第2出力端に提供する、N個出力制御サーブモジュールと、
を備え、
前記出力制御サーブモジュールは、
入力端が前記リセット信号端に接続され、非反転制御端が前記第7インバータの出力端に接続され、反転制御端が前記第8インバータの出力端に接続される、第5伝送ゲートと、
入力端がN個前記第3クロック信号端に接続され、反転制御端が前記第7インバータの出力端に接続され、非反転制御端が前記第8インバータの出力端に接続される、第6伝送ゲートと、
入力端が前記第5伝送ゲートの出力端及び前記第6伝送ゲートの出力端にそれぞれ接続され、出力端が第10インバータの入力端に接続される、第9インバータと、
入力端が前記第9インバータの出力端に接続され、出力端が前記第2出力端に接続される、第10インバータと、
を備え、
前記第1スイッチングトランジスタ、第2スイッチングトランジスタ及び前記第3スイッチングトランジスタ、前記第4スイッチングトランジスタ及び前記第5スイッチングトランジスタがN型トランジスタである、シフトレジスター。 - カスケード接続された複数の請求項1-12のいずれか1項に記載のシフトレジスター、又は、カスケード接続された複数の請求項13に記載されたシフトレジスター回路を備えるゲート駆動回路であって、
第1級シフトレジスターの以外に、他の各級シフトレジスターの第1信号入力端がそのカスケード接続された前級シフトレジスターの第1出力端に接続され、
最後1級シフトレジスターの以外に、他の各級シフトレジスターの第2信号入力端がそのカスケード接続された次級シフトレジスターの第1出力端に接続される、ゲート駆動回路。 - 請求項14に記載のゲート駆動回路において、
第1級シフトレジスターの第1信号入力端がフレームトリガ信号端に接続され、
最後1級シフトレジスターの第2信号入力端がフレームエンド信号端に接続される、ゲート駆動回路。 - 請求項1-12のいずれか1項に記載のシフトレジスター、又は請求項13に記載のシフトレジスターを駆動する駆動方法であって、
前記第1信号入力端にハイレベル信号を提供し、前記第2信号入力端にローレベル信号を提供し、前記第1クロック信号端にローレベル信号を提供し、前記第1出力端に前記ローレベル信号を出力する、第1段階と、
前記第1信号入力端にハイレベル信号を提供し、前記第2信号入力端にローレベル信号を提供し、前記第1クロック信号端にハイレベル信号を提供し、前記第1出力端に前記ハイレベル信号を出力する、第2段階と、
前記第1信号入力端にローレベル信号を提供し、前記第2信号入力端にハイレベル信号を提供し、前記第1クロック信号端にローレベル信号を提供し、前記第1出力端に前記ハイレベル信号を出力する、第3段階と、
前記第1信号入力端にローレベル信号を提供し、前記第2信号入力端にハイレベル信号を提供し、前記第1クロック信号端にハイレベル信号を提供し、前記第1出力端に前記ローレベル信号を出力する、第4段階と、
前記第1信号入力端にローレベル信号を提供し、前記第2信号入力端にローレベル信号を提供し、前記第1クロック信号端にローレベル信号を提供し、前記第1出力端に前記ローレベル信号を出力する、第5段階と、を含む、
駆動方法。 - 請求項16に記載の駆動方法において、
前記シフトレジスターに第2制御モジュール及び第2出力制御モジュールが含まれるとき、前記駆動方法は、
前記第2クロック信号にハイレベル信号を提供し、前記リセット信号端にローレベル信号を提供し、N個前記第2出力端のそれぞれがローレベル信号を出力する、第1段階と、
前記第2クロック信号にローレベル信号を提供し、前記リセット信号端にローレベル信号を提供し、N個前記第3クロック信号端に順次ハイレベル信号を提供し、N個前記第2出力端のそれぞれがローレベル信号を出力する、第2段階と、
前記第2クロック信号にハイレベル信号を提供し、前記リセット信号端にローレベル信号を提供し、N個前記第3クロック信号端に順次ハイレベル信号を提供し、N個前記第2出力端が順次N個前記第3クロック信号入力端が提供する信号と同じのハイレベル信号を出力する、第3段階と、
前記第2クロック信号にローレベル信号を提供し、前記リセット信号端にローレベル信号を提供し、N個前記第3クロック信号端に順次ハイレベル信号を提供し、N個前記第2出力端のそれぞれがローレベル信号を出力する、第4段階と、
前記第2クロック信号にハイレベル信号を提供し、前記リセット信号端にローレベル信号を提供し、N個前記第3クロック信号端に順次ハイレベル信号を提供し、N個前記第2出力端のそれぞれがローレベル信号を出力する、第5段階と、を含む、
駆動方法。 - 請求項14又は15に記載のゲート駆動回路を備える表示装置。
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