JP2018518773A5 - - Google Patents

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  1. プロセッサと、
    複数個の周辺機器と、
    プログラマブル周辺機器相互接続器と、
    イベント発生装置と、
    ソフトウェアを記憶するメモリと、を備えたマイクロコントローラであって、
    前記イベント発生装置は、前記プロセッサによってアドレス可能なイベント発生レジスタを備え、
    前記イベント発生装置は、前記プログラマブル周辺機器相互接続器に接続され、
    前記イベント発生装置は、前記イベント発生レジスタの内容に対する所定の変更を検出することができて、このような所定の変更を検出すると前記プログラマブル周辺機器相互接続器にイベントを伝えるように設定され、
    前記周辺機器の各々は、前記プログラマブル周辺機器相互接続器に接続され、
    前記周辺機器の各々は、それぞれのタスクを実行することによって前記プログラマブル周辺機器相互接続器からのタスク信号に対処するように構成され、
    前記プログラマブル周辺機器相互接続器は、各々が前記イベント発生装置のイベントを前記周辺機器の一つに属するタスクにマッピングさせる複数のマッピング関係を格納できるマッピングメモリにアクセスするように構成され、
    前記プログラマブル周辺機器相互接続器は、前記イベント発生装置のイベントから前記周辺機器の一つに属するタスクへのマッピング関係が前記マッピングメモリに格納されているとき、前記プログラマブル周辺機器相互接続器がタスク信号を前記周辺機器に送信することによって前記イベント発生装置からのイベントの信号に対処するように構成され、
    前記プログラマブル周辺機器相互接続器は、前記マッピングメモリが前記イベント発生装置の一つのイベントから二つ以上の異なるタスクへのマッピング関係を格納しているとき、前記イベントの信号を受信してから所定の最大時間内に前記二つ以上のタスク信号をそれぞれ送信するように構成され、
    前記ソフトウェアは、(i)前記イベント発生装置の一つのイベントから少なくとも二つの異なる周辺機器タスクへのマッピング関係を前記マッピングメモリに格納し、(ii)前記イベント発生レジスタの前記内容に対する前記所定の変更を行うための、前記プロセッサによって実行可能な命令を含む
    ことを特徴とするマイクロコントローラ。
  2. 前記所定の最大時間は、10マイクロ秒以下である
    ことを特徴とする、請求項1に記載のマイクロコントローラ。
  3. 前記プログラマブル周辺機器相互接続器は、それぞれの前記二つ以上のタスク信号を同時に送信するように設定される
    ことを特徴とする、請求項1または2に記載のマイクロコントローラ。
  4. 起こり得るすべてのマッピング関係について、前記プログラマブル周辺機器相互接続器がイベントの信号を受信してから前記イベントにマッピングされた二つ以上のタスク信号を送信するまでに一定の時間遅延が存在する
    ことを特徴とする、請求項3に記載のマイクロコントローラ。
  5. イベントを前記プログラマブル周辺機器相互接続器に伝えるように構成された、イベント発生を行う一つ以上の周辺機器を備え、前記プログラマブル周辺機器相互接続器は、第一周辺機器のイベントと第二周辺機器のタスクとの間のマッピング関係が前記マッピングメモリに格納されていると、前記第一周辺機器からの前記イベントの信号に対処して前記第二周辺機器にタスク信号を送信することによってチャンネルを形成するように設定される
    ことを特徴とする、請求項1乃至請求項4のいずれかに記載のマイクロコントローラ。
  6. 前記イベント発生装置は、複数の異なるイベントを伝えるように設定される
    ことを特徴とする、請求項1乃至請求項5のいずれかに記載のマイクロコントローラ。
  7. 前記イベント発生装置は、前記プロセッサによってアドレス可能な複数のイベント発生レジスタを有しており、各イベント発生レジスタは、それぞれ異なるイベントと関係付けられる
    ことを特徴とする、請求項6に記載のマイクロコントローラ。
  8. 前記イベント発生装置は、前記プログラマブル周辺機器相互接続器からタスク信号を受信できる
    ことを特徴とする、請求項1乃至請求項7のいずれかに記載のマイクロコントローラ。
  9. 前記プログラマブル周辺機器相互接続器は、イベントおよびタスクごとのそれぞれの回線によって前記周辺機器および前記イベント発生装置に接続される
    ことを特徴とする、請求項1乃至請求項8のいずれかに記載のマイクロコントローラ。
  10. 前記プログラマブル周辺機器相互接続器は、前記プロセッサによってアドレス可能で前記イベント発生装置のイベントと関係付けられた、少なくとも一つのイベントレジスタを備える
    ことを特徴とする、請求項1乃至請求項9のいずれかに記載のマイクロコントローラ。
  11. 前記イベントレジスタは、前記イベント発生レジスタとは別個であり、前記イベント発生装置は、前記イベント発生レジスタの内容に対して所定の変更が行われると前記イベントレジスタの内容に対して所定の変更がもたらされるように構成される
    ことを特徴とする、請求項10に記載のマイクロコントローラ。
  12. 前記イベント発生装置は、複数のイベント発生レジスタおよび複数のイベントレジスタを備えており、各イベント発生レジスタは、前記イベント発生レジスタの一つに対して変更が行われると前記イベントレジスタのうち関係付けられた一つに対して変更をもたらすように、前記イベントレジスタのそれぞれと関係付けられる
    ことを特徴とする、請求項1乃至請求項11のいずれかに記載のマイクロコントローラ。
  13. 前記イベント発生レジスタは前記イベントレジスタである
    ことを特徴とする、請求項10に記載のマイクロコントローラ。
  14. 前記イベント発生装置は、前記プログラマブル周辺機器相互接続器への一つ以上のイベント回線、前記プロセッサへのゼロ個以上の割り込み回線、およびゼロ個以上のレジスタ以外の出力は全く有さない
    ことを特徴とする、請求項1乃至請求項13のいずれかに記載のマイクロコントローラ。
  15. 前記イベント発生装置は、クロック入力、一つ以上のレジスタ、およびゼロ個以上のタスク回線以外の入力は全く有さない
    ことを特徴とする、請求項1乃至請求項14のいずれかに記載のマイクロコントローラ。
  16. イベントを伝えるときに割り込みを前記プロセッサに送信するための回路を備える
    ことを特徴とする、請求項1乃至請求項15のいずれかに記載のマイクロコントローラ。
  17. 各々が割り込み回線群によって前記プロセッサに接続された複数のイベント発生装置を備え、各割り込み回線群がそれぞれ異なる割り込み優先レベルを有する
    ことを特徴とする、請求項1乃至請求項16のいずれかに記載のマイクロコントローラ。
  18. プロセッサと、
    複数の周辺機器と、
    プログラマブル周辺機器相互接続器と、
    割り込み発生装置と、を備えたマイクロコントローラであって、
    前記周辺機器のうちのイベント発生周辺機器は、前記プログラマブル周辺機器相互接続器にイベントを伝えるように構成され、
    前記割り込み発生装置は、前記プログラマブル周辺機器相互接続器からタスク信号を受信すると、前記プロセッサに割り込みを送信するように設定され、
    前記プログラマブル周辺機器相互接続器は、(i)前記イベント発生周辺機器のイベントと(ii)前記割り込み発生装置との間のマッピング関係を格納できるマッピングメモリにアクセスするように構成され、
    前記プログラマブル周辺機器相互接続器は、前記イベント発生周辺機器のイベントと前記割り込み発生装置のタスクとの間のマッピング関係が前記マッピングメモリに格納されていると、前記タスクの実行を求めるタスク信号を前記割り込み発生装置に送信して前記割り込み発生装置に前記プロセッサへの割り込みを送信させることによって前記イベント発生周辺機器からの前記イベントの信号に対処するように構成される
    ことを特徴とするマイクロコントローラ。
  19. 前記割り込み発生装置は、イベント発生レジスタの内容に対する所定の変更を検出するように設定され、当該の所定の変更を検出すると、前記プログラマブル周辺機器相互接続器にイベントを伝えるイベント発生装置でもある
    ことを特徴とする、請求項18に記載のマイクロコントローラ。
  20. 前記割り込み発生装置は、前記タスク信号を受信してから所定の最大時間内に前記割り込みを送信するように設定される
    ことを特徴とする、請求項18または19に記載のマイクロコントローラ。
  21. 前記割り込み発生装置は、前記タスク信号の受信後に一定時間遅延してから前記割り込みを送信するように設定される
    ことを特徴とする、請求項18乃至請求項20のいずれかに記載のマイクロコントローラ。
  22. 各々が割り込み回線群によって前記プロセッサに接続された複数の割り込み発生装置を備え、各割り込み回線群がそれぞれ異なる割り込み優先レベルを有する
    ことを特徴とする、請求項18乃至請求項21のいずれかに記載のマイクロコントローラ。
  23. 前記プロセッサによって実行可能であって、前記イベント発生周辺機器のイベントから前記割り込み発生装置のタスクへのマッピング関係を前記マッピングメモリに格納する命令を含むソフトウェアを格納するメモリを備える
    ことを特徴とする、請求項18乃至請求項22のいずれかに記載のマイクロコントローラ。
  24. 前記割り込み発生装置は、タイミング機構を有せず、クロック入力、一つ以上のレジスタ、およびゼロ個以上のタスク回線以外の入力は有しない
    ことを特徴とする、請求項18乃至請求項23のいずれかに記載のマイクロコントローラ。
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Families Citing this family (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
GB201801572D0 (en) * 2018-01-31 2018-03-14 Nordic Semiconductor Asa Inter-processor communication
GB201806465D0 (en) 2018-04-20 2018-06-06 Nordic Semiconductor Asa Memory-access controll
GB201810663D0 (en) * 2018-06-28 2018-08-15 Nordic Semiconductor Asa Peripheral Power Domains
GB201810659D0 (en) 2018-06-28 2018-08-15 Nordic Semiconductor Asa Secure-Aware Bus System
GB201810662D0 (en) 2018-06-28 2018-08-15 Nordic Semiconductor Asa Peripheral Access On A Secure-Aware Bus System
GB201810653D0 (en) * 2018-06-28 2018-08-15 Nordic Semiconductor Asa Secure peripheral interconnect
JP7377459B2 (ja) * 2020-03-24 2023-11-10 マツダ株式会社 エンジンルーム排熱構造
TWI817747B (zh) * 2022-09-29 2023-10-01 旺宏電子股份有限公司 記憶體裝置及其管理方法

Family Cites Families (24)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE3632139A1 (de) 1986-09-22 1988-04-07 Bbc Brown Boveri & Cie Verfahren zur ausfuehrung von zwei in verschiedenen programmiersprachen geschriebenen programmen
JPH05307617A (ja) * 1992-04-28 1993-11-19 Mitsubishi Electric Corp 半導体装置
JPH07105022A (ja) * 1993-10-04 1995-04-21 Mitsubishi Electric Corp マイクロコンピュータ
US5689713A (en) 1995-03-31 1997-11-18 Sun Microsystems, Inc. Method and apparatus for interrupt communication in a packet-switched computer system
GB9611715D0 (en) 1996-06-05 1996-08-07 Int Computers Ltd Peripheral device control
US6243785B1 (en) 1998-05-20 2001-06-05 3Com Corporation Hardware assisted polling for software drivers
US7089344B1 (en) 2000-06-09 2006-08-08 Motorola, Inc. Integrated processor platform supporting wireless handheld multi-media devices
US6748548B2 (en) 2000-12-29 2004-06-08 Intel Corporation Computer peripheral device that remains operable when central processor operations are suspended
US7519802B2 (en) * 2004-05-05 2009-04-14 Hewlett-Packard Development Company, L.P. System and method for configuring a computer system
FR2905819B1 (fr) 2006-09-12 2013-01-18 Wavecom Procede de gestion de l'architecture logicielle d'un circuit de radiocommunication,application,produit programme d'ordinateur et circuit correspondants.
US7822899B2 (en) 2007-03-08 2010-10-26 Renesas Electronics Corporation Data processor and control system
US8026739B2 (en) * 2007-04-17 2011-09-27 Cypress Semiconductor Corporation System level interconnect with programmable switching
US20080276073A1 (en) 2007-05-02 2008-11-06 Analog Devices, Inc. Apparatus for and method of distributing instructions
GB0724439D0 (en) 2007-12-14 2008-01-30 Icera Inc Data transfer
JP2012522536A (ja) * 2008-04-04 2012-09-27 コンバテック テクノロジーズ インコーポレイテッド 排水可能なオストミーパウチ
WO2011045678A1 (en) 2009-10-14 2011-04-21 Energy Micro AS Direct peripheral interconnect
KR20110045949A (ko) * 2009-10-28 2011-05-04 삼성전자주식회사 회전 변환을 이용한 영상 부호화, 복호화 방법 및 장치
FR2953308B1 (fr) 2009-12-01 2011-12-09 Bull Sas Systeme autorisant des transferts directs de donnees entre des memoires de plusieurs elements de ce systeme
FR2953307B1 (fr) 2009-12-01 2011-12-16 Bull Sas Controleur d'acces direct a une memoire pour le transfert direct de donnees entre memoires de plusieurs dispositifs peripheriques
US20110197004A1 (en) * 2010-02-05 2011-08-11 Serebrin Benjamin C Processor Configured to Virtualize Guest Local Interrupt Controller
US8606975B2 (en) * 2010-05-21 2013-12-10 Oracle International Corporation Managing interrupts in a virtualized input/output device supporting multiple hosts and functions
GB2497528B (en) * 2011-12-12 2020-04-22 Nordic Semiconductor Asa Peripheral communication
GB2521607B (en) 2013-12-23 2016-03-23 Nordic Semiconductor Asa Integrated-Circuit Radio
US9952987B2 (en) * 2014-11-25 2018-04-24 Intel Corporation Posted interrupt architecture

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