JP2018092577A5 - - Google Patents
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Description
請求項１に記載した発明によれば、処理要求受付部（２７）は、電子制御装置（１１ａ〜１１ｃ，１２ａ〜１２ｃ，１３ａ〜１３ｃ，１４ａ〜１４ｃ）に対する処理要求を受け付ける。処理実行部（３１）は、複数の処理要求を同時に受け付け中に、その受け付け中の複数の処理要求を調停し、一の処理要求の信号を送信してから当該一の処理要求の信号を受信するまでの期間内で、他の処理要求の信号を送信することで、一の処理要求に応じた一の処理と他の処理要求に応じた他の処理とを並行し、複数の処理要求に応じた複数の処理を並行する。
Claims (2)
- バス（７〜１０）を介して電子制御装置（１１ａ〜１１ｃ，１２ａ〜１２ｃ，１３ａ〜１３ｃ，１４ａ〜１４ｃ）を接続する並行処理装置（３）において、
前記電子制御装置に対する処理要求を受け付ける処理要求受付部（２７）と、
複数の処理要求を同時に受け付け中に、その受け付け中の前記複数の処理要求を調停し、一の処理要求の信号を送信してから当該一の処理要求の信号を受信するまでの期間内で、他の処理要求の信号を送信することで、一の処理要求に応じた一の処理と他の処理要求に応じた他の処理とを並行し、前記複数の処理要求に応じた複数の処理を並行する処理実行部（３１）と、を備える並行処理装置。 - バス（７〜１０）を介して電子制御装置（１１ａ〜１１ｃ，１２ａ〜１２ｃ，１３ａ〜１３ｃ，１４ａ〜１４ｃ）を接続する並行処理装置（３）に、
前記電子制御装置に対する処理要求を受け付ける処理要求受付手順と、
複数の処理要求を同時に受け付け中に、その受け付け中の前記複数の処理要求を調停する調停手順と、
一の処理要求の信号を送信してから当該一の処理要求の信号を受信するまでの期間内で、他の処理要求の信号を送信することで、一の処理要求に応じた一の処理と他の処理要求に応じた他の処理とを並行し、前記複数の処理要求に応じた複数の処理を並行する処理並行手順と、を実行させる並行処理プログラム。
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