JP2018031705A5 - - Google Patents
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Description
上記目的を達成するために、本発明は、負荷電流を制御するメインスイッチング素子(Mtr)と、メインスイッチング素子にカレントミラー接続されて負荷電流に相関するセンス電流が流れるセンススイッチング素子(Str)と、を備え、
メインスイッチング素子は、出力端子として互いの間を電流が流れる第1端子(T1)および第2端子(T2)を有し、センススイッチング素子は、第1端子に接続される第3端子(T3)と、第3端子との間でセンス電流が流れる第4端子(T4)と、を有し、
第4端子に接続され、第4端子の電位を検出するためのセンス抵抗(23)を備えた半導体装置であって、
さらに、第2端子および第4端子がそれぞれ入力端子に接続されるオペアンプ(OP1,OP2,OP3,OP4)を備え、
オペアンプは、オペアンプの出力がオペアンプの入力端子にフィードバックするように構成されつつ、そのフィードバック経路にセンス抵抗を含むようにされ、
さらに、オペアンプには、第1端子よりも高い電圧(VH)が供給可能にされており、
第1端子の電位と第2端子の電位との大小関係、あるいは、第1端子の電位と第4端子の電位との大小関係に応じてセンス抵抗に流れるセンス電流の方向が切り替え可能にされ、
オペアンプは、第1オペアンプ(OP1)と第2オペアンプ(OP2)とを含み、
第1オペアンプは、第4端子が非反転入力端子に接続され、第2端子が反転入力端子に接続され、第1オペアンプの出力に応じて、非反転入力端子から第1端子よりも電位の低い基準電位に向かってセンス抵抗を介して電流が流れるようにされ、
第2オペアンプは、第1端子よりも高い電圧が供給されつつ第1オペアンプに並列に接続されるものであり、第2端子が非反転入力端子に接続され、第4端子が反転入力端子に接続され、第2オペアンプの出力に応じて、第1端子よりも電位の高い高電圧源から反転入力端子に向かってセンス抵抗を介して電流が流れるようにされ、
第1端子の電位が第2端子よりも高電位のとき、第1オペアンプが有効にされるとともに第2オペアンプが無効にされ、
第1端子の電位が第2端子よりも低電位のとき、第1オペアンプが無効にされるとともに第2オペアンプが有効にされる。
メインスイッチング素子は、出力端子として互いの間を電流が流れる第1端子(T1)および第2端子(T2)を有し、センススイッチング素子は、第1端子に接続される第3端子(T3)と、第3端子との間でセンス電流が流れる第4端子(T4)と、を有し、
第4端子に接続され、第4端子の電位を検出するためのセンス抵抗(23)を備えた半導体装置であって、
さらに、第2端子および第4端子がそれぞれ入力端子に接続されるオペアンプ(OP1,OP2,OP3,OP4)を備え、
オペアンプは、オペアンプの出力がオペアンプの入力端子にフィードバックするように構成されつつ、そのフィードバック経路にセンス抵抗を含むようにされ、
さらに、オペアンプには、第1端子よりも高い電圧(VH)が供給可能にされており、
第1端子の電位と第2端子の電位との大小関係、あるいは、第1端子の電位と第4端子の電位との大小関係に応じてセンス抵抗に流れるセンス電流の方向が切り替え可能にされ、
オペアンプは、第1オペアンプ(OP1)と第2オペアンプ(OP2)とを含み、
第1オペアンプは、第4端子が非反転入力端子に接続され、第2端子が反転入力端子に接続され、第1オペアンプの出力に応じて、非反転入力端子から第1端子よりも電位の低い基準電位に向かってセンス抵抗を介して電流が流れるようにされ、
第2オペアンプは、第1端子よりも高い電圧が供給されつつ第1オペアンプに並列に接続されるものであり、第2端子が非反転入力端子に接続され、第4端子が反転入力端子に接続され、第2オペアンプの出力に応じて、第1端子よりも電位の高い高電圧源から反転入力端子に向かってセンス抵抗を介して電流が流れるようにされ、
第1端子の電位が第2端子よりも高電位のとき、第1オペアンプが有効にされるとともに第2オペアンプが無効にされ、
第1端子の電位が第2端子よりも低電位のとき、第1オペアンプが無効にされるとともに第2オペアンプが有効にされる。
Claims (2)
- 負荷電流を制御するメインスイッチング素子(Mtr)と、前記メインスイッチング素子にカレントミラー接続されて前記負荷電流に相関するセンス電流が流れるセンススイッチング素子(Str)と、を備え、
前記メインスイッチング素子は、出力端子として互いの間を電流が流れる第1端子(T1)および第2端子(T2)を有し、
前記センススイッチング素子は、前記第1端子に接続される第3端子(T3)と、前記第3端子との間で前記センス電流が流れる第4端子(T4)と、を有し、
前記第4端子に接続され、前記第4端子の電位を検出するためのセンス抵抗(23)を備えた半導体装置であって、
さらに、前記第2端子および前記第4端子がそれぞれ入力端子に接続されるオペアンプ(OP1,OP2,OP3,OP4)を備え、
前記オペアンプは、前記オペアンプの出力が前記オペアンプの入力端子にフィードバックするように構成されつつ、そのフィードバック経路に前記センス抵抗を含むようにされ、
さらに、前記オペアンプには、前記第1端子よりも高い電圧(VH)が供給可能にされており、
前記第1端子の電位と前記第2端子の電位との大小関係、あるいは、前記第1端子の電位と前記第4端子の電位との大小関係に応じて前記センス抵抗に流れる前記センス電流の方向が切り替え可能にされ、
前記オペアンプは、第1オペアンプ(OP1)と第2オペアンプ(OP2)とを含み、
前記第1オペアンプは、前記第4端子が非反転入力端子に接続され、前記第2端子が反転入力端子に接続され、前記第1オペアンプの出力に応じて、非反転入力端子から前記第1端子よりも電位の低い基準電位に向かって前記センス抵抗を介して電流が流れるようにされ、
前記第2オペアンプは、前記第1端子よりも高い電圧が供給されつつ前記第1オペアンプに並列に接続されるものであり、前記第2端子が非反転入力端子に接続され、前記第4端子が反転入力端子に接続され、前記第2オペアンプの出力に応じて、前記第1端子よりも電位の高い高電圧源から反転入力端子に向かって前記センス抵抗を介して電流が流れるようにされ、
前記第1端子の電位が前記第2端子よりも高電位のとき、前記第1オペアンプが有効にされるとともに前記第2オペアンプが無効にされ、
前記第1端子の電位が前記第2端子よりも低電位のとき、前記第1オペアンプが無効にされるとともに前記第2オペアンプが有効にされる半導体装置。 - 負荷電流を制御するメインスイッチング素子(Mtr)と、前記メインスイッチング素子にカレントミラー接続されて前記負荷電流に相関するセンス電流が流れるセンススイッチング素子(Str)と、を備え、
前記メインスイッチング素子は、出力端子として互いの間を電流が流れる第1端子(T1)および第2端子(T2)を有し、
前記センススイッチング素子は、前記第1端子に接続される第3端子(T3)と、前記第3端子との間で前記センス電流が流れる第4端子(T4)と、を有し、
前記第4端子に接続され、前記第4端子の電位を検出するためのセンス抵抗(23)を備えた半導体装置であって、
さらに、前記第2端子および前記第4端子がそれぞれ入力端子に接続されるオペアンプ(OP1,OP2,OP3,OP4)を備え、
前記オペアンプは、前記オペアンプの出力が前記オペアンプの入力端子にフィードバックするように構成されつつ、そのフィードバック経路に前記センス抵抗を含むようにされ、
さらに、前記オペアンプには、前記第1端子よりも高い電圧(VH)が供給可能にされており、
前記第1端子の電位と前記第2端子の電位との大小関係、あるいは、前記第1端子の電位と前記第4端子の電位との大小関係に応じて前記センス抵抗に流れる前記センス電流の方向が切り替え可能にされ、
前記オペアンプ(OP3)の入力端子と、前記第2端子および前記第4端子と、の間に介在する第1スイッチ回路(31)と、
前記オペアンプの出力端子と、前記センス抵抗と、の間に介在する第2スイッチ回路(32)と、を備え、
前記第1スイッチ回路は、
前記第2端子を、非反転入力端子および反転入力端子のいずれか一方に接続するとともに、前記第4端子を、前記第2端子が接続されない他方の入力端子に接続し、
前記第2スイッチ回路は、
前記第2端子が非反転入力端子に接続されるときには、前記オペアンプの出力に応じて、非反転入力端子から前記第1端子よりも電位の低い基準電位に向かって前記センス抵抗を介して電流が流れるようにするとともに、
前記第2端子が反転入力端子に接続されるときには、前記オペアンプの出力に応じて、前記第1端子よりも電位の高い高電圧源から反転入力端子に向かって前記センス抵抗を介して電流が流れるようにする半導体装置。
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