JP2017507556A - 3相シグナリングのためのアナログビヘイビアモデリング - Google Patents
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Abstract
Description
本出願は、内容の全体が参照によって本明細書に組み込まれる、2014年1月15日に米国特許商標庁に出願された、米国非仮特許出願第14/156,329号の優先権および利益を主張する。
A B C D A B C E A B C F A B D E A B D F
A B E F A C D E A C D F A C E F A D E F
B C D E B C D F B C E F B D E F C D E F
+ + - - + - - + + - + - - + - + - + + - - - + +
102 処理回路
106 通信トランシーバ
108 ASIC
110 アプリケーションプログラミングインターフェース(API)
112 メモリ
114 ローカルデータベース
122 アンテナ
124 ディスプレイ
126 キーパッド
128 ボタン
200 装置
202 ICデバイス
204 ワイヤレストランシーバ
206 プロセッサ
208 記憶媒体
210 物理レイヤドライバ
212 バス
220 通信リンク
222 チャネル
224 チャネル
226 チャネル
230 ICデバイス
232 ディスプレイコントローラ
234 カメラコントローラ
236 プロセッサ
238 記憶媒体
240 物理レイヤドライバ
242 バス
302 マッパー
304 並直列変換器
306 Mワイヤ相エンコーダ
308 ドライバ
310 信号ワイヤ
310 ビットデータ
312 シンボル
408 極性
410 位相遷移
412 データ
502 差動受信機
504 差分信号
506 位相変化検出回路
508 信号
510 ワイヤ
512 受信クロック
522 マーカー
524 マーカー
526 マーカー
530 シンボルキャプチャウィンドウ
902 処理回路
904 シミュレーションツール
910 コネクタ
914 デジタル構成要素
916 スケジューラ
1102 処理回路
1104 モジュール
1106 モジュール
1108 モジュール
1112 モジュール
1116 プロセッサ
1118 コンピュータ可読記憶媒体
1120 バス
Claims (48)
- 少なくとも1つの処理回路を備え、前記少なくとも1つの処理回路が、
通信リンクにおける物理接続を表すデジタル信号、および前記物理接続を介して送信される3相信号を特徴づける仮想信号を生成する
ように構成され、前記仮想信号が、前記物理接続の1つまたは複数のアナログ特性を表し、前記アナログ特性が前記3相信号を定義する電圧状態を含む、
装置。 - 前記電圧状態が、少なくとも3つの有効な電圧状態を含み、各電圧状態が、前記物理接続に関連する電圧レベルに対応する、請求項1に記載の装置。
- 前記少なくとも3つの有効な電圧状態のうちの1つが、非駆動状態を含み、前記通信リンクがアクティブ動作モードであるとき、前記通信リンクにおける1つの物理接続のみが前記非駆動状態である、請求項2に記載の装置。
- 前記仮想信号が前記物理接続の1つまたは複数の動作モードの間で選択し、非アクティブ動作モードが選択されたとき、前記物理接続が、高インピーダンス状態または未定義状態である、請求項2に記載の装置。
- 前記通信リンクが、3つの物理接続を含み、アクティブ動作モードが選択されたとき、各物理接続が、前記3相信号の異なる位相を通信し、前記3つの物理接続の各々が、前記非アクティブ動作モードの前記高インピーダンス状態である、請求項4に記載の装置。
- 前記1つまたは複数の動作モードが、高速モードおよび低速モードを含む、請求項4に記載の装置。
- 前記デジタル信号が、第1の電圧状態と第2の電圧状態との間で選択する第1のバイナリビットを含む、請求項1に記載の装置。
- 前記第2の電圧状態の電圧レベルが前記仮想信号によって選択される、請求項7に記載の装置。
- 前記3相信号が、最大電圧レベルおよび最小電圧レベルで囲まれた電圧範囲内で切り替わり、
前記第1の電圧状態が、前記最小電圧レベルとして定義され、
前記第2の電圧状態の前記電圧レベルが、前記最大電圧レベル、または前記最小電圧レベルよりも大きく前記最大電圧レベルよりも小さい中間電圧レベルのいずれかとして前記仮想信号によって選択される
請求項7に記載の装置。 - 前記3相信号が、最大電圧レベルおよび最小電圧レベルで囲まれた電圧範囲内で切り替わり、
前記第1の電圧状態が、前記最大電圧レベルとして定義され、
前記第2の電圧状態の前記電圧レベルが、前記最小電圧レベル、または前記最小電圧レベルよりも大きく前記最大電圧レベルよりも小さい中間電圧レベルのいずれかとして前記仮想信号によって選択される
請求項7に記載の装置。 - 前記仮想信号が、前記通信リンクが低速動作モードで動作されるときの前記物理接続の異なるアナログビヘイビアである、前記通信リンクが高速モードで動作されるときの前記物理接続のアナログビヘイビアを特徴づける、請求項1に記載の装置。
- 前記物理接続の前記アナログビヘイビアが、立上り時間、または前記物理接続上の信号状態間の立上り時間のレートを含む、請求項11に記載の装置。
- デジタルシステムをシミュレーションするための方法であって、
通信リンクにおける物理接続を表すデジタル信号を生成するステップと、
前記物理接続を介して送信される3相信号を特徴づける仮想信号を生成するステップと、
前記物理接続の1つまたは複数のアナログ特性をモデル化するように前記仮想信号を構成するステップであり、前記アナログ特性が前記3相信号を定義する電圧状態を含む、ステップと
を含み、前記物理接続の前記アナログ特性が、前記3相信号のシグナリング状態に対応する少なくとも3つの電圧状態を含む
方法。 - 前記電圧状態が、少なくとも3つの有効な電圧状態を含み、各電圧状態が、前記物理接続に関連する電圧レベルに対応する、請求項13に記載の方法。
- 前記少なくとも3つの有効な電圧状態のうちの1つが、非駆動状態を含み、前記通信リンクがアクティブ動作モードであるとき、前記通信リンクにおける1つの物理接続のみが前記非駆動状態である、請求項14に記載の方法。
- 前記仮想信号が前記物理接続の1つまたは複数の動作モードの間で選択し、非アクティブ動作モードが選択されたとき、前記物理接続が、高インピーダンス状態または未定義状態である、請求項14に記載の方法。
- 前記通信リンクが、3つの物理接続を含み、アクティブ動作モードが選択されたとき、各物理接続が、前記3相信号の異なる位相を通信し、前記3つの物理接続の各々が、前記非アクティブ動作モードの前記高インピーダンス状態である、請求項16に記載の方法。
- 前記1つまたは複数の動作モードが、高速モードおよび低速モードを含む、請求項16に記載の方法。
- 前記デジタル信号が、第1の電圧状態と第2の電圧状態との間で選択する第1のバイナリビットを含む、請求項13に記載の方法。
- 前記第2の電圧状態の電圧レベルが前記仮想信号によって選択される、請求項19に記載の方法。
- 前記3相信号が、最大電圧レベルおよび最小電圧レベルで囲まれた電圧範囲内で切り替わり、
前記第1の電圧状態が、前記最小電圧レベルとして定義され、
前記第2の電圧状態の前記電圧レベルが、前記最大電圧レベル、または前記最小電圧レベルよりも大きく前記最大電圧レベルよりも小さい中間電圧レベルのいずれかとして前記仮想信号によって選択される
請求項19に記載の方法。 - 前記3相信号が、最大電圧レベルおよび最小電圧レベルで囲まれた電圧範囲内で切り替わり、
前記第1の電圧状態が、前記最大電圧レベルとして定義され、
前記第2の電圧状態の前記電圧レベルが、前記最小電圧レベル、または前記最小電圧レベルよりも大きく前記最大電圧レベルよりも小さい中間電圧レベルのいずれかとして前記仮想信号によって選択される
請求項19に記載の方法。 - 前記仮想信号が、前記通信リンクが低速動作モードで動作されるときの前記物理接続の異なるアナログビヘイビアである、前記通信リンクが高速モードで動作されるときの前記物理接続のアナログビヘイビアを特徴づける、請求項13に記載の方法。
- 前記物理接続の前記アナログビヘイビアが、立上り時間、または前記物理接続上の信号状態間の立上り時間のレートを含む、請求項23に記載の方法。
- 通信リンクにおける物理接続を表すデジタル信号を生成するための手段と、
前記物理接続を介して送信される3相信号を特徴づける仮想信号を生成するための手段と、
前記物理接続の1つまたは複数のアナログ特性をモデル化するように前記仮想信号を構成するための手段であり、前記アナログ特性が前記3相信号を定義する電圧状態を含む、手段と
を含み、前記物理接続の前記アナログ特性が、前記3相信号のシグナリング状態に対応する少なくとも3つの電圧状態を含む
装置。 - 前記電圧状態が、少なくとも3つの有効な電圧状態を含み、各電圧状態が、前記物理接続に関連する電圧レベルに対応する、請求項25に記載の装置。
- 前記少なくとも3つの有効な電圧状態のうちの1つが、非駆動状態を含み、前記通信リンクがアクティブ動作モードであるとき、前記通信リンクにおける1つの物理接続のみが前記非駆動状態である、請求項26に記載の装置。
- 前記仮想信号が前記物理接続の1つまたは複数の動作モードの間で選択し、非アクティブ動作モードが選択されたとき、前記物理接続が、高インピーダンス状態または未定義状態である、請求項26に記載の装置。
- 前記通信リンクが、3つの物理接続を含み、アクティブ動作モードが選択されたとき、各物理接続が、前記3相信号の異なる位相を通信し、前記3つの物理接続の各々が、前記非アクティブ動作モードの前記高インピーダンス状態である、請求項28に記載の装置。
- 前記1つまたは複数の動作モードが、高速モードおよび低速モードを含む、請求項28に記載の装置。
- 前記デジタル信号が、第1の電圧状態と第2の電圧状態との間で選択する第1のバイナリビットを含む、請求項25に記載の装置。
- 前記第2の電圧状態の電圧レベルが前記仮想信号によって選択される、請求項31に記載の装置。
- 前記3相信号が、最大電圧レベルおよび最小電圧レベルで囲まれた電圧範囲内で切り替わり、
前記第1の電圧状態が、前記最小電圧レベルとして定義され、
前記第2の電圧状態の前記電圧レベルが、前記最大電圧レベル、または前記最小電圧レベルよりも大きく前記最大電圧レベルよりも小さい中間電圧レベルのいずれかとして前記仮想信号によって選択される
請求項31に記載の装置。 - 前記3相信号が、最大電圧レベルおよび最小電圧レベルで囲まれた電圧範囲内で切り替わり、
前記第1の電圧状態が、前記最大電圧レベルとして定義され、
前記第2の電圧状態の前記電圧レベルが、前記最小電圧レベル、または前記最小電圧レベルよりも大きく前記最大電圧レベルよりも小さい中間電圧レベルのいずれかとして前記仮想信号によって選択される
請求項31に記載の装置。 - 前記仮想信号が、前記通信リンクが低速動作モードで動作されるときの前記物理接続の異なるアナログビヘイビアである、前記通信リンクが高速モードで動作されるときの前記物理接続のアナログビヘイビアを特徴づける、請求項25に記載の装置。
- 前記物理接続の前記アナログビヘイビアが、立上り時間、または前記物理接続上の信号状態間の立上り時間のレートを含む、請求項35に記載の装置。
- デジタルシステムをシミュレーションするための装置であって、
少なくとも1つの処理回路と、
プロセッサと電子通信しているプロセッサ可読記憶媒体とを備え、前記プロセッサ可読記憶媒体が、1つまたは複数の命令を有し、前記1つまたは複数の命令が、前記少なくとも1つの処理回路によって実行されたときに、前記少なくとも1つの処理回路に、
通信リンクにおける物理接続を表すデジタル信号を生成させ、
前記物理接続を介して送信される3相信号を特徴づける仮想信号を生成させ、
前記物理接続の1つまたは複数のアナログ特性をモデル化するように前記仮想信号を構成させ、前記アナログ特性が前記3相信号を定義する電圧状態を含み、
前記物理接続の前記アナログ特性が、前記3相信号のシグナリング状態に対応する少なくとも3つの電圧状態を含む
装置。 - 前記電圧状態が、少なくとも3つの有効な電圧状態を含み、各電圧状態が、前記物理接続に関連する電圧レベルに対応する、請求項37に記載の装置。
- 前記少なくとも3つの有効な電圧状態のうちの1つが、非駆動状態を含み、前記通信リンクがアクティブ動作モードであるとき、前記通信リンクにおける1つの物理接続のみが前記非駆動状態である、請求項38に記載の装置。
- 前記仮想信号が前記物理接続の1つまたは複数の動作モードの間で選択し、非アクティブ動作モードが選択されたとき、前記物理接続が、高インピーダンス状態または未定義状態である、請求項38に記載の装置。
- 前記通信リンクが、3つの物理接続を含み、アクティブ動作モードが選択されたとき、各物理接続が、前記3相信号の異なる位相を通信し、前記3つの物理接続の各々が、前記非アクティブ動作モードの前記高インピーダンス状態である、請求項40に記載の装置。
- 前記1つまたは複数の動作モードが、高速モードおよび低速モードを含む、請求項40に記載の装置。
- 前記デジタル信号が、第1の電圧状態と第2の電圧状態との間で選択する第1のバイナリビットを含む、請求項37に記載の装置。
- 前記第2の電圧状態の電圧レベルが前記仮想信号によって選択される、請求項43に記載の装置。
- 前記3相信号が、最大電圧レベルおよび最小電圧レベルで囲まれた電圧範囲内で切り替わり、
前記第1の電圧状態が、前記最小電圧レベルとして定義され、
前記第2の電圧状態の前記電圧レベルが、前記最大電圧レベル、または前記最小電圧レベルよりも大きく前記最大電圧レベルよりも小さい中間電圧レベルのいずれかとして前記仮想信号によって選択される
請求項43に記載の装置。 - 前記3相信号が、最大電圧レベルおよび最小電圧レベルで囲まれた電圧範囲内で切り替わり、
前記第1の電圧状態が、前記最大電圧レベルとして定義され、
前記第2の電圧状態の前記電圧レベルが、前記最小電圧レベル、または前記最小電圧レベルよりも大きく前記最大電圧レベルよりも小さい中間電圧レベルのいずれかとして前記仮想信号によって選択される
請求項43に記載の装置。 - 前記仮想信号が、前記通信リンクが低速動作モードで動作されるときの前記物理接続の異なるアナログビヘイビアである、前記通信リンクが高速モードで動作されるときの前記物理接続のアナログビヘイビアを特徴づける、請求項37に記載の装置。
- 前記物理接続の前記アナログビヘイビアが、立上り時間、または前記物理接続上の信号状態間の立上り時間のレートを含む、請求項47に記載の装置。
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Families Citing this family (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9584227B2 (en) | 2015-07-17 | 2017-02-28 | Qualcomm Incorporated | Low-power mode signal bridge for optical media |
WO2017159074A1 (ja) * | 2016-03-14 | 2017-09-21 | ソニー株式会社 | 送信装置、送信方法、および通信システム |
US10705894B2 (en) | 2016-05-30 | 2020-07-07 | Samsung Electronics Co., Ltd. | Electronic device for authenticating application and operating method thereof |
US10419246B2 (en) * | 2016-08-31 | 2019-09-17 | Qualcomm Incorporated | C-PHY training pattern for adaptive equalization, adaptive edge tracking and delay calibration |
KR20180061560A (ko) | 2016-11-29 | 2018-06-08 | 삼성전자주식회사 | 통신 환경에 의존하여 지연을 조절하는 전자 회로 |
US11748539B1 (en) * | 2017-09-28 | 2023-09-05 | Cadence Design Systems, Inc. | Converting analog variable delay in real number modeling code to cycle-driven simulation interface code |
US11442098B2 (en) * | 2019-06-20 | 2022-09-13 | Teradyne, Inc. | Generating a waveform based on digital pulses |
US11108604B2 (en) | 2019-08-19 | 2021-08-31 | Qualcomm Incorporated | Driver architecture for multiphase and amplitude encoding transmitters |
KR20210089811A (ko) * | 2020-01-08 | 2021-07-19 | 삼성전자주식회사 | 외부 신호에 기초하여, 전력 모드의 변경을 감지하는 전자 장치 |
US11757611B2 (en) | 2021-04-11 | 2023-09-12 | Litrinium, Inc. | PAM4 threshold phase engine |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2006093988A (ja) * | 2004-09-22 | 2006-04-06 | Sony Corp | エンコーダ装置およびデコーダ装置 |
JP2010021789A (ja) * | 2008-07-10 | 2010-01-28 | Toshiba Corp | スキュー故障検出回路およびスキュー故障検出方法 |
JP2011517159A (ja) * | 2008-03-05 | 2011-05-26 | クゥアルコム・インコーポレイテッド | 多元送信機システム及び方法 |
WO2014005117A1 (en) * | 2012-06-29 | 2014-01-03 | Qualcomm Incorporated | N-phase polarity output pin mode multiplexer |
Family Cites Families (20)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5452231A (en) | 1988-10-05 | 1995-09-19 | Quickturn Design Systems, Inc. | Hierarchically connected reconfigurable logic assembly |
US6675328B1 (en) * | 1999-10-08 | 2004-01-06 | Vigilant Networks, Llc | System and method to determine data throughput in a communication network |
US6980644B1 (en) * | 2000-05-12 | 2005-12-27 | National Semiconductor Corporation | System and method for adapting an analog echo canceller in a transceiver front end |
US6725404B1 (en) * | 2000-05-26 | 2004-04-20 | International Business Machines Corporation | Evaluation of interconnect reliability using propagation delay through interconnect |
US6760882B1 (en) * | 2000-09-19 | 2004-07-06 | Intel Corporation | Mode selection for data transmission in wireless communication channels based on statistical parameters |
US7145411B1 (en) * | 2002-03-18 | 2006-12-05 | Applied Micro Circuits Corporation | Flexible differential interconnect cable with isolated high frequency electrical transmission line |
JP4610380B2 (ja) * | 2005-03-16 | 2011-01-12 | 三菱電機株式会社 | 電力変換装置 |
US20070099586A1 (en) * | 2005-11-01 | 2007-05-03 | Silicon Laboratories Inc. | System and method for reducing spurious emissions in a wireless communication device including a testing apparatus |
US20070129926A1 (en) | 2005-12-01 | 2007-06-07 | Verheyen Henry T | Hardware acceleration system for simulation of logic and memory |
EP1936773A1 (en) * | 2006-12-22 | 2008-06-25 | Abb Research Ltd. | System and method to detect a forgotten safety ground of an electrical facility |
US9711041B2 (en) * | 2012-03-16 | 2017-07-18 | Qualcomm Incorporated | N-phase polarity data transfer |
US7492287B2 (en) * | 2007-05-23 | 2009-02-17 | Micron Technology, Inc. | Two-bit tri-level forced transition encoding |
US8352793B2 (en) * | 2008-08-15 | 2013-01-08 | Apple Inc. | Device testing method and architecture |
EP2344897B1 (en) | 2008-11-14 | 2015-06-17 | Teradyne, Inc. | Method and apparatus for testing electrical connections on a printed circuit board |
US7978110B2 (en) * | 2009-05-11 | 2011-07-12 | Taiwan Semiconductor Manufacturing Company, Ltd. | Digital-to-analog converter |
KR20110052205A (ko) * | 2009-11-12 | 2011-05-18 | 삼성전자주식회사 | 외부 루프백 테스트 기능을 갖는 전송 전용 집적회로 칩 및 그에 따른 외부 루프백 테스트 방법 |
WO2012103246A2 (en) | 2011-01-25 | 2012-08-02 | Power Analytics Corporation | Systems and methods for real-time dc microgrid power analytics for mission-critical power systems |
EP2509314B1 (en) * | 2011-04-04 | 2019-12-04 | Interlemo Holding S.A. | Installation for conveying signals between a video camera equipment and a remote equipment |
CN202403774U (zh) | 2011-12-29 | 2012-08-29 | 兰州海默科技股份有限公司 | 多相流模拟实验信号发生装置 |
US9317353B2 (en) * | 2013-12-26 | 2016-04-19 | Intel Corporation | Method, apparatus and system for performing voltage margining |
-
2014
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JP2006093988A (ja) * | 2004-09-22 | 2006-04-06 | Sony Corp | エンコーダ装置およびデコーダ装置 |
JP2011517159A (ja) * | 2008-03-05 | 2011-05-26 | クゥアルコム・インコーポレイテッド | 多元送信機システム及び方法 |
JP2010021789A (ja) * | 2008-07-10 | 2010-01-28 | Toshiba Corp | スキュー故障検出回路およびスキュー故障検出方法 |
WO2014005117A1 (en) * | 2012-06-29 | 2014-01-03 | Qualcomm Incorporated | N-phase polarity output pin mode multiplexer |
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