JP2017175008A - Esd保護回路およびesd保護方法 - Google Patents
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Abstract
Description
直列接続される2本の伝送線路4a,4bと、一端が前記2本の伝送線路の間に接続されるとともに他端がグラウンドに接続された静電容量を有する保護素子4cとからなる構成を1単位として、隣り合う単位の保護素子がアンチパラレル接続されるように複数単位を前記第1の信号端子と前記第2の信号端子との間に直列接続することを特徴とする。
反射波が一番小さくなるように前記伝送線路4a,4bの線路の長さと特性インピーダンスを設定することを特徴とする。
直列接続される2本の伝送線路4a,4bと、一端が前記2本の伝送線路の間に接続されるとともに他端がグラウンドに接続された静電容量を有する保護素子4cとからなる構成を1単位として、隣り合う単位の保護素子がアンチパラレル接続されるように複数単位を前記第1の信号端子と前記第2の信号端子との間に直列接続するステップを含むことを特徴とする。
反射波が一番小さくなるように前記伝送線路4a,4bの線路の長さと特性インピーダンスを設定するステップを更に含むことを特徴とする。
2 第1の信号端子
3 第2の信号端子
4(4A,4B,4C,4D) 保護回路
4a,4b 伝送線路
4c 保護素子
Claims (4)
- 信号が伝送される第1の信号端子(2)または第2の信号端子(3)にESDが印可されたときに、前記第1の信号端子または前記第2の信号端子に接続されている回路を前記ESDから保護するESD保護回路(1)において、
直列接続される2本の伝送線路(4a,4b)と、一端が前記2本の伝送線路の間に接続されるとともに他端がグラウンドに接続された静電容量を有する保護素子(4c)とからなる構成を1単位として、隣り合う単位の保護素子がアンチパラレル接続されるように複数単位を前記第1の信号端子と前記第2の信号端子との間に直列接続することを特徴とするESD保護回路。 - 反射波が一番小さくなるように前記伝送線路(4a,4b)の線路の長さと特性インピーダンスを設定することを特徴とする請求項1記載のESD保護回路。
- 信号が伝送される第1の信号端子(2)または第2の信号端子(3)にESDが印可されたときに、前記第1の信号端子または前記第2の信号端子に接続されている回路を前記ESDから保護するESD保護方法において、
直列接続される2本の伝送線路(4a,4b)と、一端が前記2本の伝送線路の間に接続されるとともに他端がグラウンドに接続された静電容量を有する保護素子(4c)とからなる構成を1単位として、隣り合う単位の保護素子がアンチパラレル接続されるように複数単位を前記第1の信号端子と前記第2の信号端子との間に直列接続するステップを含むことを特徴とするESD保護方法。 - 反射波が一番小さくなるように前記伝送線路(4a,4b)の線路の長さと特性インピーダンスを設定するステップを更に含むことを特徴とするESD保護方法。
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Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0435204A (ja) * | 1990-05-25 | 1992-02-06 | Nippon Telegr & Teleph Corp <Ntt> | 整合回路 |
JPH08162942A (ja) * | 1994-11-29 | 1996-06-21 | Mitsubishi Electric Corp | 出力回路、入力回路、およびこれらを用いた入出力インタフェースシステム |
JP2000510653A (ja) * | 1997-04-16 | 2000-08-15 | ザ ボード オブ トラスティーズ オブ ザ リーランド スタンフォード ジュニア ユニバーシティ | 高速集積回路のための分散型esd保護デバイス |
JP2006078268A (ja) * | 2004-09-08 | 2006-03-23 | Nec Electronics Corp | 静電気放電耐性特性の測定及び静電気破壊試験用装置 |
JP2007013031A (ja) * | 2005-07-04 | 2007-01-18 | Toshiba Corp | 高周波半導体回路及び無線通信機器 |
WO2008053555A1 (fr) * | 2006-11-02 | 2008-05-08 | Shimadzu Corporation | Circuit de protection d'entrée de signal analogique haut-débit et spectromètre de masse de temps de vol |
JP2011049559A (ja) * | 2009-08-27 | 2011-03-10 | Imec | 広帯域esd保護を与える方法とそれにより得られる回路 |
-
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Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0435204A (ja) * | 1990-05-25 | 1992-02-06 | Nippon Telegr & Teleph Corp <Ntt> | 整合回路 |
JPH08162942A (ja) * | 1994-11-29 | 1996-06-21 | Mitsubishi Electric Corp | 出力回路、入力回路、およびこれらを用いた入出力インタフェースシステム |
JP2000510653A (ja) * | 1997-04-16 | 2000-08-15 | ザ ボード オブ トラスティーズ オブ ザ リーランド スタンフォード ジュニア ユニバーシティ | 高速集積回路のための分散型esd保護デバイス |
JP2006078268A (ja) * | 2004-09-08 | 2006-03-23 | Nec Electronics Corp | 静電気放電耐性特性の測定及び静電気破壊試験用装置 |
JP2007013031A (ja) * | 2005-07-04 | 2007-01-18 | Toshiba Corp | 高周波半導体回路及び無線通信機器 |
WO2008053555A1 (fr) * | 2006-11-02 | 2008-05-08 | Shimadzu Corporation | Circuit de protection d'entrée de signal analogique haut-débit et spectromètre de masse de temps de vol |
JP2011049559A (ja) * | 2009-08-27 | 2011-03-10 | Imec | 広帯域esd保護を与える方法とそれにより得られる回路 |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPWO2022018823A1 (ja) * | 2020-07-21 | 2022-01-27 | ||
WO2022018823A1 (ja) * | 2020-07-21 | 2022-01-27 | 日本電信電話株式会社 | ドライバ回路 |
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