JP2015073058A - 光発電素子 - Google Patents

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Abstract

【課題】高い短絡電流及び開放電圧を有し、光電変換効率に優れる光発電素子を提供する。
【解決手段】n型結晶半導体基板11と、n型結晶半導体基板11の一側にこの順で積層される第1の導電型非晶質系半導体層13及び第1の透明導電膜14と、n型結晶半導体基板11の他側にこの順で積層される第2の導電型非晶質系半導体層17及び第2の透明導電膜18とを備え、一側が光入射面として用いられる光発電素子10において、第1の透明導電膜14の一側に直接積層される透明絶縁膜15をさらに備える。
【選択図】図1

Description

本発明はヘテロ接合を有する光発電素子に関する。
CO等の温室効果ガスを発生しないクリーンな発電手段として、また、原子力発電に代わる操業安全性の高い発電手段として、光発電素子(太陽電池)が注目されている。光発電素子の一つとして、発電効率の高いヘテロ接合を有する光発電素子がある。
このような光発電素子として、図6に示す構造の光発電素子40が開発されている。光発電素子40は、n型結晶半導体基板41の一側に第1の真性非晶質系半導体薄膜42、n型非晶質系半導体薄膜43及び第1の透明導電膜44がこの順に積層され、n型結晶半導体基板41の他側に第2の真性非晶質系半導体薄膜45、p型非晶質系半導体薄膜46及び第2の透明導電膜47がこの順に積層されている。また、第1の透明導電膜44の表面に第1の集電極48が、第2の透明導電膜47の表面には第2の集電極49が配設されている(特許文献1参照)。光発電素子においては、光電変換効率を向上させるために、短絡電流(Isc)、開放電圧(Voc)、曲線因子(FF:フィルファクター)等を向上させる必要がある。
一方、バックコンタクト構造を有するヘテロ接合型の光発電素子において、光入射面にSiN等から形成される反射防止膜を積層させる技術が提案されている(特許文献2、3参照)。反射防止膜を積層させることにより、効率的に光がセル内部に取り込まれ、光電変換効率が高まる。しかし、特許文献2、3には、反射防止膜の有無と、短絡電流、開放電圧等との関係についての記載は無い。すなわち、特許文献2、3に記載の光発電素子におけるSiN等の反射防止膜は、単に光入射面での光の反射を抑制することで入光量を増やす機能のみを有する膜として形成されている。
特許第5031007号公報 特許第3998619号公報 特許第4155899号公報
本発明はかかる事情に鑑みてなされたもので、高い短絡電流及び開放電圧を有し、光電変換効率に優れる光発電素子を提供することを目的とする。
前記目的に沿う本発明に係る光発電素子は、n型結晶半導体基板と、該n型結晶半導体基板の一側にこの順で積層される第1の導電型非晶質系半導体層及び第1の透明導電膜と、前記n型結晶半導体基板の他側にこの順で積層される第2の導電型非晶質系半導体層及び第2の透明導電膜とを備え、
前記第1の導電型非晶質系半導体層及び前記第2の導電型非晶質系半導体層のいずれか一方がn型非晶質系半導体層であり、他方がp型非晶質系半導体層であり、
一側が光入射面として用いられる光発電素子において、
前記第1の透明導電膜の一側に直接積層される透明絶縁膜をさらに備える。
発明者らは、光入射面側に配置される透明導電膜の光入射面側に直接透明絶縁膜を積層させることにより、この透明絶縁膜が光の反射を抑制させる効果以外に、短絡電流及び開放電圧を高める効果を有することを知見した。この理由としては、透明導電膜と導電型非晶質系半導体層とが接合することにより生じるバンドベンディングの影響が、透明絶縁膜により緩和されることなどが推測される。従って、本発明に係る光発電素子によれば、高い短絡電流及び開放電圧を有し、光電変換効率に優れる。
本発明に係る光発電素子において、前記透明絶縁膜の屈折率が1.5以上2以下であることが好ましい。このような範囲の屈折率を有する透明絶縁膜を用いることで、反射抑制機能を高め、より光変換効率を高めることができる。
本発明に係る光発電素子において、前記透明絶縁膜が窒化ケイ素、酸化ケイ素又は酸窒化ケイ素により形成されていることが好ましい。透明絶縁膜としてこれらの化合物を用いることで、光電変換効率がより高まることに加え、耐湿性も高めることができる。
本発明に係る光発電素子において、前記透明絶縁膜の厚さが10nm以上500nm以下であることが好ましい。透明絶縁膜の厚さを上記範囲とすることで、光電変換率をより高めることができる。
本発明に係る光発電素子において、前記n型結晶半導体基板と前記p型非晶質系半導体層との間に積層される真性非晶質系半導体層をさらに備えることが好ましい。基板とp型非晶質系半導体層との間に真性非晶質系半導体層を設けることで、光生成キャリアの再結合を抑制し、光電変換効率をさらに高めることができる。
本発明に係る光発電素子において、前記第1の導電型非晶質系半導体層が前記n型非晶質系半導体層であり、前記第2の導電型非晶質系半導体層が前記p型非晶質系半導体層であることが好ましい。n型非晶質系半導体層側を光入射面側に配置するいわゆるリアエミッタ型の場合の方が、第1の導電型非晶質系半導体層(n型非晶質系半導体層)と第1の透明導電膜とが接合することにより生じるバンドベンディングの影響が大きい。このため、リアエミッタ型の場合に光入射面側に透明絶縁膜を設けることで、本発明の効果をより十分に得ることができる。
ここで、真性非晶質系半導体層における「真性」とは、不純物が意図的にドープされていないことをいい、原料に本来含まれる不純物や製造過程において非意図的に混入した不純物が存在するものも含む意味である。「非晶質系」とは、非晶質体のみならず、微結晶体を含む意味である。「光入射面」とは、使用の際に太陽光等の光源と対向する側(一般的に外側)に配置され、実質的に光を入射させる側の面をいい、このとき、この光入射面とは逆の面からも光が入射するように構成されていてもよい。「屈折率」は、ナトリウムD線(波長589.3nm)での値とする。また、各層等は複数層で構成されていてもよく、各層間に他の層が介在していてもよい。
本発明に係る光発電素子によれば、光入射面側の透明導電膜に透明絶縁膜が直接積層されていることにより、短絡電流及び開放電圧が高まり、光電変換効率が優れる。
本発明の第1の実施の形態に係る光発電素子を示す断面図である。 本発明の第2の実施の形態に係る光発電素子を示す断面図である。 耐湿性試験の測定結果を示すグラフである。 (a)〜(d)は、それぞれ試験例における反射率の測定結果を示すグラフである。 膜厚測定方法を示す模式図である。 従来の光発電素子を示す断面図である。
続いて、添付した図面を参照しながら本発明を具体化した実施の形態について説明する。
(第1の実施の形態:フロントエミッタ型)
図1に示すように、本発明の第1の実施の形態に係る光発電素子10は、板状の多層構造体である。光発電素子10は、n型結晶半導体基板11と、n型結晶半導体基板11の一側(図1における上側、多層構造体の第1の主面側)にこの順で積層される第1の真性非晶質系半導体層12、p型非晶質系半導体層13(第1の導電型非晶質系半導体層)、第1の透明導電膜14及び透明絶縁膜15と、n型結晶半導体基板11の他側(図1における下側、多層構造体の第2の主面側)にこの順で積層される第2の真性非晶質系半導体層16、n型非晶質系半導体層17(第2の導電型非晶質系半導体層)及び第2の透明導電膜18とを有する。さらに、光発電素子10は、第1の透明導電膜14の表面(一側)に部分的に配設される集電極19と、第2の透明導電膜18の裏面(他側)に部分的に配設される集電極20とを有する。なお、第1の透明導電膜14の一側表面においては、線状、格子状等の平面形状で部分的に積層されている集電極20の非積層部分に透明絶縁膜15が積層されている。光発電素子10は、一側(第1の主面側、n型結晶半導体基板11を基準にp型非晶質系半導体層13側)を光入射面として使用するフロントエミッタ型である。
n型結晶半導体基板11としては、n型の半導体特性を有する結晶体であれば特に限定されず公知のものを用いることができる。n型結晶半導体基板11を構成するn型の結晶半導体としては、シリコン(Si)の他、SiC、SiGe、Ge等を挙げることができるが、生産性等の点からシリコンが好ましい。n型結晶半導体基板11は、単結晶体であってもよいし、多結晶体であってもよい。n型結晶半導体基板11の上下(一側及び他側)両面は、光の乱反射による光閉じ込めをより有効にするために、凹凸加工が行われているのが好ましい(図示しない)。なお、例えば、約1〜5質量%の水酸化ナトリウム又は水酸化カリウムを含むエッチング液に基板材料を浸漬することによって、多数のピラミッド状の凹凸部を形成できる。
第1の真性非晶質系半導体層12は、n型結晶半導体基板11の一側に積層されている。第1の真性非晶質系半導体層12を構成する半導体としては、Si、SiC、SiGe等を挙げることができるが、Siが好ましい。第1の真性非晶質系半導体層12の膜厚としては特に限定されないが、例えば1nm以上10nm以下とすることができる。この膜厚が1nm未満の場合は、欠陥が発生しやすくなることなどにより、キャリアの再結合が生じやすくなる。また、この膜厚が10nmを超える場合は、フィルファクターの低下が生じやすくなる。
第1の真性非晶質系半導体層12は、例えば、化学気相成長法(例えば、プラズマCVD法等)などの公知の方法により成膜することができる。プラズマCVD法による場合、原料ガスとしては例えばSiHとHとの混合ガスを用いることができる。
p型非晶質系半導体層13は、第1の真性非晶質系半導体層12の一側に積層されている。p型非晶質系半導体層13は、Si等の半導体にホウ素、アルミニウム等のp型ドーパントが添加されたものを用いることができる。p型非晶質系半導体層13の膜厚としては、特に限定されないが、例えば1nm以上20nm以下が好ましく、3nm以上10nm以下がより好ましい。
p型非晶質系半導体層13も、化学気相成長法(例えばプラズマCVD法等)などの公知の方法により成膜することができる。プラズマCVD法による場合、原料ガスとしては例えばSiHとBとの混合ガスを用いることができる。
第1の透明導電膜14は、p型非晶質系半導体層13の一側に積層されている。第1の透明導電膜14を構成する透明導電材料としては、例えば、インジウム錫酸化物(Indium Tin Oxide:ITO)、タングステンドープインジウム酸化物(Indium Tungsten Oxide:IWO)、セリウムドープインジウム酸化物(Indium Cerium Oxide:ICO)、インジウム亜鉛酸化物(Indium Zinc Oxide:IZO)、アルミドープ亜鉛酸化物(AZO)、ガリウムドープ亜鉛酸化物(GZO)等の公知の材料を挙げることができる。第1の透明導電膜14の膜厚としては、特に限定されないが、例えば30nm以上200nm以下が好ましく、40nm以上100nm以下がより好ましい。
第1の透明導電膜14の成膜方法としては、特に制限されず、例えばスパッタリング法、真空蒸着法、イオンプレーティング法(反応性プラズマ蒸着法)等、公知の方法を用いることができるが、イオンプレーティング法を用いることが好ましい。高エネルギー粒子が生じないイオンプレーティング法により形成することにより、p型非晶質系半導体層13表面の劣化を抑制することができる。従って、このようにすることで、良好な品質を維持したp型非晶質系半導体層13を用いることができ、フィルファクターをより高めることができる。また、イオンプレーティング法を用いることで密着性の高い第1の透明導電膜14を形成でき、このこともフィルファクターを高める原因になっていると考えられる。
透明絶縁膜15は、第1の透明導電膜14の一側に直接積層されている。但し、第1の透明導電膜14の一側表面のうち、集電極19が積層されている部分には、透明絶縁膜15は積層されていない。このように第1の透明導電膜14の表面に透明絶縁膜15が積層されていることで、例えば第1の透明導電膜14とp型非晶質系半導体層13との界面で生じるバンドベンディングの影響が緩和されることなどにより、光発電素子10の短絡電流及び開放電圧が高まる。また、透明絶縁膜15は後述するように適当な屈折率を有するものを採用することなどにより、反射防止抑制機能も発揮することができる。従って、光発電素子10は、高い光電変換効率を有することができる。
透明絶縁膜15を構成する透明絶縁材料としては、透光性かつ絶縁性を有するものであれば特に限定されず、MgF(屈折率1.37)、LaF(屈折率1.59)、NdF(屈折率1.60)、Al(屈折率1.62)、CoF(屈折率1.63)、PbF(屈折率1.75)、MgO(屈折率1.75)、ThO(屈折率1.80)、SnO(屈折率1.90)、La(屈折率1.95)、SiO(屈折率1.7〜2.0)、SiN(屈折率2.0)、In(屈折率2.00)、Nd(屈折率2.00)、Sb(屈折率2.04)、ZrO(屈折率2.10)、CoO(屈折率2.20)、TiO(屈折率2.2〜2.7)、ZnS(屈折率2.35)、Bi(屈折率2.45)、ZnSe(屈折率2.58)、CdSe(屈折率2.60)等の金属化合物(酸化物、フッ化物、窒化物等)、その他透明樹脂材料等が挙げられるが、耐久性等の点から金属化合物が好ましい。
透明絶縁膜15(透明絶縁材料)の屈折率としては、1.5以上2以下が好ましい。通常、光発電素子10は、封止材に封止されたモジュールとして用いられ、一般的な封止材であるEVA(エチレン−酢酸ビニル樹脂)等の屈折率は約1.5である。また、第1の透明導電膜14(例えばIWO、ITO等)の屈折率は通常約2である。そのため、透明絶縁膜15の屈折率を封止材の屈折率と第1の透明導電膜14の屈折率との間の値とすることで、各界面での屈折率差を抑えることができ、反射抑制機能を高めることができる。
透明絶縁膜15は、窒化ケイ素、酸化ケイ素又は酸窒化ケイ素により形成されていることが好ましい。これらは2種以上が混合して用いられていてもよい。透明絶縁膜15としてこれらの化合物(酸化ケイ素、窒化ケイ素又は酸窒化ケイ素)を用いることで、光電変換効率がより高まることに加え、耐湿性も高めることができる。また、酸素(O)と窒素(N)との組成比を調整することなどにより、屈折率を好適な範囲(例えば1.5から2の範囲)で比較的容易に制御することもできる。
透明絶縁膜15の膜厚としては、特に限定されないが、上限値としては例えば500nmが好ましく、200nmがより好ましく、100nmがさらに好ましく、80nmが特に好ましい。一方、下限値としては例えば10nmが好ましく、50nmがより好ましい。透明絶縁膜15の膜厚を前記上限値以下とすることで、透明絶縁膜15の光吸収による透光量の低下を抑えることができる。また、透明絶縁膜15の膜厚が100nmを超えると、干渉縞が現われて反射率の別のピークが生じ、300〜1200nmにおける波長域の反射率が増大する。従って、例えば膜厚を100nm以下とすることで、干渉縞の影響を抑えることができる。一方、透明絶縁膜15の膜厚を前記下限値以上とすることで、透明絶縁膜15の機能(バンドベンディングの影響緩和、耐湿性等)を効果的に発揮することができる。
透明絶縁膜15の成膜方法としては、特に制限されず、例えばスパッタリング法、真空蒸着法、イオンプレーティング法等のPVD法やCVD法等、公知の方法を用いることができる。
イオンプレーティング法により酸窒化ケイ素の透明絶縁膜15を形成する方法としては、例えば、SiOタブレットを用い、プロセスチャンバー中にNガスを導入しながら成膜する方法が挙げられる。この際、例えば、プロセスチャンバーのベース圧力を1×10−4Pa以下、Nの導入量を200〜400sccm、成膜圧力を0.8〜2.0Paの成膜条件とすることができる。なお、Nの導入量を増減させることなどで、形成される透明絶縁膜15における酸素と窒素との組成比を調整することができる。
スパッタリング法により酸窒化ケイ素の透明絶縁膜15を形成する方法としては、例えば、スパッタリングターゲットとしてSiターゲットを用い、不活性ガス、酸素ガス及び窒素ガスの混合ガス中でスパッタリングを行う方法が挙げられる。この場合、酸素ガスと窒素ガスとの比率の制御により、形成される透明絶縁膜15における酸素と窒素との組成比を調整することができる。
第2の真性非晶質系半導体層16は、n型結晶半導体基板11の他側に積層されている。第2の真性非晶質系半導体層16の材質、膜厚、成膜方法は、第1の真性非晶質系半導体層12と同様であるが、同一の材質等である必要はない。
n型非晶質系半導体層17は、第2の真性非晶質系半導体層16の他側に積層されている。n型非晶質系半導体層17は、Si等の半導体にリン、ヒ素等のn型ドーパントが添加されたものを用いることができる。n型非晶質系半導体層17の膜厚としては特に限定されないが、例えば1nm以上20nm以下が好ましく、3nm以上10nm以下がより好ましい。このような範囲の膜厚とすることで、短絡電流の低下とキャリアの再結合の発生とをバランスよく低減することができる。n型非晶質系半導体層17も、化学気相成長法(例えば、プラズマCVD法等)などの公知の方法により成膜することができる。プラズマCVD法による場合、原料ガスとしては例えばSiHとPHとの混合ガスを用いることができる。
第2の透明導電膜18は、n型非晶質系半導体層17の他側に積層されている。第2の透明導電膜18の材質、成膜方法は、第1の透明導電膜14と同様であるが、同一の材質等である必要はない。第2の透明導電膜18の膜厚としては、特に限定されないが、例えば20nm以上200nm以下が好ましく、30nm以上100nm以下がより好ましく、40nm以上70nm以下がさらに好ましい。
なお、光発電素子10においては、両面に透明導電膜14、18がそれぞれ設けられている。すなわち、光が入射しない側にも透明導電膜18を積層している。このように、p型非晶質系半導体層13又はn型非晶質系半導体層17と集電極19、20との間に透明導電膜14、18を設けることにより、界面準位の増加を抑えることなどができ、フィルファクターを高めることができる。
集電極19、20は、互いに平行に形成される複数のバスバー電極、及びこれらのバスバー電極に直交し、互いに平行に形成される複数のフィンガー電極をそれぞれ有する。
バスバー電極及びフィンガー電極は、それぞれ線状又は帯状であり、導電性材料から形成されている。この導電性材料としては、銀ペースト等の導電性接着剤や、銅線等の金属導線を用いることができる。各バスバー電極の幅としては、例えば0.5mm以上2mm以下程度であり、各フィンガー電極の幅としては、例えば10μm以上300μm以下程度である。また、各フィンガー電極間の間隔としては、例えば0.5mm以上4mm以下程度である。
集電極19、20の配設は公知の方法で行うことができる。集電極19、20の材料として導電性接着剤が用いられている場合、スクリーン印刷やグラビアオフセット印刷等の印刷法により形成することができる。また、集電極19、20に金属導線を用いる場合、導電性接着剤や低融点金属(半田等)により透明導電膜14、18上に固定することができる。
集電極19の表面(一側の面)は、接続端子として機能すべく、露出している。すなわち、集電極19の表面には透明絶縁膜15が積層されていない。但し、集電極19の表面全面が露出していてもよいし、一部のみ(例えば端部のみ)が露出していてもよい。このような積層構造を形成する方法としては、(1)第1の透明導電膜14の表面に集電極19を配設した後、集電極19の配設部分をマスクして透明絶縁膜15を成膜する方法、(2)第1の透明導電膜14の表面全面に透明絶縁膜15を成膜した後、透明絶縁膜15を部分的にエッチングし、エッチングして透明絶縁膜15を除去した部分に集電極19を配設する方法などが挙げられる。
光発電素子10は、通常、複数のものを直列に接続し、EVA等の封止材で封止されたモジュールとして使用される。複数の光発電素子10を直列接続して使用することで、発電電圧を高めることができる。
(第2の実施の形態:リアエミッタ型)
図2に示すように、本発明の第2の実施の形態に係る光発電素子30は、板状の多層構造体である。光発電素子30は、n型結晶半導体基板31と、n型結晶半導体基板31の一側(図2における上側、多層構造体の第1の主面側)にこの順で積層される第1のn型非晶質系半導体層32a及び第2のn型非晶質系半導体層32b(第1の導電型非晶質系半導体層)、第1の透明導電膜33並びに透明絶縁膜34と、n型結晶半導体基板31の他側(図2における下側、多層構造体の第2の主面側)にこの順で積層される真性非晶質系半導体層35、p型非晶質系半導体層36(第2の導電型非晶質系半導体層)及び第2の透明導電膜37とを有する。さらに、光発電素子30は、第1の透明導電膜33の表面(一側)に配設される集電極38と、第2の透明導電膜37の裏面(他側)に配設される集電極39とを有する。なお、第1の透明導電膜33の一側表面においては、線状、格子状等の平面形状で部分的に積層されている集電極38の非積層部分に透明絶縁膜34が積層されている。光発電素子30は、一側(第1の主面側、n型結晶半導体基板31を基準にn型非晶質系半導体層32a、32b側)を光入射面として使用するリアエミッタ型である。
n型結晶半導体基板31、第1又は第2の透明導電膜33、37、透明絶縁膜34、真性非晶質系半導体層35、p型非晶質系半導体層36及び集電極38、39の材質や形成方法等は、図1の光発電素子10のn型結晶半導体基板11、第1又は第2の透明導電膜14、18、透明絶縁膜15、第1又は第2の真性非晶質系半導体層12、16、p型非晶質系半導体層13及び集電極19、20とそれぞれ同様である(積層順は異なる)。
光発電素子30においては、光発電素子10と異なり、n型結晶半導体基板31と光入射面側の第1の導電型非晶質系半導体層(第1のn型非晶質系半導体層32a及び第2のn型非晶質系半導体層32b)との間に真性非晶質系半導体層を設けていない。このため、pn接合部分に対して真性非晶質系半導体層35が存在しない側から光を入射させることで、発電効率を高めることができる。
光発電素子30においては、n型非晶質系半導体層が、第1のn型非晶質系半導体層32aと第2のn型非晶質系半導体層32bとの2層構造となっている。また、n型結晶半導体基板31に直接積層される第1のn型非晶質系半導体層32aは、第2のn型非晶質系半導体層32bよりも抵抗値が高く(ドーパント量が少なく)なっている。このようにすることで、n型結晶半導体基板31とn型非晶質系半導体層32a、32bとの接合界面のパッシベーション性能を高めることができ、十分な開放電圧とフィルファクターを有する光発電素子を得ることができる。なお、n型非晶質系半導体層32a、32bの材質等は、図1の光発電素子10のn型非晶質系半導体層17と同様である。
このような抵抗値(ドーパント量)の異なる2層のn型非晶質系半導体層32a、32bは、例えば、プラズマCVD法による場合に、ドーパントガスであるPHの導入量を変えることなどにより形成することができる。例えば、第1のn型非晶質系半導体層32aの成膜の際のSiHを基準としたドーパントガスの含有量Aに対する第2のn型非晶質系半導体層32bの成膜の際のドーパントガスの含有量Bは、2倍以上50倍以下とすることができ、5倍以上20倍以下が好ましい。また、含有量Aは、100ppm以上2000ppm以下程度、含有量Bは、4000ppm以上20000ppm以下程度とすることができる。
第1のn型非晶質系半導体層32aの膜厚としては、例えば1nm以上20nm以下が好ましく、2nm以上6nm以下がより好ましい。第2のn型非晶質系半導体層32bの膜厚としては、例えば1nm以上20nm以下が好ましく、2nm以上6nm以下がより好ましい。
光発電素子30も、光発電素子10と同様、複数のものを直列に接続し、EVA等の封止材で封止されたモジュールとして使用される。光発電素子30は、リアエミッタ型であり、n型非晶質系半導体層32bと第1の透明導電膜33とが接合することにより生じるバンドベンディングの影響が大きい。このため、リアエミッタ型の場合に光入射面側に透明絶縁膜34を設けることで、効果的に発電効率を高めることができる。
本発明は前記した実施の形態に限定されるものではなく、本発明の要旨を変更しない範囲でその構成を変更することもできる。例えば、光入射面と反対側の集電極は、バスバー電極とフィンガー電極とからなる構造ではなく、全面に導電性材料が積層された構造とすることもできる。このような構造の集電極はめっきや金属箔の積層等により形成することができる。また、真性非晶質系半導体層は積層されてなくともよく、第2の透明導電膜の裏面にも透明絶縁膜が積層されていてもよい。
以下、実施例及び比較例を挙げて、本発明の内容をより具体的に説明する。なお、本発明は以下の実施例に限定されるものではない。
<実施例1>
ピラミッド状凹凸加工を施したn型単結晶シリコン基板の一側に、第1の真性非晶質系シリコン層(7nm)、p型非晶質系シリコン層(5nm)、及び第1の透明導電膜(70nm)をこの順に積層した。第1の真性非晶質系シリコン層は化学気相成長法により、p型非晶質系シリコン層は化学気相成長法により、第1の透明導電膜はIWOを用いたイオンプレーティング法により成膜した。
次いで、n型単結晶シリコン基板の他側に、第2の真性非晶質系シリコン層(7nm)、n型非晶質系シリコン層(5nm)及び第2の透明導電膜(60nm)をこの順に積層した。第2の真性非晶質系シリコン層は化学気相成長法により、n型非晶質系シリコン層は化学気相成長法により、第2の透明導電膜はIWOを用いたイオンプレーティング法により成膜した。
得られた層構造体の両面にそれぞれ、集電極として、平行な複数のバスバー電極と、このバスバー電極にそれぞれ直交する複数のフィンガー電極を形成した。この集電極は、銀ペーストを用いて印刷により形成した。
最後に、第1の透明導電膜の一側に透明絶縁膜(90nm)を積層した。この際、第1の透明導電膜上の集電極表面をマスクし、イオンプレーティング法により成膜した。具体的には、SiOタブレットを用い、プロセスチャンバー中にNガスを導入しながら成膜した。プロセスチャンバーのベース圧力は1×10−4Pa以下であり、Nの導入量を200〜400sccmの範囲とし、成膜圧力は0.8〜2.0Paの範囲内であった。成膜された透明絶縁膜の屈折率及び元素組成を測定したところ、屈折率は1.75、組成式がSiO0.50.5の酸窒化ケイ素であった。このようにして、図1のフロントエミッタ構造の光発電素子を得た。
<実施例2>
ピラミッド状凹凸加工が施されたn型単結晶シリコン基板の一側に、第1のn型非晶質系シリコン層(3nm)、第2のn型非晶質系シリコン層(3nm)及び第1の透明導電膜(70nm)をこの順に積層した。次いで、n型単結晶シリコン基板の他側に、真性非晶質系シリコン層(7nm)、p型非晶質系シリコン層(5nm)及び第2の透明導電膜(60nm)をこの順に積層した。得られた層構造体の両面にそれぞれ、集電極として、平行な複数のバスバー電極と、このバスバー電極にそれぞれ直交する複数のフィンガー電極を形成した。最後に、第1の透明導電膜の一側に透明絶縁膜(90nm)を積層した。
第1のn型非晶質系シリコン層(ライトドープ)及び第2のn型非晶質系シリコン層(ハイドープ)の成膜条件は以下のとおりとした。他の層等の成膜方法は実施例1と同様とした。このようにして、図2のリアエミッタ構造の光発電素子を得た。
・第1のn型非晶質系シリコン層(ライトドープ)
基板温度200℃
原料ガスSiH及びPH
PHの導入量800ppm
・第2のn型非晶質系シリコン層(ハイドープ)
基板温度200℃
原料ガスSiH及びPH
PHの導入量8000ppm
<実施例3>
透明絶縁膜をMgFで成膜したこと以外は実施例2と同様にして、リアエミッタ構造の光発電素子を得た。
<比較例1>
実施例1において、透明絶縁膜の積層前のものを比較例1とした。
<比較例2>
実施例2において、透明絶縁膜の積層前のものを比較例2とした。
[評価]
得られた各光発電素子の短絡電流Isc、開放電圧Voc、曲線因子(フィルファクター:FF)、変換効率(EFFICIENCY)を測定した。なお、一側を主たる光入射面とした。測定結果を表1に示す。
Figure 2015073058
表1に示されるように、実施例1は比較例1と比べて、実施例2は比較例2と比べて、短絡電流、開放電圧、曲線因子、変換効率のいずれもが高まっていることがわかる。また、酸窒化ケイ素よりも屈折率が低いMgFを用いた実施例3においても変換効率等が同様に高まっており、透明絶縁膜の効果は反射抑制とは異なる点にもあることがわかる。なお、スパッタリング法により酸窒化ケイ素の透明絶縁膜を成膜して実施例1、2と同様の構造の光発電素子を得た場合も、開放電圧及び曲線因子が高まったことを確認した。
次に、実施例1及び比較例1の光発電素子を用い、耐湿性試験をした。湿度85%、温度85℃の条件で加湿し、200時間後、400時間後、600時間後、800時間後、1000時間後の曲線因子を測定した。測定結果を図3に示す。なお、図3において、縦軸は実施例1の曲線因子を100%とした比較例1の曲線因子の比較値である。実施例1の光発電素子は、耐湿性に優れていることがわかる。
<試験例>
両面に集電極を形成せず、透明絶縁膜(酸窒化ケイ素:SiON)の膜厚を0nm、50nm、110nm及び150nmにそれぞれ変えたこと以外は、実施例1と同様にして層構造体(光発電素子)を得た。一側(透明絶縁膜側)を光入射面として、300〜1200nmの波長域における反射率を測定した。測定結果を図4に示す。(a)は膜厚0nm(透明絶縁膜を積層しなかった。)、(b)は膜厚50nm、(c)は膜厚110nm、(d)は膜厚150nmの測定結果である。図4に示されるように、SiON膜(透明絶縁膜)を設けることにより反射率は低減する。但し、SiON膜が100nmよりも厚くなると、干渉縞が現われて新たなピークが生じ、300〜1000nmの波長域の反射率は増大することがわかる。
ここで、本明細書における各層等の膜厚の測定方法について説明する。平滑部51と凹凸部(凹凸構造)52を両方有する仮想的な基板50を図5に示す。例えば透過型電子顕微鏡(TEM)を用いることで、基板50に垂直な厚さt、平面(表面)に垂直な厚さt’、凹凸部52の角度αをそれぞれ測定することができる。本明細書において、平滑部51に積層された層53の膜厚はtを指し、凹凸部52に積層された層53の膜厚はt’を指す。実際の作業では、測定時間の短縮が可能であり、かつ簡便である触針段差計等を用いた膜厚測定方法を用いるのが好ましい。例えば、KOH又はNaOHを40〜50℃に加熱した液で層53をウェットエッチングすることにより段差54を形成させ、触針段差計を用いた膜厚測定方法によりtが測定される。三角関数からt’=t×cosαが成り立つので、測定されたtにより、t’が算出される。TEM測定で得られたt’と、触針段差計を用いた膜厚測定方法により算出されたt’とは一致することが確認されたので、触針段差計を用いた膜厚測定方法を採用した。なお、触針段差計を用いた膜厚測定方法は、あらかじめ段差をつけておいたサンプルの上を、針でサンプルに触れて水平に表面をなぞることによって、サンプルの段差に応じて針を上下させる測定方法である。前記膜厚測定方法により、透明導電膜等の膜厚についても同様に測定することができる。
10:光発電素子、11:n型結晶半導体基板、12:第1の真性非晶質系半導体層、13:p型非晶質系半導体層、14:第1の透明導電膜、15:透明絶縁膜、16:第2の真性非晶質系半導体層、17:n型非晶質系半導体層、18:第2の透明導電膜、19、20:集電極、30:光発電素子、31:n型結晶半導体基板、32a:第1のn型非晶質系半導体層、32b:第2のn型非晶質系半導体層、33:第1の透明導電膜、34:透明絶縁膜、35:真性非晶質系半導体層、36:p型非晶質系半導体層、37:第2の透明導電膜、38、39:集電極、50:基板、51:平滑部、52:凹凸部、53:層、54:段差

Claims (6)

  1. n型結晶半導体基板と、該n型結晶半導体基板の一側にこの順で積層される第1の導電型非晶質系半導体層及び第1の透明導電膜と、前記n型結晶半導体基板の他側にこの順で積層される第2の導電型非晶質系半導体層及び第2の透明導電膜とを備え、
    前記第1の導電型非晶質系半導体層及び前記第2の導電型非晶質系半導体層のいずれか一方がn型非晶質系半導体層であり、他方がp型非晶質系半導体層であり、
    一側が光入射面として用いられる光発電素子において、
    前記第1の透明導電膜の一側に直接積層される透明絶縁膜をさらに備えることを特徴とする光発電素子。
  2. 請求項1記載の光発電素子において、前記透明絶縁膜の屈折率が1.5以上2以下であることを特徴とする光発電素子。
  3. 請求項1又は2記載の光発電素子において、前記透明絶縁膜が窒化ケイ素、酸化ケイ素又は酸窒化ケイ素により形成されていることを特徴とする光発電素子。
  4. 請求項1〜3のいずれか1項に記載の光発電素子において、前記透明絶縁膜の厚さが10nm以上500nm以下であることを特徴とする光発電素子。
  5. 請求項1〜4のいずれか1項に記載の光発電素子において、前記n型結晶半導体基板と前記p型非晶質系半導体層との間に積層される真性非晶質系半導体層をさらに備えることを特徴とする光発電素子。
  6. 請求項1〜5のいずれか1項に記載の光発電素子において、前記第1の導電型非晶質系半導体層が前記n型非晶質系半導体層であり、前記第2の導電型非晶質系半導体層が前記p型非晶質系半導体層であることを特徴とする光発電素子。
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