JP2015037117A - 固体撮像装置およびその製造方法、ならびに撮像装置 - Google Patents

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Abstract

【課題】積層する半導体チップの大きさが異なっていても、薄膜化工程後に良好に機能する固体撮像装置およびその製造方法を提供する。【解決手段】本発明の固体撮像装置1は、入射した光を電気信号に変換する複数の光電変換部が配置された画素アレイ11を有する第一チップ10と、第一チップ10の平面視面積よりも小さい平面視面積を有し、第一チップ10に電気的かつ物理的に接続された第二チップ20と、第一チップ10の、第二チップ20が接続された面のうち、第二チップ20に覆われていない領域をすべて覆うように設けられ、第一チップ10の平坦性を保持するように支持する支持部30とを備える。【選択図】図2

Description

本発明は、固体撮像装置、より詳しくは、積層型の固体撮像装置、およびその製造方法、ならびに当該固体撮像装置を備えた撮像装置に関する。
近年、ビデオカメラや電子スチルカメラなどが広く一般に普及している。これらのカメラには、CCD(Charge Coupled Device)型や増幅型の固体撮像装置が使用されている。増幅型の固体撮像装置は、光が入射する画素の光電変換部が生成・蓄積した信号電荷を、画素に設けられた増幅部に導き、増幅部が増幅した信号を画素から出力する。増幅型の固体撮像装置では、このような画素が二次元マトリクス状に複数配置されている。増幅型の固体撮像装置には、例えばCMOS(Complementary Metal Oxide Semiconductor)トランジスタを用いたCMOS型固体撮像装置等がある。
従来、CMOS型固体撮像装置は、二次元マトリクス状に配列された各画素の光電変換部が生成した信号電荷を、同一基板上に設けられた回路部によって行毎に順次読み出す方式を採用している。一般的なモノリシック構造(単一半導体基板から製造された構造)を有したCMOS型固体撮像装置では、光が入射する面から見た状態において、入射光を信号電荷に変換する画素アレイ部の周囲に垂直走査回路・水平走査回路・列処理回路や出力回路等の周辺回路が配置され、電気信号を伝達する為に、画素アレイ部と周辺回路の間に、列または行ごとに配線が設けられている。
現在のCMOS型固体撮像装置では、データレートの向上、面内の撮像同一性の向上、高機能化が要求されている。しかしながら、モノリシック構造を有したCMOS型固体撮像装置では、平面方向の電気伝導による速度制限や密度制限により性能の向上が難しい。
そこで、このようなCMOS型固体撮像装置において、複数の画素が配列された画素領域が形成された半導体チップと、信号処理を行うロジック回路が形成された半導体チップとを電気的に接続して1つのデバイスとして構成した固体撮像装置が種々提案され、機能・性能の向上が提案されている。
例えば、特許文献1では、画素単位毎にマイクロパッドを有する裏面照射型のイメージセンサチップと、信号処理回路が形成されてマイクロパッドを有する信号処理チップとを、マイクロバンプによって接続した半導体モジュールが開示されている。また、特許文献2では、半製品状態の画素アレイ部を備えた第1の半導体ウエハと、半製品状態のロジック回路を備えた第2の半導体ウエハとが貼り合わされた後、ダイシング等により個片化して、裏面照射型の固体撮像装置とした構成が開示されている。
特開2006−049361号公報 特開2010−245506号公報
一枚の半導体ウエハから複数の半導体チップを製造しようとする際、半導体チップはできるだけ小さいのが好ましい。その一方で、固体撮像装置の製造において接続される半導体チップのそれぞれの機能を考慮すると、最小限の大きさがそれぞれで異なることもある。通常は、画素領域の形成された半導体チップの方が大きくなる。このような大きさの異なる二つの半導体チップを積層し、固体撮像装置とするために画素領域の形成された半導体チップを薄膜化すると、薄膜化された半導体チップの一部が、他方の半導体チップによって支持されない状態が生じる。その結果、支持されていない部分が湾曲し、固体撮像装置として充分機能しなくなることがあるという問題がある。
上記事情を踏まえ、本発明は、積層する半導体チップの大きさが異なっていても、薄膜化工程後に良好に機能する固体撮像装置およびその製造方法を提供することを目的とする。
本発明の他の目的は、製造コストを抑えつつ、好適に機能する撮像装置を提供することである。
本発明の第一の態様は、入射した光を電気信号に変換する複数の光電変換部が配置された画素アレイを有する第一チップと、前記第一チップの平面視面積よりも小さい平面視面積を有し、前記第一チップに電気的かつ物理的に接続された第二チップと、前記第一チップの、前記第二チップが接続された面のうち、前記第二チップに覆われていない領域をすべて覆うように設けられ、前記第一チップの平坦性を保持するように支持する支持部とを備える固体撮像装置である。
本発明の第二の態様は、本発明の固体撮像装置を備える撮像装置である。
本発明の第三の態様は、入射した光を電気信号に変換する複数の光電変換部が配置された画素アレイを有する第一チップと、前記第一チップの平面視面積よりも小さい平面視面積を有し、前記第一チップに電気的かつ物理的に接続された第二チップとを備える固体撮像装置の製造方法であって、前記第一チップ上に前記第二チップを配置して前記第一チップと前記第二チップとを電気的に接続する第二チップ接続工程と、前記第一チップ上に液体の支持部材料を充填して固化し、支持部を形成する支持部形成工程と、前記第一チップを薄膜化する薄膜化工程とを備える。
本発明の固体撮像装置およびその製造方法によれば、積層する半導体チップの大きさが異なっていても、薄膜化工程後に良好に機能する固体撮像装置を提供することができる。
また、本発明の撮像装置によれば、製造コストを抑えつつ、好適に機能する撮像装置とすることができる。
本発明の第一実施形態に係る固体撮像素子を模式的に示す斜視図である。 上側は同固体撮像素子の正面図、下側は同固体撮像素子の平面図である。 同固体撮像装置の接続層周辺を示す拡大断面図である。 同固体撮像装置の製造方法の一過程を示す図である。 同固体撮像装置の製造方法の一過程を示す図である。 同固体撮像装置の製造方法の一過程を示す図である。 同固体撮像装置の製造方法の一過程を示す図である。 同固体撮像装置の製造方法の一過程を示す図である。 上側は本発明の第二実施形態に係る固体撮像素子の平面図、下側は同固体撮像素子の底面図である。 同固体撮像素子の変形例における底面図である。 本発明の変形例に係る固体撮像素子の正面図である。 本発明の変形例の固体撮像素子における接続層周辺を示す拡大断面図である。
本発明の第一実施形態について、図1から図8を参照して説明する。
図1は、本実施形態の固体撮像装置1を模式的に示す斜視図であり、図2の上側および下側は、それぞれ固体撮像装置1の正面図および平面図である。固体撮像素子1は、図1および図2に示すように、複数のフォトダイオード(PD、光電変換部)が二次元状に配列された画素アレイ11を有する第一チップ10と、第一チップ10と電気的に接続される第二チップ20と、第一チップ10の、第二チップ20が配置された側の面に配置されて第一チップ10を支持する支持部30とを備えている。
第一チップ10はシリコンで形成されており、画素アレイ11のPDは、入射した光を電気信号に変換する。第二チップ20は、図示しない読み出し回路および駆動回路を有し、読み出し回路によりPDが変換した電気信号を読み出し、駆動回路により第一チップ10内の電気回路を駆動する。
第一チップ10と第二チップ20とは、接続層40において電気的かつ物理的に接続されている。図3は、接続層40のうち第一チップ10と第二チップ20との電気的接続部位を含む領域を示す断面図である。第一チップ10のシリコン部分において、第二チップ20に対向する側には第一配線部12が設けられ、画素アレイ11を構成するPDと接続されている。シリコン部分の残りは、光を透過可能な薄いシリコン層13とされ、シリコン層13上に、反射防止膜14、カラーフィルタ15、樹脂膜16、およびマイクロレンズ17が順に設けられている。マイクロレンズ17は、画素アレイ11の各PDに対応するように配置されており、画素アレイ11に入射する光を対応するPDに導く。反射防止膜14の材料としては、酸化タンタル、酸化ハフニウム、窒化ケイ素、二酸化ケイ素などを用いることができる。カラーフィルタ15としては顔料または染料を有した有機膜等の公知のものが用いられる。樹脂膜16は光が画素アレイ11に入射する面(入射面)を平坦化する為に設けられるが、マイクロレンズ17と同一の材料を用いて形成されてもよい。
第一チップ10が上述の構成を有することにより、固体撮像装置1は、マイクロレンズ17が設けられた側の面を入射面とする、いわゆる裏面照射型の固体撮像装置として機能する。シリコン層13が充分光を透過するよう、第一チップ10は、例えば10マイクロメートル(μm)以下程度の厚さとされている。
第二チップ20の第一チップ10に対向する側には、第二配線部21が設けられ、シリコン部22に設けられた読み出し回路や駆動回路等と接続されている。第二チップ20は、第一チップ10に比べて十分に厚い、例えば100μm以上の厚さを有し、第一チップ10と接触する部位においては、第一チップ10を充分に支持することができる。
第一配線部12と第二配線部21とは、接続層40に設けられた接続電極41により電気的に接続されている。複数の接続電極41間の隙間は、アンダーフィルなどとも呼ばれる接続樹脂42により充填され、接続樹脂42により、第一チップ10と第二チップ20との物理的接続強度が補強されている。接続樹脂は、必要に応じて設ければよく、必ずしも設けられなくてもよい。
図2下側に示すように、固体撮像装置1の平面視において、第一チップ10は第二チップ20よりも大きいため、第一チップ10は一部に第二チップ20と重ならない領域を有している。当該領域、すなわち第一チップ10の第二チップ側の面のうち、第二チップ20に覆われない領域には、支持部30が第一チップ10に接着された状態で配置されている。その結果、支持部30により第一チップ10が支持されてその平坦性等が保持されている。
第一チップ10の周縁部には、外部機器等との接続に用いられる複数のボンディングパッド(入出力端子)18と第一チップ10の特性をテストする際に用いるテスト端子19とが設けられている。ボンディングパッド18は、導体面を入射面側に露出させているが、テスト端子19は、入射面と反対側の面に導体面を露出させている。そのため、固体撮像装置1の完成時においては、テスト端子19の導体面は、支持部30により覆われて見えなくなっている。
ボンディングパッド18およびテスト端子19は、いずれも固体撮像装置1の平面視において、第二チップ20と重ならない位置に設けられている。
以上の構成を有する固体撮像装置1の製造方法の一例について説明する。まず、準備工程として、1枚のシリコンウエハに、第一チップ10を二次元アレイ状に並べて複数製造する。以後このウエハを、「第一チップウエハ」と称する(第一チップ準備工程)。さらに、1枚のシリコンウエハに第二チップ20を二次元アレイ状に並べて複数製造し、ダイシング等により個片化して、複数の独立した第二チップ20を製造する。第二チップ20は、必要な機能に応じて最小化されたサイズのものを隙間なく並べて製造できるため、接続される第一チップの大きさに関係なく、一枚のシリコンウエハから最大限の数を製造することができる。
次に、図4に示すように、第一チップウエハ101上の各第一チップ10(不図示)に第二チップ20を配置し、第一チップ10と第二チップ20とを電気的に接続する(第二チップ接続工程)。本実施形態では、第一チップウエハ101上に接続電極41を含む接続層40(図4では不図示)を形成してから第二チップ20を配置し、熱や圧力等を掛けて接続する。
次に、図5に示すように、第一チップウエハ101上かつ第二チップ20の周囲に液状の支持部材料を充填して固化させ、支持部30を形成する(支持部形成工程)。支持部材料としては、樹脂やガラス等を用いることができる。本実施形態では支持部の厚みは第二チップ20と同等であるが、これには限られず、第二チップより薄くてもよいし、第二チップよりも厚くして、支持部が第二チップを覆うように形成してもよい。ただし、支持部を第二チップより薄くする場合は、第一チップを充分支持できる程度の剛性を発揮する程度の厚みにするよう留意する。また、第一チップ10の平面視において、第二チップおよび支持部のいずれとも重ならない領域が存在しないように注意する。
なお、支持部を形成すると、テスト端子の導体面が覆われて使用できなくなるため、第一チップ10や第二チップ20、あるいは両者が接続されたものの特性テストを行う必要がある場合は、支持部が形成される前に行う。
次に、図6に示すように、第一チップウエハ101を薄膜化して、複数の第一チップ10を形成する(薄膜化工程)。薄膜化の方法としては、公知の各種方法を用いることができ、例えば、バックグラインド (BG)工程などの物理的研削工程や、薬液を用いたケミカルエッチング、CMP(Chemical Mechanical Polishing)等が挙げられる。一般に、第一チップウエハ101の厚さは、薄膜化される前は700μm程度であり、薄膜化工程により、第一チップのPDに求められる特性に応じた膜厚(例えば、1〜5μm程度)まで薄膜化される。薄膜化工程において、形成された第一チップの表面にシリコン酸化膜が形成されてもよい。
次に、図7に示すように、第一チップ10上に、マイクロレンズ17や、ボンディングパッド18等の各種機構を形成する。これら各種機構はいずれも微細であるため、図7ではマイクロレンズ17のみ示している。
最後に、ダイシング等により、個々の第一チップ10の境界線(スクライブライン)SLに沿って第一チップ10および接続された第二チップ20の組ごとに個片化すると、図8に示すような固体撮像装置1が複数完成する。完成した固体撮像装置1においては、薄膜化された第一チップ10の一部領域が第二チップ20により支持され、残部領域が支持部30によって支持される。その結果、画素アレイ11を有する第一チップ10は平坦な状態が維持され、画素アレイ11に入射した光が好適に光電変換される。
本実施形態の固体撮像素子1によれば、第一チップ10の一方の面に、第二チップ20と支持部30とが設けられているため、第二チップ20の平面視面積が第一チップ10の平面視面積より小さくても、第一チップ10全体が支持されて第一チップ10、とりわけ画素アレイ11の撓みを好適に防止することができる。すなわち、第一チップ10の支持を考慮して第二チップ20の寸法を必要以上に大きく設定する必要はなく、所望の機能を実現するための最小限の寸法に設定することができる。その結果、一枚のウエハから製造可能な第二チップの個数を第一チップの寸法によらず最適化することができ、製造コストを著しく低減することができる。
また、支持部30が、固体撮像装置1の平面視において、第二チップ20の周囲を囲むように配置されているため、固体撮像装置1の厚さ方向に延びる側面に対して加わる力が第二チップ20に直接作用することを防ぎ、第二チップ20を好適に保護することができる。加えて、個片化の際にもダイシングの刃等が第二チップに触れにくく、第二チップを傷めにくい。
また、外部接続用のボンディングパッド18やテスト端子19が、平面視において第二チップ20と重ならない位置に配置されているため、ワイヤボンディング等により外部装置等と接続する工程や特性テストの工程において第二チップ20に過剰な力がかかりにくく、第二チップの不具合発生を抑制することができる。
さらに、テスト端子19がボンディングパッド18と別に設けられているため、ボンディングパッドを用いずに特性テスト等を行うことができ、ボンディングパッドを介した外部接続の信頼性を高く保つことができる。
本発明の第二実施形態について、図9および図10を参照して説明する。本実施形態の固体撮像装置51と、第一実施形態の固体撮像装置1との異なるところは、回路配置の態様である。なお、以降の説明において、すでに説明したものと共通する構成については、同一の符号を付して重複する説明を省略する。
図9の上側は、固体撮像装置51の平面図である。図9の下側は、固体撮像装置51の底面図であり、支持部30を除いて示している。
第一チップ10には、画素アレイ11に加え、読み出し回路の一部である垂直走査回路52が設けられている。垂直走査回路52は、固体撮像装置として機能するための動作信号を出力するもので、画素アレイ11のPDおよび第二チップ20と接続されている。
第二チップ20は、読み出し回路の一部である水平走査回路53と、駆動回路を構成する列処理回路54および出力回路55とを有している。
以上のように、本実施形態の固体撮像装置51では、第二チップの機能の一部を第一チップに配置しているが、このようにしても、第一実施形態で説明したのと同様の効果を奏することができる。さらに、例えば第一チップにデッドスペースが存在し、当該デッドスペースに第二チップの一部回路を配置可能であるような場合に、一部回路を第一チップに設けることで第二チップをさらに小型にし、第二チップの製造効率をさらに高めることができる。
本実施形態では、図10に示す変形例のように、第二チップの回路を、独立した二つの機能チップ56Aおよび56Bに分散配置し、二つの機能チップで第二チップを構成してもよい。このようにすると、回路の一部に不具合がある場合に、不具合を有する回路を含む機能チップのみを交換すればよいため、第二チップの製造歩留まりを向上させることができる。また、第二チップの配置の自由度が大きくなるという利点も有する。したがって、三つ以上の機能チップで第二チップを構成してもよいし、機能チップごとの回路の配分にも特に制限はない。
以上、本発明の各実施形態について説明したが、本発明の技術範囲は上記実施形態に限定されるものではなく、本発明の趣旨を逸脱しない範囲において構成要素の組み合わせを変えたり、各構成要素に種々の変更を加えたり、削除したりすることが可能である。
例えば、図11に示す変形例のように、支持部61を第二チップ20の厚みよりも厚く形成し、第二チップ20が支持部61で覆われるようにしてもよい。このようにすると、支持部形成工程における支持部材料の充填を容易に行うことができ、完成した固体撮像装置において第二チップも好適に保護される。
また、支持部は、固体撮像装置の平面視において、必ずしも第二チップの周囲を囲むように形成されなくてもよく、その結果第二チップの一部が固体撮像装置の側面に露出してもよい。ただし、支持部が第二チップの周囲を囲むように形成されるといくつかの利点があることは、第一実施形態の説明において述べた通りである。
さらに、第二チップに上述した以外の機能、例えばA/D(アナログ/デジタル)変換等の機能を持たせてもよい。
さらに、第一チップと第二チップとの電気的接続態様は、接続層を介した上述のものに限定されない。例えば、図12に示す変形例のように、第一チップ10および第二チップ20に、それぞれビア(Through Silicon Via, TSV)71および72を形成し、ビア71とビア72とを、導体からなる接続膜73で接続する構成なども用いることができる。この場合、第一配線部12と第二配線部21とは、第一配線部12および第二配線部21に含まれるケイ素酸化物どうしの直接接合で物理的に接続してもよいし、直接接合に適する組成で成膜されたケイ素酸化物等からなる緩衝層74を介して接続してもよい。
さらに、本発明の固体撮像装置の製造方法においても、各工程の順序等は、趣旨を逸脱しない範囲において適宜変更可能である。例えば、薄膜化工程は、第二チップ接続工程や支持部形成工程の前に行われてもよいし、第一チップウエハが予め第一チップに対応する領域ごとに個片化されてから第二チップ接続工程が行われてもよい。
本発明の固体撮像装置は、デジタルカメラやデジタルビデオカメラ等の各種撮像装置に好適に利用することができる。特に、高データレートが求められる高速撮影ビデオカメラ、面内の撮像同一性が求められる監視カメラや工業用途などの特殊カメラ、センサの小型化が求められる医療用途の撮像装置等の好適に用いることができる。
1、51 固体撮像装置
10 第一チップ
11 画素アレイ
18 ボンディングパッド(入出力端子)
19 テスト端子
20 第二チップ
30、61 支持部
101 第一チップウエハ

Claims (10)

  1. 入射した光を電気信号に変換する複数の光電変換部が配置された画素アレイを有する第一チップと、
    前記第一チップの平面視面積よりも小さい平面視面積を有し、前記第一チップに電気的かつ物理的に接続された第二チップと、
    前記第一チップの、前記第二チップが接続された面のうち、前記第二チップに覆われていない領域をすべて覆うように設けられ、前記第一チップの平坦性を保持するように支持する支持部と、
    を備える固体撮像装置。
  2. 前記支持部は、樹脂またはガラスからなる、請求項1に記載の固体撮像装置。
  3. 前記支持部は、前記固体撮像装置の平面視において、前記第二チップの周囲を囲むように配置されている、請求項1または2に記載の固体撮像装置。
  4. 前記支持部の厚みは、前記第二チップの厚みよりも大きく、前記第二チップが前記支持部に覆われている、請求項1から3のいずれか一項に記載の固体撮像装置。
  5. 前記第一チップは外部接続用の入出力端子を有し、前記入出力端子が、前記固体撮像装置の平面視において、前記第二チップと重ならない位置に設けられている、請求項1から4のいずれか一項に記載の固体撮像装置。
  6. 前記第一チップは外部接続用のテスト端子を有し、前記テスト端子が、前記固体撮像装置の平面視において、前記第二チップと重ならない位置に設けられている、請求項1から5のいずれか一項に記載の固体撮像装置。
  7. 請求項1から6のいずれか一項に記載の固体撮像装置を備える、撮像装置。
  8. 入射した光を電気信号に変換する複数の光電変換部が配置された画素アレイを有する第一チップと、前記第一チップの平面視面積よりも小さい平面視面積を有し、前記第一チップに電気的かつ物理的に接続された第二チップとを備える固体撮像装置の製造方法であって、
    前記第一チップ上に前記第二チップを配置して前記第一チップと前記第二チップとを電気的に接続する第二チップ接続工程と、
    前記第一チップ上に液体の支持部材料を充填して固化し、支持部を形成する支持部形成工程と、
    前記第一チップを薄膜化する薄膜化工程と、
    を備える、固体撮像装置の製造方法。
  9. 前記第二チップ接続工程において、前記第一チップは第一チップウエハに複数形成され、前記第一チップウエハ上に前記第二チップが配置される、請求項8に記載の固体撮像装置の製造方法。
  10. 前記支持部形成工程は、前記第二チップ接続工程に続いて行われ、前記第二チップを覆うように前記支持部材料が充填される、請求項8または9に記載の固体撮像装置の製造方法。
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Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP6292049B2 (ja) * 2013-09-02 2018-03-14 ソニー株式会社 半導体装置およびその製造方法
EP3087598A4 (en) * 2013-12-27 2017-09-20 Intel Corporation Optoelectronic packaging assemblies
DE112016003966T5 (de) * 2015-09-01 2018-06-14 Sony Corporation Gestapelter Körper
WO2020248212A1 (zh) 2019-06-14 2020-12-17 深圳市汇顶科技股份有限公司 芯片封装结构和电子设备

Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003139820A (ja) * 2001-10-30 2003-05-14 Matsushita Electric Ind Co Ltd マルチチップモジュール及びそのチップ間接続テスト方法
JP2005026633A (ja) * 2003-07-04 2005-01-27 Sony Corp 半導体パッケージの製造方法
JP2006080145A (ja) * 2004-09-07 2006-03-23 Nec Electronics Corp チップオンチップ型半導体集積回路装置
US20080308928A1 (en) * 2007-06-13 2008-12-18 Industrial Technology Research Institute Image sensor module with a three-dimensional die-stacking structure
JP2011146527A (ja) * 2010-01-14 2011-07-28 Panasonic Corp 半導体装置及びその製造方法
JP2012164870A (ja) * 2011-02-08 2012-08-30 Sony Corp 固体撮像装置とその製造方法、及び電子機器

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4734381A (en) * 1985-10-24 1988-03-29 Atlantic Richfield Company Method of making a thin film cadmium telluride solar cell
JP2004319530A (ja) * 2003-02-28 2004-11-11 Sanyo Electric Co Ltd 光半導体装置およびその製造方法
KR100541650B1 (ko) * 2003-08-12 2006-01-10 삼성전자주식회사 고체 촬상용 반도체 장치 및 그 제조방법
JP4349232B2 (ja) 2004-07-30 2009-10-21 ソニー株式会社 半導体モジュール及びmos型固体撮像装置
JP5985136B2 (ja) 2009-03-19 2016-09-06 ソニー株式会社 半導体装置とその製造方法、及び電子機器
JP4783868B1 (ja) * 2010-03-17 2011-09-28 富士フイルム株式会社 固体撮像素子及びその製造方法並びに撮像装置
WO2012145038A1 (en) * 2011-04-19 2012-10-26 Teledyne Rad-Icon Imaging Corp. Method of direct silicon tiling of a tiled image sensor array
US20130320359A1 (en) * 2012-06-04 2013-12-05 Sematech, Inc. Heterogeneous stack structures with optical to electrical timing reference distribution

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003139820A (ja) * 2001-10-30 2003-05-14 Matsushita Electric Ind Co Ltd マルチチップモジュール及びそのチップ間接続テスト方法
JP2005026633A (ja) * 2003-07-04 2005-01-27 Sony Corp 半導体パッケージの製造方法
JP2006080145A (ja) * 2004-09-07 2006-03-23 Nec Electronics Corp チップオンチップ型半導体集積回路装置
US20080308928A1 (en) * 2007-06-13 2008-12-18 Industrial Technology Research Institute Image sensor module with a three-dimensional die-stacking structure
JP2011146527A (ja) * 2010-01-14 2011-07-28 Panasonic Corp 半導体装置及びその製造方法
JP2012164870A (ja) * 2011-02-08 2012-08-30 Sony Corp 固体撮像装置とその製造方法、及び電子機器

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