JP2012084205A - 半導体メモリ - Google Patents
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Abstract
【解決手段】イネーブル信号に応じて、リファレンス電圧を生成し、リファレンス電圧供給ラインを介してセンスアンプに供給するリファレンスアンプと共に、高速立上回路を備える。高速立上回路は、イネーブル信号が非活性化を示す場合にオン状態となって所定の第1電圧を第1ラインに印加する第1FETと、リファレンス電圧供給ラインの電圧がゲート閾電圧値より高い場合にオン状態となって接地電位を上記第1ラインに印加する第2FETと、イネーブル信号が活性化を示す場合にオン状態となって第1電圧を出力する第3FETと、上記第1ラインが接地電位の状態にある間はオフ状態となる一方、この第1ラインに第1電圧が印加されている場合にはオン状態となって第3FETから出力された第1電圧を上記リファレンス電圧供給ラインに供給する第4FETと、を有する。
【選択図】図3
Description
3 センスアンプ
4 リファレンスアンプ
5 高速立上駆動回路
Claims (4)
- 読出信号に応じてメモリセルのデータ線に送出された電流値と所定閾値との大小比較結果に応じた論理レベルを有する情報データを出力するセンスアンプを備えた半導体メモリであって、
活性化状態及び非活性化状態の内のいずれか一方を示すイネーブル信号を送出する制御部と、
前記イネーブル信号が非活性化状態から活性化状態に遷移したときに前記所定閾値と等しい電圧値を有するリファレンス電圧を生成し当該リファレンス電圧をリファレンス電圧供給ラインを介して前記センスアンプに供給するリファレンスアンプと、
前記イネーブル信号が非活性化状態を示す場合にオン状態となって所定の第1電圧を第1ラインに印加する第1FETと、前記リファレンス電圧供給ラインの電圧がゲート閾電圧値より高い場合にオン状態となって接地電位を前記第1ラインに印加する第2FETと、前記イネーブル信号が活性化状態を示す場合にオン状態となって前記第1電圧を出力する第3FETと、前記第1ラインが接地電位の状態にある間はオフ状態となる一方、前記第1ラインに前記第1電圧が印加されている場合にはオン状態となって前記第3FETから出力された前記第1電圧を前記リファレンス電圧供給ラインに供給する第4FETと、を含む高速立上駆動部と、
を有することを特徴とする半導体メモリ。 - 前記高速立上駆動部は、前記第4FET及び前記リファレンス電圧供給ラインの各々にドレイン端子及びソース端子が夫々接続されており且つゲート端子に所定の第2電圧が固定供給されている第5FETを更に含むことを特徴とする請求項1記載の半導体メモリ。
- 前記第1〜第4FETはエンハンスメント形のMOSFETであり、前記第5FETはデプレッション形のMOSFETであり、
前記第5FETのゲート端子に印加されている前記第2電圧は、前記接地電位であることを特徴とする請求項2記載の半導体メモリ。 - 前記制御部は、前記読出信号が供給されていない場合には非活性化を示す前記イネーブル信号を前記リファレンスアンプ及び前記高速立上駆動部の各々に供給する一方、前記読出信号が供給されている場合には活性化を示す前記イネーブル信号を前記リファレンスアンプ及び前記高速立上駆動部の各々に供給することを特徴とする請求項1〜3のいずれか1に記載の半導体メモリ。
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Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0877788A (ja) * | 1994-09-01 | 1996-03-22 | Ricoh Co Ltd | 半導体メモリ装置 |
JPH09282880A (ja) * | 1996-04-16 | 1997-10-31 | Mitsubishi Electric Corp | 半導体集積回路 |
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Patent Citations (4)
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---|---|---|---|---|
JPH0877788A (ja) * | 1994-09-01 | 1996-03-22 | Ricoh Co Ltd | 半導体メモリ装置 |
JPH09282880A (ja) * | 1996-04-16 | 1997-10-31 | Mitsubishi Electric Corp | 半導体集積回路 |
JPH10255464A (ja) * | 1997-03-14 | 1998-09-25 | Toshiba Microelectron Corp | 半導体集積回路装置及びそのプリチャージ方法 |
JP2002056673A (ja) * | 2000-08-08 | 2002-02-22 | Mitsubishi Electric Corp | 電源回路およびそれを備える半導体記憶装置 |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2013222473A (ja) * | 2012-04-13 | 2013-10-28 | Lapis Semiconductor Co Ltd | 半導体記憶装置 |
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