JP2011185365A - 電磁弁駆動回路 - Google Patents
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Abstract
【解決手段】昇圧側駆動FET202は昇圧回路100とインジェクタ3の一方の端子の間の経路に接続される。バッテリ側駆動FET212とバッテリ側保護ダイオードDbは、電源の正極とインジェクタ3の一方の端子の間の経路に接続される。還流ダイオードDfはインジェクタ3の一方の端子とバッテリ側保護ダイオードDbの間に一方の端子が接続され、かつ他方の端子が電源グランドに接続される。インジェクタ下流側駆動FET220はインジェクタ3の他方の端子と電源グランドの間の経路に接続される。制御回路240は、インジェクタ3に流れる電流値に応じてFET202,212,220を動作させるとともに、昇圧側駆動FET202が複数回オン/オフする期間にバッテリ側駆動FET212をオンさせる。
【選択図】図1
Description
当該電磁弁駆動回路は、電源から高電圧を生成する昇圧回路と、前記昇圧回路と電磁弁の一方の端子の間の経路に接続された第1のスイッチング素子と、前記電源の正極に接続された第2のスイッチング素子と、該第2のスイッチング素子の負極側と前記電磁弁の一方の端子の間の経路に接続された第1のダイオードと、前記電磁弁の一方の端子と前記第1のダイオードの間に一方の端子が接続され、かつ他方の端子が電源グランドに接続された第2のダイオードと、前記電磁弁の他方の端子と電源グランドの間の経路に接続された第3のスイッチング素子と、前記電磁弁に流れる電流値に応じて前記第1のスイッチング素子及び前記第2のスイッチング素子及び前記第3のスイッチング素子を動作させる制御手段を有する電磁弁駆動回路であって、前記制御手段は、前記第1のスイッチング素子が複数回オン/オフする期間に前記第2のスイッチング素子をオンさせるピークホールドアシスト手段を備えるようにしたものである。
最初に、図1を用いて、本実施形態による電磁弁駆動回路を用いた電磁弁制御システムの構成について説明する。
図1は、本発明の第1の実施形態による電磁弁駆動回路を用いた電磁弁制御システムの構成を示すブロック回路図である。
図2は、本発明の第1の実施形態による電磁弁駆動回路を用いた電磁弁制御システムの動作を説明するタイミングチャートである。
図3は、本発明の第1の実施形態による電磁弁駆動回路の効果の説明図である。
100…昇圧回路
200…駆動回路
202…昇圧側駆動FET
212…バッテリ側駆動FET
220…インジェクタ下流側駆動FET
240…インジェクタ制御回路
241…昇圧側電流検出回路
242…バッテリ側電流検出回路
243…インジェクタ下流側電流検出回路
244…検出電流選択回路
245…ゲート駆動ロジック回路
245A…ピークホールドアシスト(PHA)回路
300…制御回路
Db…バッテリ側保護ダイオード
Df…還流ダイオード
Dh…昇圧側保護ダイオード
Dr…電流回生ダイオード
Rb…バッテリ側電流検出抵抗
Rh…昇圧側電流検出抵抗
Ri…インジェクタ下流側電流検出抵抗
Claims (8)
- 電源から高電圧を生成する昇圧回路と、
前記昇圧回路と電磁弁の一方の端子の間の経路に接続された第1のスイッチング素子と、
前記電源の正極に接続された第2のスイッチング素子と、
該第2のスイッチング素子の負極側と前記電磁弁の一方の端子の間の経路に接続された第1のダイオードと、
前記電磁弁の一方の端子と前記第1のダイオードの間に一方の端子が接続され、かつ他方の端子が電源グランドに接続された第2のダイオードと、
前記電磁弁の他方の端子と電源グランドの間の経路に接続された第3のスイッチング素子と、
前記電磁弁に流れる電流値に応じて前記第1のスイッチング素子及び前記第2のスイッチング素子及び前記第3のスイッチング素子を動作させる制御手段を有する電磁弁駆動回路であって、
前記制御手段は、前記第1のスイッチング素子が複数回オン/オフする期間に前記第2のスイッチング素子をオンさせるピークホールドアシスト手段を備えることを特徴とする電磁弁駆動回路。 - 請求項1記載の電磁弁駆動回路において、
前記制御手段は、前記第1のスイッチング素子をオン/オフすることで、前記電磁弁に流れる電流を第1の電流値に保持することを特徴とする電磁弁駆動回路。 - 請求項2記載の電磁弁駆動回路において、
前記制御手段は、前記電磁弁を通電する電流を前記第1の電流値に保持する期間のうち、前記第1のスイッチング素子をオフかつ前記第2のスイッチング素子をオンしている間に、前記電磁弁に流れる電流が増加する場合、前記第2のスイッチング素子をオフすることを特徴とする電磁弁駆動回路。 - 請求項1記載の電磁弁駆動回路において、
前記制御手段は、前記第1のスイッチング素子をオフし、かつ前記第2のスイッチング素子をオン/オフすることで、前記電磁弁を通電する電流を前記第1の電流値よりも小さな第2の電流値に保持することを特徴とする電磁弁駆動回路。 - 請求項1記載の電磁弁駆動回路において、
前記制御手段は、前記電磁弁を通電する電流が前記第1の電流値から前記第2の電流値に移行する期間に、前記第1のスイッチング素子をオフし、かつ前記第2及び第3のスイッチング素子をオンすることで、前記電磁弁に前記電源の電圧を印加し、
かつ、前記電磁弁を通電する電流が前記第1の電流値よりも小さく前記第2の電流値よりも大きな第3の電流値になると、前記第2のスイッチング素子をオフすることを特徴とする電磁弁駆動回路。 - 請求項1記載の電磁弁駆動回路において、
前記制御手段は、前記電磁弁を通電する電流が前記第1の電流値から前記第2の電流値に移行する期間に、前記第1及び第2のスイッチング素子をオフし、かつ前記第3のスイッチング素子をオンし、前記電磁弁に流れる電流を前記第2のダイオードを介して還流させることを特徴とする電磁弁駆動回路。 - 請求項1記載の電磁弁駆動回路において、
前記第1のダイオードに並列に接続された抵抗とコンデンサの直列回路を備えることを特徴とする電磁弁駆動回路。 - 請求項1記載の電磁弁駆動回路において、
前記昇圧回路と前記第1のスイッチング素子の間の経路に一方の端子が接続され、かつ前記電磁弁の他方の端子と前記第3のスイッチング素子の正極側との間の経路に他方の端子が接続された第3のダイオードを備え、
前記制御手段は、前記第1の電流値から前記第2の電流値に移行する期間及び前記電磁弁の通電電流を停止する場合に、前記第1、第2及び第3のスイッチング素子を全てオフし、前記電磁弁に流れる電流を前記第3のダイオードを介して前記昇圧回路に回生させることを特徴とする電磁弁駆動回路。
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