JP2011146580A - Method of manufacturing silicon carbide semiconductor device - Google Patents

Method of manufacturing silicon carbide semiconductor device Download PDF

Info

Publication number
JP2011146580A
JP2011146580A JP2010006950A JP2010006950A JP2011146580A JP 2011146580 A JP2011146580 A JP 2011146580A JP 2010006950 A JP2010006950 A JP 2010006950A JP 2010006950 A JP2010006950 A JP 2010006950A JP 2011146580 A JP2011146580 A JP 2011146580A
Authority
JP
Japan
Prior art keywords
silicon carbide
gas
insulating film
semiconductor device
nitriding
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2010006950A
Other languages
Japanese (ja)
Other versions
JP5126240B2 (en
Inventor
Hisakazu Tanioka
寿一 谷岡
Akiyuki Furuhashi
壮之 古橋
Tomokatsu Watanabe
友勝 渡辺
Yukiyasu Nakao
之泰 中尾
Masayuki Imaizumi
昌之 今泉
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP2010006950A priority Critical patent/JP5126240B2/en
Publication of JP2011146580A publication Critical patent/JP2011146580A/en
Application granted granted Critical
Publication of JP5126240B2 publication Critical patent/JP5126240B2/en
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Abstract

<P>PROBLEM TO BE SOLVED: To solve the problem in nitriding processing on an insulating film/silicon carbide interface, wherein when an NO gas or N<SB>2</SB>O gas is introduced into a high-temperature reaction furnace, those gases are thermally decomposed and a new interface level is generated by re-oxidation by oxygen produced during the thermal decomposition, so reducible interface level density is suppressed. <P>SOLUTION: The method of manufacturing a silicon carbide semiconductor device includes a step of forming an insulating film on a wafer whose surface is formed of a silicon carbide layer, and a nitriding processing step of nitriding an interface between the silicon carbide layer and an insulating film by heat-treating the wafer after insulating film formation at a predetermined processing temperature in a nitrogen oxide gas atmosphere to which carbon monoxide gas is added. <P>COPYRIGHT: (C)2011,JPO&INPIT

Description

本発明は、炭化珪素半導体装置の製造方法に関し、特に、炭化珪素MOSFETのオン抵抗を低減するための製造方法に関する。   The present invention relates to a method for manufacturing a silicon carbide semiconductor device, and more particularly to a method for reducing the on-resistance of a silicon carbide MOSFET.

炭化珪素(SiC)は、珪素(Si)に比べて、バンドギャップが広く、また絶縁破壊電界強度、飽和電子速度および熱伝導度などの物性値が優れており、半導体パワーデバイス材料として優れた性質を有する。炭化珪素を用いたパワーデバイスとして実現を期待されているのが、高耐圧・低損失の高出力絶縁ゲート型電界効果トランジスタ(MOSFET)である。炭化珪素は熱酸化法により良質の二酸化珪素(SiO2)からなる絶縁膜の形成が可能であるという優れた特徴があるため、炭化珪素MOSFETのゲート絶縁膜として、二酸化珪素(SiO2)膜を用いることができる。炭化珪素上のSiO2膜は、熱酸化法あるいは化学気相堆積(CVD)法等の方法によって形成できる。 Silicon carbide (SiC) has a wider band gap than silicon (Si) and has excellent physical properties such as dielectric breakdown field strength, saturation electron velocity and thermal conductivity, and is an excellent property as a semiconductor power device material. Have What is expected to be realized as a power device using silicon carbide is a high output insulated gate field effect transistor (MOSFET) with high breakdown voltage and low loss. Since silicon carbide has an excellent feature that an insulating film made of high-quality silicon dioxide (SiO 2 ) can be formed by a thermal oxidation method, a silicon dioxide (SiO 2 ) film is used as a gate insulating film of a silicon carbide MOSFET. Can be used. The SiO 2 film on silicon carbide can be formed by a method such as a thermal oxidation method or a chemical vapor deposition (CVD) method.

炭化珪素は上述のように優れた物性値を有するものの、従来の製造方法で炭化珪素MOSFETを作製しても、チャネル層(反転層)の移動度が小さく、物性値から期待される性能はいまだ実現されていない。これは、従来の熱酸化法で形成した二酸化珪素(SiO2)/炭化珪素(SiC)のいわゆるMOS界面には多数の界面準位(トラップ)が発生するため、チャネル層内で十分に移動可能な多数キャリアを存在させることが困難であり、チャネルコンダクタンス(チャネル移動度μch)が非常に低くなるからである。この結果、素子のオン抵抗(導通時のソース/ドレイン間抵抗)が大きくなり、オン動作時の損失が増大するという不具合が生じた。 Although silicon carbide has excellent physical property values as described above, even if a silicon carbide MOSFET is manufactured by a conventional manufacturing method, the mobility of the channel layer (inversion layer) is small, and the performance expected from the physical property values is still Not realized. This is because a large number of interface states (traps) are generated at the so-called MOS interface of silicon dioxide (SiO 2 ) / silicon carbide (SiC) formed by the conventional thermal oxidation method, so that it can move sufficiently within the channel layer. This is because it is difficult to cause a large number of majority carriers to exist, and the channel conductance (channel mobility μch) becomes very low. As a result, there is a problem that the on-resistance (source / drain resistance during conduction) of the element increases and the loss during the on-operation increases.

かかるMOS界面に存在する界面準位を低減するために、種々の方法が研究・報告されている。例えば、特許文献1に開示された減圧雰囲気下で窒化処理する方法、特許文献2に開示された不活性ガスで窒素酸化ガスを希釈して窒化処理する方法、特許文献3に開示されたコールドウォール炉を用いて窒化処理する方法等が報告されている。また、特許文献4に開示された、一酸化窒素(NO)、二酸化窒素(NO)、アンモニア(NH)、水素(H)の単体ガスまたは混合ガス雰囲気で紫外線照射しながら熱処理する方法も報告されている。 Various methods have been studied and reported in order to reduce the interface state existing at the MOS interface. For example, a method of nitriding under a reduced pressure atmosphere disclosed in Patent Document 1, a method of nitriding by diluting a nitrogen oxidizing gas with an inert gas disclosed in Patent Document 2, a cold wall disclosed in Patent Document 3 A method of nitriding using a furnace has been reported. Further, heat treatment is performed while irradiating with ultraviolet rays in a single gas or mixed gas atmosphere of nitrogen monoxide (NO), nitrogen dioxide (N 2 O), ammonia (NH 3 ), and hydrogen (H 2 ) disclosed in Patent Document 4. A method has also been reported.

特開2005−136386JP-A-2005-136386 特開2006−210818JP 2006-210818 A 特開2005−109396JP 2005-109396 A 特開2000−286258JP 2000-286258 A

上述のように、熱酸化法による絶縁膜形成後のNOガスまたはNOガス雰囲気中での高温熱処理(窒化処理)は、チャネル移動度を向上させる手段として有望である。しかしながら、かかる窒化処理においてNOガスもしくはNOガスを高温の反応炉内に導入すると、これらのガスが熱分解し、この熱分解時に発生する酸素による再酸化によって新たな界面準位が発生するため、低減できる界面準位密度が抑制されるといった問題があった。 As described above, the high-temperature heat treatment (nitriding treatment) in the NO gas or N 2 O gas atmosphere after forming the insulating film by the thermal oxidation method is promising as a means for improving the channel mobility. However, when NO gas or N 2 O gas is introduced into a high-temperature reactor in such nitriding treatment, these gases are thermally decomposed, and new interface states are generated due to re-oxidation by oxygen generated during the thermal decomposition. Therefore, there is a problem that the interface state density that can be reduced is suppressed.

上述の特許文献1,2,3記載の発明は、窒化処理雰囲気の酸素分圧を小さくすることによって酸化速度を遅くして、ゲート絶縁膜/炭化珪素界面の再酸化を防止する技術であるが、NOガスやNOガスの分解自体の防止は極めて困難なため、微量の酸素が発生してしまう不具合が生じた。同様に、紫外線を照射しながら高温熱処理する方法においても、NOガスもしくはNOガス雰囲気では酸化力の高いラジカル酸素(-O-)による再酸化が、NOガスもしくはNOガスとNHガスもしくはHガスの混合雰囲気では両者の反応により生じるHOによる再酸化がそれぞれ生じて新たな界面準位を発生させるため、窒化処理による界面準位密度低減の効果が抑制されてしまう問題があった。本発明は、上述の問題点を解決するためになされたものである。 The inventions described in Patent Documents 1, 2, and 3 described above are techniques for reducing the oxidation rate by reducing the oxygen partial pressure in the nitriding atmosphere and preventing reoxidation at the gate insulating film / silicon carbide interface. In addition, since it is extremely difficult to prevent the decomposition of NO gas and N 2 O gas itself, there is a problem that a trace amount of oxygen is generated. Similarly, in the method of performing high-temperature heat treatment while irradiating ultraviolet rays, reoxidation with radical oxygen (—O—) having high oxidizing power in NO gas or N 2 O gas atmosphere causes NO gas or N 2 O gas and NH 3 to be reoxidized. In a mixed atmosphere of gas or H 2 gas, re-oxidation by H 2 O caused by the reaction of both occurs, and a new interface state is generated, so that the effect of reducing the interface state density by nitriding treatment is suppressed. was there. The present invention has been made to solve the above-described problems.

本発明者らは、窒化処理に有効な1100℃以上の高温の処理温度領域では、かかる酸素量(分圧)でもゲート絶縁膜/炭化珪素界面が再酸化されて、窒化処理による界面準位低減効果が抑制されることを初めて見出し、以下に詳述する半導体装置の製造方法を発明するに至った。   In the processing temperature region of 1100 ° C. or higher effective for nitriding, the present inventors re-oxidize the gate insulating film / silicon carbide interface even with such an oxygen amount (partial pressure), and reduce the interface state by nitriding. The inventors have found that the effect is suppressed for the first time, and have invented a method for manufacturing a semiconductor device described in detail below.

本発明に係る半導体装置の製造方法は、表面が炭化珪素層から成るウエハ上に絶縁膜を形成する工程と、絶縁膜形成後のウエハを一酸化炭素ガスが添加された酸化窒素系ガス雰囲気中で所定の処理温度で熱処理することにより炭化珪素層と絶縁膜との界面を窒化する窒化処理工程と、を備える。   The method of manufacturing a semiconductor device according to the present invention includes a step of forming an insulating film on a wafer having a silicon carbide layer on the surface, and a nitrogen oxide gas atmosphere in which carbon monoxide gas is added to the wafer after the insulating film is formed. And a nitriding treatment step of nitriding the interface between the silicon carbide layer and the insulating film by performing a heat treatment at a predetermined treatment temperature.

本発明に係る半導体装置の製造方法によると、再酸化による界面準位の生成を抑制できるため、窒化処理により低減される界面準位量が増大して、チャネル移動度が向上する効果をもたらす。この結果、オン抵抗の小さい低損失の半導体装置が製造可能となる。   According to the method for manufacturing a semiconductor device according to the present invention, the generation of interface states due to reoxidation can be suppressed, so that the amount of interface states reduced by nitriding treatment is increased and the channel mobility is improved. As a result, a low-loss semiconductor device with low on-resistance can be manufactured.

この発明の実施の形態1に係る炭化珪素半導体装置の断面構造を概略的に示す図である。It is a figure which shows roughly the cross-section of the silicon carbide semiconductor device which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係る炭化珪素半導体装置の製造方法の工程断面図である。It is process sectional drawing of the manufacturing method of the silicon carbide semiconductor device which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係る炭化珪素半導体装置の製造方法の工程断面図である。It is process sectional drawing of the manufacturing method of the silicon carbide semiconductor device which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係る炭化珪素半導体装置の製造方法の工程断面図である。It is process sectional drawing of the manufacturing method of the silicon carbide semiconductor device which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係る炭化珪素半導体装置の製造方法の工程断面図である。It is process sectional drawing of the manufacturing method of the silicon carbide semiconductor device which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係る炭化珪素半導体装置の製造に使用する反応炉の模式図である。It is a schematic diagram of the reactor used for manufacture of the silicon carbide semiconductor device which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係る炭化珪素半導体装置の製造におけるゲート絶縁膜作製に関連する処理工程時系列および各工程における温度プロファイルを示す図である。It is a figure which shows the temperature profile in each process process time series relevant to gate insulating film preparation in manufacture of the silicon carbide semiconductor device which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係る炭化珪素半導体装置の製造方法に用いられる反応炉における反応炉内での各ガスの流れと生じる反応を模式的に示した図である。It is the figure which showed typically the flow of each gas and the reaction which arises in the reactor in the reactor used for the manufacturing method of the silicon carbide semiconductor device which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係る炭化珪素半導体装置の製造方法の工程断面図である。It is process sectional drawing of the manufacturing method of the silicon carbide semiconductor device which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係る炭化珪素半導体装置の製造方法の工程断面図である。It is process sectional drawing of the manufacturing method of the silicon carbide semiconductor device which concerns on Embodiment 1 of this invention. この発明の実施の形態2に係る炭化珪素半導体装置の製造におけるゲート絶縁膜作製に関連する処理工程時系列および各工程における温度プロファイルを示す図である。It is a figure which shows the temperature profile in each process process time series relevant to gate insulating film preparation in manufacture of the silicon carbide semiconductor device which concerns on Embodiment 2 of this invention. この発明の実施の形態3に係る炭化珪素半導体装置の断面構造を概略的に示す図である。It is a figure which shows roughly the cross-section of the silicon carbide semiconductor device which concerns on Embodiment 3 of this invention.

実施の形態1.
図1は、実施の形態1の炭化珪素半導体装置の製造方法によって製造される炭化珪素半導体装置の断面模式図を示したものである。炭化珪素半導体装置の一例として、nチャネル炭化珪素MOSFETの断面構造を示す。
Embodiment 1 FIG.
1 is a schematic cross-sectional view of a silicon carbide semiconductor device manufactured by the method for manufacturing a silicon carbide semiconductor device of the first embodiment. As an example of the silicon carbide semiconductor device, a cross-sectional structure of an n-channel silicon carbide MOSFET is shown.

図1において、炭化珪素半導体装置は、低抵抗のn型炭化珪素基板10の第一の主面上に形成されたn型の炭化珪素ドリフト層20と、炭化珪素ドリフト層20の表面側で所定の幅だけ離間した部位に形成され、第1不純物であるアルミニウム(Al)をp型不純物として含有するp型のベース領域30と、ベース領域30のそれぞれの断面方向に対して内部側の表層部位に、ベース領域30より浅く形成され、第2不純物である窒素(N)をn型不純物として含有するn型のソース領域40と、ベース領域30およびソース領域40を含む炭化珪素ドリフト層20の表面側に形成され、ソース領域40の表面側の一部を除き、二酸化珪素から成るゲート絶縁膜50と、ゲート絶縁膜50上の一対のソース領域40間の領域を含む部位に対向する位置に設けられたゲート電極60と、ゲート絶縁膜50が形成されていないソース領域40の表面に設けられたソース電極70と、炭化珪素基板10の第一の主面と反対側の第二の主面、すなわち、裏面側に設けられたドレイン電極80とで構成されている。   In FIG. 1, the silicon carbide semiconductor device has an n-type silicon carbide drift layer 20 formed on the first main surface of low-resistance n-type silicon carbide substrate 10 and a predetermined surface side of silicon carbide drift layer 20. And a p-type base region 30 containing aluminum (Al) as the first impurity as a p-type impurity, and a surface layer portion on the inner side with respect to the respective cross-sectional directions of the base region 30 The n-type source region 40 is formed shallower than the base region 30 and contains the second impurity nitrogen (N) as an n-type impurity, and the surface of the silicon carbide drift layer 20 including the base region 30 and the source region 40. The gate insulating film 50 made of silicon dioxide and a portion including a region between the pair of source regions 40 on the gate insulating film 50 are formed except for a part on the surface side of the source region 40. A gate electrode 60 provided at a position where the gate insulating film 50 is not formed, a source electrode 70 provided on the surface of the source region 40 where the gate insulating film 50 is not formed, and a second electrode opposite to the first main surface of the silicon carbide substrate 10. And a drain electrode 80 provided on the back surface side.

なお、図1において、ベース領域30中でゲート絶縁膜50を介してゲート電極60と対向し、オン動作時にチャネル層が形成される領域をチャネル領域と称する。また、炭化珪素ドリフト層20の表層部位でイオン注入されていない領域とソース領域40との間でチャネル領域を挟む距離をチャネル長と称する。   In FIG. 1, a region in the base region 30 that faces the gate electrode 60 through the gate insulating film 50 and in which a channel layer is formed during the ON operation is referred to as a channel region. Further, the distance between which the channel region is sandwiched between the region where the ion implantation is not performed at the surface layer portion of silicon carbide drift layer 20 and source region 40 is referred to as a channel length.

まず、図1に示す炭化珪素半導体装置の動作の概要を説明する。図1の炭化珪素半導体装置では、ゲート電極60に電圧が印加されると、このゲート電極直下のベース領域30表面にチャネル層が形成され、ソース領域40と炭化珪素ドリフト層20との間に電荷の流れる経路が形成される。炭化珪素MOSFETがnチャネルMOSFETの場合、多数キャリアは電子であり、ソース領域40から炭化珪素ドリフト層20へ流れ込む電子は、ドレイン電極80への印加電圧によって生じる電界に沿って炭化珪素ドリフト層20およびn型炭化珪素基板10を経てドレイン電極80に到達する。したがって、ゲート電極60に電圧を印加することにより、ドレイン電極80からソース電極70に電流が流れる。   First, an outline of the operation of the silicon carbide semiconductor device shown in FIG. 1 will be described. In the silicon carbide semiconductor device of FIG. 1, when a voltage is applied to gate electrode 60, a channel layer is formed on the surface of base region 30 immediately below the gate electrode, and a charge is generated between source region 40 and silicon carbide drift layer 20. Is formed. When the silicon carbide MOSFET is an n-channel MOSFET, majority carriers are electrons, and electrons flowing from the source region 40 into the silicon carbide drift layer 20 are generated along the electric field generated by the voltage applied to the drain electrode 80 and the silicon carbide drift layer 20 and It reaches the drain electrode 80 through the n-type silicon carbide substrate 10. Therefore, a current flows from the drain electrode 80 to the source electrode 70 by applying a voltage to the gate electrode 60.

一方、炭化珪素MOSFETがpチャネルMOSFETであり、多数キャリアが正孔の場合には、ドレイン電極80から注入される正孔が炭化珪素ドリフト層20を介して流れてベース領域30に到達し、次いで、ベース領域30表面に形成されたチャネル層を介してソース電極70の電位に従ってソース領域40に流れ込む。これにより、正孔がドレイン電極80からソース電極70に流れる。   On the other hand, when the silicon carbide MOSFET is a p-channel MOSFET and the majority carriers are holes, the holes injected from drain electrode 80 flow through silicon carbide drift layer 20 and reach base region 30, and then Then, it flows into the source region 40 according to the potential of the source electrode 70 through the channel layer formed on the surface of the base region 30. As a result, holes flow from the drain electrode 80 to the source electrode 70.

実施の形態1の炭化珪素半導体装置であるnチャネルMOSFETの製造方法について、図2〜10を用いて説明する。図2〜5および図9、図10は、nチャネルMOSFETの各製造工程における断面模式図をそれぞれ示したものである。   A method of manufacturing an n-channel MOSFET that is the silicon carbide semiconductor device of the first embodiment will be described with reference to FIGS. 2 to 5 and FIGS. 9 and 10 are schematic cross-sectional views in the respective manufacturing steps of the n-channel MOSFET.

図2に示すように、まず、第一の主面の面方位が(0001)面であり、4Hのポリタイプを有する低抵抗のn型炭化珪素基板10の表面上に、例えば、化学気相堆積法(Chemical Vapor Deposition:CVD)により、1×1015cm-3〜1×1018cm-3のn型の不純物濃度、5〜50μmの層厚の炭化珪素ドリフト層20をエピタキシャル成長する。かかる条件で炭化珪素ドリフト層20を形成することにより、数100V〜3kV以上の耐圧を具備する縦型の高耐圧MOSFETが実現できる。 As shown in FIG. 2, first, on the surface of the low resistance n-type silicon carbide substrate 10 whose first main surface has a (0001) plane and has a 4H polytype, for example, a chemical vapor phase is formed. Silicon carbide drift layer 20 having an n-type impurity concentration of 1 × 10 15 cm −3 to 1 × 10 18 cm −3 and a layer thickness of 5 to 50 μm is epitaxially grown by a deposition method (Chemical Vapor Deposition: CVD). By forming the silicon carbide drift layer 20 under such conditions, a vertical high breakdown voltage MOSFET having a breakdown voltage of several hundred V to 3 kV or more can be realized.

次に、図3に示すように、炭化珪素ドリフト層20の表面に第1注入マスク100を形成し、当該第1注入マスク100をマスクとして、p型の第1不純物であるAlを炭化珪素ドリフト層20中にイオン注入する。このとき、Alのイオン注入の深さは炭化珪素ドリフト層20の層厚を超えない程度、すなわち0.5〜3μm程度に設定する。また、イオン注入されたAlの不純物濃度は、1×1017cm-3〜1×1019cm-3の範囲内で、かつ、炭化珪素ドリフト層20のn型不純物濃度より高くなるように予め設定する。炭化珪素ドリフト層20中でAlがイオン注入されてp型の導電型となる領域が、ベース領域30として機能する。 Next, as shown in FIG. 3, first implantation mask 100 is formed on the surface of silicon carbide drift layer 20, and using p-type first impurity Al as a silicon carbide drift, using first implantation mask 100 as a mask. Ions are implanted into the layer 20. At this time, the depth of ion implantation of Al is set to a level that does not exceed the thickness of the silicon carbide drift layer 20, that is, about 0.5 to 3 μm. Further, the impurity concentration of the ion-implanted Al is set in advance within a range of 1 × 10 17 cm −3 to 1 × 10 19 cm −3 and higher than the n-type impurity concentration of the silicon carbide drift layer 20. Set. A region in which Al is ion-implanted in silicon carbide drift layer 20 and becomes p-type conductivity functions as base region 30.

第1注入マスク100を除去後、図4に示すように、炭化珪素ドリフト層20の表面に第1注入マスク100よりチャネル長方向において幅の広い第2注入マスク110を形成する。第2注入マスク110が形成された炭化珪素ドリフト層20の表面に、n型の第2不純物である窒素(N)をイオン注入する。Nのイオン注入深さはベース領域30の厚さより浅くなるように設定する。また、イオン注入したNの不純物濃度は1×1018cm-3〜1×1021cm-3の範囲内でベース領域30のp型不純物濃度を超えるように予め設定する。炭化珪素ドリフト層20内のNが注入された領域のうちn型となる領域がソース領域40として機能する。第2注入マスク110を除去後、熱処理装置内で、アルゴン(Ar)ガスなどの不活性ガス雰囲気中で1300〜1900℃の処理温度で、30秒〜1時間のアニールを行う。かかるアニール処理により、イオン注入されたN、Alを電気的に活性化させる。 After removing first implantation mask 100, a second implantation mask 110 having a width wider than that of first implantation mask 100 in the channel length direction is formed on the surface of silicon carbide drift layer 20, as shown in FIG. Nitrogen (N), which is an n-type second impurity, is ion-implanted into the surface of the silicon carbide drift layer 20 on which the second implantation mask 110 is formed. The ion implantation depth of N is set so as to be shallower than the thickness of the base region 30. Further, the impurity concentration of the ion-implanted N is set in advance so as to exceed the p-type impurity concentration of the base region 30 within a range of 1 × 10 18 cm −3 to 1 × 10 21 cm −3 . Of the region into which N is implanted in silicon carbide drift layer 20, the n-type region functions as source region 40. After removing the second implantation mask 110, annealing is performed in a heat treatment apparatus in an inert gas atmosphere such as argon (Ar) gas at a treatment temperature of 1300 to 1900 ° C. for 30 seconds to 1 hour. By such annealing treatment, ion-implanted N and Al are electrically activated.

続いて、図5に示すように、ソース領域40、ベース領域30を含む炭化珪素ドリフト層20の表面を熱酸化して、100nm以下の厚さで所望の膜厚のSiOから成るゲート絶縁膜50を形成する。
次に、実施の形態1の炭化珪素半導体装置の製造方法における特徴的な製造工程、すなわち窒化処理工程について、以下に詳述する。
Subsequently, as shown in FIG. 5, the surface of the silicon carbide drift layer 20 including the source region 40 and the base region 30 is thermally oxidized, and a gate insulating film made of SiO 2 having a desired thickness of 100 nm or less. 50 is formed.
Next, a characteristic manufacturing process, that is, a nitriding process in the method for manufacturing the silicon carbide semiconductor device of the first embodiment will be described in detail below.

図6に示す反応炉200を用いて、図7のシーケンスに従って窒化処理を実施する。なお、図7では、縦軸は各処理工程における温度を、横軸は時間をそれぞれ表し、NOガスまたはNOガス雰囲気下での窒化処理工程が、時系列的に温度プロファイルとともに示される。 Using the reaction furnace 200 shown in FIG. 6, nitriding is performed according to the sequence shown in FIG. In FIG. 7, the vertical axis represents the temperature in each processing step, and the horizontal axis represents time, and the nitriding step in an NO gas or N 2 O gas atmosphere is shown with a temperature profile in time series.

図6の反応炉200の動作を以下に説明する。先ず、反応炉200内のボート201にそれぞれ半導体製造装置が多数形成されたウエハを設置する。ボート201を用いることにより、同時に複数枚のウエハ処理が可能となり、製造コストを低減できる効果がある。ボート201で空いた部分は、ダミー基板204を設置して、成膜中に空いた部分が汚れないようにする。反応炉200内にウエハを設置後、ガス導入口203から処理用の各ガスを導入、反応炉200の周辺部に取り付けられたヒーター202によって反応炉200内を加熱する。ヒーター202の出力を電子制御することにより、所望の処理温度を高精度に制御できる。   The operation of the reaction furnace 200 of FIG. 6 will be described below. First, a wafer on which a large number of semiconductor manufacturing apparatuses are formed is installed in the boat 201 in the reaction furnace 200. By using the boat 201, it is possible to process a plurality of wafers at the same time, and the manufacturing cost can be reduced. A dummy substrate 204 is installed in the vacant part of the boat 201 to prevent the vacant part from becoming dirty during film formation. After the wafer is placed in the reaction furnace 200, each gas for processing is introduced from the gas inlet 203, and the inside of the reaction furnace 200 is heated by the heater 202 attached to the periphery of the reaction furnace 200. A desired processing temperature can be controlled with high accuracy by electronically controlling the output of the heater 202.

続いて、窒化処理工程について説明する。反応炉200内にウエハ300を導入した後、反応炉200内およびガス配管の圧力が1.3Pa以下に到達するまで真空排気する。かかる真空排気は、反応炉200内の酸化性ガスの除去を目的として実施する。目標圧力に到達後、ガス導入口203から反応炉200内に不活性ガスを流入させて大気圧に戻してから、同雰囲気を保持しながら昇温する。所望の熱処理温度に到達後、NOガスもしくはNOガスと酸素に対して反応性が高いCOガスとをガス導入口203から反応炉200内に導入する。COガスは、NOガスもしくはNOガスを、例えばCOガスのような酸化力の低い気体へと変化させる性質を有する。ちなみに、COガスは炭化珪素層表面を窒化処理するような高温の熱処理領域でも極めて安定で、熱分解しない特徴を有する。 Next, the nitriding process will be described. After the wafer 300 is introduced into the reaction furnace 200, it is evacuated until the pressure in the reaction furnace 200 and the gas piping reaches 1.3 Pa or less. Such evacuation is performed for the purpose of removing the oxidizing gas in the reaction furnace 200. After reaching the target pressure, an inert gas is caused to flow into the reaction furnace 200 from the gas inlet 203 to return to atmospheric pressure, and then the temperature is raised while maintaining the same atmosphere. After reaching a desired heat treatment temperature, NO gas or N 2 O gas and CO gas highly reactive with oxygen are introduced into the reaction furnace 200 from the gas inlet 203. The CO gas has a property of changing NO gas or N 2 O gas into a gas having low oxidizing power such as CO 2 gas. Incidentally, CO gas is extremely stable even in a heat treatment region at a high temperature such as nitriding the surface of the silicon carbide layer, and has a feature that it does not thermally decompose.

図8は、反応炉200内での各ガスの流れと生じる反応を模式的に示した図である。窒化処理時にNOガスやNOガスで代表されるような酸化窒素系ガスの熱分解で発生した酸素(O)はCOガスと反応して、酸化力の低い安定なガスであるCO(CO+O→2CO)ガスとなる。上述の混合ガスに加えてNやArなどの不活性ガスで希釈した雰囲気や減圧雰囲気で窒化処理しても同様の効果を奏する。 FIG. 8 is a diagram schematically showing the flow of each gas in the reaction furnace 200 and the reaction that occurs. Oxygen (O 2 ) generated by thermal decomposition of a nitric oxide-based gas represented by NO gas or N 2 O gas during nitriding treatment reacts with CO gas, and CO 2 is a stable gas with low oxidizing power. (CO + O 2 → 2CO 2 ) gas. The same effect can be obtained by nitriding in an atmosphere diluted with an inert gas such as N 2 or Ar or a reduced pressure atmosphere in addition to the above mixed gas.

上述の方法による窒化処理によって、ゲート絶縁膜/炭化珪素界面を再酸化して界面準位を生ぜしめるおそれのある酸素(O)の発生が防止されるので、効果的に窒化処理が実施できる。また、窒化処理時間に制限は無くなり、ゲート絶縁膜材料や膜厚に応じた最適な時間を選択することが可能となる。窒化処理時の処理温度は、窒化の効果が高い1100℃以上1300℃以下の範囲が好適である。降温時の雰囲気は上述の不活性ガスあるいは混合ガス雰囲気等が好適である。
なお、COガスはニッケル(Ni)や鉄(Fe)を含有する材料を腐食する性質があるため、ガス配管、排気配管をSUS配管とする点に注意を要する。
By the nitriding treatment by the above-described method, generation of oxygen (O 2 ) that may re-oxidize the gate insulating film / silicon carbide interface and generate an interface state is prevented, so that the nitriding treatment can be effectively performed. . Further, there is no limitation on the nitriding time, and it is possible to select an optimal time according to the gate insulating film material and film thickness. The treatment temperature during nitriding is preferably in the range of 1100 ° C. or higher and 1300 ° C. or lower where the nitriding effect is high. The above-mentioned inert gas or mixed gas atmosphere is suitable for the temperature drop.
In addition, since CO gas has a property which corrodes the material containing nickel (Ni) and iron (Fe), attention is required for the gas piping and the exhaust piping to be SUS piping.

COガスの最適な混合比率について、以下に考察する。一例として、NOガスとCOガスの最適な混合比率(体積比)について説明する。
NOガスとCOガスを混合した場合、以下の3つの反応が生じる。
2NO→N+O (1)
2CO+O→2CO (2)
2NO+2CO→2CO+N (3)
反応(1)はNOガスの熱分解によって酸素が生成される反応である。反応式(2)は反応(1)で発生したOガスをCOガスにより、COガスへ変化させる反応である。反応(3)は界面準位を低減させる役割を担うNOガスがCOガスによって消費される反応である。
The optimum mixing ratio of CO gas will be discussed below. As an example, the optimum mixing ratio (volume ratio) of NO gas and CO gas will be described.
When NO gas and CO gas are mixed, the following three reactions occur.
2NO → N 2 + O 2 (1)
2CO + O 2 → 2CO 2 (2)
2NO + 2CO → 2CO 2 + N 2 (3)
Reaction (1) is a reaction in which oxygen is generated by thermal decomposition of NO gas. Reaction formula (2) is a reaction in which the O 2 gas generated in the reaction (1) is changed to CO 2 gas by CO gas. Reaction (3) is a reaction in which NO gas, which plays a role in reducing the interface state, is consumed by CO gas.

反応(1)、(2)によって生成されたOガスを全てCOガスに変化せしめるには、COガス流量をOガス発生量の2倍以上にする必要がある。しかし、反応(3)から、NOガスがCOガスと反応して消費される点も考慮しなければならない。よって、COガス流量はNOガス流量よりも少なくする必要がある。つまり、最適な条件は、NOガスとCOガスの混合比率[CO]/[NO](以下、体積比を表す)が1以下で、かつ、生成されるOガス発生量の2倍以上となる。反応式(1)〜(3)に従い生成されるOガス発生量の算出は、表1に示すNOガス反応方程式を利用して、表2の計算方法により可能である。すなわち、表2に、熱処理温度、反応炉に流すNOガス流量を代入することによって、t秒後のOガス発生量を求めることができる。t秒を、ガスがウエハに到達する時間と一致するようになるまで計算すれば算出できる。 In order to change all of the O 2 gas generated by the reactions (1) and (2) into CO 2 gas, it is necessary to set the CO gas flow rate to at least twice the O 2 gas generation amount. However, it must also be taken into account that NO gas reacts with CO gas and is consumed from reaction (3). Therefore, the CO gas flow rate needs to be smaller than the NO gas flow rate. In other words, the optimum condition is that the mixing ratio [CO] / [NO] (hereinafter, the volume ratio) of NO gas and CO gas is 1 or less, and more than twice the amount of generated O 2 gas is generated. Become. Calculation of the O 2 gas generation amount produced | generated according to Reaction Formula (1)-(3) is possible by the calculation method of Table 2 using the NO gas reaction equation shown in Table 1. That is, by substituting the heat treatment temperature and the NO gas flow rate flowing in the reactor into Table 2, the amount of O 2 gas generated after t seconds can be obtained. It can be calculated by calculating t seconds until the gas reaches the wafer time.

Figure 2011146580
Figure 2011146580

Figure 2011146580

上述の表中で、Ea, E-aは矢印方向(⇔)の活性化エネルギーを表し、ka、k-aは矢印方向(⇔)の反応測定定数を表す。Eb, E-b, kb、k-b以下も同様である。また、Rは気体定数を、Tは温度、tは時間をそれぞれ表す。
Figure 2011146580

In the above table, Ea and Ea represent activation energy in the arrow direction (⇔), and ka and ka represent reaction measurement constants in the arrow direction (⇔). The same applies to Eb, Eb, kb, and below kb. R represents a gas constant, T represents temperature, and t represents time.

例えば、熱処理温度を1250℃、反応炉200内でウエハに到達するまでにガスが滞留する時間を30秒とした場合、Oガス発生量は、0.1×NOガス流量発生する。つまり、NOガス流量の10%に相当するOガスが発生する。この場合のNOガス流量とCOガス流量の最適な混合比率[CO]/[NO]は、COガス流量がOガス発生量より多いという観点から0.1より大きく、COガス流量がNOガス流量より少ないという観点から1より小さい範囲内となる。 For example, when the heat treatment temperature is 1250 ° C. and the time that the gas stays before reaching the wafer in the reaction furnace 200 is 30 seconds, the amount of O 2 gas generated is 0.1 × NO gas flow rate. That is, O 2 gas corresponding to 10% of the NO gas flow rate is generated. The optimum mixing ratio [CO] / [NO] of the NO gas flow rate and the CO gas flow rate in this case is larger than 0.1 from the viewpoint that the CO gas flow rate is larger than the O 2 gas generation amount, and the CO gas flow rate is NO gas. It is within a range smaller than 1 from the viewpoint of less than the flow rate.

ArやNなど不活性ガスを混合した場合においても同様の計算方法によりOガス発生量は算出可能であるので、最適な混合比率[CO]/[NO]の範囲を見積もることができる。 Even when an inert gas such as Ar or N 2 is mixed, the amount of O 2 gas generated can be calculated by the same calculation method, so that the optimum range of the mixing ratio [CO] / [NO] can be estimated.

以上の計算に従って最適化された混合比率[CO]/[NO]を有する混合ガスを用いることにより、炭化珪素/ゲート絶縁膜界面の再酸化が生じるおそれのない窒化処理を施すことが可能となる。   By using a mixed gas having a mixture ratio [CO] / [NO] optimized in accordance with the above calculation, it is possible to perform a nitriding process that does not cause reoxidation of the silicon carbide / gate insulating film interface. .

次に、図9に示すように、ゲート絶縁膜50上に、導電性を有する多結晶珪素膜を減圧CVD法により成膜して、所定の形状にパターニングすることによりゲート電極60を形成する。このとき、ゲート電極60は、ゲート絶縁膜50を介して、一対のソース領域40と例えば10nm〜5μmの範囲でオーバーラップしていることが望ましい。   Next, as shown in FIG. 9, a polycrystalline silicon film having conductivity is formed on the gate insulating film 50 by a low pressure CVD method, and patterned into a predetermined shape, thereby forming a gate electrode 60. At this time, the gate electrode 60 preferably overlaps with the pair of source regions 40 through the gate insulating film 50 in the range of, for example, 10 nm to 5 μm.

その後、図10に示すように、ゲート電極60に覆われた部分およびその近傍を除くゲート絶縁膜50を除去する。最後に、ソース領域40に電気的に接続されるソース電極70を、炭化珪素基板10の裏面側にドレイン電極80をそれぞれ形成して、図1に示すnチャネルMOSFETが完成する。ここで、ソース電極70およびドレイン電極80を構成する材料として、Al合金などが挙げられる。   Thereafter, as shown in FIG. 10, the gate insulating film 50 excluding the portion covered with the gate electrode 60 and the vicinity thereof is removed. Finally, source electrode 70 electrically connected to source region 40 is formed and drain electrode 80 is formed on the back surface side of silicon carbide substrate 10 to complete the n-channel MOSFET shown in FIG. Here, examples of the material constituting the source electrode 70 and the drain electrode 80 include an Al alloy.

上述の工程で製造した炭化珪素半導体装置の一種である炭化珪素MOSFETは、窒化処理時にCOガスを添加することにより、炭化珪素表面を再酸化するおそれのある酸素(O)の発生を効果的に防止するので、窒化処理により低減される界面準位量が増大する。この結果、チャネル層内で高いチャネル移動度が得られるので、炭化珪素MOSFETのオン抵抗が小さくなり、オン動作時の損失を低減できる効果を奏する。 A silicon carbide MOSFET which is a kind of silicon carbide semiconductor device manufactured in the above-described process effectively generates oxygen (O 2 ) that may reoxidize the silicon carbide surface by adding CO gas during nitriding. Therefore, the amount of interface states reduced by nitriding increases. As a result, since high channel mobility is obtained in the channel layer, the on-resistance of the silicon carbide MOSFET is reduced, and the loss during the on-operation can be reduced.

なお、本実施の形態において、ゲート絶縁膜50は炭化珪素を熱酸化して形成した酸化珪素膜である例を示したが、ゲート絶縁膜50はCVD法、蒸着法、スパッタ法、イオンクラスタービーム法、分子線エピタキシー法などで形成した堆積膜であっても良い。また、ゲート絶縁膜材料も酸化珪素に限らず、窒化珪素膜、酸化窒化珪素膜、酸化アルミニウム膜、窒化アルミニウム膜、酸化ハフニウム膜、酸化ジルコニウム膜などであっても良い。さらに、ゲート絶縁膜は、例えば、窒化珪素と二酸化珪素を組み合わせた積層構造などであっても良い。   In the present embodiment, the gate insulating film 50 is an example of a silicon oxide film formed by thermally oxidizing silicon carbide. However, the gate insulating film 50 is formed by a CVD method, a vapor deposition method, a sputtering method, an ion cluster beam. It may be a deposited film formed by a method, a molecular beam epitaxy method or the like. The material of the gate insulating film is not limited to silicon oxide, and may be a silicon nitride film, a silicon oxynitride film, an aluminum oxide film, an aluminum nitride film, a hafnium oxide film, a zirconium oxide film, or the like. Further, the gate insulating film may have a laminated structure in which silicon nitride and silicon dioxide are combined, for example.

また、炭化珪素基板10として、第一の主面の面方位が(0001)面であり、4Hのポリタイプを有する低抵抗のn型炭化珪素基板10を一例として示したが、炭化珪素基板10は4Hに限定されるものではなく、第一の主面の方位が(000−1)面、(11−20)面などであっても良く、これらの面方位からいずれかの方向に傾斜しているものであっても良い。さらに、炭化珪素基板10のポリタイプとしては、6Hや3Cであっても良い。   Further, as silicon carbide substrate 10, a low resistance n-type silicon carbide substrate 10 having a (0001) plane as a first main surface and a 4H polytype is shown as an example. Is not limited to 4H, and the orientation of the first principal surface may be the (000-1) plane, the (11-20) plane, etc., and is inclined in any direction from these plane orientations. May be. Further, the polytype of the silicon carbide substrate 10 may be 6H or 3C.

なお、ゲート電極80の材料は低抵抗多結晶珪素の例を示したが、導電型としてはn型、p型のいずれでも良い。また、n型またはp型の低抵抗多結晶炭化珪素であっても良い。さらに、ゲート電極80の材料はAlやチタニウム(Ti)、モリブデン(Mo)、タンタル(Ta)、ニオブ(Nb)、タングステン(W)あるいはそれらの金属の窒化物でも良い。ソース電極90とドレイン電極100の材料についても、ゲート電極80と同様の金属で構成されても良い。また、各電極形成後、1000℃程度でアニールしても良い。   The material of the gate electrode 80 is an example of low-resistance polycrystalline silicon, but the conductivity type may be either n-type or p-type. Further, it may be n-type or p-type low resistance polycrystalline silicon carbide. Further, the material of the gate electrode 80 may be Al, titanium (Ti), molybdenum (Mo), tantalum (Ta), niobium (Nb), tungsten (W), or nitrides of these metals. The material for the source electrode 90 and the drain electrode 100 may also be made of the same metal as that for the gate electrode 80. Moreover, you may anneal at about 1000 degreeC after each electrode formation.

実施の形態2.
実施の形態1で説明した炭化珪素半導体装置の製造方法はゲート絶縁膜形成後に窒化処理する工程に関するものであったが、実施の形態2に係る炭化珪素半導体装置の製造方法は、実施の形態1の工程に加えて、炭化珪素表面にゲート絶縁膜を形成する前に実施する窒化処理する工程に関する。
Embodiment 2. FIG.
Although the method for manufacturing the silicon carbide semiconductor device described in the first embodiment relates to the nitriding process after forming the gate insulating film, the method for manufacturing the silicon carbide semiconductor device according to the second embodiment is the same as in the first embodiment. In addition to this step, the present invention relates to a nitriding step that is performed before forming a gate insulating film on the surface of silicon carbide.

図11は、ゲート絶縁膜形成前の炭化珪素基体表面の窒化処理工程、化学的気相成長法による二酸化珪素膜の形成工程およびその後の窒化処理工程に至る各工程における反応炉内の温度プロファイルを表わす図である。   FIG. 11 shows the temperature profile in the reaction furnace in each step from the nitridation process on the surface of the silicon carbide substrate before the formation of the gate insulating film, the silicon dioxide film formation process by chemical vapor deposition, and the subsequent nitridation process. FIG.

図11では、縦軸に各処理工程における温度、横軸に時間をそれぞれ示し、NOガスまたはNOガス雰囲気下での窒化処理工程、化学的気相成長法による酸化膜形成工程、およびその後のNOガスまたはNOガス雰囲気下での窒化処理工程を含むゲート絶縁膜形成工程が、時系列的に各対応の温度プロファイルとともに示される。 In FIG. 11, the vertical axis indicates the temperature in each processing step, and the horizontal axis indicates time. The nitriding step in an NO gas or N 2 O gas atmosphere, the oxide film forming step by chemical vapor deposition, and the subsequent steps A gate insulating film forming process including a nitriding process process in an atmosphere of NO gas or N 2 O gas is shown together with corresponding temperature profiles in time series.

まず、アルゴン(Ar)または窒素(N)などの不活性ガス雰囲気下での窒化処理用反応炉内にベース領域30およびソース領域40形成後のウエハを導入する。 First, the wafer after the base region 30 and the source region 40 are formed is introduced into a nitriding reactor in an inert gas atmosphere such as argon (Ar) or nitrogen (N 2 ).

窒化処理用反応炉内の温度が所望の処理温度に到達した時点で、NOガスもしくはNOガスと酸素に対して反応性が高いCOガスとを反応炉200内に導入する。窒化処理時に酸化窒素系ガスの熱分解で発生した酸素(O)はCOガスと反応して、酸化力の低い安定なガスであるCO(CO+O→2CO)ガスとなる。上述の混合ガスに加えてNやArなどの不活性ガスで希釈した雰囲気や減圧雰囲気で窒化処理しても同様の効果を奏する。このような窒化処理工程を実施することにより、炭化珪素表面を酸素によって再酸化されることなしに窒素原子(N)がパッシベートするので、次工程で堆積される二酸化珪素膜との界面が良好となる。 When the temperature in the nitriding reactor reaches a desired processing temperature, NO gas or N 2 O gas and CO gas that is highly reactive with oxygen are introduced into the reactor 200. Oxygen (O 2 ) generated by the thermal decomposition of the nitric oxide-based gas during the nitriding treatment reacts with the CO gas to become CO 2 (CO + O 2 → 2CO 2 ) gas, which is a stable gas with low oxidizing power. The same effect can be obtained by nitriding in an atmosphere diluted with an inert gas such as N 2 or Ar or a reduced pressure atmosphere in addition to the above mixed gas. By carrying out such a nitriding process, nitrogen atoms (N) are passivated without reoxidizing the silicon carbide surface with oxygen, so that the interface with the silicon dioxide film deposited in the next process is good. Become.

窒化処理温度としては、1100℃〜1300℃が好適である。この窒化処理時間としては、30分〜6時間程度が好適である。
窒化処理工程後、ウエハ取出し温度まで降温する。降温時の雰囲気は上述の不活性ガスあるいは混合ガス雰囲気等が好適である。これにより、ゲート絶縁膜形成前の窒化処理工程が終了する。ゲート絶縁膜形成後の窒化処理は実施の形態1とほぼ同様なので、省略する。
The nitriding temperature is preferably 1100 ° C. to 1300 ° C. The nitriding time is preferably about 30 minutes to 6 hours.
After the nitriding process, the temperature is lowered to the wafer removal temperature. The above-mentioned inert gas or mixed gas atmosphere is suitable for the temperature drop. Thereby, the nitriding process step before forming the gate insulating film is completed. The nitridation process after the formation of the gate insulating film is substantially the same as in the first embodiment, and is omitted.

実施の形態1の場合と同様、上述の処理によって、炭化珪素表面を再酸化して界面準位を発生させるおそれのある酸素(O)の発生を防止しつつ、効果的に窒化処理が実施できる。また、窒化処理時間に制限は無くなり、ゲート絶縁膜材料や膜厚に応じた最適な処理時間を選択することが可能となる。 As in the case of the first embodiment, the above-described treatment effectively performs nitriding while preventing the generation of oxygen (O 2 ) that may re-oxidize the silicon carbide surface and generate interface states. it can. Further, there is no limitation on the nitriding time, and it is possible to select an optimum processing time according to the gate insulating film material and film thickness.

実施の形態3.
図12は、本発明の実施の形態3における炭化珪素半導体装置である炭化珪素MOSFETの断面模式図である。図12において、炭化珪素基板10の第一の主面上にn型の炭化珪素ドリフト層20、p型のウェル領域30、n型のソース領域40が、順に積層して形成されている。n型の炭化珪素ドリフト層20、p型のウェル領域30、n型のソース領域40には、ウェル領域30、ソース領域40を貫通して炭化珪素ドリフト層20に達するトレンチが設けられている。
Embodiment 3 FIG.
FIG. 12 is a schematic cross-sectional view of a silicon carbide MOSFET which is a silicon carbide semiconductor device in the third embodiment of the present invention. In FIG. 12, n-type silicon carbide drift layer 20, p-type well region 30, and n-type source region 40 are sequentially stacked on the first main surface of silicon carbide substrate 10. The n-type silicon carbide drift layer 20, the p-type well region 30, and the n-type source region 40 are provided with trenches that penetrate the well region 30 and the source region 40 and reach the silicon carbide drift layer 20.

トレンチの表面およびソース領域40の表面には、ソース領域40の表面側の一部を除き酸化珪素から成るゲート絶縁膜50が形成されている。さらに、ゲート絶縁膜50上で、炭化珪素ドリフト層20、ウェル領域30、ソース領域40に対向する位置にはゲート電極60が形成されている。また、ゲート絶縁膜50が形成されていないソース領域40の表面にはソース電極70が、また、炭化珪素基板10の第一の主面と反対側の第二の主面、すなわち、裏面側にはドレイン電極80がそれぞれ形成されている。本実施の形態の炭化珪素MOSFETは、構造がトレンチ構造であることの他は、実施の形態1と同様であるので詳細な説明は省略する。   A gate insulating film 50 made of silicon oxide is formed on the surface of the trench and the surface of the source region 40 except for a part on the surface side of the source region 40. Furthermore, a gate electrode 60 is formed on the gate insulating film 50 at a position facing the silicon carbide drift layer 20, the well region 30, and the source region 40. Further, source electrode 70 is formed on the surface of source region 40 where gate insulating film 50 is not formed, and on the second main surface opposite to the first main surface of silicon carbide substrate 10, that is, on the back surface side. Each has a drain electrode 80 formed thereon. Since the silicon carbide MOSFET of the present embodiment is the same as that of the first embodiment except that the structure is a trench structure, detailed description thereof is omitted.

本実施の形態のトレンチ構造の炭化珪素MOSFETにおいても、実施の形態1に示した炭化珪素MOSFETを製造する場合と同様、ゲート絶縁膜50形成後に酸化窒素系ガスと酸素との反応性が高く、かつ、反応後は酸化力の低い気体へと変化せしめるようなCOガスとの混合ガスを用いて窒化処理を行なうことにより、炭化珪素層とゲート絶縁膜50との界面に形成される界面準位が低減でき、この結果、チャネル移動度を高めることが可能となる。   Also in the silicon carbide MOSFET having the trench structure of the present embodiment, as in the case of manufacturing the silicon carbide MOSFET shown in the first embodiment, the reactivity between the nitrogen oxide-based gas and oxygen is high after the gate insulating film 50 is formed. In addition, after the reaction, an interface state formed at the interface between the silicon carbide layer and the gate insulating film 50 by performing a nitriding process using a mixed gas of CO gas that changes to a gas having a low oxidizing power. As a result, channel mobility can be increased.

また、炭化珪素IGBT(Insulated Gate Bipolar Transistor)においても、本実施の形態の場合と同じく、ゲート絶縁膜50形成後に、COガスと酸化窒素系ガスの混合ガスを用いて窒化処理を行なうことにより、同様の効果を奏する。   Also, in the case of silicon carbide IGBT (Insulated Gate Bipolar Transistor), as in the case of the present embodiment, after the gate insulating film 50 is formed, a nitriding treatment is performed using a mixed gas of CO gas and nitrogen oxide-based gas. The same effect is produced.

なお、上記実施の形態1〜3において、電子をキャリアとするnチャネルMOSFETの例を示したが、正孔をキャリアとするpチャネルMOSFETでも同様の効果を奏することは言うまでもない。   In the first to third embodiments, an example of an n-channel MOSFET using electrons as carriers has been described. Needless to say, a p-channel MOSFET using holes as carriers also has the same effect.

10 炭化珪素基板、20 ドリフト層、30 ウェル領域、40 ソース領域、50 ゲート絶縁膜、60 ゲート電極、70 ソース電極、80 ドレイン電極、200 炉、201 ボート、202 ヒーター、203 ガス導入口、204 ダミー基板、300 基板。   10 silicon carbide substrate, 20 drift layer, 30 well region, 40 source region, 50 gate insulating film, 60 gate electrode, 70 source electrode, 80 drain electrode, 200 furnace, 201 boat, 202 heater, 203 gas inlet, 204 dummy Substrate, 300 substrate.

Claims (8)

表面が炭化珪素層から成るウエハ上に絶縁膜を形成する工程と、
前記絶縁膜形成後のウエハを一酸化炭素ガスを混合した酸化窒素系ガス雰囲気中で熱処理することにより前記炭化珪素層と絶縁膜との界面を窒化する窒化処理工程と、
を備える炭化珪素半導体装置の製造方法。
Forming an insulating film on a wafer having a silicon carbide layer on the surface;
A nitriding treatment step of nitriding an interface between the silicon carbide layer and the insulating film by heat-treating the wafer after forming the insulating film in a nitrogen oxide-based gas atmosphere mixed with carbon monoxide gas;
A method for manufacturing a silicon carbide semiconductor device comprising:
前記酸化窒素系ガスは一酸化窒素ガスあるいは二酸化窒素ガスのいずれか一方あるいは両方であることを特徴とする請求項1記載の炭化珪素半導体装置の製造方法。 2. The method for manufacturing a silicon carbide semiconductor device according to claim 1, wherein the nitrogen oxide-based gas is one or both of nitrogen monoxide gas and nitrogen dioxide gas. 前記熱処理工程は、不活性ガスと酸化窒素系ガスと一酸化炭素ガスとの混合雰囲気でなされることを特徴とする請求項1記載の炭化珪素半導体装置の製造方法。 2. The method for manufacturing a silicon carbide semiconductor device according to claim 1, wherein the heat treatment step is performed in a mixed atmosphere of an inert gas, a nitrogen oxide-based gas, and a carbon monoxide gas. 前記熱処理工程は、前記ウエハを1100℃以上1300℃以下の処理温度で加熱することを特徴とする請求項1〜3のいずれか1項記載の炭化珪素半導体装置の製造方法。 The method for manufacturing a silicon carbide semiconductor device according to claim 1, wherein the heat treatment step heats the wafer at a processing temperature of 1100 ° C. or higher and 1300 ° C. or lower. 前記絶縁膜は、二酸化珪素膜であることを特徴とする請求項1〜4のいずれか1項記載の炭化珪素半導体装置の製造方法。 The method for manufacturing a silicon carbide semiconductor device according to claim 1, wherein the insulating film is a silicon dioxide film. 前記熱処理工程は、減圧雰囲気下で窒化することを特徴とする請求項1〜5のいずれか1項記載の炭化珪素半導体装置の製造方法。 The method for manufacturing a silicon carbide semiconductor device according to claim 1, wherein the heat treatment step includes nitriding in a reduced pressure atmosphere. 前記絶縁膜形成前のウエハを、一酸化炭素ガスが添加された酸化窒素系ガス雰囲気中で所定の処理温度で熱処理することにより前記炭化珪素層表面を窒化する窒化処理工程をさらに備える請求項1ないし5のいずれか1項記載の炭化珪素半導体装置の製造方法。 The nitriding treatment step of nitriding the surface of the silicon carbide layer by heat-treating the wafer before forming the insulating film at a predetermined treatment temperature in a nitrogen oxide gas atmosphere to which carbon monoxide gas is added. The manufacturing method of the silicon carbide semiconductor device of any one of thru | or 5. 酸化窒素系ガス流量に対する一酸化炭素ガス流量の体積比が1以下でかつ生成される酸素ガス流量の2倍以上であることを特徴とする請求項1ないし7のいずれか1項記載の炭化珪素半導体装置の製造方法。 8. The silicon carbide according to claim 1, wherein a volume ratio of the carbon monoxide gas flow rate to the nitrogen oxide gas flow rate is 1 or less and twice or more than a generated oxygen gas flow rate. A method for manufacturing a semiconductor device.
JP2010006950A 2010-01-15 2010-01-15 Method for manufacturing silicon carbide semiconductor device Active JP5126240B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2010006950A JP5126240B2 (en) 2010-01-15 2010-01-15 Method for manufacturing silicon carbide semiconductor device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2010006950A JP5126240B2 (en) 2010-01-15 2010-01-15 Method for manufacturing silicon carbide semiconductor device

Publications (2)

Publication Number Publication Date
JP2011146580A true JP2011146580A (en) 2011-07-28
JP5126240B2 JP5126240B2 (en) 2013-01-23

Family

ID=44461160

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2010006950A Active JP5126240B2 (en) 2010-01-15 2010-01-15 Method for manufacturing silicon carbide semiconductor device

Country Status (1)

Country Link
JP (1) JP5126240B2 (en)

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2013149842A (en) * 2012-01-20 2013-08-01 Mitsubishi Electric Corp Method of manufacturing silicon carbide semiconductor device
JP2019050294A (en) * 2017-09-11 2019-03-28 株式会社豊田中央研究所 Silicon carbide semiconductor device
JP2020027894A (en) * 2018-08-13 2020-02-20 富士電機株式会社 Insulated gate semiconductor device and manufacturing method thereof
JP2021048198A (en) * 2019-09-17 2021-03-25 株式会社東芝 Method of manufacturing semiconductor device
JP2021153167A (en) * 2020-03-19 2021-09-30 株式会社東芝 Semiconductor device, manufacturing method for semiconductor device, inverter circuit, driving device, vehicle, and elevator

Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001111046A (en) * 1999-10-08 2001-04-20 Toshiba Corp Semiconductor device and formation of insulating film
WO2003047000A1 (en) * 2001-11-30 2003-06-05 Matsushita Electric Industrial Co., Ltd. Semiconductor device and production method therefor
JP2005252284A (en) * 2001-03-12 2005-09-15 Renesas Technology Corp Method for manufacturing semiconductor integrated circuit device
JP2006156478A (en) * 2004-11-25 2006-06-15 Mitsubishi Electric Corp Silicon carbide semiconductor device and its manufacturing method
JP2006210818A (en) * 2005-01-31 2006-08-10 Matsushita Electric Ind Co Ltd Semiconductor element and its manufacturing method
JP2006216918A (en) * 2005-02-07 2006-08-17 Kyoto Univ Manufacturing method of semiconductor device

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001111046A (en) * 1999-10-08 2001-04-20 Toshiba Corp Semiconductor device and formation of insulating film
JP2005252284A (en) * 2001-03-12 2005-09-15 Renesas Technology Corp Method for manufacturing semiconductor integrated circuit device
WO2003047000A1 (en) * 2001-11-30 2003-06-05 Matsushita Electric Industrial Co., Ltd. Semiconductor device and production method therefor
JP2006156478A (en) * 2004-11-25 2006-06-15 Mitsubishi Electric Corp Silicon carbide semiconductor device and its manufacturing method
JP2006210818A (en) * 2005-01-31 2006-08-10 Matsushita Electric Ind Co Ltd Semiconductor element and its manufacturing method
JP2006216918A (en) * 2005-02-07 2006-08-17 Kyoto Univ Manufacturing method of semiconductor device

Cited By (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2013149842A (en) * 2012-01-20 2013-08-01 Mitsubishi Electric Corp Method of manufacturing silicon carbide semiconductor device
JP2019050294A (en) * 2017-09-11 2019-03-28 株式会社豊田中央研究所 Silicon carbide semiconductor device
JP2020027894A (en) * 2018-08-13 2020-02-20 富士電機株式会社 Insulated gate semiconductor device and manufacturing method thereof
JP7196458B2 (en) 2018-08-13 2022-12-27 富士電機株式会社 Method for manufacturing insulated gate semiconductor device
JP2021048198A (en) * 2019-09-17 2021-03-25 株式会社東芝 Method of manufacturing semiconductor device
JP7242488B2 (en) 2019-09-17 2023-03-20 株式会社東芝 Semiconductor device manufacturing method
JP2021153167A (en) * 2020-03-19 2021-09-30 株式会社東芝 Semiconductor device, manufacturing method for semiconductor device, inverter circuit, driving device, vehicle, and elevator
JP7346368B2 (en) 2020-03-19 2023-09-19 株式会社東芝 Semiconductor device, semiconductor device manufacturing method, inverter circuit, drive device, vehicle, and elevator
US11764270B2 (en) 2020-03-19 2023-09-19 Kabushiki Kaisha Toshiba Semiconductor device, method for manufacturing semiconductor device, inverter circuit, drive device, vehicle, and elevator

Also Published As

Publication number Publication date
JP5126240B2 (en) 2013-01-23

Similar Documents

Publication Publication Date Title
JP6332357B2 (en) Method for manufacturing silicon carbide semiconductor device
JP6222771B2 (en) Method for manufacturing silicon carbide semiconductor device
JP2016063111A (en) Semiconductor device and manufacturing method of the same
JP2011091186A (en) Method of fabricating silicon carbide semiconductor device
JP5126240B2 (en) Method for manufacturing silicon carbide semiconductor device
JP2006210818A (en) Semiconductor element and its manufacturing method
JP2011165941A (en) Semiconductor device and method of fabricating the same
JP2008117878A (en) Manufacturing method for semiconductor device
US6559068B2 (en) Method for improving inversion layer mobility in a silicon carbide metal-oxide semiconductor field-effect transistor
JP4549167B2 (en) Method for manufacturing silicon carbide semiconductor device
JP7047250B2 (en) Manufacturing method of silicon carbide semiconductor device
JP2009158788A (en) Vertical mosfet and manufacturing method of the vertical mosfet
WO2015015672A1 (en) Silicon carbide semiconductor device and method for manufacturing same
JP2010034481A (en) Method of manufacturing semiconductor device, and semiconductor device
JP2012038919A (en) Method for manufacturing silicon carbide semiconductor device
JP4867333B2 (en) Silicon carbide semiconductor device and method for manufacturing silicon carbide semiconductor device
JP5728153B2 (en) Manufacturing method of semiconductor device
JP5197474B2 (en) Method for manufacturing silicon carbide semiconductor device
JP2017055098A (en) Manufacturing method for semiconductor device and semiconductor manufacturing device for use therein
JP6162388B2 (en) Method for manufacturing silicon carbide semiconductor device
JP2013247141A (en) Method of manufacturing silicon carbide semiconductor device
JP4016928B2 (en) Method for manufacturing silicon carbide semiconductor device
JP5687220B2 (en) Method for manufacturing silicon carbide semiconductor device
CN105161526B (en) The method for improving vertical conductive structure SiC MOSFET channel mobilities
JP2015069989A (en) Method of manufacturing silicon carbide semiconductor device

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20111024

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20120412

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20120508

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20120621

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20121002

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20121015

R151 Written notification of patent or utility model registration

Ref document number: 5126240

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R151

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20151109

Year of fee payment: 3

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

S111 Request for change of ownership or part of ownership

Free format text: JAPANESE INTERMEDIATE CODE: R313113

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250