JP2011049731A5 - - Google Patents
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- チップ内電源に接続された第１の接続点と、第２の接続点との間に接続され、第１のスイッチ制御信号に応じてオンする第１のスイッチと、
前記第２の接続点とチップ内グランドとの間に接続され、寄生容量を有する回路部と、
前記第２の接続点と第３の接続点との間に接続され、第２のスイッチ制御信号に応じてオンする第２のスイッチと、
前記第３の接続点と前記チップ内グランドとの間に接続されたデカップリング容量と、
前記第１の接続点と前記第３の接続点との間に接続され、第３のスイッチ制御信号に応じてオンする第３のスイッチと、
前記回路部が動作状態になる動作期間において、前記第１、２のスイッチ制御信号を出力し、前記回路部が停止状態になる停止期間において、前記第３のスイッチ制御信号を出力し、前記回路部が前記停止状態から前記動作状態に移行する移行期間において、前記第２のスイッチ制御信号を出力するスイッチ制御回路と
を具備する半導体集積回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2009195221A JP5271850B2 (ja) | 2009-08-26 | 2009-08-26 | 半導体集積回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2009195221A JP5271850B2 (ja) | 2009-08-26 | 2009-08-26 | 半導体集積回路 |
Publications (3)
| Publication Number | Publication Date |
|---|---|
| JP2011049731A JP2011049731A (ja) | 2011-03-10 |
| JP2011049731A5 true JP2011049731A5 (ja) | 2012-03-29 |
| JP5271850B2 JP5271850B2 (ja) | 2013-08-21 |
Family
ID=43835642
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2009195221A Expired - Fee Related JP5271850B2 (ja) | 2009-08-26 | 2009-08-26 | 半導体集積回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP5271850B2 (ja) |
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-
2009
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