JP2010166108A5 - - Google Patents
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Claims (2)
- 入力信号を遅延させて出力する遅延回路であって、
前記遅延回路は、入力端子と、前記入力端子とインバータ回路を介して接続された第一内部遅延回路と、前記入力端子と接続された第二内部遅延回路と、前記第一内部遅延回路と前記第二内部遅延回路の出力信号を受けて遅延信号を出力する選択回路と、を備え、
前記第一内部遅延回路及び前記第二内部遅延回路は、入力段インバータ回路と、前記入力段インバータ回路と電源端子の間の設けられた第一電流源と、前記入力段インバータ回路の出力端子と接地端子の間の設けられた容量と、前記容量の電圧を受けて前記出力信号を出力する定電流インバータと、を備え、
前記選択回路は、セット端子が前記第一内部遅延回路の出力端子に接続され、リセット端子が前記第二内部遅延回路の出力端子に接続され、出力端子が前記遅延回路の出力端子に接続されたラッチ回路である、
ことを特徴とする遅延回路。 - 前記入力段インバータ回路と接地端子の間に第三電流源を備えた、
ことを特徴とする請求項１記載の遅延回路。
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