JP2009536362A - 光学有効集積回路パッケージ - Google Patents
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Abstract
【選択図】図8b
Description
1)光学サブアセンブリが光学的に予め整列され、ワイヤボンディングのような電気相互接続を介して簡単に所定位置に「嵌って」マイクロチップに接続することができるので、ICパッケージアセンブリ及びプリント基板(PCB)アセンブリに対する光学的アラインメント問題が排除され、
2)光学サブアセンブリは、ICパッケージ内のマイクロチップ用の標準電気的インターフェースと、外部光ファイバケーブル用の標準光学的インターフェースとを有し、
3)チップ設計者及びチップ製造業者は、これらのアーキテクチャ又は製作方法を変更する必要がなく、
4)光学的変換がマイクロチップから僅か数ミリメートルで起こるので、マイクロチップとの間の極めて高密度及び極めて高速のデータ転送速度を直接提供することができ、
5)パッケージとの間の典型的な高速銅トレースは、設計のためにマザーボード設計の簡略化及び光学送受信機のような余分な構成要素の排除を必ずしも必要とせず、
6)ICパッケージとの間のより高速の入力及び出力信号において電力消費率が低下する。
本開示のICパッケージを光学的に利用可能にするのに用いる光学サブアセンブリ(OSA)は、電気信号と光信号との間で変換することができるモジュールとして定められる。OSAは、ICパッケージ内に配置することができる光学的に整列されたモジュールである。OSAは、標準電気的インターフェース(ワイヤボンディング又はフリップチップ接続のための金パッドのような)及び標準光学的インターフェース(高精密成形及びアラインメントダウエルピンを組み込み、NTTによって当初開発された機械的伝送(MT)マルチファイバ光フェルールのような)を備える小型の低背型モジュールである。
マイクロチップ製造業者が利用可能な数多くの標準タイプのICパッケージが存在する。これらのパッケージは、特に、サイズ、許容損失、ピン数、及びピン当たりの最大データ転送速度が多岐にわたる。デュアルインライン・パッケージ(DIP)[図03参照]は、少ないピン数の低速パッケージの実施例であるのに対し、ピン・グリッド・アレイ(PGA)は、より多くのピン数での中速パッケージ[図04参照]の実施例である。典型的には、マイクロチップ製造業者は、サイズ及び性能に基づいてICパッケージを選択する。図5に示すように、ICパッケージのアセンブリは、エポキシ樹脂又は半田リフロー技術のいずれかを用いた、ICパッケージの中心区域内へのマイクロチップ[15]の配置及び取り付けを伴う。これは、1960年代にIBMによって最初に発明されたcontrolled collapse chip connect(C4)と呼ばれる工程においてワイヤボンディング[17]又は微小半田ボールリフローのいずれかにより外部に電気的に接続される。ICパッケージ内の一連の内部電気トレースライン[19]は、マイクロチップから外部の外部ピン又は接続部に通じており、「クアドフラットパック(QFP)」パッケージの実施例が図示されている[図05参照]。
光学有効キャビティダウンBGA ICパッケージ[図07a、07b、08a、08b及び9参照]の1つのバージョンは、以下の副部品からなる。
a.インターポーザ基板[21](マイクロチップと外部との間に信号をルーティングする)、
b.金属裏当て[23](又はヒートスプレッダプレート)
c.ユーザ定義マイクロチップ[47]
d.ワイヤボンディング[49]
e.グロブトップ封入エポキシ樹脂[25]
f.半田ボール[27](典型的には、規則的マトリックスアレイの両方向で1.27ミリメートルピッチの0.8ミリメートル直径)
g.1つ又はそれ以上の光学サブアセンブリ(OSA)[100]
光学有効キャビティアップ・フリップチップ(FC)BGA ICパッケージ(FC−BGA)[図10a、10b、11及び12参照]は、それがユーザ定義のマイクロチップ上のcontrolled−collapse chip connects(C4)の方法に依存するので、極めて高いピン配列密度及びピン数並びに高いデータ転送速度を可能にする。C4は、ユーザ定義のマイクロチップとインターポーザ基板との間の効果的な微小半田ボール取り付け方法である。
a.インターポーザ基板[51](マイクロチップと外部との間に信号をルーティングする)
b.微小半田ボール(アンダーフィルを備えた)を用いてcontrolled−collapse chip connected(C4)されたユーザ定義のマイクロチップ[61]
c.マイクロチップの上にハウジングを作成するための鋳型又は封入[55](同様に若干量のグロブトップ封入エポキシ樹脂を含むことができる)
d.半田ボール[53](典型的には、規則的マトリックスアレイの両方向で1.27ミリメートルピッチの0.8ミリメートル直径)
e.ワイヤボンディング又はフリップチップのいずれかを用いてインターポーザ基板に取り付ける1つ又はそれ以上の光学サブアセンブリ(OSA)[100]
45 クリップ
47 ユーザ定義マイクロチップ
100 光学サブアセンブリ(OSA)
Claims (23)
- 電気回路基板を光ファイバに接続するための光学有効集積回路パッケージであって、
a.ユーザ定義のマイクロチップと、
b.前記マイクロチップと前記電気回路基板との間に信号をルーティングするための電気接続部を含む基板と、
c.前記光ファイバと予め整列されたレーザを有する光学サブアセンブリ(OSA)と、
を備え、
前記OSAが、該OSAを前記マイクロチップに接続する標準電気的インターフェースと、前記光ファイバに接続するための標準光学的インターフェースとを更に含み、これによって前記OSAが、前記光ファイバに光学的に接続された前記レーザに前記マイクロチップを接続する、
ことを特徴とするパッケージ。 - 前記標準電気的インターフェースが、ワイヤボンディング又はフリップチップのための金パッドを含む、
請求項1に記載のパッケージ。 - 前記マイクロチップ及び基板を接続するワイヤボンディングを更に含む、
請求項2に記載のパッケージ。 - 前記標準光学的インターフェースが、高精密成形及びアラインメントダウエルピンを組み込む機械的伝送(MT)マルチファイバ光フェルールを含む、
請求項1に記載のパッケージ。 - 前記基板に固定され、且つ前記ユーザ定義のマイクロチップが配置された第1のゾーンと、前記OSAが配置された第2のゾーンとを有するハウジングを更に含む、
ことを特徴とする請求項1に記載のパッケージ。 - 前記マイクロチップ及び前記ワイヤボンディングを覆うグロブトップ封入エポキシ樹脂を更に含む、
請求項5に記載のパッケージ。 - 前記基板が更に、前記電気回路基板に接続するための半田ボールを更に含む、請求項1に記載のパッケージ。
- 電気回路基板を光ファイバに接続するための光学有効集積回路パッケージであって、
a.アンダーフィルを備えた微小半田ボールを用いてcontrolled collapse chip connect(C4)されたユーザ定義のマイクロチップと、
b.前記マイクロチップと前記電気回路基板との間に信号をルーティングするための電気接続部を含む基板と、
c.前記マイクロチップの上にハウジングを作成するための鋳造体又は封入体と、
d.前記光ファイバと予め整列されたレーザを有する光学サブアセンブリ(OSA)と、
を備え、
前記OSAが更に、該OSAを前記マイクロチップに接続する標準電気的インターフェースと、前記光ファイバに接続するための標準光学的インターフェースとを更に含み、これによって前記OSAが、前記光ファイバに光学的に接続された前記レーザに前記マイクロチップを接続する、
ことを特徴とするパッケージ。 - 光コネクタと混成光学有効集積回路パッケージの光学ポートとの間の接続を固定するための嵌合クリップであって、前記光コネクタが、光ケーブルを取り付ける光ケーブル端部と前記光ケーブル端部の反対側にあるコネクタ端部とを有し、前記嵌合クリップが、
a.前記光ケーブルの通過を許容する開口部を含む、前記光コネクタを実質的に覆うためのカバーと、
b.前記カバーから延びて前記光ケーブル端部に対して力を加えるためのS字形湾曲特徴部と、
c.前記光コネクタのコネクタ端部の方向に前記カバーから延びて、前記嵌合クリップ及び前記光コネクタによって形成されたアセンブリを前記光学ポートに固定するためのフック形特徴部と、
を備え、
嵌合クリップ/光コネクタアセンブリの固定において、前記フック形特徴部が、前記混成光学有効集積回路パッケージの内部のノッチと前記光学ポート上の突起部との少なくとも1つに相互作用する、
ことを特徴とする嵌合クリップ。 - 前記カバーから延びて、前記光学ポートへの固定において前記嵌合クリップを扱うための翼型特徴部を更に含む、
ことを特徴とする請求項10に記載の嵌合クリップ。 - 光コネクタと混成光学有効集積回路パッケージの光学ポートとの間の接続を固定するため嵌合クリップを用いる方法であって、
a.フック形特徴部が延びた嵌合クリップを準備する段階と、
b.前記嵌合クリップ内に前記光コネクタを挿入し、これによって嵌合クリップ/光コネクタアセンブリを形成する段階と、
c.前記フック形特徴部と前記混成光学有効集積回路パッケージの内部のノッチ及び前記光学ポート上の突起部の少なくとも1つとの間の相互作用を用いて、前記光学ポートに前記嵌合クリップ/光コネクタアセンブリを固定する段階と、
を含む方法。 - 光ファイバに電気回路基板を接続するためのパッケージを組み立てる方法であって、
ユーザ定義のマイクロチップと電気回路基板との間に信号をルーティングするための電気接続部を含む基板を準備する段階と、
前記光ファイバと予め整列されたレーザを有する光学サブアセンブリ(OSA)を準備する段階と、
を含み、
前記OSAが、該OSAを前記ユーザ定義のマイクロチップに接続する標準電気的インターフェースと、前記光ファイバに接続するための標準光学的インターフェースとを更に含み、
前記方法が更に、
前記マイクロチップを挿入するための第1のゾーンと前記OSAを挿入するための第2のゾーンとを含むボックスハウジングを準備する段階と、
前記基板の上部に前記ハウジングを取り付ける段階と、
前記標準電気的インターフェースが前記第1のゾーン内に突出し始めるまで前記第2のゾーンを通って横方向に前記OSAを摺動する段階と、
を含む方法。 - 前記取り付け段階が、前記基板に前記ハウジングを積層する段階を含む、
請求項12に記載の方法。 - 前記OSAの下面を前記ハウジングに接合する段階を更に含む、
請求項12に記載の方法。 - エポキシ樹脂を用いて前記第2のゾーンにおいて前記OSAの周りの空きスペースを充填する段階を更に含む、
請求項14に記載の方法。 - 導電性エポキシ樹脂を用いて前記第1のゾーンにおいて前記ユーザ定義のマイクロチップを固定する段階を更に含む、
請求項12に記載の方法。 - 前記ユーザ定義のマイクロチップを前記OSAの標準電気的インターフェースに、及び前記基板の電気接続にワイヤボンディングする段階を更に含む、
請求項16に記載の方法。 - 前記ユーザ定義のマイクロチップ及び前記ワイヤボンディングによって形成されたワイヤボンドをエポキシ樹脂で覆う段階を更に含む、
請求項17に記載の方法。 - 前記基板の電気回路基板上に半田ボールを配置する段階を更に含む、
請求項18に記載の方法。 - 前記パッケージをPCB上に取り付ける段階を更に含む、
請求項19に記載の方法。 - 光ファイバに電気回路基板を接続するためのパッケージを組み立てる方法であって、
ユーザ定義のマイクロチップと電気回路基板との間に信号をルーティングするための電気接続部を含み且つ半田パッドを含む基板を準備する段階と、
前記光ファイバと予め整列されたレーザを有する光学サブアセンブリ(OSA)を準備する段階と、
を含み、
前記OSAが、該OSAをユーザ定義のマイクロチップに接続する標準電気的インターフェースと、前記光ファイバに接続するための標準光学的インターフェースとを更に含み、
前記方法が更に、
前記標準電気的インターフェースを前記基板の電気接続部と整列させることによって前記基板上に前記OSAを接続する段階と、
微小半田ボールを用いて前記ユーザ定義のマイクロチップを前記半田パッドに接続する段階と、
前記ユーザ定義のマイクロチップ及び前記OSAをハウジングで封入する段階と、
を含む方法。 - 前記接続段階が、前記ユーザ定義のマイクロチップをエポキシ樹脂でアンダーフィルする段階を含む、
請求項21に記載の方法。 - 前記半田ボールで前記基板の下面を覆う段階を更に含む、
請求項12に記載の方法。
Applications Claiming Priority (4)
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US79774706P | 2006-05-05 | 2006-05-05 | |
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