JP2009284475A - 映像走査変換装置 - Google Patents
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Abstract
【解決手段】映像走査変換装置は、フィルム映像の第1フレームに基づくフィールドN1及びN2の組をエンコードした第1符号化単位と、第1フレームに基づくフィールドN3及び第1フレームとは異なる第2フレームに基づくフィールドM1の組をエンコードした第2符号化単位とを含む映像ストリームを処理する。装置は、映像ストリームを受け取って第1および第2符号化単位をデコードし、フィールドN1、N2、N3及びM1の各データを順次出力するデコード回路と、デコード回路が出力した2つのフィールドからフレームを生成する走査変換回路とを備えている。フィールドN3に対応するフレームを出力する場合、走査変換回路は、フィールドN3のデータを用いずに、フィールドN1及びN2を用いてフレームを生成する。
【選択図】図3
Description
図3は、本実施形態の映像走査変換装置101の構成を説明するためのブロック図である。映像走査変換装置101は、たとえば1つの半導体チップとして実現される。
実施形態1では、メモリ2はデコード回路1から送られてくる、デコードされたフィールドを順次格納し、最新の2枚のフィールドを保持するとした。
図8は本実施形態の映像走査変換装置103を説明するためのブロック図である。
図12は本実施形態の映像走査変換装置104を説明するためのブロック図である。
2、7 メモリ
3 3−2プルダウン変換検出回路
4 走査変換回路
5 システムコントローラ
6、8 メモリ制御回路
10 入力端子
Claims (10)
- エンコードされた映像ストリームをデコードし、走査方式を変換して出力する映像走査変換装置であって、
前記映像ストリームは、フィルム映像の第1フレームに基づくフィールドN1及びフィールドN2の組をエンコードした第1符号化単位と、前記第1フレームに基づくフィールドN3及び前記第1フレームとは異なる第2フレームに基づくフィールドM1の組をエンコードした第2符号化単位とを含んでおり、
前記映像ストリームを受け取って前記第1符号化単位および前記第2符号化単位をデコードし、前記フィールドN1、N2、N3及びM1の各データを順次出力するデコード回路と、
前記デコード回路から出力されたフィールドデータに対応して、前記デコード回路から出力された2つのフィールドデータからフレームを生成し、当該フレームを出力する走査変換回路と、
を備え、
前記走査変換回路は、
前記フィールドN3のデータに対応するフレームを出力する場合、前記フィールドN3のデータを用いずに、前記フィールドN1及びN2を用いてフレームを生成する、映像走査変換装置。 - 前記走査変換回路は、前記フィールドN1又はN2のデータに対応するフレームを出力する場合、前記フィールドN1およびN2のデータを用いてフレームを生成する、
請求項1に記載の映像走査変換装置。 - 前記フィールドN1及びN3は、トップフィールドであり、
前記フィールドN2及びM1は、ボトムフィールドである、請求項1に記載の映像走査変換装置。 - 前記デコード回路から出力されたフィールドのデータを、2フィールド分格納可能なメモリをさらに備え、
前記デコード回路に、前記第1符号化単位が入力され、前記第1符号化単位の後に第2符号化単位が入力された場合において、
前記デコード回路は、前記フィールドN3のデータを出力する際、前記メモリには、前記フィールドN1及びN2が保持されており、前記フィールドN3のデータを前記メモリに格納しないようにする、請求項1に記載の映像走査変換装置。 - 前記デコード回路からの複数のフィールドの出力に基づいて、前記映像ストリームが、前記第1フレームおよび第2フレームを含むプログレッシブ映像を3−2プルダウン変換した映像であることを検出する検出回路をさらに備え、
前記映像ストリームが、前記第1フレームおよび第2を含むプログレッシブ映像を3−2プルダウン変換した映像であることを前記検出回路が検出したとき、前記走査変換回路は前記フレームを生成する、請求項1に記載の映像走査変換装置。 - 前記フィールドN1の画質は、前記フィールドN3の画質よりも良い、請求項1に記載の映像走査変換装置。
- 前記メモリは、前記フィールドN1のデータを少なくとも2フィールド期間より長い期間保持する、請求項4に記載の映像走査変換装置。
- 前記デコード回路から出力されたフィールドのデータを、少なくとも2フィールド分格納可能な第1メモリと、
前記走査変換回路が生成した前記フレームのデータを格納可能な第2メモリと
をさらに備え、
前記走査変換回路は、前記フィールドN2のデータに対応するフレームを出力する場合、前記第1メモリは、前記フィールドN1およびN2のデータを保持しており、前記走査変換回路は、前記メモリに保持された前記フィールドN1のデータ、および、前記デコード回路から出力された前記フィールドN2のデータに基づいてフレームを生成し、当該生成した前記フレームのデータを前記第2メモリに格納し、
前記フィールドN3のデータに対応するフレームを出力する場合、フィールドのデータを用いてフレームを生成せずに、前記第2メモリに格納されたフレームのデータを出力する、請求項1に記載の映像走査変換装置。 - 前記映像ストリームは、24フレーム/秒のフィルム映像から3−2プルダウン変換された60フィールド/秒のインタレース映像であり、
前記走査変換回路は、60フレーム/秒のプログレッシブ映像のフレームを出力する、請求項1に記載の映像走査変換装置。 - 前記映像ストリームには、前記映像ストリームが、前記第1フレームおよび第2フレームを含むプログレッシブ映像を3−2プルダウン変換した映像であることを示す識別子が含まれており、
前記識別子に基づいて、前記映像ストリームが、前記第1フレームおよび第2を含むプログレッシブ映像を3−2プルダウン変換した映像であることを検出する検出回路をさらに備え、
前記映像ストリームが、前記第1フレームおよび第2フレームを含むプログレッシブ映像を3−2プルダウン変換した映像であることを前記検出回路が検出したとき、前記走査変換回路は前記フレームを生成する、請求項1に記載の映像走査変換装置。
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