JP2009098539A - 表示装置および画素回路 - Google Patents
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Abstract
【解決手段】発光素子OLEDの第1電極は、第1電源に接続され、そこに電流に応じて発光する。駆動トランジスタTDRのソース電極は、第2電源Vddに接続され、発光素子OLEDの第2電極にドレイン電流を供給する。データ保持容量Csは、第1電極が駆動トランジスタのゲート電極に接続される。第1スイッチSW1は、画素選択期間にオンしてデータ線のデータを前記データ保持容量Csに書込む。そして、データ保持容量Csの第2電極の電位を、画素選択期間の中の少なくとも一部の期間と画素非選択期間の中の少なくとも一部の期間とで変化させる。これによって、第2電源の配線抵抗RLにより生じる電源電圧の変動が補償される。
【選択図】図2A
Description
図4に具体例1の画素回路、およびそれに接続される制御線、電源線の構成を示す。
図5に具体例2の表示装置の全体構成図を示す。図6には、具体例2の画素部分及び関連する周辺部分を抜き出した回路図を示す。
r2on*r3on/r2off/r3off < 0.01
となるよう設計されることが好適である。ここで、スイッチSW2のオン抵抗とオフ抵抗の比(オン抵抗/オフ抵抗)をR2、スイッチSW3のオン抵抗とオフ抵抗の比(オン抵抗/オフ抵抗)をR3と表すと、上式は、R2*R3<0.01と表される。
図7に具体例3の画素回路、制御線、電源線構成、および駆動タイミング波形を示す。具体例3の全体構成は図5と同様である。具体例2で基準電位線10を基準電圧Vrefに接続していたスイッチSW3が取り除かれ、ダイレクトに基準電位線10を基準電位Vrefに接続している。そして、この基準電位線10は、抵抗RLRを介し基準電源Vrefに接続されている。従って、スイッチSW2がオンの時に、電源Vddと、基準電源Vrefが抵抗RLRとスイッチSW2のオン抵抗を介し接続される。
r2on < RLR*M/10
となるよう設定されることが好適である。また、r2on<RLR*M/40となるように設定されることがさらに好適である。このように設定することで、スイッチSW2がオンの際にデータ保持容量Csの基準電極の電位を電源電圧Vddに応じた電圧と、基準電位Vrefに切り換えて設定することができる。ここで、Mは水平方向の画素数である。具体例3の場合、水平方向の全画素におけるスイッチSW2がオンして、電源Vddに接続されるため、画素数が多いほど、電源Vddまでの抵抗が実質的に小さくなる。基準電位線10を垂直方向に配置した場合には、垂直方向の画素数をMに採用すればよく、またいずれか小さい方の画素数を採用してもよい。
Claims (12)
- 複数のデータ線および複数の走査線の交点に対応して、複数の画素をマトリクス状に配置する表示装置において、
各画素が、
第1電極が第1電源に接続され、流れる電流に応じて発光する発光素子と、
ソース電極が第2電源に接続され、前記発光素子の第2電極にドレイン電流を供給する駆動トランジスタと、
第1電極が駆動トランジスタのゲート電極に接続されたデータ保持容量と、
画素選択期間にオンしてデータ線のデータを前記データ保持容量に書込む第1スイッチと、
を含み、
前記データ保持容量の第2電極の電位を、画素選択期間の中の少なくとも一部の期間と画素非選択期間の中の少なくとも一部の期間とで変化させることを特徴とする表示装置。 - 請求項1に記載の表示装置において、
前記第2電源と前記データ保持容量の第2電極との接続を制御する第2スイッチをさらに有するとともに、前記データ保持容量の第2電極と前記第2電源とは異なる基準電源とを抵抗を介し接続することを特徴とする表示装置。 - 請求項2に記載の表示装置において、
前記データ保持容量と前記基準電源との間の抵抗をRLR、前記第2スイッチのオン抵抗をRon、表示装置の水平方向または垂直方向の画素数のうち少ない方の画素数をMとするときに、Ron<RL*M/40を満たすことを特徴とする表示装置。 - 請求項1に記載の表示装置において、
さらに、
前記データ保持容量の第2電極と、前記第2電源との接続を制御する第2スイッチと、
前記データ保持容量の第2電極と、第2電源とは異なる基準電源との接続を制御する第3スイッチと、
を有することを特徴とする表示装置。 - 請求項4に記載の表示装置において、
前記第2スイッチのオン抵抗とオフ抵抗の比であるオン抵抗/オフ抵抗をR2、第3スイッチのオン抵抗とオフ抵抗の比であるオン抵抗/オフ抵抗をR3とするとき、R2*R3<0.01を満たすことを特徴とする表示装置。 - 請求項4に記載の表示装置において、
前記第2スイッチおよび前記第3スイッチが、画素領域内に設けられた薄膜トランジスタであることを特徴とする表示装置。 - 請求項4に記載の表示装置において、
前記第2スイッチが画素領域内に設けられた薄膜トランジスタであり、前記第3スイッチが、画素領域の外に設けられたトランジスタであることを特徴とする表示装置。 - 請求項1に記載の表示装置において、
前記データ保持容量の第2電極と前記基準電源を接続する基準電位線が、前記第2電源線と直交することを特徴とする表示装置。 - 請求項1記載の表示装置において、
前記データ保持容量の第2電極と前記基準電源を接続する基準電位線が、前記走査線の走査方向と直交することを特徴とする表示装置。 - 請求項1記載の表示装置において、
前記データ保持容量が、前記駆動トランジスタのゲートノードに生じる、前記データ保持容量を除いた容量である寄生容量よりも大きいことを特徴とする表示装置。 - 請求項1に記載の表示装置において、
前記データ保持容量の第2電極の電位を、画素選択期間の中の少なくとも一部の期間と画素非選択期間の中の少なくとも一部の期間とで変化させることで、電源電圧の変動による書込み電圧への影響が補償されることを特徴とする表示装置。 - 複数の画素をマトリクス状に配置した表示装置における画素回路であって、
第1電極が第1電源に接続され、素子を流れる電流に応じて発光する発光素子と、
ソース電極が第2電源に接続され、前記発光素子の第2電極にドレイン電流を供給する駆動トランジスタと、
第1電極が駆動トランジスタのゲート電極に接続されたデータ保持容量と、
画素選択期間にオンしてデータ線のデータを前記データ保持容量に書込む第1スイッチと、
を含み、
前記データ保持容量の第2電極の電位を、画素選択期間の中の少なくとも一部の期間と画素非選択期間の中の少なくとも一部の期間とで変化させることを特徴とする画素回路。
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