JP2009089196A - 固体撮像装置及び撮像信号出力回路 - Google Patents
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Abstract
【解決手段】固体撮像素子で撮像して得た画素信号を、出力クロックに同期してnビットで出力させる場合と、nの整数倍のビット数で出力させる場合とを選択できる構成とする。そのために、クロック変換部26と、振り分け部32と、第1のセレクタ31と、第2のセレクタ27と、出力モードの制御部とを備える。振り分け部32は、クロック変換部26で変換されたクロックに同期して、固体撮像素子で撮像して得た画素信号のそれぞれのビットデータを、少なくとも2系統のビットデータに交互に振り分ける。第1のセレクタ31は、振り分け部32で振り分けられたビットデータと、振り分けられていないビットデータとの出力を選択する。第2のセレクタ27は、クロック変換部26で変換された周波数のクロックと、変換されていない周波数のクロックとの出力を選択する。
【選択図】図2
Description
このため、例えば1画素の画素信号を出力させるビット数を増やすようにして、転送レートを低くすることが行われている。
例えば、1画素が8ビットで構成される場合に、その8ビットの画素データを出力させるために8個の端子を設けて、その8個の端子から8ビットの画素データを並列に出力する構成として、画素クロックの1周期(又は半周期)で、1画素の画素データを出力する構成が一般的である。
構成要素として、クロック変換部と、振り分け部と、第1のセレクタと、第2のセレクタと、出力モードの制御部とを備える。
クロック変換部は、クロックを少なくとも1/2倍の周波数のクロックとする。
振り分け部は、クロック変換部で変換されたクロックに同期して、固体撮像素子で撮像して得た画素信号のそれぞれのビットデータを、少なくとも2系統のビットデータに交互に振り分ける。
第1のセレクタは、振り分け部で振り分けられたビットデータと、振り分けられていないビットデータとの出力を選択する。
第2のセレクタは、クロック変換部で変換された周波数のクロックと、変換されていない周波数のクロックとの出力を選択する。
出力モードの制御部は、第1及び第2のセレクタでの出力を指定する。
この場合、構成として、画素信号を振り分ける振り分け部と、転送レートに対応したクロックを用意するクロック変換部とを用意して、それぞれの出力を選択する構成で対応でき、簡単な構成で実現できる効果を有する。
本実施の形態においては、COMSイメージセンサをイメージセンサ(固体撮像素子)として使用した固体撮像装置に適用したものである。本実施の形態の固体撮像装置は、例えばビデオカメラ、デジタルスチルカメラなどの各種撮像装置に内蔵されて使用される。
本例の場合には、1画素の画素信号を、アナログ/デジタル変換器14で12ビットのデジタル画素信号に変換する構成としてあり、その12ビットの画素信号を1単位として、出力部20から並列出力させる構成としてある。出力部20から出力させる際には、1画素ごとの出力タイミングに同期した画素クロックを、同時に出力させる構成としてあり、イメージセンサ10内で、その画素クロックを生成させる構成としてある。
1DDR出力モードは、1画素12ビットの画素信号を、画素クロックの半周期ごとに、12個の出力ポートからそれぞれ1ビットずつ出力させる出力フォーマットのモードであり、後述説明する図3の出力状態に相当する。
1SDR出力モードは、1画素12ビットの画素信号を、画素クロックの1周期ごとに、12個の出力ポートからそれぞれ1ビットずつ出力させる出力フォーマットのモードであり、後述説明する図4の出力状態に相当する。
2SDR出力モードは、1画素12ビットの画素信号を、24個の出力ポートに振り分けて、元の画素クロックの1/2周期ごとに1ビットずつ出力させる出力フォーマットのモードであり、後述説明する図5の出力状態に相当する。
図2において、入力端子21−0〜21−n(nはビット数に対応した整数)は、イメージセンサ10内の信号処理部14(図1)から画素信号が供給される端子である。上述したように、この例では1画素の画素信号が12ビットで構成されるので、nは11であり、12個の入力端子21−0〜21−11を備えることになる。それぞれの入力端子21−0〜21−nに1画素の画素信号の1つのビット位置の信号が順に供給される。
データ選択部30−0の構成を説明すると、入力端子21−0に得られる画素信号を、セレクタ31と2SDR変換回路32に供給する。2SDR変換回路32は、供給される画素信号を、1ビットずつ順に2系統のビットデータ2SDR DT0,2SDR DT1に交互に振り分ける振り分け部として機能させて、2SDR出力フォーマットの信号に変換する変換回路である。変換回路32での変換動作の具体的な例は、タイミング図(図5)の説明時に後述する。
セレクタ31は、2つの出力ポート22a−0,22b−0を備えている。その2つの出力ポート22a−0,22b−0が、それぞれイメージセンサ(固体撮像装置)10が備える出力ポートである。図2では、各データ選択部30−0〜30−nの第1の系統の出力ポートを、出力ポート22a−0,22a−1,・・・,22a−nとして示し、各データ選択部30−0〜30−nの第2の系統の出力ポートを、出力ポート22b−0,22b−1,・・・,22b−nとして示す。
このため、イメージセンサ10内の画素クロック生成部(図示せず)から画素クロックが供給されるクロック入力端子24を備え、その画素クロックを分周器26に供給して、1/2の周波数のクロックに変換する構成としてある。分周器26での分周動作は、入力端子23に得られる出力モード指定信号を、モード判別部25で判別した結果に基づいて行う。即ち、1/2の周波数のクロックが必要な出力モードであるとモード判別部25で判別した場合にだけ、分周器26を作動させる。或いは、分周器26を常時作動させてもよい。
まず、図3を参照して、1DDR出力モードで出力させる例について説明する。この1DDR出力モードは、1画素12ビットの画素信号を、画素クロックの半周期ごとに、12個の出力ポートからそれぞれ1ビットずつ出力させる出力フォーマットのモードである。
そして、この画素信号に同期して、図3(b)に示すように、入力端子24に示す画素クロックが供給される。この図3(b)に示す画素クロックは、1画素あたり1周期のクロックである。
そして、出力ポート28から出力させる画素クロックについては、図3(d)に示すように、分周器26で1/2の周波数とされたクロックを出力させるように、セレクタ27で選択させる。図3(c)及び(d)に示すように、この例ではクロックの立ち上がり及び立ち下がりに連動して、画素データが変化している。
そして、この画素信号に同期して、図4(b)に示すように、入力端子24に示す画素クロックが供給される。この図4(b)に示す画素クロックは、1画素あたり1周期のクロックである。
そして、出力ポート28から出力させる画素クロックについては、図4(d)に示すように、出力部20に入力した画素クロックを、そのままの周波数で出力させるように、セレクタ27で選択させる。図4(c)及び(d)に示すように、この例ではクロックの立ち下がりに連動して、画素データが変化している。
この画素信号に同期して、図5(a)に示すように、入力端子24に示す画素クロックが供給される。この図5(a)に示す画素クロックは、1画素あたり1周期のクロックであり、分周器26で、図5(b)に示すように、1/2の周波数のクロックが生成される。
この図5(g)及び(h)に示す第1の系統の画素データ2SDR DT0と第2の系統の画素データ2SDR DT1とを、図5(h)に示す画素クロック(図5(b)のクロックと同じ)と同期させて出力させるように、セレクタ31,27で選択処理を行う。
また、本実施の形態の構成の場合には、2SDR出力モード用に各ビットの画素信号を振り分ける回路と、クロックの変換回路と、それぞれを選択するセレクタとを設けるだけの比較的簡単な構成で実現でき、本実施の形態のようにマルチ出力モード対応とすることが、イメージセンサとしてそれほど回路構成を複雑化することにはならず、簡単な構成で実現できる。
本実施の形態の例においては、1DDR出力モードと、1SDR出力モードと、2SDR出力モードの他に、4SDR出力モードを選択できる構成としたものである。
本実施の形態においても、COMSイメージセンサをイメージセンサ(固体撮像素子)として使用した固体撮像装置に適用したものであり、イメージセンサの全体構成は、先に説明した第1の実施の形態で説明した図1の構成と同じであり、その出力部20の構成を図6に示した構成とする。
データ選択部130−0の構成を説明すると、入力端子121−0に得られる画素信号を、セレクタ131と2SDR変換回路132と4SDR変換回路133に供給する。2SDR変換回路132は、供給される画素信号を、1ビットずつ順に2系統のビットデータ2SDR DT0,2SDR DT1に交互に振り分ける振り分け部として機能させて、2SDR出力フォーマットの信号に変換する変換回路である。
4SDR変換回路133は、供給される画素信号を、1ビットずつ順に4系統のビットデータ4SDR DT0,4SDR DT1,4SDR DT2,4SDR DT3に交互に振り分ける振り分け部として機能させて、4SDR出力フォーマットの信号に変換する変換回路である。
セレクタ131は、4つの出力ポート122a−0,122b−0,122c−0,122d−0を備えている。その4つの出力ポート122a−0,122b−0,122c−0,122d−0が、それぞれイメージセンサ(固体撮像装置)10が備える出力ポートである。図6では、各データ選択部30−0〜30−nの第1の系統の出力ポートを、出力ポート122a−0,122a−1,・・・,22a−nとして示す。また、各データ選択部130−0〜130−nの第2の系統の出力ポートを、出力ポート122b−0,122b−1,・・・,122b−nとして示す。また、各データ選択部130−0〜130−nの第3の系統の出力ポートを、出力ポート122c−0,122c−1,・・・,122b−cとして示す。さらに、各データ選択部130−0〜130−nの第4の系統の出力ポートを、出力ポート122d−0,122d−1,・・・,122d−nとして示す。
このため、イメージセンサ10内の画素クロック生成部(図示せず)から画素クロックが供給されるクロック入力端子124を備え、その画素クロックを分周器126に供給して、1/2の周波数のクロックに変換する構成としてある。分周器126での分周動作は、入力端子123に得られる出力モード指定信号を、モード判別部125で判別した結果に基づいて行う。即ち、1/2又は1/4の周波数のクロックが必要な出力モードであるとモード判別部25で判別した場合にだけ、分周器126を作動させる。或いは、分周器126を常時作動させてもよい。
1DDR出力モードと、1SDR出力モードと、2SDR出力モードの出力状態については、既に第1の実施の形態で、図3〜図5で説明したものと同じ出力状態であり、ここでは省略する。
そして、4SDR出力モードを選択した際には、図7に示す状態で出力される。
この画素信号に同期して、図7(a)に示すように、入力端子124に示す画素クロックが供給される。この図7(a)に示す画素クロックは、1画素あたり1周期のクロックであり、分周器126で、図7(b)に示すように、1/2の周波数のクロックが生成され、さらに、図7(c)に示すように、1/4の周波数のクロックが生成される。
この図7(i)〜(l)に示す各系統の画素データを、図7(m)に示す画素クロック(図7(c)の1/4の周波数のクロックと同じ)と同期させて出力させるように、セレクタ131,127で選択処理を行う。
なお、図示はしないが、この第2の実施の形態の構成の原理を適用して、さらに1/8の周波数のクロックに同期させて、8つの系統の出力ポートに振り分けるなど、より転送レートを低下させることも可能である。
この図8の構成によると、共用化した分だけデータ変換回路の構成を簡単にすることができる。
Claims (4)
- 固体撮像素子で撮像して得た画素信号を、出力クロックに同期してnビット(nは整数)又はnの整数倍のビット数で出力させる固体撮像装置であって、
クロックを少なくとも1/2倍の周波数のクロックとするクロック変換部と、
前記クロック変換部で変換されたクロックに同期して、前記固体撮像素子で撮像して得た画素信号のそれぞれのビットデータを、少なくとも2系統のビットデータに交互に振り分ける振り分け部と、
前記振り分け部で振り分けられたビットデータと、振り分けられていないビットデータとの出力を選択する第1のセレクタと、
前記クロック変換部で変換された周波数のクロックと、変換されていない周波数のクロックとの出力を選択する第2のセレクタと、
前記第1及び第2のセレクタでの出力を指定する出力モードの制御部とを備えることを特徴とする
固体撮像装置。 - 請求項1記載の固体撮像装置において、
前記制御部が指定する出力モードとして、
前記第1のセレクタで、振り分けられていないビットデータの出力を選択し、
前記クロック変換部で変換された1/2倍の周波数のクロックを前記第2のセレクタで選択する出力モードを用意したことを特徴とする
固体撮像装置。 - 請求項2記載の固体撮像装置において、
前記クロック変換部は、さらに1/4倍の周波数のクロックへの変換を行い、
前記振り分け部は、さらに4系統のビットデータに交互に振り分けることを行い、
前記第1のセレクタとして、1系統のビットデータと、2系統に振り分けられたビットデータと、4系統に振り分けられたビットデータとの出力を選択し、
前記第2のセレクタとして、変換されていない周波数のクロックと、1/2倍の周波数のクロックと、1/4倍の周波数のクロックとの出力を選択することを特徴とする
固体撮像装置。 - 固体撮像素子で撮像して得た画素信号を、出力クロックに同期してnビット(nは整数)又はnの整数倍のビット数で出力させる撮像信号出力回路であって、
クロックを少なくとも1/2倍の周波数のクロックとするクロック変換部と、
前記クロック変換部で変換されたクロックに同期して、前記固体撮像素子で撮像して得た画素信号のそれぞれのビットデータを、少なくとも2系統のビットデータに交互に振り分ける振り分け部と、
前記振り分け部で振り分けられたビットデータと、振り分けられていないビットデータとの出力を選択する第1のセレクタと、
前記クロック変換部で変換された周波数のクロックと、変換されていない周波数のクロックとの出力を選択する第2のセレクタと、
前記第1及び第2のセレクタでの出力を指定する出力モードの制御部とを備えることを特徴とする
撮像信号出力回路。
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