JP2008134625A5 - - Google Patents
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Claims (26)
前記トランジスタのソース電極及びドレイン電極の一方は発光素子の画素電極と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第2のスイッチを介して第1の配線と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第3のスイッチを介して前記トランジスタのゲート電極と電気的に接続され、
前記トランジスタのゲート電極は、前記保持容量及び前記第4のスイッチを介して第2の配線に電気的に接続され、
前記トランジスタのゲート電極は、前記保持容量及び前記第1のスイッチを介して第3の配線に電気的に接続されていることを特徴とする半導体装置(ただし前記発光素子と並列接続されたトランジスタを有する半導体装置を除く)。 A transistor, a storage capacitor, a first switch, a second switch, a third switch, and a fourth switch;
One of the source electrode and the drain electrode of the transistor is electrically connected to the pixel electrode of the light emitting element ,
The other of the source electrode and the drain electrode of the transistor is electrically connected to the first wiring through the second switch,
The other of the source electrode and the drain electrode of the transistor is electrically connected to the gate electrode of the transistor through the third switch,
A gate electrode of the transistor is electrically connected to a second wiring through the storage capacitor and the fourth switch;
A gate electrode of the transistor is electrically connected to a third wiring through the storage capacitor and the first switch. However , the semiconductor device is characterized in that a transistor connected in parallel with the light emitting element is provided. Excluding semiconductor devices) .
前記トランジスタのソース電極及びドレイン電極の一方は発光素子の画素電極と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の一方は前記第2の保持容量を介して前記トランジスタのゲート電極と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第2のスイッチを介して第1の配線と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第3のスイッチを介して前記トランジスタのゲート電極と電気的に接続され、
前記トランジスタのゲート電極は、前記第1の保持容量及び前記第4のスイッチを介して第2の配線と電気的に接続され、
前記トランジスタのゲート電極は、前記第1の保持容量及び前記第1のスイッチを介して第3の配線と電気的に接続されていることを特徴とする半導体装置(ただし前記発光素子と並列接続されたトランジスタを有する半導体装置を除く)。 A transistor, a first storage capacitor, a second storage capacitor, a first switch, a second switch, a third switch, and a fourth switch;
One of the source electrode and the drain electrode of the transistor is electrically connected to the pixel electrode of the light emitting element ,
One of the source electrode and the drain electrode of the transistor is electrically connected to the gate electrode of the transistor through the second storage capacitor,
The other of the source electrode and the drain electrode of the transistor is electrically connected to the first wiring through the second switch,
The other of the source electrode and the drain electrode of the transistor is electrically connected to the gate electrode of the transistor through the third switch,
A gate electrode of the transistor is electrically connected to a second wiring through the first storage capacitor and the fourth switch;
A gate electrode of the transistor is electrically connected to a third wiring through the first storage capacitor and the first switch (provided that the transistor is connected in parallel with the light emitting element) Except for semiconductor devices having a transistor) .
前記トランジスタのソース電極及びドレイン電極の一方は発光素子の画素電極と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の一方は前記第2の保持容量を介して前記トランジスタのゲート電極と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の一方は第5のスイッチを介して第4の配線と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第2のスイッチを介して第1の配線と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第3のスイッチを介して前記トランジスタのゲート電極と電気的に接続され、
前記トランジスタのゲート電極は、前記第1の保持容量及び前記第4のスイッチを介して第2の配線に電気的に接続され、
前記トランジスタのゲート電極は、前記第1の保持容量及び前記第1のスイッチを介して第3の配線に電気的に接続されていることを特徴とする半導体装置(ただし前記発光素子と並列接続されたトランジスタを有する半導体装置を除く)。 A transistor, a first storage capacitor, a second storage capacitor, a first switch, a second switch, a third switch, a fourth switch, and a fifth switch;
One of the source electrode and the drain electrode of the transistor is electrically connected to the pixel electrode of the light emitting element ,
One of the source electrode and the drain electrode of the transistor is electrically connected to the gate electrode of the transistor through the second storage capacitor,
One of a source electrode and a drain electrode of the transistor is electrically connected to a fourth wiring through a fifth switch;
The other of the source electrode and the drain electrode of the transistor is electrically connected to the first wiring through the second switch,
The other of the source electrode and the drain electrode of the transistor is electrically connected to the gate electrode of the transistor through the third switch,
A gate electrode of the transistor is electrically connected to a second wiring through the first storage capacitor and the fourth switch;
A gate electrode of the transistor is electrically connected to a third wiring through the first storage capacitor and the first switch (provided that the transistor is connected in parallel with the light emitting element). Except for semiconductor devices having a transistor) .
前記第2の配線は前記第1のスイッチを制御する配線と同一であることを特徴とする半導体装置。 In any one of Claims 1 thru | or 3,
The semiconductor device according to claim 1, wherein the second wiring is the same as the wiring for controlling the first switch.
前記第2の配線は前行もしくは次行の第1のスイッチ乃至第4のスイッチを制御する走査線のいずれかであることを特徴とする半導体装置。 In any one of Claims 1 thru | or 3,
2. The semiconductor device according to claim 1, wherein the second wiring is any one of scanning lines for controlling the first switch to the fourth switch of the previous row or the next row.
前記トランジスタのソース電極及びドレイン電極の一方は発光素子の画素電極と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の一方は前記第2の保持容量を介して前記トランジスタのゲート電極と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第2のスイッチを介して第1の配線と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第3のスイッチを介して前記トランジスタのゲート電極と電気的に接続され、
前記トランジスタのゲート電極は、前記第1の保持容量及び前記第4のスイッチを介して前記第1の配線と電気的に接続され、
前記トランジスタのゲート電極は、前記第1の保持容量及び前記第1のスイッチを介して第3の配線と電気的に接続されていることを特徴とする半導体装置(ただし前記発光素子と並列接続されたトランジスタを有する半導体装置を除く)。 A transistor, a first storage capacitor, a second storage capacitor, a first switch, a second switch, a third switch, and a fourth switch;
One of the source electrode and the drain electrode of the transistor is electrically connected to the pixel electrode of the light emitting element ,
One of the source electrode and the drain electrode of the transistor is electrically connected to the gate electrode of the transistor through the second storage capacitor,
The other of the source electrode and the drain electrode of the transistor is electrically connected to the first wiring through the second switch,
The other of the source electrode and the drain electrode of the transistor is electrically connected to the gate electrode of the transistor through the third switch,
A gate electrode of the transistor is electrically connected to the first wiring through the first storage capacitor and the fourth switch;
A gate electrode of the transistor is electrically connected to a third wiring through the first storage capacitor and the first switch (provided that the transistor is connected in parallel with the light emitting element) Except for semiconductor devices having a transistor) .
前記トランジスタのソース電極及びドレイン電極の一方は発光素子の画素電極と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の一方は前記第2の保持容量を介して前記トランジスタのゲート電極と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第2のスイッチを介して第1の配線と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第3のスイッチを介して前記トランジスタのゲート電極と電気的に接続され、
前記トランジスタのゲート電極は、前記第1の保持容量及び前記整流素子を介して第2の配線に電気的に接続され、
前記トランジスタのゲート電極は、前記第1の保持容量及び前記第1のスイッチを介して第3の配線に電気的に接続されていることを特徴とする半導体装置(ただし前記発光素子と並列接続されたトランジスタを有する半導体装置を除く)。 A transistor, a first storage capacitor, a second storage capacitor, a first switch, a second switch, a third switch, and a rectifying element;
One of the source electrode and the drain electrode of the transistor is electrically connected to the pixel electrode of the light emitting element ,
One of the source electrode and the drain electrode of the transistor is electrically connected to the gate electrode of the transistor through the second storage capacitor,
The other of the source electrode and the drain electrode of the transistor is electrically connected to the first wiring through the second switch,
The other of the source electrode and the drain electrode of the transistor is electrically connected to the gate electrode of the transistor through the third switch,
A gate electrode of the transistor is electrically connected to a second wiring through the first storage capacitor and the rectifier;
A gate electrode of the transistor is electrically connected to a third wiring through the first storage capacitor and the first switch (provided that the transistor is connected in parallel with the light emitting element). Except for semiconductor devices having a transistor) .
前記トランジスタのソース電極及びドレイン電極の一方は発光素子の画素電極と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の一方は前記第2の保持容量を介して前記トランジスタのゲート電極と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第2のスイッチを介して第1の配線と電気的に接続され、
前記トランジスタのソース電極及びドレイン電極の他方は前記第3のスイッチを介して前記トランジスタのゲート電極と電気的に接続され、
前記トランジスタのゲート電極は、前記第1の保持容量及び前記第1のスイッチを介して第3の配線に電気的に接続され、
前記第4のスイッチは前記第1の保持容量と並列に電気的に接続され、なおかつ前記第1のスイッチを介して前記第3の配線に電気的に接続されていることを特徴とする半導体装置(ただし前記発光素子と並列接続されたトランジスタを有する半導体装置を除く)。 A transistor, a first storage capacitor, a second storage capacitor, a first switch, a second switch, a third switch, and a fourth switch;
One of the source electrode and the drain electrode of the transistor is electrically connected to the pixel electrode of the light emitting element ,
One of the source electrode and the drain electrode of the transistor is electrically connected to the gate electrode of the transistor through the second storage capacitor,
The other of the source electrode and the drain electrode of the transistor is electrically connected to the first wiring through the second switch,
The other of the source electrode and the drain electrode of the transistor is electrically connected to the gate electrode of the transistor through the third switch,
A gate electrode of the transistor is electrically connected to a third wiring through the first storage capacitor and the first switch;
The semiconductor device is characterized in that the fourth switch is electrically connected in parallel with the first storage capacitor and is electrically connected to the third wiring via the first switch. (However, a semiconductor device having a transistor connected in parallel with the light emitting element is excluded) .
前記トランジスタは、薄膜トランジスタであることを特徴とする半導体装置。 In any one of Claims 1 thru | or 8,
The semiconductor device is a thin film transistor.
前記トランジスタは、Nチャネル型トランジスタであることを特徴とする半導体装置。 In any one of Claims 1 thru | or 9,
The semiconductor device is an N-channel transistor.
前記トランジスタの半導体層は、非晶質半導体膜からなることを特徴する半導体装置。 In any one of Claims 1 to 10,
A semiconductor device, wherein the semiconductor layer of the transistor is made of an amorphous semiconductor film.
前記トランジスタの半導体層は、アモルファスシリコンからなることを特徴する半導体装置。 In any one of Claims 1 to 11,
A semiconductor device, wherein the semiconductor layer of the transistor is made of amorphous silicon.
前記トランジスタの半導体層は、結晶性半導体膜からなることを特徴する半導体装置。 In any one of Claims 1 thru | or 9,
A semiconductor device, wherein the semiconductor layer of the transistor is made of a crystalline semiconductor film.
前記第1の配線の電位は、前記画素電極の電位に前記トランジスタのしきい値電圧を加算した値より高いことを特徴する半導体装置。 In any one of Claims 1 thru / or Claim 13,
The semiconductor device is characterized in that the potential of the first wiring is higher than a value obtained by adding the threshold voltage of the transistor to the potential of the pixel electrode.
前記トランジスタは、Pチャネル型トランジスタであることを特徴とする半導体装置。 In any one of Claims 1 thru | or 9,
The semiconductor device is a P-channel transistor.
前記第1の配線の電位は、前記画素電極の電位から前記トランジスタのしきい値電圧を減算した値より低いことを特徴する半導体装置。 In any one of Claim 1 thru | or Claim 9, and Claim 15,
The semiconductor device according to claim 1, wherein the potential of the first wiring is lower than a value obtained by subtracting a threshold voltage of the transistor from the potential of the pixel electrode.
前記第1のスイッチ乃至第4のスイッチはトランジスタであることを特徴とする半導体装置。 In any one of Claims 1 thru | or 16,
The semiconductor device, wherein the first to fourth switches are transistors.
ソース電極及びドレイン電極の一方が負荷に電気的に接続され、ソース電極及びドレイン電極の他方が第1の配線に電気的に接続され、ゲート電極が前記第1の保持容量を介して第2の配線と電気的に接続されるトランジスタと、
前記トランジスタのゲートソース間電圧を保持する第2の保持容量と、
前記第1の保持容量に第1の電圧を、前記第2の保持容量に第2の電圧を保持させる手段と、
前記第2の保持容量の第2の電圧を前記トランジスタのしきい値電圧まで放電させる手段と、
前記第2の配線からビデオ信号に応じた電位を前記第1の保持容量に入力することにより前記トランジスタに設定された電流を前記負荷に供給する手段とを有することを特徴とする半導体装置(ただし前記負荷と並列接続されたトランジスタを有する半導体装置を除く)。 A first holding capacity;
One of the source electrode and the drain electrode is electrically connected to the load, the other of the source electrode and the drain electrode is electrically connected to the first wiring, and the gate electrode is connected to the second via the first storage capacitor. A transistor electrically connected to the wiring;
A second holding capacitor for holding a gate-source voltage of the transistor;
Means for holding the first voltage in the first holding capacitor and holding the second voltage in the second holding capacitor;
Means for discharging a second voltage of the second storage capacitor to a threshold voltage of the transistor;
Wherein a and a means for supplying the current set by the transistor by inputting a potential in accordance with the video signal from said second wiring to said first storage capacitor to the load (provided that Except a semiconductor device having a transistor connected in parallel with the load) .
前記トランジスタは、薄膜トランジスタであることを特徴とする半導体装置。 In claim 18,
The semiconductor device is a thin film transistor.
前記トランジスタは、Nチャネル型トランジスタであることを特徴とする半導体装置。 In claim 18 or claim 19,
The semiconductor device is an N-channel transistor.
前記トランジスタの半導体層は、非晶質半導体膜からなることを特徴する半導体装置。 In any one of claims 18 to 20,
A semiconductor device, wherein the semiconductor layer of the transistor is made of an amorphous semiconductor film.
前記トランジスタの半導体層は、アモルファスシリコンからなることを特徴する半導体装置。 In any one of Claims 18 to 21,
A semiconductor device, wherein the semiconductor layer of the transistor is made of amorphous silicon.
前記トランジスタの半導体層は、結晶性半導体膜からなることを特徴する半導体装置。 In any one of claims 18 to 20,
A semiconductor device, wherein the semiconductor layer of the transistor is made of a crystalline semiconductor film.
前記トランジスタは、Pチャネル型トランジスタであることを特徴とする半導体装置。 In claim 18 or claim 19,
The semiconductor device is a P-channel transistor.
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