JP2008022232A - リミッタ回路 - Google Patents
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Abstract
【解決手段】それぞれが、PINダイオード(1−1、1−2)と、該PINダイオード及び接続部のインダクタンスを線路の位相回転により使用周波数において打ち消す整合用マイクロ波回路(4−1、4−2)からなる、第1直列回路と第2直列回路を、主マイクロストリップ線路(4)と接地導体間に、λ/4間隔で接続する。
【選択図】図1
Description
Ohio Microwave Ltd、"Pin Diode Limiter s 0.5 TO 18 GHz"、[online]、[平成18年4月20日検索]、 インターネット〈URL:http://www.ohiomicrowave.c om/herotek/herotek7.html〉
信号入力端と信号出力端との間に配置された主のマイクロストリップ線路と、
前記主のマイクロストリップ線路の第1接続点と接地導体との間に接続部を介して直列に接続された、第1PINダイオードと、該第1PINダイオード及び接続部のインダクタンスを線路の位相回転により使用周波数において打ち消す第1整合用マイクロ波回路と、
前記第1接続点から使用周波数の電気長λ/4(但し、λは波長)だけ離れた前記主のマイクロストリップ線路の第2接続点と接地導体との間に接続部を介して直列に接続された、第2PINダイオードと、該第2PINダイオード及び接続部のインダクタンスを線路の位相回転により使用周波数において打ち消すための第2整合用マイクロ波回路と、を備えることを特徴とする。
第2整合用マイクロ波回路は、前記第2接続点から前記第2PINダイオードを見たインダクタンスを使用周波数において実質的に零にするλ/2より僅かに短い長さの第2副マイクロストリップ線路を有することを特徴とする。
前記第2整合用マイクロ波回路は、前記第2接続点から前記第2PINダイオードを見たインダクタンスを使用周波数において実質的に零にする、前記主のマイクロストリップ線路より細い幅且つλ/2より短い長さの第4副マイクロストリップ線路と、該第4副マイクロストリップ線路の端部と接地導体との間に接続された第2チップキャパシタとを有することを特徴とする。
ωC=(cosθ1−cosθ0)/(Z0・sinθ0)、で表される。
2−1〜2−5 VIAホール
3 DCリターン線路
4 主マイクロストリップ線路
4−1〜4−4 副マイクロストリップ線路
5 誘電体基板
6−1〜6−4 キャパシタ
7 信号入力端
8 信号出力端
Claims (3)
- マイクロ波帯で使用するPINダイオードを用いた表面実装型のリミッタ回路において、
信号入力端と信号出力端との間に配置された主のマイクロストリップ線路と、
前記主のマイクロストリップ線路の第1接続点と接地導体との間に接続部を介して直列に接続された、第1PINダイオードと、該第1PINダイオード及び接続部のインダクタンスを線路の位相回転により使用周波数において打ち消す第1整合用マイクロ波回路と、
前記第1接続点から使用周波数の電気長λ/4(但し、λは波長)だけ離れた前記主のマイクロストリップ線路の第2接続点と接地導体との間に接続部を介して直列に接続された、第2PINダイオードと、該第2PINダイオード及び接続部のインダクタンスを線路の位相回転により使用周波数において打ち消すための第2整合用マイクロ波回路と、を備えることを特徴とするリミッタ回路。 - 前記第1整合用マイクロ波回路は、前記第1接続点から前記第1PINダイオードを見たインダクタンスを使用周波数において実質的に零にするλ/2より僅かに短い長さの第1副マイクロストリップ線路を有し、
第2整合用マイクロ波回路は、前記第2接続点から前記第2PINダイオードを見たインダクタンスを使用周波数において実質的に零にするλ/2より僅かに短い長さの第2副マイクロストリップ線路を有することを特徴とする、請求項1に記載のリミッタ回路。 - 前記第1整合用マイクロ波回路は、前記第1接続点から前記第1PINダイオードを見たインダクタンスを使用周波数において実質的に零にする、前記主のマイクロストリップ線路より細い幅且つλ/2より短い長さの第3副マイクロストリップ線路と、該第3副マイクロストリップ線路の端部と接地導体との間に接続された第1チップキャパシタとを有し、
前記第2整合用マイクロ波回路は、前記第2接続点から前記第2PINダイオードを見たインダクタンスを使用周波数において実質的に零にする、前記主のマイクロストリップ線路より細い幅且つλ/2より短い長さの第4副マイクロストリップ線路と、該第4副マイクロストリップ線路の端部と接地導体との間に接続された第2チップキャパシタとを有することを特徴とする、請求項1に記載のリミッタ回路。
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- 2006-07-12 JP JP2006191677A patent/JP2008022232A/ja active Pending
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