JP2007206681A - 半導体装置、表示装置及び電子機器 - Google Patents
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Landscapes
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Abstract
【解決手段】第1乃至第3のトランジスタとメモリ回路、及び切替回路を備え、第1のトランジスタは、ゲート端子がデータ線に接続され、第1端子が第1の電源線に接続されている。第2のトランジスタは、ゲート端子が第1の走査線に接続され、第1端子が第1のトランジスタの第2端子に接続されている。第3のトランジスタは、発光素子と接続し、その発光・消灯状態を制御する。第3の走査線により制御された切替回路は、メモリ回路及び第2の電源線との接続の切替を行い、入力された電位を第3のトランジスタに印加する。
【選択図】図1
Description
102 スイッチトランジスタ
103 メモリ回路
104 切替回路
105 駆動トランジスタ
106 発光素子
107 対向電極
108 データ線
109 第1の走査線
110 第2の走査線
111 第3の走査線
112 第1の電源線
113 第2の電源線
501 データトランジスタ
502 スイッチトランジスタ
503 トランジスタ
504 トランジスタ
505 トランジスタ
506 トランジスタ
507 トランジスタ
508 トランジスタ
509 トランジスタ
510 トランジスタ
511 トランジスタ
512 駆動トランジスタ
513 発光素子
514 対向電極
515 第1の走査線
516 第2の走査線
517 第3の走査線
518 第1の電源線
519 第2の電源線
520 データ線
521 メモリ回路
522 切替回路
1201 基板
1202 結晶性半導体膜
1203A 導電膜
1203B 導電膜
1204 絶縁膜
1205 絶縁膜
1206 層間絶縁膜
1207 導電膜
1208 絶縁膜
1209 画素電極
1210 電界発光層
1211 対向電極
1301 画素
1302 画素部
1303 信号線駆動回路
1304 第1の走査線駆動回路
1305 第2の走査線駆動回路
1306 FPC
1307 基板
1311 シフトレジスタ
1312 ラッチ回路
1313 ラッチ回路
1314 シフトレジスタ
1315 バッファ
1317 バッファ
1401 第2の電源線
1402 対向電極
1403 駆動トランジスタ
1404 発光素子
1406 モニタ電源線
1407 モニタ電源線
1408 モニタ用電流源
1409 モニタ用発光素子
1410 サンプリング回路
1411 電源回路
1412 電源回路用電源線
2100 画素部
2101 選択トランジスタ
2102 駆動トランジスタ
2103 保持容量
2104 発光素子
2200 画素
2201 選択トランジスタ
2202 駆動トランジスタ
2203 保持容量
2204 発光素子
2205 走査線
2206 データ線
2207 電源線
2208 対向電極
5001 表示パネル
5002 画素部
5003 走査線駆動回路
5004 信号線駆動回路
5011 回路基板
5012 コントロール回路
5013 信号分割回路
5014 接続配線
5101 チューナ
5102 映像信号増幅回路
5103 映像信号処理回路
5105 音声信号増幅回路
5106 音声信号処理回路
5107 スピーカー
5108 制御回路
5109 入力部
5201 筐体
5202 表示画面
5203 スピーカー
5204 操作スイッチ
5210 充電器
5212 筐体
5213 表示部
5216 操作キー
5217 スピーカー部
5301 表示パネル
5302 プリント配線基板
5303 画素部
5304 第1の走査線駆動回路
5305 第2の走査線駆動回路
5306 信号線駆動回路
5307 コントローラ
5308 CPU
5309 メモリ
5310 電源回路
5311 音声処理回路
5312 送受信回路
5313 FPC
5314 インターフェース部
5315 アンテナ用ポート
5316 VRAM
5317 DRAM
5318 フラッシュメモリ
5320 制御信号生成回路
5321 デコーダ
5322 レジスタ
5323 演算回路
5324 RAM
5325 入力手段
5326 マイク
5327 スピーカー
5328 アンテナ
5330 ハウジング
5331 プリント基板
5332 スピーカー
5333 マイクロフォン
5334 送受信回路
5335 信号処理回路
5336 入力手段
5337 バッテリー
5339 筐体
5340 アンテナ
6001 筐体
6002 支持台
6003 表示部
6101 本体
6102 筐体
6103 表示部
6104 キーボード
6105 外部接続ポート
6106 ポインティングマウス
6201 本体
6202 表示部
6203 スイッチ
6204 操作キー
6205 赤外線ポート
6301 筐体
6302 表示部
6303 スピーカー部
6304 操作キー
6305 記録媒体挿入部
6401 本体
6402 筐体
6403 表示部A
6404 表示部B
6405 記録媒体(DVD等)読込部
6406 操作キー
6407 スピーカー部
Claims (15)
- データ線と、
第1乃至第3の走査線と、
第1及び第2の電源線と、
発光素子と、
ゲート端子が前記データ線に接続され、第1端子が前記第1の電源線に接続された第1のトランジスタと、
ゲート端子が前記第1の走査線に接続され、第1端子が前記第1のトランジスタの第2端子に接続された第2のトランジスタと、
メモリ回路と、
切替回路と、
ゲート端子が前記切替回路に接続され、第2端子が前記発光素子に接続された第3のトランジスタと、を有し、
前記メモリ回路は、前記第2のトランジスタの第2端子、及び前記第2の走査線に接続され、
前記切替回路は、前記第2のトランジスタの第2端子、前記メモリ回路、及び前記第3の走査線に接続され、
前記切替回路は、前記第3のトランジスタと、前記メモリ回路及び前記第2の電源線との接続の切替を行い、入力された電位を、前記第3のトランジスタのゲート端子に印加することを特徴とする半導体装置。 - 請求項1において、
前記第1のトランジスタ及び前記第2のトランジスタは、Nチャネル型トランジスタであり、前記第3のトランジスタはPチャネル型トランジスタであることを特徴とする半導体装置。 - データ線と、
第1乃至第3の走査線と、
第1及び第2の電源線と、
発光素子と、
ゲート端子が前記データ線に接続され、第1端子が前記第1の電源線に接続された第1のNチャネル型トランジスタと、
ゲート端子が前記第1の走査線に接続され、第1端子が前記第1のNチャネル型トランジスタの第2端子に接続された第2のNチャネル型トランジスタと、
メモリ回路と、
切替回路と、
第1端子が前記第2の電源線に接続され、第2端子が前記発光素子に接続された第1のPチャネル型トランジスタと、を有し、
前記メモリ回路は、第1の入力端子が前記第2のNチャネル型トランジスタの第2端子に接続され、第2の入力端子が前記第2の走査線に接続されたNOR回路と、
ゲート端子が前記NOR回路の出力端子に接続され、第1端子が前記第1の電源線に接続された第3のNチャネル型トランジスタと、
ゲート端子が前記第1の走査線に接続され、第1端子が前記第2の電源線に接続された第2のPチャネル型トランジスタと、
ゲート端子がNOR回路の出力端子に接続され、第1端子が前記第2のPチャネル型トランジスタの第2端子に接続され、第2端子が前記第3のNチャネル型トランジスタの第2端子に接続された第3のPチャネル型トランジスタと、を有し、
前記切替回路は、ゲート端子が前記第3の走査線に接続され、第1端子が前記第2のNチャネル型トランジスタの第2端子、前記第3のNチャネル型トランジスタの第2端子、及び前記第3のPチャネル型トランジスタの第2端子に接続され、第2端子が前記第1のPチャネル型トランジスタのゲート端子に接続された第4のNチャネル型トランジスタと、
ゲート端子が前記第3の走査線に接続され、第1端子が前記第2の電源線に接続され、
第2端子が前記第4のNチャネル型トランジスタの第2端子及び前記第1のPチャネル型トランジスタのゲート端子に接続された第4のPチャネル型トランジスタと、を有し、
前記メモリ回路には、前記第1のPチャネル型トランジスタがオンとなる第1の電位またはオフとなる第2の電位が入力され、
前記第2の電源線には、前記第1のPチャネル型トランジスタがオフとなる第3の電位が入力され、
前記切替回路は、前記第1の電位または前記第2の電位と、前記第3の電位のいずれか1つを、前記第1のPチャネル型トランジスタのゲート端子に印加することを特徴とする半導体装置。 - 請求項1乃至請求項3のいずれか一において、
前記第1の電源線の電位は、前記第2の電源線の第3の電位よりも低いことを特徴とする半導体装置。 - 請求項1乃至請求項4のいずれか一において、
前記発光素子は、エレクトロルミネセンス素子であることを特徴とする半導体装置。 - 複数の画素を有する表示部と、駆動回路を具備する表示装置であって、
前記画素は、
データ線と、
第1乃至第3の走査線と、
第1及び第2の電源線と、
発光素子と、
ゲート端子が前記データ線に接続され、第1端子が前記第1の電源線に接続された第1のトランジスタと、
ゲート端子が前記第1の走査線に接続され、第1端子が前記第1のトランジスタの第2端子に接続された第2のトランジスタと、
メモリ回路と、
切替回路と、
ゲート端子が前記切替回路に接続され、第2端子が前記発光素子に接続された第3のトランジスタと、を有し、
前記メモリ回路は、前記第2のトランジスタの第2端子、及び前記第2の走査線に接続され、
前記切替回路は、前記第2のトランジスタの第2端子、前記メモリ回路、及び前記第3の走査線に接続され、
前記切替回路は、前記第3のトランジスタと、前記メモリ回路及び前記第2の電源線との接続の切替を行い、入力された電位を、前記第3のトランジスタのゲート端子に印加することを特徴とする半導体装置を有する表示装置。 - 請求項6において、
前記前記第1のトランジスタ及び前記第2のトランジスタは、Nチャネル型トランジスタであり、前記第3のトランジスタはPチャネル型トランジスタであることを特徴とする表示装置。 - 複数の画素を有する表示部と、駆動回路を具備する表示装置であって、
前記画素は、
データ線と、
第1乃至第3の走査線と、
第1及び第2の電源線と、
発光素子と、
ゲート端子が前記データ線に接続され、第1端子が前記第1の電源線に接続された第1のNチャネル型トランジスタと、
ゲート端子が前記第1の走査線に接続され、第1端子が前記第1のNチャネル型トランジスタの第2端子に接続された第2のNチャネル型トランジスタと、
メモリ回路と、
切替回路と、
第1端子が前記第2の電源線に接続され、第2端子が前記発光素子に接続された第1のPチャネル型トランジスタと、を有し、
前記メモリ回路は、第1の入力端子が前記第2のNチャネル型トランジスタの第2端子に接続され、第2の入力端子が前記第2の走査線に接続されたNOR回路と、
ゲート端子が前記NOR回路の出力端子に接続され、第1端子が前記第1の電源線に接続された第3のNチャネル型トランジスタと、
ゲート端子が前記第1の走査線に接続され、第1端子が前記第2の電源線に接続された第2のPチャネル型トランジスタと、
ゲート端子がNOR回路の出力端子に接続され、第1端子が前記第2のPチャネル型トランジスタの第2端子に接続され、第2端子が前記第3のNチャネル型トランジスタの第2端子に接続された第3のPチャネル型トランジスタと、を有し、
前記切替回路は、ゲート端子が前記第3の走査線に接続され、第1端子が前記第2のNチャネル型トランジスタの第2端子、前記第3のNチャネル型トランジスタの第2端子、及び前記第3のPチャネル型トランジスタの第2端子に接続され、第2端子が前記第1のPチャネル型トランジスタのゲート端子に接続された第4のNチャネル型トランジスタと、
ゲート端子が前記第3の走査線に接続され、第1端子が前記第2の電源線に接続され、
第2端子が前記第4のNチャネル型トランジスタの第2端子及び前記第1のPチャネル型トランジスタのゲート端子に接続された第4のPチャネル型トランジスタと、を有し、
前記メモリ回路には、前記第1のPチャネル型トランジスタがオンとなる第1の電位またはオフとなる第2の電位が入力され、
前記第2の電源線には、前記第1のPチャネル型トランジスタがオフとなる第3の電位が入力され、
前記切替回路は、前記第1の電位または前記第2の電位と、前記第3の電位のいずれか1つを、前記第1のPチャネル型トランジスタのゲート端子に印加することを特徴とする半導体装置を有する表示装置。 - 請求項6乃至請求項8のいずれか一において、
前記第1の電源線の電位は、前記第2の電源線の電位よりも低いことを特徴とする表示装置。 - 請求項6乃至請求項9のいずれか一において、
前記発光素子は、エレクトロルミネセンス素子であることを特徴とする表示装置。 - 表示パネルを備えた電子機器であって、
前記表示パネルは、複数の画素を有する表示部と、駆動回路と、を有し、
前記画素は、
データ線と、
第1乃至第3の走査線と、
第1及び第2の電源線と、
発光素子と、
ゲート端子が前記データ線に接続され、第1端子が前記第1の電源線に接続された第1のトランジスタと、
ゲート端子が前記第1の走査線に接続され、第1端子が前記第1のトランジスタの第2端子に接続された第2のトランジスタと、
メモリ回路と、
切替回路と、
ゲート端子が前記切替回路に接続され、第2端子が前記発光素子に接続された第3のトランジスタと、を有し、
前記メモリ回路は、前記第2のトランジスタの第2端子、及び前記第2の走査線に接続され、
前記切替回路は、前記第2のトランジスタの第2端子、前記メモリ回路、及び前記第3の走査線に接続され、
前記切替回路は、前記第3のトランジスタと、前記メモリ回路及び前記第2の電源線との接続の切替を行い、入力された電位を、前記第3のトランジスタのゲート端子に印加することを特徴とする半導体装置を有する表示パネルを備えた電子機器。 - 請求項11において、
前記第1のトランジスタ及び前記第2のトランジスタは、Nチャネル型トランジスタであり、前記第3のトランジスタはPチャネル型トランジスタであることを特徴とする電子機器。 - 表示パネルを備えた電子機器であって、
前記表示パネルは、複数の画素を有する表示部と、駆動回路と、を有し、
前記画素は、
データ線と、
第1乃至第3の走査線と、
第1及び第2の電源線と、
発光素子と、
ゲート端子が前記データ線に接続され、第1端子が前記第1の電源線に接続された第1のNチャネル型トランジスタと、
ゲート端子が前記第1の走査線に接続され、第1端子が前記第1のNチャネル型トランジスタの第2端子に接続された第2のNチャネル型トランジスタと、
メモリ回路と、
切替回路と、
第1端子が前記第2の電源線に接続され、第2端子が前記発光素子に接続された第1のPチャネル型トランジスタと、を有し、
前記メモリ回路は、第1の入力端子が前記第2のNチャネル型トランジスタの第2端子に接続され、第2の入力端子が前記第2の走査線に接続されたNOR回路と、
ゲート端子が前記NOR回路の出力端子に接続され、第1端子が前記第1の電源線に接続された第3のNチャネル型トランジスタと、
ゲート端子が前記第1の走査線に接続され、第1端子が前記第2の電源線に接続された第2のPチャネル型トランジスタと、
ゲート端子がNOR回路の出力端子に接続され、第1端子が前記第2のPチャネル型トランジスタの第2端子に接続され、第2端子が前記第3のNチャネル型トランジスタの第2端子に接続された第3のPチャネル型トランジスタと、を有し、
前記切替回路は、ゲート端子が前記第3の走査線に接続され、第1端子が前記第2のNチャネル型トランジスタの第2端子、前記第3のNチャネル型トランジスタの第2端子、及び前記第3のPチャネル型トランジスタの第2端子に接続され、第2端子が前記第1のPチャネル型トランジスタのゲート端子に接続された第4のNチャネル型トランジスタと、
ゲート端子が前記第3の走査線に接続され、第1端子が前記第2の電源線に接続され、
第2端子が前記第4のNチャネル型トランジスタの第2端子及び前記第1のPチャネル型トランジスタのゲート端子に接続された第4のPチャネル型トランジスタと、を有し、
前記メモリ回路には、前記第1のPチャネル型トランジスタがオンとなる第1の電位またはオフとなる第2の電位が入力され、
前記第2の電源線には、前記第1のPチャネル型トランジスタがオフとなる第3の電位が入力され、
前記切替回路は、前記第1の電位または前記第2の電位と、前記第3の電位のいずれか1つを、前記第1のPチャネル型トランジスタのゲート端子に印加することを特徴とする半導体装置を有する表示パネルを備えた電子機器。 - 請求項11乃至請求項13のいずれか一において、
前記第1の電源線の電位は、前記第2の電源線の電位よりも低いことを特徴とする電子機器。 - 請求項11乃至請求項14のいずれか一において、
前記発光素子は、エレクトロルミネセンス素子であることを特徴とする電子機器。
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