JP2007165454A - 半導体装置 - Google Patents
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Abstract
【課題】ダミーチップの面積が小さくても充分にパッケージの反りを低減することができる半導体装置を得る。
【解決手段】本発明に係る半導体装置は、配線基板と、配線基板上に積層して搭載された大きさの異なる複数の半導体チップと、複数の半導体チップの最上層の半導体チップに並列に配置されたダミーチップと、複数の半導体チップ及びダミーチップを封止する樹脂とを有する。そして、ダミーチップは、最上層の半導体チップよりも厚い。
【選択図】図1
【解決手段】本発明に係る半導体装置は、配線基板と、配線基板上に積層して搭載された大きさの異なる複数の半導体チップと、複数の半導体チップの最上層の半導体チップに並列に配置されたダミーチップと、複数の半導体チップ及びダミーチップを封止する樹脂とを有する。そして、ダミーチップは、最上層の半導体チップよりも厚い。
【選択図】図1
Description
本発明は、配線基板上に大きさの異なる複数の半導体チップが積層して搭載されたチップ積層型の半導体装置に関し、特にダミーチップの面積が小さくても充分にパッケージの反りを低減することができる半導体装置に関するものである。
チップ積層型の半導体装置として、特許文献1又は2には、リードフレームの半導体チップと対向する部分にダミーチップを搭載することにより、パッケージ上下の樹脂量を等しくし、パッケージの反りを低減するものが開示されている。また、特許文献3には、最上層の半導体チップに並列にダミーチップを配置する半導体装置が開示されている。
配線基板上に大きさの異なる複数の半導体チップが積層して搭載されたチップ積層型の半導体装置において、最上層の半導体チップが極端に小さい場合には、チップの上部の樹脂量が多くなり、パッケージが反るという問題があった。
また、特許文献3のようにダミーチップが最上層の半導体チップと同じ厚みの場合は、ダミーチップの面積が小さいと充分にパッケージの反りを低減することができないという問題があった。
本発明は、上述のような課題を解決するためになされたもので、その目的は、ダミーチップの面積が小さくても充分にパッケージの反りを低減することができる半導体装置を得るものである。
本発明に係る半導体装置は、配線基板と、配線基板上に積層して搭載された大きさの異なる複数の半導体チップと、複数の半導体チップの最上層の半導体チップに並列に配置されたダミーチップと、複数の半導体チップ及びダミーチップを封止する樹脂とを有し、ダミーチップは、最上層の半導体チップよりも厚い。本発明のその他の特徴は以下に明らかにする。
本発明により、ダミーチップの面積が小さくても充分にパッケージの反りを低減することができる。
図1は、本発明の実施の形態に係る半導体装置を示す断面図である。この半導体装置は、配線基板11と、配線基板11上に積層して搭載された大きさの異なる複数の半導体チップ12〜14と、半導体チップ12〜14の最上層の半導体チップ14に並列に配置されたダミーチップ15と、半導体チップ12〜14と配線基板11をそれぞれ接続するボンディングワイヤ16と、半導体チップ12〜14、ダミーチップ15及びボンディングワイヤ16を封止する樹脂17と、配線基板11の下面に設けられた半田ボール18とを有する。そして、ダミーチップ15の厚みBは、最上層の半導体チップ14の厚みAよりも厚い(B>A)。
このように、最上層の半導体チップ14に並列にダミーチップ15を配置することにより、チップ上の樹脂17の量を低減することができるため、パッケージの反りを抑えることができる。そして、ダミーチップ15を最上層の半導体チップ14よりも厚くすることで、ダミーチップ15の面積が小さくても充分にパッケージの反りを低減することができる。
また、ダミーチップ15にはボンディングワイヤが接続していない。これにより、ダミーチップ15を厚くしたことにより、ダミーチップ15上の樹脂17の厚みを薄くした場合でも、ボンディングワイヤがパッケージ上部に透けて見えるなどの不具合の発生を防止することができる。
11 配線基板
12-14 半導体チップ
15 ダミーチップ
17 樹脂
12-14 半導体チップ
15 ダミーチップ
17 樹脂
Claims (2)
- 配線基板と、
前記配線基板上に積層して搭載された大きさの異なる複数の半導体チップと、
前記複数の半導体チップの最上層の半導体チップに並列に配置されたダミーチップと、
前記複数の半導体チップ及び前記ダミーチップを封止する樹脂とを有し、
前記ダミーチップは、前記最上層の半導体チップよりも厚いことを特徴とする半導体装置。 - 前記ダミーチップにはボンディングワイヤが接続していないことを特徴とする請求項1に記載の半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2005357680A JP2007165454A (ja) | 2005-12-12 | 2005-12-12 | 半導体装置 |
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Family Applications (1)
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Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009117702A (ja) * | 2007-11-08 | 2009-05-28 | Nec Electronics Corp | 半導体装置 |
US8237251B2 (en) | 2008-01-23 | 2012-08-07 | Elpida Memory, Inc. | Semiconductor device including semiconductor chips with different thickness |
US9185348B2 (en) | 2008-04-24 | 2015-11-10 | Samsung Electronics Co., Ltd. | Method of recommending broadcasting contents and recommending apparatus therefor in multimedia contents reproducing device |
US9270918B2 (en) | 2008-04-24 | 2016-02-23 | Samsung Electronics Co., Ltd. | Method of recommending broadcasting contents and recommending apparatus therefor |
CN109585473A (zh) * | 2017-09-29 | 2019-04-05 | 三星电子株式会社 | 图像感测设备及其制造方法 |
CN110444528A (zh) * | 2018-05-04 | 2019-11-12 | 晟碟信息科技(上海)有限公司 | 包含虚设下拉式引线键合体的半导体装置 |
US10916533B2 (en) | 2018-07-05 | 2021-02-09 | Samsung Electronics Co., Ltd. | Semiconductor package |
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- 2005-12-12 JP JP2005357680A patent/JP2007165454A/ja active Pending
Cited By (14)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009117702A (ja) * | 2007-11-08 | 2009-05-28 | Nec Electronics Corp | 半導体装置 |
US8237251B2 (en) | 2008-01-23 | 2012-08-07 | Elpida Memory, Inc. | Semiconductor device including semiconductor chips with different thickness |
US8372693B2 (en) | 2008-01-23 | 2013-02-12 | Elpida Memory, Inc. | Semiconductor device including semiconductor chips with different thickness |
US9185348B2 (en) | 2008-04-24 | 2015-11-10 | Samsung Electronics Co., Ltd. | Method of recommending broadcasting contents and recommending apparatus therefor in multimedia contents reproducing device |
US9270918B2 (en) | 2008-04-24 | 2016-02-23 | Samsung Electronics Co., Ltd. | Method of recommending broadcasting contents and recommending apparatus therefor |
US10277951B2 (en) | 2008-04-24 | 2019-04-30 | Samsung Electronics Co., Ltd. | Method of recommending broadcasting contents and recommending apparatus therefor in multimedia contents reproducing device |
JP2019068049A (ja) * | 2017-09-29 | 2019-04-25 | 三星電子株式会社Samsung Electronics Co.,Ltd. | イメージセンシング装置及びその製造方法 |
CN109585473A (zh) * | 2017-09-29 | 2019-04-05 | 三星电子株式会社 | 图像感测设备及其制造方法 |
US10741607B2 (en) | 2017-09-29 | 2020-08-11 | Samsung Electronics Co., Ltd. | Image sensing apparatus and manufacturing method thereof |
US11482564B2 (en) | 2017-09-29 | 2022-10-25 | Samsung Electronics Co., Ltd. | Image sensing apparatus |
CN110444528A (zh) * | 2018-05-04 | 2019-11-12 | 晟碟信息科技(上海)有限公司 | 包含虚设下拉式引线键合体的半导体装置 |
CN110444528B (zh) * | 2018-05-04 | 2021-04-20 | 晟碟信息科技(上海)有限公司 | 包含虚设下拉式引线键合体的半导体装置 |
US11031372B2 (en) | 2018-05-04 | 2021-06-08 | Western Digital Technologies, Inc. | Semiconductor device including dummy pull-down wire bonds |
US10916533B2 (en) | 2018-07-05 | 2021-02-09 | Samsung Electronics Co., Ltd. | Semiconductor package |
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