JP2005242769A - 電源リセット回路とそれを内蔵したレギュレータic - Google Patents
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Abstract
【解決手段】 電源リセット回路1はICで構成されており、内部に演算増幅器(オペアンプ)12、基準電圧発生回路13、制御トランジスタ14、内部抵抗16が設けられている。電源電圧VCCが設定値よりも低下した場合に、負荷に給電している電源のリセット信号を端子15cから出力する。リセット信号を出力するための検出電圧の初期設定値を規定する抵抗R1、R2をICに内蔵し、かつ外付け抵抗はR3の一個で検出電圧の可変調整を可能とする。
【選択図】 図1
Description
検出電圧設定値(Vx)=基準電圧(Vref)×(R1+R2)/R2(V)・・・(1)
により設定される。すなわち、図5の例では、前記レベルはICで構成される電源リセット回路11の内部抵抗により規定されることになる。
検出電圧設定値(Vx)=基準電圧(Vref)×(R3+R4)/R4(V)・・・(2)
により設定される。図5の例では、内部抵抗R1、R2は製造時に決定される抵抗値に固定されるが、図6の例ではR3、R4の抵抗値を変更して電源リセット回路11の端子15bに接続できるという利点がある。
Vx=(Vref)×(R1+R2+R3)/R2(V)・・・(3)
により、リセット信号を出力するための検出電圧を設定する。ここで、抵抗R3は抵抗値が異なるものを接続変えが可能である。また、Vxは前記初期設定値よりも、基準電圧(Vref)×(R3/R2)だけ増大している。したがって、図1の例では、内部抵抗16による検出電圧の初期設定値のレベルよりも高い検出電圧のレベルに調整可能である。
Vx=(Vref)×(R1+R2+R3)/(R2+R3)(V)・・・(4)
により、リセット信号を出力するための検出電圧を設定する。ここで、抵抗R3は抵抗値が異なるものを接続変えが可能である。また、分母に(R2+R3)の項が入っているので、初期設定値のレベルよりも低い検出電圧のレベルに調整可能である。
Vx=Vref×[{(R1×R3)/(R1+R3)+R2}/R2](V)・・・(5)
により、リセット信号を出力するための検出電圧を設定する。この例では、前記初期値のレベルよりも低い検出電圧のレベルに調整可能である。この検出電圧のレベルは、抵抗R3により可変とすることができる。
Vx=Vref×[{R1+(R2×R3')/(R2+R3')}/{(R2×R3')/(R2+R3')}](V)・・・(6)
により、リセット信号を出力するための検出電圧を設定する。この例では、前記初期値のレベルよりも高い検出電圧のレベルに調整可能である。この検出電圧のレベルは、抵抗R3により可変とすることができる。
Vx=Vref1×(R1+R2)/R2・・・(7)
により決定される。
検出電圧(Vx)=1.25V×(2.2K+1K)/1K=4.0V、ここに、R1=2.2KΩ、R2=1KΩである。また、単品のレギュレータIC(b)、(c)の出力電圧は、それぞれ(8)、(9)式
Vout1=Vref2X(R3+R4)/R4・・・(8)
Vout2=Vref3X(R5+R6)/R6・・・(9)
により決定される。
出力電圧1(Vout1)=1.8V×(834+1K)/1K=3.3V、ただし、R3=834Ω、R4=1KΩである。また、
出力電圧2(Vout2)=1.8V×(389+1K)/1K=2.5V、である。ここに、R5=389Ω、R6=1KΩである。
Claims (12)
- 電源電圧が所定レベルよりも低下したことを検出して、電源リセット信号を出力するICで構成される電源リセット回路であって、電源電圧の入力端子と、オペアンプと、前記オペアンプの非反転入力端子に基準電圧を入力する基準電圧発生回路と、前記オペアンプの反転入力端子に接続点からの信号が入力される直列接続された2個の抵抗と、単一の外付け抵抗が接続される接続端子とを備え、前記直列接続された2個の抵抗の一端に電源電圧を印加し、前記直列接続された2個の抵抗の他端を接地に接続して、前記オペアンプからの出力信号をリセット信号として出力することを特徴とする、電源リセット回路
- 前記オペアンプの出力端子に制御トランジスタを接続したことを特徴とする、請求項1に記載の電源リセット回路。
- 前記単一の外付け抵抗を前記電源電圧の入力端子と前記直列接続された2個の抵抗の一端間に接続したことを特徴とする、請求項1または請求項2に記載の電源リセット回路。
- 前記外付け抵抗を接続することにより、前記直列接続された2個の抵抗で設定される電源電圧の低下を検出するレベルよりも高いレベルを設定することを特徴とする、請求項3に記載の電源リセット回路。
- 前記単一の外付け抵抗を、接地と前記直列接続された2個の抵抗の他端間に接続したことを特徴とする、請求項1または請求項2に記載の電源リセット回路。
- 前記外付け抵抗を接続することにより、前記直列接続された2個の抵抗で設定される電源電圧の低下を検出するレベルよりも低いレベルを設定することを特徴とする、請求項5に記載の電源リセット回路。
- 前記単一の外付け抵抗を、前記直列接続された2個の抵抗の接続点と前記電源電圧の入力端子間、または前記直列接続された2個の抵抗の接続点と前記接地間に接続したことを特徴とする、請求項1または請求項2に記載の電源リセット回路。
- 前記外付け抵抗を接続することにより、前記直列接続された2個の抵抗で設定される電源電圧の低下を検出するレベルよりも高いレベルまたは低いレベルのいずれかのレベルを設定することを特徴とする、請求項7に記載の電源リセット回路。
- 前記請求項1なしい請求項8のいずれかに記載の電源リセット回路をIC内部に設け、少なくとも1つの調整された電圧を出力することを特徴とする、レギュレータIC。
- 前記レギュレータICは、前記電源リセット回路と回路部品を共用していることを特徴とする、請求項9に記載のレギュレータIC。
- 前記回路部品には、少なくとも基準電圧発生回路が含まれていることを特徴とする、請求項10に記載のレギュレータIC。
- 前記基準電圧発生回路で発生する基準電圧が入力される非反転入力端子と、2個の直列接続された抵抗の接続点に接続される反転入力端子を有するオペアンプを設け、前記オペアンプの出力端子を制御トランジスタに接続して、当該制御トランジスタから前記調整された電圧を出力することを特徴とする、請求項11に記載のレギュレータIC。
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