JP2005136664A - 発振回路 - Google Patents
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Abstract
【解決手段】振動子Xが外部接続される外部端子1,2と、端子1,2間に接続されたインバータ回路I1と、一端が外部端子1に接続され、内部端子N0からの入力制御信号に従ってオン/オフするスイッチ素子S0と、スイッチ素子S0の他端と外部端子2の間に接続された内蔵帰還抵抗Rfi1,Rfi2と、内蔵帰還抵抗Rfi1に並列に接続され、内部端子N1からの入力制御信号に従ってオン/オフするスイッチ素子S1と、内蔵帰還抵抗Rfi2に並列に接続され、内部端子N2からの入力制御信号に従ってオン/オフするスイッチ素子S2とを備え、スイッチ素子S0をOFFして、外部端子1をインバータ回路I1の出力から絶縁し、外部端子1のリーク電流を測定可能とした。
【選択図】 図1
Description
半導体集積回路で構成され、振動子を外付けして所定の周波数の発振信号を得る発振回路において、
上記振動子が外部接続される第1および第2の外部端子と、
上記第1および第2の外部端子間に接続されたインバータ回路と、
一端が上記第1の外部端子に接続され、第1の入力制御信号に従ってオン/オフする第1のスイッチ素子と、
上記第1のスイッチ素子の他端と上記第2の外部端子の間に接続された第1の内蔵抵抗と
を備えた
ことを特徴とする。
半導体集積回路で構成され、振動子を外付けして所定の周波数の発振信号を得る発振回路において、
上記振動子が外部接続される第1および第2の外部端子と、
上記第1および第2の外部端子間に接続されたインバータ回路と、
上記インバータ回路に並列に接続され、第1の入力制御信号に従ってオン/オフし、所定のオン抵抗値を有する第1のスイッチ素子と
を備えた
ことを特徴とする。
図1は本発明の実施の形態1の発振回路C3を示す回路図である。この発振回路C3は、半導体ICの内部に設けられる。
インバータ回路I1の入力端子は外部端子1に接続し、インバータ回路I1の出力端子は外部端子2に接続している。また、バッファ回路I2の入力端子は外部端子2に接続し、バッファ回路I2の出力端子は内部端子OUTに接続している。内部端子OUTは、IC内部回路に接続しており、IC内部回路に発振回路C3の出力信号を送る。
スイッチ素子S0は、外部端子1とノード5の間に接続されており、その間に経路をつくる。スイッチ素子S0をON/OFF制御する制御信号端子は内部端子N0に接続している。内部端子N0はIC内部回路に接続し、IC内部回路からの信号を受信する。
内蔵帰還抵抗Rfi1はノード5とノード3の間に接続し、内蔵帰還抵抗Rfi2はノード3と外部端子2の間に接続している。
スイッチ素子S1は、ノード5とノード3の間に接続されており(つまり内蔵帰還抵抗Rfi1に並列に接続されており)、その間に経路をつくる。スイッチ素子S1のON/OFFを制御する制御信号端子は内部端子N1に接続している。内部端子N1は、IC内部回路に接続しており、IC内部回路からの信号を受ける。
スイッチ素子S2は外部端子2とノード3の間に接続されており(つまり内蔵帰還抵抗Rfi2に並列に接続されており)、その間に経路をつくる。スイッチ素子S2をON/OFF制御する制御信号端子は内部端子N2に接続している。内部端子N2は、IC内部回路に接続しており、IC内部回路からの信号を受ける。
一方、IC外部には、振動子(水晶振動子またはセラミック振動子)X、ダンピング抵抗Rd、およびコンデンサCg,Cdが接続される。振動子Xは外部端子1とノード4の間に接続され、ダンピング抵抗Rdは外部端子2とノード4の間に接続され、コンデンサCgは外部端子1とGND間に接続され、コンデンサCdはノード4とGND間に接続される。
スイッチ素子S0は内部端子N0に入力される制御信号の論理値に応じてON/OFFする。図1の発振回路C3では、内部端子N0に“1”が入力されるとスイッチ素子S0がON、“0”が入力されるとOFFする。なお、逆の論理とすることも可能である。
図2は実施の形態1の発振回路C3の外部端子1に流れるリーク電流の測定法を示す図である。図2において、内部端子N0からの制御信号によってスイッチ素子0をOFFし、外部端子1から内蔵抵抗を絶縁した状態で、外部端子1に直流電圧V1を印加したときに外部端子1に流れる微小な電流をリーク電流として測定する。
スイッチ素子S1は内部端子N1に入力される制御信号の論理値に応じてON/OFFする。図1の発振回路C3では、内部端子N1に“1”が入力されるとスイッチ素子S1がON、“0”が入力されるとOFFする。なお、逆の論理とすることも可能である。
N1=“0”,N2=“0”のとき、帰還抵抗=2[MΩ]、
N1=“0”,N2=“1”のとき、帰還抵抗=1.6[MΩ]、
N1=“1”,N2=“0”のとき、帰還抵抗=0.4[MΩ]
となる。
図4は本発明の実施の形態2の発振回路C4を示す回路図である。この発振回路C4は、半導体ICの内部に設けられる。なお、図4において、上記図1と同様のものには同じ符号を付してある。
スイッチ素子S3は、外部端子1とノード3に接続されており、(つまりスイッチ素子S1に並列に接続されており)、その間に経路をつくる。スイッチ素子S3をON/OFF制御する制御信号端子は内部端子N3に接続している。内部端子N3は、IC内部回路に接続しており、IC内部回路からの信号を受ける。
スイッチ素子S4は、外部端子2とノード3に接続されており、(つまりスイッチ素子S2に並列に接続されており)、その間に経路をつくる。スイッチ素子S4をON/OFF制御する制御信号端子は内部端子N4に接続している。内部端子N4は、IC内部回路に接続しており、IC内部回路からの信号を受ける。
スイッチ素子S1は内部端子N1に入力される制御信号の論理値に応じてON/OFFし、スイッチ素子S2は内部端子N2に入力される制御信号の論理値に応じてON/OFFし、スイッチ素子S3は内部端子N3に入力される制御信号の論理値に応じてON/OFFし、スイッチ素子S4は内部端子N4に入力される制御信号の論理値に応じてON/OFFする。
1,2 外部端子
3,4,5 ノード
I1 インバータ回路
I2 バッファ回路
Rfi1,Rfi2 内蔵抵抗
S0,S1,S2,S3,S4 スイッチ素子
OUT,N0,N1,N2 内部端子
X 振動子
Cg,Cd コンデンサ
Rd ダンピング抵抗
Claims (6)
- 半導体集積回路で構成され、振動子を外付けして所定の周波数の発振信号を得る発振回路において、
上記振動子が外部接続される第1および第2の外部端子と、
上記第1および第2の外部端子間に接続されたインバータ回路と、
一端が上記第1の外部端子に接続され、第1の入力制御信号に従ってオン/オフする第1のスイッチ素子と、
上記第1のスイッチ素子の他端と上記第2の外部端子の間に接続された第1の内蔵抵抗と
を備えた
ことを特徴とする発振回路。 - 上記第1の内蔵抵抗と上記第2の外部端子の間に接続された第2の内蔵抵抗と、
上記第1の内蔵抵抗に並列に接続され、第2の入力制御信号に従ってオン/オフする第2のスイッチ素子と、
上記第2の内蔵抵抗に並列に接続され、第3の入力制御信号に従ってオン/オフする第3のスイッチ素子と
をさらに備えた
ことを特徴とする請求項1記載の発振回路。 - 半導体集積回路で構成され、振動子を外付けして所定の周波数の発振信号を得る発振回路において、
上記振動子が外部接続される第1および第2の外部端子と、
上記第1および第2の外部端子間に接続されたインバータ回路と、
上記インバータ回路に並列に接続され、第1の入力制御信号に従ってオン/オフし、所定のオン抵抗値を有する第1のスイッチ素子と
を備えた
ことを特徴とする発振回路。 - 上記第1のスイッチ素子に並列に接続され、第2の入力制御信号に従ってオン/オフし、所定のオン抵抗値を有する第2のスイッチ素子を備えたことを特徴とする請求項3記載の発振回路。
- 上記第1および第2のスイッチ素子からなる並列回路と上記第2の外部端子の間に接続され、第3の入力制御信号に従ってオン/オフし、所定のオン抵抗値を有する第3のスイッチ素子をさらに備えたことを特徴とする請求項4記載の発振回路。
- 上記第3のスイッチ素子に並列に接続され、第4の入力制御信号に従ってオン/オフし、所定のオン抵抗値を有する第4のスイッチ素子を備えたことを特徴とする請求項5記載の発振回路。
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