JP2004023878A - 電源欠相検出回路付コンバータ - Google Patents
電源欠相検出回路付コンバータ Download PDFInfo
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Abstract
【解決手段】3相交流電源1から出力された3相の交流電圧R、S、Tは3相全波整流回路2で全波整流されて直流電圧P、Nが得られる。直流電圧P、Nは絶縁回路3で絶縁後、検出電圧VACにレベル変換される。検出電圧VACは比較器4で低電圧レベルUVLと比較され、VACがUVL以下のときにハイレベルとなる低電圧検出信号UVSが出力される。この低電圧検出信号UVSはCPU5に汎用ポートP1より入力され、低電圧検出信号UVSが所定の時間内に所定の回数よりも多く入力されると、電源の欠相が発生したと判断する。
【選択図】図1
Description
【発明の属する技術】
本発明は3相交流電圧を直流に変換するコンバータに関し、特に電源の欠相を検出する方法に関する。
【0002】
【従来の技術】
特開平06―335154号では、交流電圧から直流に変換された直流電圧の変動量から電源の欠相を検出する方法が開示されている。
【0003】
図4はこの従来例の構成図である。インバータ装置22の入力端にフィルタコンデンサ23が接続されている。フィルタコンデンサ23の両端電圧は電圧検出器24によって検出され、サンプリング回路25で架線を流れる交流周波数の2倍の周波数の周期で抽出される。そして微分演算回路26、絶対値演算回路27、一次遅れ回路28に入力することにより、両端電圧の変動量の累積値が得られる。この累積値V4は制御装置29に入力され、所定の基準値C1と比較して異常値と判断され続ける時間t(w)が所定の基準時問C2以上となった場合に、ゲート制御部30からインバータ装置22に対して保護動作指令が出力される。
【0004】
【発明が解決しようとする課題】
上記公報に記載された従来技術では、回生時に直流電圧が上がり、欠相時にも直流電圧の変動が起きるため、回生時の電圧変動と欠相時の電圧変動を見分けることが難しい。このため、回生時において欠相を誤検出する可能性がある。
【0005】
そこで、本発明の目的は、力行、回生時にかかわらず電源欠相を検出できる電源欠相回路付きコンバータを提供することにある。
【0006】
【課題を解決するための手段】
上記目的を達成するために、本発明のコンバータは、3相交流電圧が全波整流された検出電圧を所定の低電圧レベルと比較し、検出電圧が低電圧レベルを下回ったとき低電圧検出信号を出力する低電圧検出手段と、低電圧検出信号が所定の時間内に所定の回数よりも多く出力されたとき、電源の欠相が発生したと判断する処理手段を有する。
【0007】
所定の時間内に所定の回数よりも多く低電圧検出信号が発生したとき電源が欠相したと判断するが、電圧の変動回数は力行、回生に無関係なので、力行、回生にかかわらず電源欠相を検出できる。
【0008】
【発明の実施の形態】
次に、本発明の実施形態について図面を参照して説明する。
【0009】
図1は本発明の一実施形態の電源欠相検出回路の構成図である。3相交流電源1から出力された3相の交流電圧R、S、Tは3相全波整流回路2で全波整流されて直流電圧P、Nが得られる。直流電圧P、Nは絶縁回路3で絶縁後、検出電圧VACにレベル変換される。検出電圧VACは比較器4で低電圧レベルUVLと比較され、VACがUVL以下のときにハイレベルとなる低電圧検出信号UVSが出力される。この低電圧検出信号UVSはCPU5に汎用ポートP1より入力され、欠相検出処理が実行される。ここで、CPU5で500μs毎の割り込みで欠相検出処理が実行され、100msで欠相を検出するものと仮定する。
【0010】
図2は欠相検出処理のフローチャートである。ステップ11で、低電圧検出信号UVSが立ち上がると、ステップ12に低電圧検出信号UVSの回数を示すカウンタAが+1インクリメントされる。ステップ13で、カウンタAが零かどうか判定する。零でなければステップ14で、時間カウンタであるカウンタBが+1にインクリメントされる。ステップ15で、カウンタBが200を超えた、つまり低電圧が100ms経過したどうか判定する。超えていなければ、そのまま何もせずに戻る。超えていれば、ステップ16で、カウンタAが10以上かどうか判定する。10以上であれば、電源の欠相が発生したものとして欠相異常処理(コンバータの運転の停止、故障の表示、上位シーケンサとドライブ装置への故障の報告)を行う。カウンタAが10未満およびステップ17の処理の後、ステップ18で、カウンタA、Bを共に零にクリヤする。
【0011】
ここで、T相が欠相したとすると、図3のT相時の波形のようにR、Sの合成波形となる。そのため電源1周期あたり二回低電圧検出信号UVSがハイレベルとなる。低電圧検出信号UVSの回数と時間の関係を表1に示す。
【0012】
【表1】
このように欠相発生時は低電圧検出信号UVSが周期的にハイ/ロウを繰り返すので、最初の低電圧検出信号UVSの立ち上がりから100msをカウンタBで計測し、その間にカウンタAで計測した低電圧検出信号UVSの発生回数が10回以上であれば欠相と判断する。
【0013】
【発明の効果】
以上説明したように、本発明は、3相全波整流された検出電圧と予め定められた低電圧レベルと比較し、検出電圧が低電圧レベルを下回ったとき低電圧検出信号を出力する低電圧検出手段を備え、予め定められた時間内に予め定められた回数より多くの低電圧検出信号が発生した場合、電源の欠相と判断することにより、力行、回生に拘らず電源の欠相を検出できる。
【図面の簡単な説明】
【図1】本発明の一実施形態の電源欠相検出回路付コンバータのブロック図である。
【図2】電源欠相検出処理のフローチャートである。
【図3】電源欠相検出処理のタイミングチャートである。
【図4】従来例の構成図である。
【符号の説明】
1 3相電源
2 3相全波整流回路
3 絶縁回路
4 比較器
5 CPU
11〜18 ステップ
R、S、T 3相交流電圧
P 直流電圧(P側)
N 直流電圧(N側)
VAC 検出電圧
UVS 低電圧検出信号
Claims (1)
- 3相交流電圧を直流に変換するコンバータにおいて、
3相交流電圧が全波整流された検出電圧を所定の低電圧レベルと比較し、前記検出電圧が前記低電圧レベルを下回ったとき低電圧検出信号を出力する低電圧検出手段と、
前記低電圧検出信号が所定の時間内に所定の回数よりも多く出力されたとき、電源の欠相が発生したと判断する処理手段を有することを特徴とする電源欠相検出回路付コンバータ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2002174742A JP2004023878A (ja) | 2002-06-14 | 2002-06-14 | 電源欠相検出回路付コンバータ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2002174742A JP2004023878A (ja) | 2002-06-14 | 2002-06-14 | 電源欠相検出回路付コンバータ |
Publications (1)
Publication Number | Publication Date |
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JP2004023878A true JP2004023878A (ja) | 2004-01-22 |
Family
ID=31173636
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2002174742A Pending JP2004023878A (ja) | 2002-06-14 | 2002-06-14 | 電源欠相検出回路付コンバータ |
Country Status (1)
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- 2002-06-14 JP JP2002174742A patent/JP2004023878A/ja active Pending
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