JP2002203868A - 電極の形成方法 - Google Patents
電極の形成方法Info
- Publication number
- JP2002203868A JP2002203868A JP2000399292A JP2000399292A JP2002203868A JP 2002203868 A JP2002203868 A JP 2002203868A JP 2000399292 A JP2000399292 A JP 2000399292A JP 2000399292 A JP2000399292 A JP 2000399292A JP 2002203868 A JP2002203868 A JP 2002203868A
- Authority
- JP
- Japan
- Prior art keywords
- film
- forming
- plating
- electrode layer
- laminated
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
- H01L2224/1147—Manufacturing methods using a lift-off mask
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
- H01L2224/115—Manufacturing methods by chemical or physical modification of a pre-existing or pre-deposited material
- H01L2224/11502—Pre-existing or pre-deposited material
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
- H01L2224/118—Post-treatment of the bump connector
- H01L2224/11848—Thermal treatments, e.g. annealing, controlled cooling
- H01L2224/11849—Reflowing
Landscapes
- Wire Bonding (AREA)
Abstract
に形成する。 【解決手段】 レジスト膜107の開口108の底部に
露出するNi/Pd積層膜106上に選択的に、それぞ
れ電解めっき法を用いて形成されたAgめっき膜109
及びSnめっき膜111からなる積層膜を形成する工程
と、レジスト膜107及びNi/Pd積層膜106を除
去し、露出するNi/Pd積層膜106の表面に選択的
に自然酸化膜201を形成する工程と、自然酸化膜20
1が形成された状態で、電解めっき法を用いて、前記積
層膜109,111の表面にCuめっき膜110を形成
する工程と、前記積層膜109,111とCuめっき膜
110とを合金化させハンダバンプ112を形成する工
程と、ハンダバンプ112をマスクにして、Ti膜10
5を除去する工程とを含む。
Description
Sn−Ag三元系ハンダからなる電極の形成方法に関す
る。
リント配線基板有する電子機器が廃棄時に戸外に放置さ
れて雨が当たると、ハンダからPbが次第に溶け出す。
Pbは、環境や人体に悪影響を及ぼす恐れがある。その
ため、Pbを含まないハンダ、いわゆるPbフリーハン
ダへの置き換えが図られている。
Ag三元系のハンダがある。Sn−Ag三元系ハンダ
は、Sn,Agに微量のCu又はBiを添加(0.5〜
4重量%)した合金である。
プにも同様に鉛を用いないハンダを用いることが提唱さ
れている。ハンダバンプの形成には、めっき法、蒸着法
等が用いられる。
必要な部分以外の電極材を除去する。バンプに必要な部
分は微小であるので、蒸着法では電極材の無駄が多くな
る。Sn−Ag−Cu三元系ハンダ用のバンプは高価な
Agを含んでおり、材料の無駄が多い蒸着法は向かな
い。
は、めっき法を用いて形成されることが考えられてい
る。ところが、めっき法を用いて面内の組成が均一な三
元系のめっき膜を形成するの技術は無いという問題があ
った。その結果、面内のハンダの組成のばらつきによ
り、ハンダバンプの融点が面内で異なり、実装時の歩留
まり低下が懸念されるという問題があった。
き法を用いて面内の組成が均一な三元系のめっき膜を形
成するの技術が無い。よって、面内のハンダの組成のバ
ラツキにより、実装時の歩留まり低下が懸念されるとい
う問題があった。
Ag三元系ハンダからなる電極の形成方法において、面
内のハンダの組成を均一にし、歩留まりの向上が図り得
る電極形成方法を提供することにある。
目的を達成するために以下のように構成されている。
形成方法は、被処理基板上に第1の電極層を形成する工
程と、第1の電極層上に、貴金属を含む第2の電極層を
形成する工程と、前記第2の電極層上に開口を有するマ
スク層を形成する工程と、前記マスク層の開口の底部に
露出する第2の電極層上に選択的に、それぞれ電解めっ
き法を用いてAg膜及びSn膜からなる積層膜を形成す
る工程と、前記マスク層及び第2の電極層を除去し、露
出する第1の電極層の表面を酸化して絶縁膜を形成する
工程と、前記絶縁膜が形成された状態で、電解めっき法
を用いて、前記積層膜の表面に選択的にめっき膜を形成
する工程と、前記積層膜とめっき膜との合金を形成する
工程と、前記合金をマスクにして、第1の電極層を除去
する工程とを含むことを特徴とする。第2の電極層は、
Ni膜と貴金属膜とが順次積層された積層膜であること
が好ましい。
することが好ましい。 (2)本発明(請求項4)に係わる電極形成方法は、被
処理基板上に貴金属を含む電極層を形成する工程と、前
記電極層上に開口を有するマスク層を形成する工程と、
前記マスク層の開口の底部に露出する前記電極層上に選
択的に、それぞれ電解めっき法を用いてAg膜及びSn
膜からなる積層膜を形成する工程と、前記マスク層を除
去した後に、前記積層膜をマスクにして前記電極層を除
去する工程と、前記電極層が除去された後に、無電解め
っき法を用いて前記積層膜の表面にめっき膜を形成する
工程と、前記積層膜とめっき膜との合金を形成する工程
とを含むことを特徴とする。前記バリアメタル層は、T
i膜又はTa膜と、Ni膜と、Pd膜とが順次積層され
た積層膜であることが好ましい。上記二つの発明におい
ては、前記めっき膜がCu膜或いはBi膜であることが
好ましい。
の作用・効果を有する。
を構成する元素の組成比に応じて、各めっき膜を順次形
成することによって、組成制御が容易になる。さらに、
貴金属が含まれる層を除去した後に、Cu又はBiを含
むめっき膜を形成することによって、精密な組成制御を
行うことができる。
用いることによって、第2の電極層を除去した後に、第
1の電極層を大気にさらすことによって、第1の電極層
の表面に自然酸化膜が形成されるので、特別な処理を用
いずに、露出する第1の電極層の表面に選択的に絶縁膜
を形成することができる。
を参照して説明する。なお、本発明は、ICのダイ、又
は実装基板に形成されるハンダバンプに適用することが
できる。
実施形態に係わるハンダバンプの製造工程を示す工程断
面図である。先ず、図1(a)に示すように、絶縁層1
01のコンタクトホール内に形成されたプラグ102に
接続するパッド電極103を絶縁層101上に形成す
る。次に全面にポリイミド等のパッシベーション層10
4を形成した後、パッシベーション層104に底部にパ
ッド電極103が露出する開口を形成する。次に、電解
めっき時の通電層及びバリアメタルとして、スパッタ法
を用いてTi膜105、及びNi/Pd積層膜106を
同一チャンバ内で連続して蒸着する。
50μm以上のレジスト膜107を塗布した後、リソグ
ラフィ手法により、バンプを形成する箇所のみレジスト
膜107に開口108を形成する。通常、レジスト膜1
07に形成される開口の位置は、パッド電極上である。
105及びNi/Pd積層膜106に通電して、電解め
っき法を用いて、Agめっき膜109,Cuめっき膜1
10,Snめっき膜111の順で、2μm,0.5μ
m,50μmの膜厚比で積層する。電解めっき法を用い
ているので、Agめっき膜109,Cuめっき膜110
及びSnめっき膜111の積層膜は、開口の底部に露出
するNi/Pd積層膜106上に選択的に形成される。
難しいので上述した順番で順次めっき膜を形成すること
が好ましい。
いで、Ag/Cu/Snめっき積層膜109,110,
111をマスクとして、不要となったTi膜105及び
Ni/Pd積層膜106をエッチングする。
り、Agめっき膜109,Cuめっき膜110,及びS
nめっき膜111を共晶化により合金化し、ハンダバン
プ112を形成する。
ンダバンプを構成する元素の成分比に応じて、めっき膜
を順次形成することによって、面内のハンダバンプの組
成を均一にすることができる。
た方法によれば、元素の成分比に応じた膜厚比のめっき
膜を順次形成することによって、ハンダに応じたバンプ
を形成することができる。ところが、以下に示すような
問題点があった。
は、強い酸を用いたエッチング溶液を用いる必要があ
る。Pdのウエットエッチング時にCuめっき膜も優先
的にエッチングされてしまい、ウェハ面内でのハンダバ
ンプ組成にバラツキが生じ、実装時の歩留まり低下が懸
念されるという問題があった。
ング量を考慮してCuめっき膜を形成して、組成比を合
わせるという方法が考えられる。元々のハンダバンプ中
のCuの量は微量(重量比で0.5〜4%以下程度)で
あり、Cuのエッチング量を見積もることは非常に難し
いので、精密な組成制御が困難であるという問題があっ
た。次の第2,3の実施形態では、より精密に組成制御
を行うことが出来る電極形成方法について説明する。
の実施形態に係わるハンダ電極の形成方法を示す工程断
面図である。先ず、図2(a)に示すように、絶縁層1
01のコンタクトホール内に形成されたプラグ102に
接続するパッド電極103を絶縁層101上に形成す
る。次に全面にポリイミド等のパッシベーション層10
4を形成した後、パッシベーション層104にパッド電
極103が露出する開口を形成する。次に、電解めっき
時の通電層及びバリアメタルとして、スパッタ法を用い
てTi膜105、及びNi/Pd積層膜106を連続し
て蒸着し、バリアメタル層を形成する。
50μm以上のレジスト膜107を塗布した後、リソグ
ラフィ手法により、バンプを形成する箇所のみレジスト
膜107に開口108を形成する。
っき法を用いて、開口に底部に露出するNi/Pd積層
膜106上に、Agめっき膜109及びSnめっき膜1
11を順次積層する。Agめっき膜109の膜厚は2μ
m、Snめっき膜111の膜厚は50μmである。な
お、Sn膜上にAg膜を堆積することは難しいので上述
した順番で順次めっき膜を形成することが好ましい。
ト膜107の剥離を行う。次いで、図2(e)に示すよ
うに、Agめっき膜109及びSnめっき膜111をマ
スクにして、Ni/Pd積層膜106をウエットエッチ
ングにより除去する。この際、用いられるエッチング溶
液としては、逆王水系のエッチング液が挙げられる。積
層膜のエッチング後、大気にさらされることによって、
Ti膜105上には、自然酸化膜201が形成される。
化膜201を貫通し、Ti膜105に接続する導電ピン
に通電しつつ、電解めっき法を用いてAgめっき膜10
9及びSnめっき膜111の表面にCuめっき膜110
を選択的に堆積させる。Ti膜105の表面には自然酸
化膜201が形成されているので、Cuめっき膜110
は電解めっき法によりAgめっき膜109及びSnめっ
き膜111の表面に選択的に形成される。
ハンダリフロー処理により、Agめっき膜109,Sn
めっき膜111,及びCuめっき膜110を共晶化させ
て合金化し、Sn−Ag−Cu系のハンダバンプ112
を形成する。次に、ハンダバンプ112をマスクに残存
するTi膜105をウエットエッチングにより除去する
この際用いられるエッチング駅としては過酸化水素水を
含有するエッチング液が挙げられる。なお、リフロー処
理とTi膜のエッチング工程との順番を逆にしても良
い。リフロー処理の前にTi膜のエッチングを行う場合
には、Agめっき膜109,Snめっき膜111,及び
Cuめっき膜110がマスクとして用いられる。
じて、めっき膜を順次形成することによって、ハンダバ
ンプを容易に形成することができるとういう効果に加え
て以下の効果がある。貴金属を含む金属層をウエットエ
ッチングした後に、Cuめっき膜を形成することによっ
て、Cuめっき膜の堆積量の制御が容易となり、ハンダ
バンプの組成制御が容易になる。
積層膜をエッチングした後大気にさらすことによって、
同様に自然酸化膜が形成される。よって、電解めっき法
を用いてSnとAgとの積層膜の表面に選択的にめっき
膜を形成することができる。
の実施形態に係わるハンダバンプの製造工程を示す工程
断面図である。先ず、図3(a)に示すように、絶縁層
101のコンタクトホール内に形成されたプラグ102
に接続するパッド電極103を絶縁層101上に形成す
る。次に全面にポリイミド等のパッシベーション層10
4を形成した後、パッシベーション層104にパッド電
極103が露出する開口を形成する。次に、電解めっき
時の通電層及びバリアメタルとして、スパッタ法を用い
てTi膜105、及びNi/Pd積層膜106を連続し
て蒸着する。
50μm以上のレジスト膜107を塗布した後、リソグ
ラフィ手法により、バンプを形成する箇所のみレジスト
膜107に開口108を形成する。
っき法を用いて、開口108の底部に露出するNi/P
d積層膜106上に、Agめっき膜109及びSnめっ
き膜111を順次堆積する。Agめっき膜109の膜厚
は2μm、Snめっき膜111の膜厚は50μmであ
る。
ト膜を除去する。次いで、図3(e)に示すように、A
gめっき膜109及びSnめっき膜111の積層膜をマ
スクにして、Ni/Pd積層膜106をウエットエッチ
ングにより除去する。その後、Ti膜105をウエット
エッチングにより除去する。
めっき法によりAgめっき膜及びSnめっき膜の表面に
選択的に、Cuめっき膜110を形成する。Cuめっき
膜110の膜厚は0.5μmである。
ハンダリフロー処理により、Agめっき膜109,Sn
めっき膜111,及びCuめっき膜110を共晶化させ
て合金化し、Sn−Ag−Cu系のハンダバンプ112
を形成する。
除去した後に、Cu膜を形成しているので、第2の実施
形態と同様の効果がある。なお、本実施形態では、バリ
アメタル層として、3層構造の電極材を用いたが、貴金
属を含めば2層であっても良い。
るものではない。例えば、上記実施形態では、Cuを添
加したSn−Ag三元系ハンダバンプについて説明した
が、Biを添加したSn−Ag三元系ハンダバンプにつ
いても本発明を適用することができる。
範囲で、種々変形して実施することが可能である。
極を構成する元素の組成比に応じて、各めっき膜を順次
形成することによって、組成制御が容易になる。さら
に、貴金属が含まれる層を除去した後に、Cu又はBi
を含むめっき膜を形成することによって、更に精密な組
成制御を行うことができる。
法を示す図。
法を示す図。
法を示す図。
Claims (6)
- 【請求項1】被処理基板上に第1の電極層を形成する工
程と、 第1の電極層上に、貴金属を含む第2の電極層を形成す
る工程と、 前記第2の電極層上に開口を有するマスク層を形成する
工程と、 前記マスク層の開口の底部に露出する第2の電極層上に
選択的に、それぞれ電解めっき法を用いてAg膜及びS
n膜からなる積層膜を形成する工程と、 前記マスク層及び第2の電極層を除去し、露出する第1
の電極層の表面を酸化し絶縁膜を形成する工程と、 前記絶縁膜が形成された状態で、電解めっき法を用い
て、前記積層膜の表面に選択的にめっき膜を形成する工
程と、 前記積層膜とめっき膜との合金を形成する工程と、 前記合金をマスクにして、第1の電極層を除去する工程
とを含むことを特徴とする電極の形成方法。 - 【請求項2】第2の電極層は、Ni膜と貴金属膜とが順
次積層された積層膜であることを特徴とする請求項1に
記載の電極の形成方法。 - 【請求項3】第1の電極層は、Ti又はTaを主成分と
することを特徴とする請求項1に記載の電極の形成方
法。 - 【請求項4】被処理基板上に貴金属を含む電極層を形成
する工程と、 前記電極層上に開口を有するマスク層を形成する工程
と、 前記マスク層の開口の底部に露出する前記電極層上に選
択的に、それぞれ電解めっき法を用いてAg膜及びSn
膜からなる積層膜を形成する工程と、 前記マスク層wy除去した後に、前記積層膜をマスクに
して前記電極層を除去する工程と、 前記電極層を除去した後に、無電解めっき法を用いて前
記積層膜の表面にめっき膜を形成する工程と、 前記積層膜とめっき膜との合金を形成する工程とを含む
ことを特徴とする電極の形成方法。 - 【請求項5】前記電極層は、Ti膜又はTa膜と、Ni
膜と、Pd膜とが順次積層された積層膜であることを特
徴とする請求項4に記載の電極の形成方法。 - 【請求項6】前記めっき膜が、Cu膜或いはBi膜であ
ることを特徴とする請求項1又は4に記載の電極の形成
方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000399292A JP3682227B2 (ja) | 2000-12-27 | 2000-12-27 | 電極の形成方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000399292A JP3682227B2 (ja) | 2000-12-27 | 2000-12-27 | 電極の形成方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2002203868A true JP2002203868A (ja) | 2002-07-19 |
JP3682227B2 JP3682227B2 (ja) | 2005-08-10 |
Family
ID=18864089
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2000399292A Expired - Fee Related JP3682227B2 (ja) | 2000-12-27 | 2000-12-27 | 電極の形成方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3682227B2 (ja) |
Cited By (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2006004809A1 (en) * | 2004-06-30 | 2006-01-12 | Unitive International Limited | Methods of forming lead free solder bumps and related structures |
KR100850212B1 (ko) | 2007-04-20 | 2008-08-04 | 삼성전자주식회사 | 균일한 무전해 도금 두께를 얻을 수 있는 반도체 소자의제조방법 |
JP2010003914A (ja) * | 2008-06-20 | 2010-01-07 | Toshiba Corp | 半田バンプの製造方法 |
US7709293B2 (en) | 2007-03-02 | 2010-05-04 | Fujitsu Limited | Semiconductor device and manufacturing method of the semiconductor device |
US7839000B2 (en) | 2002-06-25 | 2010-11-23 | Unitive International Limited | Solder structures including barrier layers with nickel and/or copper |
US7879715B2 (en) | 2002-06-25 | 2011-02-01 | Unitive International Limited | Methods of forming electronic structures including conductive shunt layers and related structures |
WO2012101975A1 (ja) * | 2011-01-26 | 2012-08-02 | 三菱マテリアル株式会社 | Sn合金バンプの製造方法 |
DE102013108986A1 (de) | 2012-08-24 | 2014-02-27 | Tdk Corporation | Anschlussstruktur sowie Halbleiterelement und Modelsubstrat mit einer solchen Anschlussstruktur |
DE102013108979A1 (de) | 2012-08-24 | 2014-02-27 | Tdk Corporation | Anschlussstruktur und Halbleiterbauelement |
US8970037B2 (en) | 2012-08-24 | 2015-03-03 | Tdk Corporation | Terminal structure, and semiconductor element and module substrate comprising the same |
US9070606B2 (en) | 2012-08-24 | 2015-06-30 | Tdk Corporation | Terminal structure and semiconductor device |
WO2016056656A1 (ja) * | 2014-10-10 | 2016-04-14 | 石原ケミカル株式会社 | 合金バンプの製造方法 |
-
2000
- 2000-12-27 JP JP2000399292A patent/JP3682227B2/ja not_active Expired - Fee Related
Cited By (27)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7839000B2 (en) | 2002-06-25 | 2010-11-23 | Unitive International Limited | Solder structures including barrier layers with nickel and/or copper |
US8294269B2 (en) | 2002-06-25 | 2012-10-23 | Unitive International | Electronic structures including conductive layers comprising copper and having a thickness of at least 0.5 micrometers |
US7879715B2 (en) | 2002-06-25 | 2011-02-01 | Unitive International Limited | Methods of forming electronic structures including conductive shunt layers and related structures |
WO2006004809A1 (en) * | 2004-06-30 | 2006-01-12 | Unitive International Limited | Methods of forming lead free solder bumps and related structures |
US7709293B2 (en) | 2007-03-02 | 2010-05-04 | Fujitsu Limited | Semiconductor device and manufacturing method of the semiconductor device |
KR100958857B1 (ko) * | 2007-03-02 | 2010-05-20 | 후지쯔 가부시끼가이샤 | 반도체 장치 및 그 제조 방법 |
US7956468B2 (en) | 2007-03-02 | 2011-06-07 | Fujitsu Limited | Semiconductor device |
KR100850212B1 (ko) | 2007-04-20 | 2008-08-04 | 삼성전자주식회사 | 균일한 무전해 도금 두께를 얻을 수 있는 반도체 소자의제조방법 |
JP2010003914A (ja) * | 2008-06-20 | 2010-01-07 | Toshiba Corp | 半田バンプの製造方法 |
US8822326B2 (en) | 2011-01-26 | 2014-09-02 | Mitsubishi Materials Corporation | Method for manufacturing Sn alloy bump |
WO2012101975A1 (ja) * | 2011-01-26 | 2012-08-02 | 三菱マテリアル株式会社 | Sn合金バンプの製造方法 |
JP2012153939A (ja) * | 2011-01-26 | 2012-08-16 | Mitsubishi Materials Corp | Sn合金バンプの製造方法 |
EP2669937A4 (en) * | 2011-01-26 | 2016-07-27 | Mitsubishi Materials Corp | METHOD FOR PRODUCING AN SN ALLOYING BUFFER |
DE102013108979A1 (de) | 2012-08-24 | 2014-02-27 | Tdk Corporation | Anschlussstruktur und Halbleiterbauelement |
US9640500B2 (en) | 2012-08-24 | 2017-05-02 | Tdk Corporation | Terminal structure and semiconductor device |
US9070606B2 (en) | 2012-08-24 | 2015-06-30 | Tdk Corporation | Terminal structure and semiconductor device |
US9257402B2 (en) | 2012-08-24 | 2016-02-09 | Tdk Corporation | Terminal structure, and semiconductor element and module substrate comprising the same |
DE102013108979A9 (de) | 2012-08-24 | 2016-04-07 | Tdk Corporation | Anschlussstruktur und Halbleiterbauelement |
DE102013108979B4 (de) | 2012-08-24 | 2020-01-23 | Tdk Corporation | Anschlussstruktur und Halbleiterbauelement |
DE102013108986A1 (de) | 2012-08-24 | 2014-02-27 | Tdk Corporation | Anschlussstruktur sowie Halbleiterelement und Modelsubstrat mit einer solchen Anschlussstruktur |
US8970037B2 (en) | 2012-08-24 | 2015-03-03 | Tdk Corporation | Terminal structure, and semiconductor element and module substrate comprising the same |
DE102013108986B4 (de) | 2012-08-24 | 2019-07-25 | Tdk Corporation | Anschlussstruktur sowie Halbleiterelement und Modulsubstrat mit einer solchen Anschlussstruktur |
JPWO2016056656A1 (ja) * | 2014-10-10 | 2017-09-14 | 石原ケミカル株式会社 | 合金バンプの製造方法 |
EP3206225A4 (en) * | 2014-10-10 | 2018-07-04 | Ishihara Chemical Co., Ltd. | Method for manufacturing alloy bump |
US10062657B2 (en) | 2014-10-10 | 2018-08-28 | Ishihara Chemical Co., Ltd. | Method for manufacturing alloy bump |
KR101778498B1 (ko) | 2014-10-10 | 2017-09-13 | 이시하라 케미칼 가부시키가이샤 | 합금 범프의 제조방법 |
WO2016056656A1 (ja) * | 2014-10-10 | 2016-04-14 | 石原ケミカル株式会社 | 合金バンプの製造方法 |
Also Published As
Publication number | Publication date |
---|---|
JP3682227B2 (ja) | 2005-08-10 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US4016050A (en) | Conduction system for thin film and hybrid integrated circuits | |
USRE46147E1 (en) | Semiconductor device and method of fabricating the same | |
JP3748785B2 (ja) | 鉛フリーバンプの形成方法 | |
JP3210547B2 (ja) | 電気めっきはんだ端子およびその製造方法 | |
US9177827B2 (en) | Etchant and method for manufacturing semiconductor device using same | |
JP2001351940A (ja) | Icチップにおいて銅相互接続配線 | |
JP3682227B2 (ja) | 電極の形成方法 | |
US8900478B2 (en) | Etchant and method for manufacturing semiconductor device using same | |
JPH1032208A (ja) | 半導体装置の製造方法 | |
JP2008028112A (ja) | 半導体装置の製造方法 | |
JP2005057264A (ja) | パッケージ化された電気構造およびその製造方法 | |
JP2001118872A (ja) | バンプの形成方法 | |
JP2000349111A (ja) | はんだ接合用電極 | |
JP2005244157A (ja) | プリント配線基板、その製造方法および半導体装置 | |
JP2000012605A (ja) | 半導体チップの電極部の形成方法 | |
JP3916850B2 (ja) | 半導体装置 | |
JPH0137876B2 (ja) | ||
JPH07201922A (ja) | 基板上へのハンダバンプの形成方法 | |
JP2006120803A (ja) | 半導体装置及び半導体装置の製造方法 | |
TWI287285B (en) | Fabricating method of solder bump and structure thereof | |
JP3297717B2 (ja) | 半導体装置の電極形成方法 | |
JP3980473B2 (ja) | 電子部品の製造方法 | |
JPH04217323A (ja) | 半導体装置用バンプ電極の製造方法 | |
TWI244187B (en) | Method of forming conductive connection structure on multilayer board and structure thereof | |
JP4157693B2 (ja) | 半導体装置及びその製造方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20040311 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20040316 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20040517 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20050517 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20050520 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090527 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090527 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100527 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110527 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110527 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120527 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120527 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130527 Year of fee payment: 8 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130527 Year of fee payment: 8 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140527 Year of fee payment: 9 |
|
LAPS | Cancellation because of no payment of annual fees |