JP2001118805A - (Cu−C)シード層の形成法 - Google Patents
(Cu−C)シード層の形成法Info
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Abstract
タクトホールの凹部をスパッタ法、メッキ法等により配
線金属で容易に埋め込むことができるようにする技術の
提供。 【解決手段】 配線溝、ビアホール、コンタクトホール
の凹部に配線に利用するCuを埋め込む前の半導体基板
上に、Cu微粒子を有機溶媒に分散させたCu微粒子分
散液またはCu有機塩溶液を塗布し、塗布膜の形成され
た基板を焼成して、塗布膜中の有機物質を蒸発および燃
焼せしめることにより(Cu−C)シード層を形成する。
Description
半導体基板上ヘの、スパッタ法、メッキ法、CVD法等
によるCuの埋め込みを容易にするために、該基板上に
(Cu−C)シード層を形成する方法に関するものであ
る。
積化及び高速化により、半導体基板の配線の微細化と多
層化が進んでいる。そのために配線ピッチが狭まり、配
線間容量や配線遅延によるLSIの性能低下が起こる。
これを防ぐために、抵抗率の低い配線材料と誘電率の低
い層間絶縁膜を用いる必要に迫られ、配線材料として、
従来のAl合金等の代わりに抵抗率の低い、かつ、エレ
クトロマイグレーション(EM)耐性の高いCuを使用
する動きが活発になってきている。Cu成膜技術として
はスパッタ法、CVD法、メッキ法等があり、配線溝、
ビアホール、コンタクトホール等に堆積させる方法が開
発されている。メッキ法によりCuを成膜する際には、
スパッタ法、CVD法によりCuシード層を付ける必要
がある。
うには、Cuシード層を必要とするが、従来のCuシー
ド層の形成法において、次のような問題があった。Cu
シード層をスパッタ法を用いて作製すると、このシード
層は配線溝、ビアホール、コンタクトホールの底に凸状
あるいは平坦に形成されるため、配線溝やこれらのホー
ルの底部のコーナーがメッキを行うための最適な形状に
ならない。また、アスペクト比の高い配線溝やこれらの
ホールにCuシード層を形成することは困難である。C
uシード層をCVD法を用いて作製すると、膜質を制御
することが困難であり、また、プロセスコストも非常に
高価になる。
術の問題点を解決するためになされたものであり、膜質
の制御が容易であること、プロセスコストが安価である
ことに加え、配線溝、ビアホール、コンタクトホール等
の凹部を有する半導体基板に対し、凹部に(Cu−C)シ
ード層を凹状に形成すること(図1)で、メッキ法による
Cuの埋め込みを容易にすることを課題としている。
ド層形成法は、配線溝、ビアホール、コンタクトホール
の凹部に配線に利用するCuを埋め込む前の半導体基板
上に、(Cu−C)シード層を形成するものであり、該凹
部にシード層が凹状に形成されるので、スパッタ法、メ
ッキ法、CVD法等によるCuの該凹部への埋め込みを
容易に行うことができる。
溝、ビアホール、コンタクトホールの凹部の内表面を含
む半導体基板上に、Cu微粒子を有機溶媒に分散させた
Cu微粒子分散液またはCu有機塩溶液を塗布し、塗布
膜の形成された基板を焼成して有機物質を蒸発および燃
焼せしめ、(Cu−C)シード層を形成することからな
る。前記Cu微粒子は平均粒径0.1μm以下であるこ
とが望ましい。平均粒径が0.1μmを超えると、該粒
子が凹部内に入り込みにくくなるからである。前記焼成
は、真空または還元ガス(例えば、H2/N2混合ガス
等)雰囲気中で行うことが望ましく、100〜450℃
で、1〜30分間行われる。焼成温度が100℃未満だ
と有機物質が十分に蒸発または燃焼されず、また、45
0℃を超えると半導体素子に熱的ダメージを与えるとい
う問題がある。
ルアセトン銅トリメチルビニルシラン{(hfac)Cu
(tmvs)}、ヘキサフルオロアセチルアセトン銅ジメ
チル−1,5シクロオクタジエン{(hfac)Cu(D
MCOD)}、ヘキサフルオロアセチルアセトン銅トリ
エトキシビニルシラン{(hfac)Cu(teov
s)}、ビスジピバロイルメタン銅{(dpm)2Cu}、
ビスヘキサフルオロアセチルアセトン銅{(hfac)2
Cu}、フタル酸銅、アセチルアセトン銅、ナフテン酸
銅、およびオレイン酸銅から選ばれるものであることが
望ましい。
として、ポリオキシエチレンラウリルエーテル、ポリエ
チレングリコールモノラウレート、ポリオキシエチレン
ラウリルアミンから選ばれる非イオン性界面活性剤を添
加することが望ましい。
る前処理として、配線溝、ビアホール、コンタクトホー
ル等の凹部の内表面を含む基板表面に、指向性スパッタ
のようなスパッタによりTiN、Ta、TaN、WN等
のバリア膜を、またはCVDでバリヤ膜を形成すること
ができる。
シード層を半導体基板上の配線溝等の凹部に凹状に作製
することにより、半導体基板上の該凹部への、スパッタ
法、メッキ法、CVD法等による配線Cu材料の埋め込
みを容易にすることができる。スパッタ法の場合は、作
製された(Cu−C)シード層が凹状であり、しかもアス
ペクト比を減少させるように堆積させることが可能なの
で、スパッタ法でさらにCuを堆積させ続けても凸状に
なり難くなり、配線溝やホール等を完全に埋め込むこと
ができる。また、メッキ法の場合は、凹部に対しコンフ
ォーマルに形成された凹状シード層から等方的にメッキ
されていくため、ボイドが発生し難くなる。
は、特に制限されないが、Cu微粒子が有機溶媒に分散
した市販のCu微粒子分散液(例えば、真空冶金株式会
社製、パーフェクトカッパー(商品名))等がある。こ
の市販のCu微粒子分散液は、Cuがコロイド粒子状態
で存在しているものである。
粒子分散液は、例えば上記したような製品であり、半導
体基板上にCu薄膜を形成する際の乾燥・焼成工程で蒸
発するような有機溶媒、好ましくは100℃以上で蒸発
する有機溶媒と、平均粒径0.1μm以下のCu金属微
粒子、またはCu金属含有微粒子とを混合してなり、該
微粒子の表面が有機溶媒で覆われて個々に独立して分散
している粘度が100cP以下の分散液である。また、
Cu微粒子の濃度は、5〜70wt%、好ましくは15
〜50wt%である。Cu含有微粒子は、Cu金属元素
以外にCuへの溶解度が低く、かつ半導体基板の基材
(絶縁層構成材料)と反応しやすい金属またはこれらの
金属を含む化合物を少なくとも一種含有していてもよ
く、これにより基材との接着性が向上されうる。この金
属元素の具体的な例としては、例えば、Mg、Al、
B、Ta、NbおよびVから選ばれる金属またはこれら
金属を含む化合物が挙げられる。
粒子は、該微粒子分散液の形態で、半導体基板上のアス
ペクト比の大きい配線溝、ビアホール、コンタクトホー
ル等の凹部に対しても何らの問題もなく入り込み、そし
て、所定の雰囲気中、所定の温度・時間で加熱されるこ
とにより、該分散液の分散媒等が蒸発され、燃焼され、
微粒子同士が融着して凹部内に凹状の(Cu−C)シード
層を形成できる。この凹状のシード層は、基板の凹部に
対してコンフォーマルな状態からアスペクト比を減少さ
せる状態まで任意に制御できる。
が、本発明はこれらの例によってなんら限定されるもの
ではない。 実施例1 Cu微粒子分散液(真空冶金(株)製、商品名:パーフェ
クトカッパー)により、Si基板上に設けられた配線溝
等を処理した。このSi基板には0.3〜5μmの配線
溝と0.15〜2μmのビアホール、コンタクトホール
があり、これらの配線溝等を含む基板表面にはスパッタ
により、TiNのバリヤ層が厚さ70nmで形成されて
いる。
1000rpmで回転させ、その上方から上記のCu微
粒子分散液を滴下し、2000rpmでスピンコートし
た。この基板を10Paの真空雰囲気中、350℃で1
分間加熱して有機溶媒および残留有機成分を蒸発、燃焼
させた。このようにして、図1に示すように、配線溝、
ビアホール、コンタクトホール等の凹部内に凹状の(C
u−C)シード層を形成せしめた。(Cu−C)シード層
をつけることにより、スパッタ法を用いてCuを配線
溝、ビアホール、コンタクトホール等に埋め込みやすく
なった。また、メッキ法の場合は、アスペクト比10ま
での配線溝、ビアホール、コンタクトホール等にCuを
埋め込むことができた。 実施例2 ナフテン酸銅、溶媒としてミネラルスピリット、そして
ポリエチレングリコールモノラウレートを重量比2:
2:1で混合したCu有機塩溶液により、実施例1の場
合と同じ基板上に設けられた配線溝、ビアホール、コン
タクトホールを処理した。このSi基板には0.3〜5
μmの配線溝と0.15〜2μmのビアホール、コンタ
クトホールがあり、配線溝およびこれらのホールを含む
基板表面にはスパッタにより、TiNのバリヤ層が厚さ
70nmで形成されている。
1000rpmで回転させ、その上方から上記のCu有
機塩溶液を滴下し、2000rpmでスピンコートし
た。この基板を10Paの真空雰囲気中、350℃で1
分間加熱して有機溶媒および残留有機成分を蒸発、燃焼
させた。このようにして、図1に示すように、配線溝、
ビアホール、コンタクトホール等の凹部内に凹状の(C
u−C)シード層を形成せしめた。(Cu−C)シード層
をつけることにより、スパッタ法を用いてCuを配線
溝、ビアホール、コンタクトホール等に埋め込むことが
たやすくなった。また、メッキ法の場合は、アスペクト
比10までの配線溝、ビアホール、コンタクトホール等
にCuを埋め込むことができた。 実施例3 フタル酸銅、溶媒としてエタノール、そしてポリエチレ
ングリコールモノラウレートを重量比2:2:1で混合
したCu有機塩溶液により、実施例1の場合と同じ基板
上に設けられた配線溝等を処理した。このSi基板には
0.3〜5μmの配線溝と0.15〜2μmのビアホー
ル、コンタクトホールがあり、配線溝およびこれらのホ
ールを含む基板表面にはスパッタにより、TiNのバリ
ヤ層が厚さ70nmで形成されている。
1000rpmで回転させ、その上方から上記のCu有
機塩溶液を滴下し、2000rpmでスピンコートし
た。この基板を還元ガス(H2/N2混合ガス)雰囲気
中、350℃で1分間加熱して有機溶媒および残留有機
成分を蒸発、燃焼させた。このようにして、図1に示す
ように、配線溝、ビアホール、コンタクトホール等の凹
部内に凹状の(Cu−C)シード層を形成せしめた。(C
u−C)シード層をつけることにより、スパッタ法を用
いてCuを配線溝、ビアホール、コンタクトホール等に
埋め込むことがたやすくなった。また、メッキ法の場合
は、アスペクト比10までの配線溝、ビアホール、コン
タクトホール等にCuを埋め込むことができた。
ロセスコストの低い(Cu−C)シード層の形成が可能と
なる。本発明により形成された凹状の(Cu−C)シード
層を用いれば、半導体基板の配線溝、ビアホール、コン
タクトホール等をスパッタ法、メッキ法等によりCuで
埋め込むことが容易になり、好ましいCu配線を形成し
うる。
を模式的に示す半導体基板の断面図。
Si基板
Claims (6)
- 【請求項1】 配線溝、ビアホール、コンタクトホール
の凹部に配線に利用するCuを埋め込む前の半導体基板
上に、(Cu−C)シード層を形成することを特徴とする
(Cu−C)シード層の形成法。 - 【請求項2】 前記(Cu−C)シード層は、Cu微粒子
を有機溶媒に分散させたCu微粒子分散液またはCu有
機塩溶液を半導体基板上に塗布し、塗布膜の形成された
基板を焼成して、塗布膜中の有機物質を蒸発および燃焼
せしめることにより形成されることを特徴とする請求項
1記載の(Cu−C)シード層の形成法。 - 【請求項3】 前記Cu微粒子の平均粒径が0.1μm
以下であることを特徴とする請求項2記載の(Cu−C)
シード層の形成法。 - 【請求項4】 前記Cu有機塩は、ヘキサフルオロアセ
チルアセトン銅トリメチルビニルシラン{(hfac)C
u(tmvs)}、ヘキサフルオロアセチルアセトン銅ジ
メチル−1,5シクロオクタジエン{(hfac)Cu
(DMCOD)}、ヘキサフルオロアセチルアセトン銅ト
リエトキシビニルシラン{(hfac)Cu(teov
s)}、ビスジピバロイルメタン銅{(dpm)2Cu}、
ビスヘキサフルオロアセチルアセトン銅{(hfac)2
Cu}、フタル酸銅、アセチルアセトン銅、ナフテン酸
銅、またはオレイン酸銅であることを特徴とする請求項
2記載の(Cu−C)シード層の形成法。 - 【請求項5】 前記Cu有機塩溶液に、界面活性剤とし
て、ポリオキシエチレンラウリルエーテル、ポリエチレ
ングリコールモノラウレート、ポリオキシエチレンラウ
リルアミンから選ばれる非イオン性界面活性剤を添加す
ることを特徴とする請求項2または請求項4記載の(C
u−C)薄膜の形成法。 - 【請求項6】 前記焼成を、真空または還元ガス雰囲気
中、100〜450℃で行うことを特徴とする請求項2
〜請求項5のいずれかに記載の(Cu−C)シード層の形
成法。
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Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2008013516A2 (en) * | 2005-05-13 | 2008-01-31 | Cambrios Technologies Corp. | Seed layers, cap layers, and thin films and methods of making thereof |
JP2012227253A (ja) * | 2011-04-18 | 2012-11-15 | Asahi Glass Co Ltd | 下地導電層付き基板の製造方法および貫通電極基板の製造方法 |
US20160330847A1 (en) * | 2009-04-24 | 2016-11-10 | Sumitomo Electric Industries, Ltd. | Method for producing printed wiring board |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0969522A (ja) * | 1995-09-01 | 1997-03-11 | Fujitsu Ltd | 埋め込み導電層の形成方法 |
JPH09134891A (ja) * | 1995-09-06 | 1997-05-20 | Vacuum Metallurgical Co Ltd | 半導体基板への薄膜形成方法 |
JP2001102380A (ja) * | 1999-09-30 | 2001-04-13 | Hitachi Ltd | 半導体集積回路装置およびその製造方法 |
-
1999
- 1999-10-21 JP JP29979999A patent/JP4751496B2/ja not_active Expired - Fee Related
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0969522A (ja) * | 1995-09-01 | 1997-03-11 | Fujitsu Ltd | 埋め込み導電層の形成方法 |
JPH09134891A (ja) * | 1995-09-06 | 1997-05-20 | Vacuum Metallurgical Co Ltd | 半導体基板への薄膜形成方法 |
JP2001102380A (ja) * | 1999-09-30 | 2001-04-13 | Hitachi Ltd | 半導体集積回路装置およびその製造方法 |
Non-Patent Citations (1)
Title |
---|
國分 宏 H KOKUBUN: "ULSI配線用銅薄膜の新堆積技術", 応用物理学会学術講演会講演予稿集1998秋2 EXTENDED ABSTRACTS (THE 59TH AUTUMN MEETING, 1998);THE, JPN6010038499, September 1998 (1998-09-01), JP, pages 748, ISSN: 0001906297 * |
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2008013516A2 (en) * | 2005-05-13 | 2008-01-31 | Cambrios Technologies Corp. | Seed layers, cap layers, and thin films and methods of making thereof |
WO2008013516A3 (en) * | 2005-05-13 | 2008-03-20 | Cambrios Technologies Corp | Seed layers, cap layers, and thin films and methods of making thereof |
US7655081B2 (en) | 2005-05-13 | 2010-02-02 | Siluria Technologies, Inc. | Plating bath and surface treatment compositions for thin film deposition |
US7695981B2 (en) | 2005-05-13 | 2010-04-13 | Siluria Technologies, Inc. | Seed layers, cap layers, and thin films and methods of making thereof |
US20160330847A1 (en) * | 2009-04-24 | 2016-11-10 | Sumitomo Electric Industries, Ltd. | Method for producing printed wiring board |
US20160330850A1 (en) * | 2009-04-24 | 2016-11-10 | Sumitomo Electric Industries, Ltd. | Method for producing printed wiring board |
JP2012227253A (ja) * | 2011-04-18 | 2012-11-15 | Asahi Glass Co Ltd | 下地導電層付き基板の製造方法および貫通電極基板の製造方法 |
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