JP2000293141A - 液晶表示装置の駆動方法 - Google Patents
液晶表示装置の駆動方法Info
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- JP2000293141A JP2000293141A JP11098548A JP9854899A JP2000293141A JP 2000293141 A JP2000293141 A JP 2000293141A JP 11098548 A JP11098548 A JP 11098548A JP 9854899 A JP9854899 A JP 9854899A JP 2000293141 A JP2000293141 A JP 2000293141A
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Abstract
(57)【要約】
【課題】 データドライバのＬＣＤパネルへの書き込み
回路にサンプルホールド回路を用いた場合、サンプルホ
ールド回路が各ドレインラインに固定されているので、
サンプルホールド回路のスイッチ容量のばらつきに起因
して、出力電圧が各ラインで変動し、画面に縞状の濃淡
ができるという欠点があった。 【解決手段】 ゲート電極、ドレイン電極、コモン電極
を持つアクティブマトリクス型の液晶表示パネルのドレ
イン電極を１ラインごとに順次駆動するドライバ回路
と、１ラインごとに表示データのサンプル・記憶系統で
あるサンプルホールド回路を備えた液晶表示装置の、１
フィールド中の各ラインに接続するサンプルホールド回
路のサンプル・記憶系統を１フィールド〜数フィールド
ごとに異なるサンプル・記憶系統と切換える。
回路にサンプルホールド回路を用いた場合、サンプルホ
ールド回路が各ドレインラインに固定されているので、
サンプルホールド回路のスイッチ容量のばらつきに起因
して、出力電圧が各ラインで変動し、画面に縞状の濃淡
ができるという欠点があった。 【解決手段】 ゲート電極、ドレイン電極、コモン電極
を持つアクティブマトリクス型の液晶表示パネルのドレ
イン電極を１ラインごとに順次駆動するドライバ回路
と、１ラインごとに表示データのサンプル・記憶系統で
あるサンプルホールド回路を備えた液晶表示装置の、１
フィールド中の各ラインに接続するサンプルホールド回
路のサンプル・記憶系統を１フィールド〜数フィールド
ごとに異なるサンプル・記憶系統と切換える。
Description
【０００１】
【発明の属する技術分野】本発明は、マトリクス表示パ
ネルの駆動方法に関するものである。
ネルの駆動方法に関するものである。
【０００２】
【従来の技術】低温ｐ−Ｓｉ技術は、ｐ−ＳｉＴＦＴを
ガラス基板上に形成することで直接液晶パネル（ＬＣ
Ｄ）にデータドライバを造り込めるため、ＬＣＤパネル
モジュールの薄膜化、高性能化、低コスト化が実現でき
る。
ガラス基板上に形成することで直接液晶パネル（ＬＣ
Ｄ）にデータドライバを造り込めるため、ＬＣＤパネル
モジュールの薄膜化、高性能化、低コスト化が実現でき
る。
【０００３】しかし、低温ｐ−ＳｉＴＦＴを用いてデー
タドライバを設計する場合、低温ｐ−ＳｉＴＦＴは単結
晶ＳｉＴＦＴに比べて電流駆動能力がおよそ１／５以下
であり、またＴＦＴの電流特性のばらつきが大きいた
め、パネルの大型化、高精細化に伴う高周波応答のため
の回路技術において、動作マージンを十分にとって素子
性能のばらつきを吸収させる設計技術が必要になってい
る。
タドライバを設計する場合、低温ｐ−ＳｉＴＦＴは単結
晶ＳｉＴＦＴに比べて電流駆動能力がおよそ１／５以下
であり、またＴＦＴの電流特性のばらつきが大きいた
め、パネルの大型化、高精細化に伴う高周波応答のため
の回路技術において、動作マージンを十分にとって素子
性能のばらつきを吸収させる設計技術が必要になってい
る。
【０００４】この種の液晶駆動方法は、映像信号にアナ
ログデータを用いるアナログ線順次方式とディジタルデ
ータを用いるディジタル線順次方式があり、データドラ
イバでは通常、映像信号をラッチするラッチ回路部と、
ラッチした信号をＬＣＤパネルに書き込む回路部を備え
ている。ラッチした信号をＬＣＤパネルい書き込む回路
部としては、サンプルホールド回路を用いる場合とオペ
アンプを用いる場合が一般的である。次にそれぞれの方
式における一般例を示す。
ログデータを用いるアナログ線順次方式とディジタルデ
ータを用いるディジタル線順次方式があり、データドラ
イバでは通常、映像信号をラッチするラッチ回路部と、
ラッチした信号をＬＣＤパネルに書き込む回路部を備え
ている。ラッチした信号をＬＣＤパネルい書き込む回路
部としては、サンプルホールド回路を用いる場合とオペ
アンプを用いる場合が一般的である。次にそれぞれの方
式における一般例を示す。
【０００５】図５は液晶表示装置の一般的なアナログ線
順次駆動方式におけるドレインラインの駆動部分のブロ
ック図、図６にサンプルホールド回路２及びドライバ回
路３の回路図、また、図７はこの液晶表示装置のタイミ
ング図を示す。
順次駆動方式におけるドレインラインの駆動部分のブロ
ック図、図６にサンプルホールド回路２及びドライバ回
路３の回路図、また、図７はこの液晶表示装置のタイミ
ング図を示す。
【０００６】ドレインラインの駆動は線順次スキャン方
式で行われ、表示信号ＶＩはサンプルホールド回路２で
１ライン分記憶され、次にラインの記憶時にその信号を
出力する。そのため、サンプルホールド回路２は２ライ
ン分必要である。
式で行われ、表示信号ＶＩはサンプルホールド回路２で
１ライン分記憶され、次にラインの記憶時にその信号を
出力する。そのため、サンプルホールド回路２は２ライ
ン分必要である。
【０００７】サンプルホールド回路２の１ライン分は、
図５の（ａ）で示された系統でＳ１・Ｌ，Ｓ２・Ｌ，・
・・，Ｓｎ・Ｌのタイミングでスイッチングされ容量Ｃ
に記憶される。また他の１ライン分を記憶するとき
（（ｂ）系統）、１ライン前に記憶された信号（（ａ）
系統）をＬのタイミングでドレインラインＤｎへ出力す
る構成になっている。
図５の（ａ）で示された系統でＳ１・Ｌ，Ｓ２・Ｌ，・
・・，Ｓｎ・Ｌのタイミングでスイッチングされ容量Ｃ
に記憶される。また他の１ライン分を記憶するとき
（（ｂ）系統）、１ライン前に記憶された信号（（ａ）
系統）をＬのタイミングでドレインラインＤｎへ出力す
る構成になっている。
【０００８】同様に次にラインの記憶時（ａ）では、１
ライン前に記憶された信号（（ｂ）系統）がドレインラ
インＤｎへ出力される。
ライン前に記憶された信号（（ｂ）系統）がドレインラ
インＤｎへ出力される。
【０００９】このように１フィールドごとに１ライン目
の信号は、サンプルホールド回路２の（ａ）系統、２ラ
イン目の信号は（ｂ）系統とういように奇数ラインはサ
ンプルホールド回路２の（ａ）系統、偶数ラインはサン
プルホールド回路２の（ｂ）系統で記憶、出力される構
成となっている。
の信号は、サンプルホールド回路２の（ａ）系統、２ラ
イン目の信号は（ｂ）系統とういように奇数ラインはサ
ンプルホールド回路２の（ａ）系統、偶数ラインはサン
プルホールド回路２の（ｂ）系統で記憶、出力される構
成となっている。
【００１０】図８は液晶表示装置の一般的なディジタル
線順次駆動方式におけるドレインラインの駆動部分のブ
ロック図である。表示データであるディジタルデータで
ラッチ５を行い、ドレインラインへの出力時にＤＡＣ回
路部６にてＤ／Ａ変換を行う方法が考えられる。ＤＡＣ
部６にてＤ／Ａ変化された表示データはオペアンプを介
して、１ラインごとに画素部に入力される。
線順次駆動方式におけるドレインラインの駆動部分のブ
ロック図である。表示データであるディジタルデータで
ラッチ５を行い、ドレインラインへの出力時にＤＡＣ回
路部６にてＤ／Ａ変換を行う方法が考えられる。ＤＡＣ
部６にてＤ／Ａ変化された表示データはオペアンプを介
して、１ラインごとに画素部に入力される。
【００１１】
【発明が解決しようとする課題】上述した図５〜図７に
おける従来のデータドライバのＬＣＤパネルへの書き込
み回路にサンプルホールド回路２を用いた場合、サンプ
ルホールド回路２が各ドレインラインＤｎに固定された
構成になっているので、サンプルホールド回路のスイッ
チ容量のばらつきによって出力電圧が各ラインによって
変動していまい、同一信号を入力しても、出力電圧が各
ラインごとに変動するため、画面にしま状に濃淡がで
き、画質が大きく劣化するという欠点があった。
おける従来のデータドライバのＬＣＤパネルへの書き込
み回路にサンプルホールド回路２を用いた場合、サンプ
ルホールド回路２が各ドレインラインＤｎに固定された
構成になっているので、サンプルホールド回路のスイッ
チ容量のばらつきによって出力電圧が各ラインによって
変動していまい、同一信号を入力しても、出力電圧が各
ラインごとに変動するため、画面にしま状に濃淡がで
き、画質が大きく劣化するという欠点があった。
【００１２】上述した図８における従来のデータドライ
バのＬＣＤパネルへの書き込み回路にオペアンプを用い
る場合、低温ｐ−ＳｉＴＦＴを用いてオペアンプを構成
すると、その素子性能のばらつき（主にしきい値電圧）
のため非常に大きな出力誤差が生じるという欠点があっ
た。
バのＬＣＤパネルへの書き込み回路にオペアンプを用い
る場合、低温ｐ−ＳｉＴＦＴを用いてオペアンプを構成
すると、その素子性能のばらつき（主にしきい値電圧）
のため非常に大きな出力誤差が生じるという欠点があっ
た。
【００１３】本発明の目的は、ＬＣＤパネルへの書き込
み回路部の構成素子のばらつきによる画質劣化を防止す
ることができる液晶表示装置の駆動方法を提供するもの
である。
み回路部の構成素子のばらつきによる画質劣化を防止す
ることができる液晶表示装置の駆動方法を提供するもの
である。
【００１４】
【課題を解決するための手段】ゲート電極、ドレイン電
極、コモン電極を持つアクティブマトリクス型の液晶表
示パネルのドレイン電極を１ラインごとに順次駆動する
ドライバ回路と、１ラインごとに表示データのサンプル
・記憶系統であるサンプルホールド回路を備えた液晶表
示装置の、１フィールド中の各ラインに接続するサンプ
ルホールド回路のサンプル・記憶系統を１フィールド〜
数フィールドごとに異なるサンプル・記憶系統と切換え
るようにした構成を有している。
極、コモン電極を持つアクティブマトリクス型の液晶表
示パネルのドレイン電極を１ラインごとに順次駆動する
ドライバ回路と、１ラインごとに表示データのサンプル
・記憶系統であるサンプルホールド回路を備えた液晶表
示装置の、１フィールド中の各ラインに接続するサンプ
ルホールド回路のサンプル・記憶系統を１フィールド〜
数フィールドごとに異なるサンプル・記憶系統と切換え
るようにした構成を有している。
【００１５】またゲート電極、ドレイン電極、コモン電
極を持つアクティブマトリクス型の液晶表示パネルのド
レイン電極を１ラインごとに順次駆動するドライバ回路
と、１ラインごとに表示データを表示部に出力するバッ
ファー部にオペアンプを備えた液晶表示装置の、１フィ
ールド中の各ラインに接続するオペアンプを１フィール
ド〜数フィールドごとに異なるオペアンプと切換えるよ
うにすることを特徴とする液晶表示装置の駆動方法であ
る。
極を持つアクティブマトリクス型の液晶表示パネルのド
レイン電極を１ラインごとに順次駆動するドライバ回路
と、１ラインごとに表示データを表示部に出力するバッ
ファー部にオペアンプを備えた液晶表示装置の、１フィ
ールド中の各ラインに接続するオペアンプを１フィール
ド〜数フィールドごとに異なるオペアンプと切換えるよ
うにすることを特徴とする液晶表示装置の駆動方法であ
る。
【００１６】本発明によれば、上記した構成により、Ｌ
ＣＤパネルへの書き込み回路の構成素子のばらつきいよ
る画質劣化を防止することができる。
ＣＤパネルへの書き込み回路の構成素子のばらつきいよ
る画質劣化を防止することができる。
【００１７】
【発明の実施の形態】本発明の請求項１記載の発明は、
ゲート電極、ドレイン電極、コモン電極を持つアクティ
ブマトリクス型の液晶表示パネルのドレイン電極を１ラ
インごとに順次駆動するドライバ回路と、１ラインごと
に表示データのサンプル・記憶系統であるサンプルホー
ルド回路を備えた液晶表示装置の、１フィールド中の各
ラインに接続しているサンプルホールド回路のサンプル
・記憶系統を異なるラインに接続しているサンプル・記
憶系統と１フィールド〜数フィールドごとに切換えるよ
うにしたことを特徴とする液晶表示装置の駆動方法であ
る。
ゲート電極、ドレイン電極、コモン電極を持つアクティ
ブマトリクス型の液晶表示パネルのドレイン電極を１ラ
インごとに順次駆動するドライバ回路と、１ラインごと
に表示データのサンプル・記憶系統であるサンプルホー
ルド回路を備えた液晶表示装置の、１フィールド中の各
ラインに接続しているサンプルホールド回路のサンプル
・記憶系統を異なるラインに接続しているサンプル・記
憶系統と１フィールド〜数フィールドごとに切換えるよ
うにしたことを特徴とする液晶表示装置の駆動方法であ
る。
【００１８】上記した構成により、サンプルホールド回
路の構成素子のばらつきいよる画質劣化を防止すること
ができる。
路の構成素子のばらつきいよる画質劣化を防止すること
ができる。
【００１９】本発明の請求項２の発明は、ゲート電極、
ドレイン電極、コモン電極を持つアクティブマトリクス
型の液晶表示パネルのドレイン電極を１ラインごとに順
次駆動するドライバ回路と、１ラインごとに表示データ
のサンプル・記憶系統であるサンプルホールド回路を備
えた液晶表示装置の、１フィールド中の各ラインに接続
しているサンプルホールド回路のサンプル・記憶系統を
１フィールド〜数フィールドごとに異なるサンプルホー
ルド回路と切換えると共に、前記１フィールド中の各ド
レインライン総数ｍと前記サンプル・記憶系統総数ｐと
の数値の間にｍ＜ｐなる関係をもたせることを特徴とす
る液晶表示装置の駆動方法である。
ドレイン電極、コモン電極を持つアクティブマトリクス
型の液晶表示パネルのドレイン電極を１ラインごとに順
次駆動するドライバ回路と、１ラインごとに表示データ
のサンプル・記憶系統であるサンプルホールド回路を備
えた液晶表示装置の、１フィールド中の各ラインに接続
しているサンプルホールド回路のサンプル・記憶系統を
１フィールド〜数フィールドごとに異なるサンプルホー
ルド回路と切換えると共に、前記１フィールド中の各ド
レインライン総数ｍと前記サンプル・記憶系統総数ｐと
の数値の間にｍ＜ｐなる関係をもたせることを特徴とす
る液晶表示装置の駆動方法である。
【００２０】上記した構成により、サンプルホールド回
路の構成素子のばらつきいよる画質劣化を防止すること
ができる。
路の構成素子のばらつきいよる画質劣化を防止すること
ができる。
【００２１】本発明の請求項３の発明は、ゲート電極、
ドレイン電極、コモン電極を持つアクティブマトリクス
型の液晶表示パネルのドレイン電極を１ラインごとに順
次駆動するドライバ回路と、１ラインごとに表示データ
を表示部に出力するバッファー部にオペアンプを備えた
液晶表示装置の、１フィールド中の各ラインに接続して
いるオペアンプを、異なるラインに接続しているオペア
ンプと１フィールド〜数フィールドごとに切換えるよう
にすることを特徴とする液晶表示装置の駆動方法であ
る。
ドレイン電極、コモン電極を持つアクティブマトリクス
型の液晶表示パネルのドレイン電極を１ラインごとに順
次駆動するドライバ回路と、１ラインごとに表示データ
を表示部に出力するバッファー部にオペアンプを備えた
液晶表示装置の、１フィールド中の各ラインに接続して
いるオペアンプを、異なるラインに接続しているオペア
ンプと１フィールド〜数フィールドごとに切換えるよう
にすることを特徴とする液晶表示装置の駆動方法であ
る。
【００２２】上記した構成により、オペアンプ回路の構
成素子のばらつきいよる画質劣化を防止することができ
る。
成素子のばらつきいよる画質劣化を防止することができ
る。
【００２３】本発明の請求項４の発明は、ゲート電極、
ドレイン電極、コモン電極を持つアクティブマトリクス
型の液晶表示パネルのドレイン電極を１ラインごとに順
次駆動するドライバ回路と、１ラインごとに表示データ
を表示部に出力するバッファー部にオペアンプを備えた
液晶表示装置の、１フィールド中の各ラインに接続して
いるオペアンプを１フィールドごとに異なるオペアンプ
と切換えると共に、前記１フィールド中の各ドレインラ
イン総数ｍと前記オペアンプ総数ｐとの数値の間にｍ＜
ｐなる関係をもたせることを特徴とする液晶表示装置の
駆動方法である。
ドレイン電極、コモン電極を持つアクティブマトリクス
型の液晶表示パネルのドレイン電極を１ラインごとに順
次駆動するドライバ回路と、１ラインごとに表示データ
を表示部に出力するバッファー部にオペアンプを備えた
液晶表示装置の、１フィールド中の各ラインに接続して
いるオペアンプを１フィールドごとに異なるオペアンプ
と切換えると共に、前記１フィールド中の各ドレインラ
イン総数ｍと前記オペアンプ総数ｐとの数値の間にｍ＜
ｐなる関係をもたせることを特徴とする液晶表示装置の
駆動方法である。
【００２４】上記した構成により、オペアンプ回路の構
成素子のばらつきいよる画質劣化を防止することができ
る。
成素子のばらつきいよる画質劣化を防止することができ
る。
【００２５】（実施の形態１）図１は、本発明の実施の
形態１における液晶表示装置のサンプルホールド回路の
回路図、図２はタイミング図である。ドレインライン駆
動部分のブロック図である。この実施の形態１が図５に
示された従来の液晶表示装置と相違する点は、１ライン
ごとに表示データを表示部に出力するサンプル・記憶系
統であるサンプルホールド回路総数が、ドレインライン
総数ｍに対し、ｍ＋１個で構成されている点である。
形態１における液晶表示装置のサンプルホールド回路の
回路図、図２はタイミング図である。ドレインライン駆
動部分のブロック図である。この実施の形態１が図５に
示された従来の液晶表示装置と相違する点は、１ライン
ごとに表示データを表示部に出力するサンプル・記憶系
統であるサンプルホールド回路総数が、ドレインライン
総数ｍに対し、ｍ＋１個で構成されている点である。
【００２６】図１において、ドレインラインＤｎ（ｍ）
はスイッチＳＴｍ（Ａ）とＳＴｍ（Ｂ）によって、１フ
ィールドごとにサンプルホールド回路Ｓｎ（ｍ）とＳｎ
（ｍ＋１）に切換えて接続する。同様にドレインライン
Ｄｎ（ｍ−１）はスイッチＳＴｍ−１（Ａ）とＳＴｍ−
１（Ｂ）によって、２フィールドごとにサンプルホール
ド回路Ｓｎ（ｍ−１）とＳｎ（ｍ）に切換えて接続する
ことになる。
はスイッチＳＴｍ（Ａ）とＳＴｍ（Ｂ）によって、１フ
ィールドごとにサンプルホールド回路Ｓｎ（ｍ）とＳｎ
（ｍ＋１）に切換えて接続する。同様にドレインライン
Ｄｎ（ｍ−１）はスイッチＳＴｍ−１（Ａ）とＳＴｍ−
１（Ｂ）によって、２フィールドごとにサンプルホール
ド回路Ｓｎ（ｍ−１）とＳｎ（ｍ）に切換えて接続する
ことになる。
【００２７】このように、各ラインのサンプル・記憶系
統を１フィールドごとに切換えることにより、ドレイン
ラインの出力がサンプルホールド回路２の構成素子のば
らつきによって変化するのを平均化することができるの
で、画面が均一化され、画質を良好に保ことができる。
また同様に、サンプルホールド回路の切換えを数フィー
ルドごとにしても同様の効果が得られる。
統を１フィールドごとに切換えることにより、ドレイン
ラインの出力がサンプルホールド回路２の構成素子のば
らつきによって変化するのを平均化することができるの
で、画面が均一化され、画質を良好に保ことができる。
また同様に、サンプルホールド回路の切換えを数フィー
ルドごとにしても同様の効果が得られる。
【００２８】（実施の形態２）図３は、本発明の実施の
形態２における液晶表示装置のオペアンプ回路の回路
図、図４はタイミング図である。この実施の形態１が図
８に示された従来の液晶表示装置と相違する点は、１ラ
インごとに表示データを表示部に出力するバッファー部
を構成するオペアンプ回路総数がドレインラインの総数
ｍに対し、ｍ＋１個で構成されている点である。
形態２における液晶表示装置のオペアンプ回路の回路
図、図４はタイミング図である。この実施の形態１が図
８に示された従来の液晶表示装置と相違する点は、１ラ
インごとに表示データを表示部に出力するバッファー部
を構成するオペアンプ回路総数がドレインラインの総数
ｍに対し、ｍ＋１個で構成されている点である。
【００２９】図３において、ドレインラインＤｎ（ｍ）
はスイッチＳＴｍ（Ａ）とＳＴｍ（Ｂ）によって、１フ
ィールドごとにオペアンプ回路Ａｎ（ｍ）とＡｎ（ｍ＋
１）に切換えて接続する。同様にドレインラインＤｎ
（ｍ−１）はスイッチＳＴｍ−１（Ａ）とＳＴｍ−１
（Ｂ）によって、１フィールドごとにオペアンプ回路Ａ
ｎ（ｍ−１）とＡｎ（ｍ）に切換えて接続することにな
る。
はスイッチＳＴｍ（Ａ）とＳＴｍ（Ｂ）によって、１フ
ィールドごとにオペアンプ回路Ａｎ（ｍ）とＡｎ（ｍ＋
１）に切換えて接続する。同様にドレインラインＤｎ
（ｍ−１）はスイッチＳＴｍ−１（Ａ）とＳＴｍ−１
（Ｂ）によって、１フィールドごとにオペアンプ回路Ａ
ｎ（ｍ−１）とＡｎ（ｍ）に切換えて接続することにな
る。
【００３０】このように、各ラインのオペアンプ回路を
１フィールドごとに切換えることにより、ドレインライ
ンへの出力がオペアンプ回路７を構成する素子性能のば
らつきによって変化するのを平均化することができるの
で、画面が均一化され、画質を良好に保ことができる。
また同様に、オペアンプ回路の切換えを数フィールドご
とにしても同様の効果が得られる。
１フィールドごとに切換えることにより、ドレインライ
ンへの出力がオペアンプ回路７を構成する素子性能のば
らつきによって変化するのを平均化することができるの
で、画面が均一化され、画質を良好に保ことができる。
また同様に、オペアンプ回路の切換えを数フィールドご
とにしても同様の効果が得られる。
【００３１】
【発明の効果】以上説明したように本発明は、表示デー
タを表示部４に出力するＬＣＤパネルへの書き込み回路
にサンプルホールド回路２を用いる場合に、サンプルホ
ールド回路のスイッチ容量のばらつきによって、各ライ
ンごとに出力電圧が変化するのを平均化することができ
るので、画質が均一化され、画質を良好に保つことがで
きる。
タを表示部４に出力するＬＣＤパネルへの書き込み回路
にサンプルホールド回路２を用いる場合に、サンプルホ
ールド回路のスイッチ容量のばらつきによって、各ライ
ンごとに出力電圧が変化するのを平均化することができ
るので、画質が均一化され、画質を良好に保つことがで
きる。
【００３２】また、表示データを表示部４に出力するＬ
ＣＤパネルへの書き込み回路にオペアンプ回路７を用い
る場合に、オペアンプ回路７を構成するＴｒの素子性能
のばらつきによって、各ライン間に生じる出力偏差を平
均化することができるので、画質が均一化され、画質を
良好に保つことができる。
ＣＤパネルへの書き込み回路にオペアンプ回路７を用い
る場合に、オペアンプ回路７を構成するＴｒの素子性能
のばらつきによって、各ライン間に生じる出力偏差を平
均化することができるので、画質が均一化され、画質を
良好に保つことができる。
【図１】本発明の実施の形態１における液晶表示装置の
サンプルホールド回路の回路図
サンプルホールド回路の回路図
【図２】本発明の実施の形態１における液晶表示装置の
タイミング図
タイミング図
【図３】本発明の実施の形態２における液晶表示装置の
オペアンプ回路の回路図
オペアンプ回路の回路図
【図４】本発明の実施の形態１における液晶表示装置の
タイミング図
タイミング図
【図５】従来の液晶表示装置の一般的なアナログ線順次
方式におけるドレインラインのブロック図
方式におけるドレインラインのブロック図
【図６】図５におけるサンプルホールド回路の回路図
【図７】図５におけるタイミング図
【図８】従来の液晶表示装置の一般的なディジタル線順
次方式におけるドレインラインのブロック図
次方式におけるドレインラインのブロック図
Ｄｎ（ｍ） ドレインライン ＳＴｍ（Ａ） スイッチ ＳＴｍ（Ｂ） スイッチ Ｓｎ（ｍ） サンプルホールド回路
───────────────────────────────────────────────────── フロントページの続き Ｆターム(参考） 2H093 NA16 NA42 NA53 NC12 NC16 NC21 NC22 NC23 NC34 ND09 5C006 AA16 AC28 AF42 AF44 AF83 BB16 BC12 BF02 BF04 BF11 BF25 FA22 FA26 FA51 5C080 AA10 BB05 DD05 DD27 EE29 FF11 JJ02 JJ03 JJ04
Claims (4)
- 【請求項１】 ゲート電極、ドレイン電極、コモン電極
を持つアクティブマトリクス型の液晶表示パネルのドレ
イン電極を１ラインごとに順次駆動するドライバ回路
と、１ラインごとに表示データのサンプル・記憶系統で
あるサンプルホールド回路を備えた液晶表示装置の、１
フィールド中の各ラインに接続する前記サンプルホール
ド回路のサンプル・記憶系統を異なるラインに接続して
いるサンプル・記憶系統と１フィールド〜数フィールド
ごとに切換えるようにしたことを特徴とする液晶表示装
置の駆動方法。 - 【請求項２】 ゲート電極、ドレイン電極、コモン電極
を持つアクティブマトリクス型の液晶表示パネルのドレ
イン電極を１ラインごとに順次駆動するドライバ回路
と、１ラインごとに表示データのサンプル・記憶系統で
あるサンプルホールド回路を備えた液晶表示装置の、１
フィールド中の各ラインに接続する前記サンプルホール
ド回路のサンプル・記憶系統を１フィールド〜数フィー
ルドごとに異なるサンプルホールド回路と切換えると共
に、前記１フィールド中の各ドレインライン総数ｍと前
記サンプル・記憶系統総数ｐとの数値の間にｍ＜ｐなる
関係をもたせることを特徴とする液晶表示装置の駆動方
法。 - 【請求項３】 ゲート電極、ドレイン電極、コモン電極
を持つアクティブマトリクス型の液晶表示パネルのドレ
イン電極を１ラインごとに順次駆動するドライバ回路
と、１ラインごとに表示データを表示部に出力するバッ
ファー部にオペアンプを備えた液晶表示装置の、１フィ
ールド中の各ラインに接続いているオペアンプを異なる
ラインに接続しているオペアンプと１フィールド〜数フ
ィールドごとに切換えるようにすることを特徴とする液
晶表示装置の駆動方法。 - 【請求項４】 ゲート電極、ドレイン電極、コモン電極
を持つアクティブマトリクス型の液晶表示パネルのドレ
イン電極を１ラインごとに順次駆動するドライバ回路
と、１ラインごとに表示データを表示部に出力するバッ
ファー部にオペアンプを備えた液晶表示装置の、１フィ
ールド中の各ラインに接続するオペアンプを１フィール
ド〜数フィールドごとに異なるオペアンプと切換えると
共に、前記１フィールド中の各ドレインライン総数ｍと
前記オペアンプ総数ｐとの数値の間にｍ＜ｐなる関係を
もたせることを特徴とする液晶表示装置の駆動方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11098548A JP2000293141A (ja) | 1999-04-06 | 1999-04-06 | 液晶表示装置の駆動方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11098548A JP2000293141A (ja) | 1999-04-06 | 1999-04-06 | 液晶表示装置の駆動方法 |
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ID=14222754
Family Applications (1)
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|---|---|---|---|
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Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005301007A (ja) * | 2004-04-14 | 2005-10-27 | Toppoly Optoelectronics Corp | データドライバーと駆動方法 |
| JP2006047963A (ja) * | 2004-08-03 | 2006-02-16 | Au Optronics Corp | 液晶表示器及びその駆動方法 |
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-
1999
- 1999-04-06 JP JP11098548A patent/JP2000293141A/ja active Pending
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8004513B2 (en) | 2002-03-06 | 2011-08-23 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor integrated circuit and method of driving the same |
| US8373694B2 (en) | 2002-03-06 | 2013-02-12 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor integrated circuit and method of driving the same |
| JP2005301007A (ja) * | 2004-04-14 | 2005-10-27 | Toppoly Optoelectronics Corp | データドライバーと駆動方法 |
| JP2006047963A (ja) * | 2004-08-03 | 2006-02-16 | Au Optronics Corp | 液晶表示器及びその駆動方法 |
| US8674920B2 (en) | 2004-08-03 | 2014-03-18 | Au Optronics Corp. | Liquid crystal display and method for driving the same |
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| JP4658016B2 (ja) * | 2006-10-27 | 2011-03-23 | 株式会社半導体エネルギー研究所 | 半導体装置 |
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