JP2000152485A - 過電流保護回路 - Google Patents
過電流保護回路Info
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- JP2000152485A JP2000152485A JP10315727A JP31572798A JP2000152485A JP 2000152485 A JP2000152485 A JP 2000152485A JP 10315727 A JP10315727 A JP 10315727A JP 31572798 A JP31572798 A JP 31572798A JP 2000152485 A JP2000152485 A JP 2000152485A
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Abstract
(57)【要約】
【課題】 信頼性を向上した過電流保護回路を得る。
【解決手段】 短絡が発生すると、過電流検知信号ｃに
より制御信号ラッチ回路４がリセットされると同時に、
制御信号再出力回路３のタイマがスタートする。短絡数
カウント回路５は短絡数をカウントアップする。タイマ
が規定時間に達すると、復旧信号ｄを制御信号ラッチ回
路４にラッチさせて負荷２を復旧する。短絡数カウント
回路５が規定回数をカウントすると負荷２を強制的に遮
断し、また周期リセット回路６のリセット信号出力を停
止させて負荷２への電源供給を強制的に禁止させる。
より制御信号ラッチ回路４がリセットされると同時に、
制御信号再出力回路３のタイマがスタートする。短絡数
カウント回路５は短絡数をカウントアップする。タイマ
が規定時間に達すると、復旧信号ｄを制御信号ラッチ回
路４にラッチさせて負荷２を復旧する。短絡数カウント
回路５が規定回数をカウントすると負荷２を強制的に遮
断し、また周期リセット回路６のリセット信号出力を停
止させて負荷２への電源供給を強制的に禁止させる。
Description
【０００１】
【発明の属する技術分野】本発明は過電流保護回路に関
し、特に宇宙用搭載機器に用いて好適な過電流保護回路
に関する。
し、特に宇宙用搭載機器に用いて好適な過電流保護回路
に関する。
【０００２】
【従来の技術】一般の電源回路、例えばインタフエース
出力回路の負荷側が短絡した場合、短絡（による他の回
路の損傷に対する）保護が必要となる。特に、宇宙用
（人工衛星用）搭載機器の場合、修理がきわめて難しい
ことから過電流保護回路の重要性が高まる。従来は、例
えば図４に示すように、電流制限回路１１と電力定格の
充分に大きい電力トランジスタＴＲ１を組み合わせるこ
とによって、負荷短絡電流を制限することが行われる。
出力回路の負荷側が短絡した場合、短絡（による他の回
路の損傷に対する）保護が必要となる。特に、宇宙用
（人工衛星用）搭載機器の場合、修理がきわめて難しい
ことから過電流保護回路の重要性が高まる。従来は、例
えば図４に示すように、電流制限回路１１と電力定格の
充分に大きい電力トランジスタＴＲ１を組み合わせるこ
とによって、負荷短絡電流を制限することが行われる。
【０００３】すなわち図４において、負荷（例えば、イ
ンタフェース回路）２に電源を供給する出力トランジス
タＴＲ１のエミッタ抵抗器Ｒ１に流れる負荷電流が増加
し、抵抗器Ｒ１の端子間電圧がダイオードＤ１の順方向
電圧（例えば約０．６Ｖ）に達したところにて負荷電流
（短絡電流）が制限される。しかし、この場合制限され
ているとはいえ、短絡負荷電流が流れ続ける問題があ
る。
ンタフェース回路）２に電源を供給する出力トランジス
タＴＲ１のエミッタ抵抗器Ｒ１に流れる負荷電流が増加
し、抵抗器Ｒ１の端子間電圧がダイオードＤ１の順方向
電圧（例えば約０．６Ｖ）に達したところにて負荷電流
（短絡電流）が制限される。しかし、この場合制限され
ているとはいえ、短絡負荷電流が流れ続ける問題があ
る。
【０００４】実開昭５７−１８８３７号公報には、保護
回路付き電力変換装置であって、コンバータ、キャパシ
タ、トランジスタ、インバータ、直流リアクトル、事故
検出制御回路、べース遮断回路にて構成された過電流保
護回路が提案されている。すなわち、短絡あるいは過負
荷等の回路遮断が必要とされる事故を検出した場合、直
ちに回路遮断を行い、一定時間後自動的に再閉路し、事
故が改善されていなければ遮断／再閉路を一定回数繰り
返した後非可逆遮断を行い、事故が改善されれば定常通
電状態にもどる。
回路付き電力変換装置であって、コンバータ、キャパシ
タ、トランジスタ、インバータ、直流リアクトル、事故
検出制御回路、べース遮断回路にて構成された過電流保
護回路が提案されている。すなわち、短絡あるいは過負
荷等の回路遮断が必要とされる事故を検出した場合、直
ちに回路遮断を行い、一定時間後自動的に再閉路し、事
故が改善されていなければ遮断／再閉路を一定回数繰り
返した後非可逆遮断を行い、事故が改善されれば定常通
電状態にもどる。
【０００５】この提案の主要部分は、図３に示す回路に
て実現できる。図３において、この過電流保護回路は、
負荷２に電源を供給する出力（ＰＮＰ）電力トランジス
タＴＲ１、出力トランジスタＴＲ１のエミッタ電流を検
知する電流制限回路１１、出力トランジスタＴＲ１の過
電流を検知する過電流検知回路１２、出力トランジスタ
ＴＲ１の動作を制御する制御信号ラッチ回路４にて構成
される。
て実現できる。図３において、この過電流保護回路は、
負荷２に電源を供給する出力（ＰＮＰ）電力トランジス
タＴＲ１、出力トランジスタＴＲ１のエミッタ電流を検
知する電流制限回路１１、出力トランジスタＴＲ１の過
電流を検知する過電流検知回路１２、出力トランジスタ
ＴＲ１の動作を制御する制御信号ラッチ回路４にて構成
される。
【０００６】電流制限回路１１においては、出力トラン
ジスタＴＲ１の負荷電流（エミッタ電流）が流れる抵抗
器Ｒ１の端子間電圧が、（ＰＮＰ）トランジスタＴＲ２
のベース・エミッタ間順方向電圧（例えば約０．６Ｖ）
に達したところにてトランジスタＴＲ２に（コレクタ）
電流が流れる。
ジスタＴＲ１の負荷電流（エミッタ電流）が流れる抵抗
器Ｒ１の端子間電圧が、（ＰＮＰ）トランジスタＴＲ２
のベース・エミッタ間順方向電圧（例えば約０．６Ｖ）
に達したところにてトランジスタＴＲ２に（コレクタ）
電流が流れる。
【０００７】一方、過電流検知回路１２においては、ト
ランジスタＴＲ２に（コレクタ）電流が流れると、抵抗
器Ｒ２，Ｒ３にて分割された電圧が（ＮＰＮ）トランジ
スタＴＲ３を導通させる。また、トランジスタＴＲ３の
コレクタは制御信号ラッチ回路４のリセット端子Ｒを接
地し、制御信号ラッチ回路４をリセットする。制御信号
ラッチ回路４はリセットされると出力Ｑが解放されて、
抵抗器Ｒ４，Ｒ５にて分割印加されていた出力トランジ
スタＴＲ１のバイアス電圧が失われ、負荷電流が遮断さ
れる。
ランジスタＴＲ２に（コレクタ）電流が流れると、抵抗
器Ｒ２，Ｒ３にて分割された電圧が（ＮＰＮ）トランジ
スタＴＲ３を導通させる。また、トランジスタＴＲ３の
コレクタは制御信号ラッチ回路４のリセット端子Ｒを接
地し、制御信号ラッチ回路４をリセットする。制御信号
ラッチ回路４はリセットされると出力Ｑが解放されて、
抵抗器Ｒ４，Ｒ５にて分割印加されていた出力トランジ
スタＴＲ１のバイアス電圧が失われ、負荷電流が遮断さ
れる。
【０００８】負荷電流が遮断された後、制御信号がデー
タ端子Ｄに供給されると、制御信号ラッチ回路４の出力
Ｑが接地され、出力トランジスタＴＲ１のバイアス電圧
が復旧され、負荷電流が流れる。負荷２に過電流異常
（例えば短絡）が存在し続けると負荷電流の遮断／復旧
が繰り返されることとなる。例えばある一定回数負荷電
流の遮断／復旧が繰り返されると制御信号の印加を停止
して、負荷電流の非可逆遮断を行う。
タ端子Ｄに供給されると、制御信号ラッチ回路４の出力
Ｑが接地され、出力トランジスタＴＲ１のバイアス電圧
が復旧され、負荷電流が流れる。負荷２に過電流異常
（例えば短絡）が存在し続けると負荷電流の遮断／復旧
が繰り返されることとなる。例えばある一定回数負荷電
流の遮断／復旧が繰り返されると制御信号の印加を停止
して、負荷電流の非可逆遮断を行う。
【０００９】
【発明が解決しようとする課題】実開昭５７−１８８３
７号公報記載の提案、あるいは図３に示す過電流保護回
路においては、事故検出制御回路、べース（バイアス）
遮断回路等が故障した場合、正常動作時に誤って負荷電
流を遮断することがあり得る問題がある。また、その逆
に（過電流）異常動作時に負荷電流を遮断しないことも
あり得る問題がある。さらに、負荷電流の遮断／復旧繰
り返し回数設定が誤れば、許容回数を考慮して設計され
ている部品を破損することもあり得る問題がある。
７号公報記載の提案、あるいは図３に示す過電流保護回
路においては、事故検出制御回路、べース（バイアス）
遮断回路等が故障した場合、正常動作時に誤って負荷電
流を遮断することがあり得る問題がある。また、その逆
に（過電流）異常動作時に負荷電流を遮断しないことも
あり得る問題がある。さらに、負荷電流の遮断／復旧繰
り返し回数設定が誤れば、許容回数を考慮して設計され
ている部品を破損することもあり得る問題がある。
【００１０】本発明の目的は、信頼性を向上した過電流
保護回路を提供することである。
保護回路を提供することである。
【００１１】
【課題を解決するための手段】本発明による過電流保護
回路は、負荷の過電流異常を検知して前記負荷の電源を
遮断した後、一定時間後に前記電源を復旧し、前記電源
の遮断／復旧の回数が一定数を超えたとき前記負荷への
電源供給を強制遮断するようにした過電流保護回路であ
って、前記電源の遮断／復旧を制御する制御回路に冗長
性を持たせることを特徴とする。
回路は、負荷の過電流異常を検知して前記負荷の電源を
遮断した後、一定時間後に前記電源を復旧し、前記電源
の遮断／復旧の回数が一定数を超えたとき前記負荷への
電源供給を強制遮断するようにした過電流保護回路であ
って、前記電源の遮断／復旧を制御する制御回路に冗長
性を持たせることを特徴とする。
【００１２】また、前記制御回路を複数個並列的に設
け、これ等制御回路の出力の多数決によって制御動作を
行うことを特徴とする。さらに、前記負荷回路に抵抗器
を介して前記電源を供給し、前記抵抗器における電圧降
下を検知することにより前記過電流異常を検知すること
を特徴とする。
け、これ等制御回路の出力の多数決によって制御動作を
行うことを特徴とする。さらに、前記負荷回路に抵抗器
を介して前記電源を供給し、前記抵抗器における電圧降
下を検知することにより前記過電流異常を検知すること
を特徴とする。
【００１３】本発明の作用は次の通りである。短絡数カ
ウント回路、制御信号再出力回路等を、例えば３重冗長
構成として、これ等３重の制御回路の出力の多数決によ
り確実に過電流保護回路の動作を保証する。
ウント回路、制御信号再出力回路等を、例えば３重冗長
構成として、これ等３重の制御回路の出力の多数決によ
り確実に過電流保護回路の動作を保証する。
【００１４】
【発明の実施の形態】以下に、本発明の実施例について
図面を参照して説明する。図１は本発明による過電流保
護回路の実施例の構成を示すブロック図であり、図２は
その詳細ブロック図であって、図２〜４と同等部分は同
一符号にて示している。図１において、本発明による過
電流保護回路は、同一の制御機能を持つ複数（例えば、
３重冗長構成）の制御回路２０、複数の制御回路２０の
制御出力の多数決をとる多数決回路１４、負荷（例えば
インタフェース出力回路）２への電源を与え負荷電流を
制御する電流制限／過電流検知部１にて構成される。
図面を参照して説明する。図１は本発明による過電流保
護回路の実施例の構成を示すブロック図であり、図２は
その詳細ブロック図であって、図２〜４と同等部分は同
一符号にて示している。図１において、本発明による過
電流保護回路は、同一の制御機能を持つ複数（例えば、
３重冗長構成）の制御回路２０、複数の制御回路２０の
制御出力の多数決をとる多数決回路１４、負荷（例えば
インタフェース出力回路）２への電源を与え負荷電流を
制御する電流制限／過電流検知部１にて構成される。
【００１５】これらの回路（多数決回路１４をのぞく）
の詳細は図２に示すようになっている。図２において、
電流制限／過電流検知部１は、負荷２に電源を供給する
出力（ＰＮＰ）トランジスタＴＲ１、出力トランジスタ
ＴＲ１のエミッタ電流を検知する電流制限回路１１、出
力トランジスタＴＲ１の過電流を検知する過電流検知回
路１２にて構成される。
の詳細は図２に示すようになっている。図２において、
電流制限／過電流検知部１は、負荷２に電源を供給する
出力（ＰＮＰ）トランジスタＴＲ１、出力トランジスタ
ＴＲ１のエミッタ電流を検知する電流制限回路１１、出
力トランジスタＴＲ１の過電流を検知する過電流検知回
路１２にて構成される。
【００１６】また、制御回路２０は、インタフェース出
力回路（負荷）２ヘの制御信号ａを基に、復旧信号ｄを
制御信号ラッチ回路３にラッチさせ、過電流検知信号ｃ
が発生した場合に、規定時間後再度復旧信号ｄを制御信
号ラッチ回路４にラッチさせる機能を持つ制御信号再出
力回路３を有する。さらに、短絡回数（負荷電流の遮断
／復旧回数）をカウントし、一定回数となった場合にイ
ンタフェース出力回路２への印加電源を強制的に遮断す
るインタフェース停止信号ｅを発生する短絡数カウント
回路５を有する。
力回路（負荷）２ヘの制御信号ａを基に、復旧信号ｄを
制御信号ラッチ回路３にラッチさせ、過電流検知信号ｃ
が発生した場合に、規定時間後再度復旧信号ｄを制御信
号ラッチ回路４にラッチさせる機能を持つ制御信号再出
力回路３を有する。さらに、短絡回数（負荷電流の遮断
／復旧回数）をカウントし、一定回数となった場合にイ
ンタフェース出力回路２への印加電源を強制的に遮断す
るインタフェース停止信号ｅを発生する短絡数カウント
回路５を有する。
【００１７】さらにまた、定められた周期毎に短絡数カ
ウント回路５に対してリセット信号出力し、インタフェ
ース停止信号ｅが発生した場合は機能を停止し、外部か
ら強制リセット信号ｂを入力した場合は、他の状態に関
わらずリセット信号を出力する周期リセット回路６を有
する。さらに、復旧信号ｄをラッチする制御信号ラッチ
回路４、制御信号ラッチ回路４の出力Ｑを電流制限／過
電流検知部１へ通過させ、インタフェース停止信号ｅが
発生した場合に遮断させるゲート回路７を有する。
ウント回路５に対してリセット信号出力し、インタフェ
ース停止信号ｅが発生した場合は機能を停止し、外部か
ら強制リセット信号ｂを入力した場合は、他の状態に関
わらずリセット信号を出力する周期リセット回路６を有
する。さらに、復旧信号ｄをラッチする制御信号ラッチ
回路４、制御信号ラッチ回路４の出力Ｑを電流制限／過
電流検知部１へ通過させ、インタフェース停止信号ｅが
発生した場合に遮断させるゲート回路７を有する。
【００１８】さらにまた、過電流検知信号ｃを位相反転
するインバータ８、インバータ８の出力と復旧信号ｄと
の論理積をとって短絡数カウント回路５のクロックＣＫ
として供給するＡＮＤ回路９、周期リセット回路６の出
力とインタフェース停止信号ｅとの論理和をとり、位相
反転して出力するＮＯＲ回路１０を有する。さらに、Ｎ
ＯＲ回路１０の出力と強制リセット信号ｂとの論理積を
とり、位相反転して短絡数カウント回路５をリセットす
るＮＡＮＤ回路１３を有して構成される。
するインバータ８、インバータ８の出力と復旧信号ｄと
の論理積をとって短絡数カウント回路５のクロックＣＫ
として供給するＡＮＤ回路９、周期リセット回路６の出
力とインタフェース停止信号ｅとの論理和をとり、位相
反転して出力するＮＯＲ回路１０を有する。さらに、Ｎ
ＯＲ回路１０の出力と強制リセット信号ｂとの論理積を
とり、位相反転して短絡数カウント回路５をリセットす
るＮＡＮＤ回路１３を有して構成される。
【００１９】本発明の実施例の動作を図２により説明す
る。図２の電流制限／過電流検知部１の電流制限回路１
１においては、出力トランジスタＴＲ１の負荷電流（エ
ミッタ電流）が流れる抵抗器Ｒ１の端子間電圧が（ＰＮ
Ｐ）トランジスタＴＲ２のベース・エミッタ間順方向電
圧（例えば約０．６Ｖ）に達したところにてトランジス
タＴＲ２に（コレクタ）電流が流れる。一方、過電流検
知回路１２においては、トランジスタＴＲ２に（コレク
タ）電流が流れると、抵抗器Ｒ２，Ｒ３にて分割された
電圧が（ＮＰＮ）トランジスタＴＲ３を導通させる。
る。図２の電流制限／過電流検知部１の電流制限回路１
１においては、出力トランジスタＴＲ１の負荷電流（エ
ミッタ電流）が流れる抵抗器Ｒ１の端子間電圧が（ＰＮ
Ｐ）トランジスタＴＲ２のベース・エミッタ間順方向電
圧（例えば約０．６Ｖ）に達したところにてトランジス
タＴＲ２に（コレクタ）電流が流れる。一方、過電流検
知回路１２においては、トランジスタＴＲ２に（コレク
タ）電流が流れると、抵抗器Ｒ２，Ｒ３にて分割された
電圧が（ＮＰＮ）トランジスタＴＲ３を導通させる。
【００２０】また、トランジスタＴＲ３の（常時は抵抗
器Ｒ６を介して電源電圧Ｖccにつり上げられている）コ
レクタには過電流検知信号ｃが表れ、制御信号ラッチ回
路４のリセット端子Ｒを接地し制御信号ラッチ回路４を
リセットする。制御信号ラッチ回路４はリセットされる
と出力Ｑが解放されて、抵抗器Ｒ４，Ｒ５にて分割印加
されていた出力トランジスタＴＲ１のバイアス電圧が失
われ、負荷電流が遮断される。
器Ｒ６を介して電源電圧Ｖccにつり上げられている）コ
レクタには過電流検知信号ｃが表れ、制御信号ラッチ回
路４のリセット端子Ｒを接地し制御信号ラッチ回路４を
リセットする。制御信号ラッチ回路４はリセットされる
と出力Ｑが解放されて、抵抗器Ｒ４，Ｒ５にて分割印加
されていた出力トランジスタＴＲ１のバイアス電圧が失
われ、負荷電流が遮断される。
【００２１】負荷電流が遮断された後、復旧信号ｄがデ
ータ端子Ｄに供給されると、制御信号ラッチ回路４の出
力Ｑが接地され、出力トランジスタＴＲ１のバイアス電
圧が復旧され、負荷電流が流れる。負荷２に過電流異常
（例えば短絡）が存在し続けると負荷電流の遮断／復旧
が繰り返されることとなる。負荷２に過電流異常（例え
ば短絡）が発生すると、過電流検知信号ｃにより制御信
号ラッチ回路４がリセットされると同時に、制御信号再
出力回路３のタイマがスタートする。この時、インタフ
ェース出力回路２（の電源）は遮断される。短絡数カウ
ント回路５は短絡（負荷２の過電流異常）を認識して、
短絡数をカウントアップする。
ータ端子Ｄに供給されると、制御信号ラッチ回路４の出
力Ｑが接地され、出力トランジスタＴＲ１のバイアス電
圧が復旧され、負荷電流が流れる。負荷２に過電流異常
（例えば短絡）が存在し続けると負荷電流の遮断／復旧
が繰り返されることとなる。負荷２に過電流異常（例え
ば短絡）が発生すると、過電流検知信号ｃにより制御信
号ラッチ回路４がリセットされると同時に、制御信号再
出力回路３のタイマがスタートする。この時、インタフ
ェース出力回路２（の電源）は遮断される。短絡数カウ
ント回路５は短絡（負荷２の過電流異常）を認識して、
短絡数をカウントアップする。
【００２２】制御信号再出力回路３のタイマが規定時間
に達すると、復旧動作の制御信号（復旧信号）ｄを制御
信号ラッチ回路４にラッチさせ、インタフェース回路
（負荷）２を復旧する。短絡状態が持続していれば上述
の動作を繰り返し、短絡数カウント回路５が規定回数を
カウントした時点にて、インタフェース回路２を強制的
に遮断し、また、周期リセット回路６のリセット信号出
力を停止させて、以後のインタフェース制御（負荷２へ
の電源供給）を強制的に禁止させる。
に達すると、復旧動作の制御信号（復旧信号）ｄを制御
信号ラッチ回路４にラッチさせ、インタフェース回路
（負荷）２を復旧する。短絡状態が持続していれば上述
の動作を繰り返し、短絡数カウント回路５が規定回数を
カウントした時点にて、インタフェース回路２を強制的
に遮断し、また、周期リセット回路６のリセット信号出
力を停止させて、以後のインタフェース制御（負荷２へ
の電源供給）を強制的に禁止させる。
【００２３】上述の過程中に短絡状態が解除されれば、
短絡数カウント回路５のカウントアップが停止し、規定
数をカウントする前に周期リセット回路６からのリセッ
ト信号により、カウント数がリセットされる。周期リセ
ット回路６に対する強制リセット信号ｂは、状況に無関
係に短絡保護機能を初期化したい場合に用いる。図１に
示すように、上述の動作機能（制御回路２０）をすべて
３重冗長構成とし、多数決回路１４により正確な動作を
確保する。
短絡数カウント回路５のカウントアップが停止し、規定
数をカウントする前に周期リセット回路６からのリセッ
ト信号により、カウント数がリセットされる。周期リセ
ット回路６に対する強制リセット信号ｂは、状況に無関
係に短絡保護機能を初期化したい場合に用いる。図１に
示すように、上述の動作機能（制御回路２０）をすべて
３重冗長構成とし、多数決回路１４により正確な動作を
確保する。
【００２４】
【発明の効果】以上説明したように本発明によれば、負
荷となるインタフェース出力回路に発生した短絡回数を
カウントし、短絡が復帰せずに一定回数に達するとイン
タフェース出力回路への電源の供給を停止することによ
り、インタフェース出力回路の損傷（破壊）を防止でき
るという効果がある。また、制御回路を冗長化すること
により、回路動作の信頼性を向上できる効果もある。
荷となるインタフェース出力回路に発生した短絡回数を
カウントし、短絡が復帰せずに一定回数に達するとイン
タフェース出力回路への電源の供給を停止することによ
り、インタフェース出力回路の損傷（破壊）を防止でき
るという効果がある。また、制御回路を冗長化すること
により、回路動作の信頼性を向上できる効果もある。
【図１】本発明の実施例のブロック図である。
【図２】本発明の実施例の詳細ブロック図である。
【図３】従来の過電流保護回路の一例のブロック図であ
る。
る。
【図４】従来の過電流保護回路の他の例のブロック図で
ある。
ある。
１ 電流制限／過電流検知部 ２ 負荷 ３ 制御信号再出力回路 ４ 制御信号ラッチ回路 ５ 短絡数カウント回路 ６ 周期リセット回路 ７ ゲート回路 ８ インバータ ９ ＡＮＤ回路 １０ ＮＯＲ回路 １１ 電流制限回路 １２ 過電流検知回路 １３ ＮＡＮＤ回路 １４ 多数決回路 ２０ 制御回路
Claims (3)
- 【請求項１】 負荷の過電流異常を検知して前記負荷の
電源を遮断した後、一定時間後に前記電源を復旧し、前
記電源の遮断／復旧の回数が一定数を超えたとき前記電
源の前記負荷への供給を強制終了するようにした過電流
保護回路であって、前記電源の遮断／復旧を制御する制
御回路に冗長性を持たせることを特徴とする過電流保護
回路。 - 【請求項２】 前記制御回路を複数個並列的に設け、こ
れ等制御回路の出力の多数決によって制御動作を行うこ
とを特徴とする請求項１記載の過電流保護回路。 - 【請求項３】 前記負荷に抵抗器を介して前記電源を供
給し、前記抵抗器における電圧降下を検知することによ
り前記過電流異常を検知することを特徴とする請求項１
あるいは２記載の過電流保護回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10315727A JP2000152485A (ja) | 1998-11-06 | 1998-11-06 | 過電流保護回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10315727A JP2000152485A (ja) | 1998-11-06 | 1998-11-06 | 過電流保護回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2000152485A true JP2000152485A (ja) | 2000-05-30 |
Family
ID=18068815
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10315727A Withdrawn JP2000152485A (ja) | 1998-11-06 | 1998-11-06 | 過電流保護回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2000152485A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012098772A (ja) * | 2010-10-29 | 2012-05-24 | Yokogawa Electric Corp | デジタル出力装置 |
| JP2018085856A (ja) * | 2016-11-24 | 2018-05-31 | アンデン株式会社 | 過電流保護装置 |
| KR20200043061A (ko) * | 2018-10-17 | 2020-04-27 | 현대엘리베이터주식회사 | Ｓｍｐｓ용 단락 보호 장치 |
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1998
- 1998-11-06 JP JP10315727A patent/JP2000152485A/ja not_active Withdrawn
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