JP2000150573A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
- Publication number
- JP2000150573A JP2000150573A JP10321575A JP32157598A JP2000150573A JP 2000150573 A JP2000150573 A JP 2000150573A JP 10321575 A JP10321575 A JP 10321575A JP 32157598 A JP32157598 A JP 32157598A JP 2000150573 A JP2000150573 A JP 2000150573A
- Authority
- JP
- Japan
- Prior art keywords
- bump
- electrode pad
- semiconductor chip
- wiring board
- wire
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/0401—Bonding areas specifically adapted for bump connectors, e.g. under bump metallisation [UBM]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/0554—External layer
- H01L2224/05599—Material
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
- H01L2224/113—Manufacturing methods by local deposition of the material of the bump connector
- H01L2224/1133—Manufacturing methods by local deposition of the material of the bump connector in solid form
- H01L2224/1134—Stud bumping, i.e. using a wire-bonding apparatus
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
- H01L2224/118—Post-treatment of the bump connector
- H01L2224/1183—Reworking, e.g. shaping
- H01L2224/1184—Reworking, e.g. shaping involving a mechanical process, e.g. planarising the bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
- H01L2224/818—Bonding techniques
- H01L2224/81801—Soldering or alloying
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
- H01L2224/85909—Post-treatment of the connector or wire bonding area
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01004—Beryllium [Be]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01005—Boron [B]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01006—Carbon [C]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01029—Copper [Cu]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/0103—Zinc [Zn]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01033—Arsenic [As]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01047—Silver [Ag]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01049—Indium [In]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/0105—Tin [Sn]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01079—Gold [Au]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01082—Lead [Pb]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/014—Solder alloys
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/102—Material of the semiconductor or solid state bodies
- H01L2924/1025—Semiconducting materials
- H01L2924/10251—Elemental semiconductors, i.e. Group IV
- H01L2924/10253—Silicon [Si]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/102—Material of the semiconductor or solid state bodies
- H01L2924/1025—Semiconducting materials
- H01L2924/1026—Compound semiconductors
- H01L2924/1032—III-V
- H01L2924/10329—Gallium arsenide [GaAs]
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Wire Bonding (AREA)
Abstract
(57)【要約】
【課題】 パッドピッチ150μm以下の条件でも、半
導体チップと配線基板との電気的な接続を確実に行い得
る半導体装置の製造方法を提供する。 【解決手段】 半導体チップの電極パッド上に第1のバ
ンプを形成する工程と、配線基板7の電極パッド8上に
低融点金属からなるワイヤ6の先端を超音波圧着、熱圧
着または超音波併用熱圧着により接合した後、その接合
部からワイヤ6を分離して電極パッド8上に第2のバン
プ9を形成する工程と、半導体チップの電極パッド上に
形成した第1のバンプと配線基板7の電極パッド8上に
形成した第2のバンプ9とを互いに加熱して接合させる
工程とを有する。
導体チップと配線基板との電気的な接続を確実に行い得
る半導体装置の製造方法を提供する。 【解決手段】 半導体チップの電極パッド上に第1のバ
ンプを形成する工程と、配線基板7の電極パッド8上に
低融点金属からなるワイヤ6の先端を超音波圧着、熱圧
着または超音波併用熱圧着により接合した後、その接合
部からワイヤ6を分離して電極パッド8上に第2のバン
プ9を形成する工程と、半導体チップの電極パッド上に
形成した第1のバンプと配線基板7の電極パッド8上に
形成した第2のバンプ9とを互いに加熱して接合させる
工程とを有する。
Description
【0001】
【発明の属する技術分野】本発明は、配線基板にバンプ
を介して半導体チップを実装してなる半導体装置の製造
方法に関する。
を介して半導体チップを実装してなる半導体装置の製造
方法に関する。
【0002】
【従来の技術】半導体装置の多極化に伴い、半導体チッ
プを金属細線(ワイヤ)を用いて基板電極に接続するワ
イヤボンディング方式に代えて、ワイヤレスボンディン
グ方式が用いられるようになってきている。ワイヤレス
ボンディング方式の例えばフリップチップ方式は、一般
に、半導体チップ上にはんだバンプを形成し、このバン
プ付きの半導体チップを裏返して(すなわちフェースダ
ウンで)、チップ実装用の配線基板に位置合わせした
後、はんだを溶かして一括接続する方法を採っている。
プを金属細線(ワイヤ)を用いて基板電極に接続するワ
イヤボンディング方式に代えて、ワイヤレスボンディン
グ方式が用いられるようになってきている。ワイヤレス
ボンディング方式の例えばフリップチップ方式は、一般
に、半導体チップ上にはんだバンプを形成し、このバン
プ付きの半導体チップを裏返して(すなわちフェースダ
ウンで)、チップ実装用の配線基板に位置合わせした
後、はんだを溶かして一括接続する方法を採っている。
【0003】
【発明が解決しようとする課題】ところが、こうした方
法では、配線基板の電極パッド上に公知の印刷技術を用
いてはんだベーストを塗布した後、そのはんだペースト
上に半導体チップのバンプを押圧しつつ加熱すると、溶
融したはんだペーストの殆どがチップ側のバンプに吸い
取られてしまう。その結果、半導体チップと配線基板と
の間に電気的な接続状態が得られないという不具合が生
じている。
法では、配線基板の電極パッド上に公知の印刷技術を用
いてはんだベーストを塗布した後、そのはんだペースト
上に半導体チップのバンプを押圧しつつ加熱すると、溶
融したはんだペーストの殆どがチップ側のバンプに吸い
取られてしまう。その結果、半導体チップと配線基板と
の間に電気的な接続状態が得られないという不具合が生
じている。
【0004】この対策としては、配線基板の電極パッド
上にはんだバンプを形成し、これによって基板電極に対
するはんだの接合強度を高めておくことが考えられる。
具体的には、配線基板の電極パッド上にはんだペースト
を塗布した後、フラックスを塗布してから配線基板をリ
フロー炉に通し、そのときの熱ではんだを溶融させるこ
とにより、はんだバンプを形成する。
上にはんだバンプを形成し、これによって基板電極に対
するはんだの接合強度を高めておくことが考えられる。
具体的には、配線基板の電極パッド上にはんだペースト
を塗布した後、フラックスを塗布してから配線基板をリ
フロー炉に通し、そのときの熱ではんだを溶融させるこ
とにより、はんだバンプを形成する。
【0005】また、上記対策を採用するにあたっては、
半導体チップのパッドピッチに対応して配線基板のパッ
ドピッチが150μm以下になると、はんだペーストが
溶融するときにバンプ間にはんだブリッジが発生してし
まう。そのため、パッドピッチ150μm以下では採用
できないという難点もある。
半導体チップのパッドピッチに対応して配線基板のパッ
ドピッチが150μm以下になると、はんだペーストが
溶融するときにバンプ間にはんだブリッジが発生してし
まう。そのため、パッドピッチ150μm以下では採用
できないという難点もある。
【0006】本発明は、上記課題を解決するためになさ
れたもので、その目的とするところは、第1に、配線基
板上のバンプ形成工程を簡略化すること、第2に、パッ
ドピッチ150μm以下の条件でも、半導体チップと配
線基板との電気的な接続を確実に行い得る半導体装置の
製造方法を提供することにある。
れたもので、その目的とするところは、第1に、配線基
板上のバンプ形成工程を簡略化すること、第2に、パッ
ドピッチ150μm以下の条件でも、半導体チップと配
線基板との電気的な接続を確実に行い得る半導体装置の
製造方法を提供することにある。
【0007】
【課題を解決するための手段】本発明に係る半導体装置
の製造方法では、半導体チップの電極パッド上に第1の
バンプを形成する工程と、配線基板の電極パッド上に第
1のバンプよりも融点の低い金属からなる金属細線の端
部を超音波圧着、熱圧着または超音波併用熱圧着により
接合した後、その接合部から金属細線を分離して電極パ
ッド上に第2のバンプを形成する工程と、半導体チップ
の電極パッド上に形成した第1のバンプと配線基板の電
極パッド上に形成した第2のバンプとを互いに加熱して
接合させる工程とを有したものとなっている。
の製造方法では、半導体チップの電極パッド上に第1の
バンプを形成する工程と、配線基板の電極パッド上に第
1のバンプよりも融点の低い金属からなる金属細線の端
部を超音波圧着、熱圧着または超音波併用熱圧着により
接合した後、その接合部から金属細線を分離して電極パ
ッド上に第2のバンプを形成する工程と、半導体チップ
の電極パッド上に形成した第1のバンプと配線基板の電
極パッド上に形成した第2のバンプとを互いに加熱して
接合させる工程とを有したものとなっている。
【0008】この半導体装置の製造方法においては、バ
ンプ位置精度の向上、供給量の安定化によりバンプ間の
ブリッジが発生しにくくなる。また、基板バンプ形成
時、リフロー工程がない場合は、配線基板の電極パッド
上に金属細線の端部を超音波圧着、熱圧着または超音波
併用熱圧着により接合して第2のバンプを形成すること
により、配線基板の電極パッドと第2のバンプとの間に
十分な接合強度が得られる。よって、リフロー工程が必
要なくなる。またこれにより、半導体チップ側に形成し
た第1のバンプと配線基板側に形成した第2のバンプと
を互いに加熱して接合させる際には、その前のバンプ形
成過程で配線基板の電極パッドに第2のバンプを十分に
接合させていることから、第2のバンプ材料の殆どが第
1のバンプに吸い取られることはなく、また第2のバン
プ材料の一部が第1のバンプ側に吸い取られることでバ
ンプ間のブリッジもより発生しにくくなる。
ンプ位置精度の向上、供給量の安定化によりバンプ間の
ブリッジが発生しにくくなる。また、基板バンプ形成
時、リフロー工程がない場合は、配線基板の電極パッド
上に金属細線の端部を超音波圧着、熱圧着または超音波
併用熱圧着により接合して第2のバンプを形成すること
により、配線基板の電極パッドと第2のバンプとの間に
十分な接合強度が得られる。よって、リフロー工程が必
要なくなる。またこれにより、半導体チップ側に形成し
た第1のバンプと配線基板側に形成した第2のバンプと
を互いに加熱して接合させる際には、その前のバンプ形
成過程で配線基板の電極パッドに第2のバンプを十分に
接合させていることから、第2のバンプ材料の殆どが第
1のバンプに吸い取られることはなく、また第2のバン
プ材料の一部が第1のバンプ側に吸い取られることでバ
ンプ間のブリッジもより発生しにくくなる。
【0009】
【発明の実施の形態】以下、本発明の実施の形態につい
て図面を参照しつつ詳細に説明する。図1乃至図4は、
本発明に係る半導体装置の製造方法の一実施形態を説明
する工程図である。
て図面を参照しつつ詳細に説明する。図1乃至図4は、
本発明に係る半導体装置の製造方法の一実施形態を説明
する工程図である。
【0010】先ず、半導体装置の製造にあたっては、図
1に示すように、半導体チップ1の電極パッド2上に例
えばボールバンプ方式で第1のバンプ3を形成する。こ
の場合、半導体チップ1としてはシリコンチップの他、
GaAs(ガリウム砒素)などの化合物半導体によるチ
ップが適用される。基板としては有機、無機基板、基板
電極パッドは金(Au)、銀(Ag)、銅(Cu)、パ
ラジウム(Pd)などが適用される。また、第1のバン
プ3としては、Au、Pd、銅、銀またはそれらを含む
合金が適用される。また、鉛(Pb)、スズ(Sn)、
インジウム(In)、亜鉛(Zn)、銀、ビスマス(B
i)あるいはこれらを含む合金でもよい。
1に示すように、半導体チップ1の電極パッド2上に例
えばボールバンプ方式で第1のバンプ3を形成する。こ
の場合、半導体チップ1としてはシリコンチップの他、
GaAs(ガリウム砒素)などの化合物半導体によるチ
ップが適用される。基板としては有機、無機基板、基板
電極パッドは金(Au)、銀(Ag)、銅(Cu)、パ
ラジウム(Pd)などが適用される。また、第1のバン
プ3としては、Au、Pd、銅、銀またはそれらを含む
合金が適用される。また、鉛(Pb)、スズ(Sn)、
インジウム(In)、亜鉛(Zn)、銀、ビスマス(B
i)あるいはこれらを含む合金でもよい。
【0011】図1においては、半導体チップ1の電極パ
ッド2上に、超音波式のバンプボンダー(キャピラリ)
4を用いて、例えばAu−Pd合金からなるワイヤの先
端を溶融してボールを形成し、このボールを超音波US
を併用して電極パッド2上に熱圧着することにより、第
1のバンプ3を形成する。
ッド2上に、超音波式のバンプボンダー(キャピラリ)
4を用いて、例えばAu−Pd合金からなるワイヤの先
端を溶融してボールを形成し、このボールを超音波US
を併用して電極パッド2上に熱圧着することにより、第
1のバンプ3を形成する。
【0012】このときの形成条件としては、例えば線径
が25μmのワイヤを用いてその先端にボールを形成
し、このボールに30g程度の圧力を加えつつ、周波数
60kHz〜200kHzで出力10mW〜50mWの
超音波USを5m秒〜50m秒加え、チップ温度は80
℃〜300℃に加熱して熱圧着する。
が25μmのワイヤを用いてその先端にボールを形成
し、このボールに30g程度の圧力を加えつつ、周波数
60kHz〜200kHzで出力10mW〜50mWの
超音波USを5m秒〜50m秒加え、チップ温度は80
℃〜300℃に加熱して熱圧着する。
【0013】また、ボール圧着後は、図示せぬクランパ
によりワイヤをクランプした状態で該クランパを上方ま
たは横方向に移動させるか、或いはバンプボンダー(キ
ャピラリ)4を上昇させてワイヤを若干引き出し該引き
出し部を局所的に加熱することにより、ワイヤを付け根
部分から分断する。その際、公知の平坦化処理によって
バンプ高さを揃えておいてもよい。これにより、半導体
チップ1の電極パッド2上には、例えば55μm〜90
μm径の第1のバンプ3が形成される。
によりワイヤをクランプした状態で該クランパを上方ま
たは横方向に移動させるか、或いはバンプボンダー(キ
ャピラリ)4を上昇させてワイヤを若干引き出し該引き
出し部を局所的に加熱することにより、ワイヤを付け根
部分から分断する。その際、公知の平坦化処理によって
バンプ高さを揃えておいてもよい。これにより、半導体
チップ1の電極パッド2上には、例えば55μm〜90
μm径の第1のバンプ3が形成される。
【0014】一方、上記半導体チップ1が実装される配
線基板側においても、その電極パッド上に第2のバンプ
を形成する。このバンプ形成に際しては、図2に示すよ
うに、ウェッジツール5に通したワイヤ(金属細線)6
を用いて、配線基板7の電極パッド8上に第2のバンプ
9を形成する。配線基板7としては、ガラスエポキシに
代表される有機基板またはセラミクス等の無機基板など
が適用される。電極パッドとしては、金、銀、銅、パラ
ジウムもしくはこれらを含む合金などで形成される。ま
た、第2のバンプ9(ワイヤ6の線材)としては、例え
ばPb(鉛)、Sn(スズ)、In(インジウム)また
はZn(亜鉛)、銀、ビスマスあるいはこれらを含む合
金など、第1のバンプ3よりも融点の低い金属が適用さ
れる。
線基板側においても、その電極パッド上に第2のバンプ
を形成する。このバンプ形成に際しては、図2に示すよ
うに、ウェッジツール5に通したワイヤ(金属細線)6
を用いて、配線基板7の電極パッド8上に第2のバンプ
9を形成する。配線基板7としては、ガラスエポキシに
代表される有機基板またはセラミクス等の無機基板など
が適用される。電極パッドとしては、金、銀、銅、パラ
ジウムもしくはこれらを含む合金などで形成される。ま
た、第2のバンプ9(ワイヤ6の線材)としては、例え
ばPb(鉛)、Sn(スズ)、In(インジウム)また
はZn(亜鉛)、銀、ビスマスあるいはこれらを含む合
金など、第1のバンプ3よりも融点の低い金属が適用さ
れる。
【0015】図2においては、配線基板7の電極パッド
8上に、ウェッジツール5を用いて、例えばSn−In
合金からなるワイヤ6の先端を押圧するとともに、その
押圧したワイヤ6の先端部分(第2のバンプ9となる部
分)に超音波を印加してこれを圧着することにより、第
2のバンプ9を形成する。
8上に、ウェッジツール5を用いて、例えばSn−In
合金からなるワイヤ6の先端を押圧するとともに、その
押圧したワイヤ6の先端部分(第2のバンプ9となる部
分)に超音波を印加してこれを圧着することにより、第
2のバンプ9を形成する。
【0016】このときの形成条件としては、例えば線径
が25μmのワイヤ6を用いてその先端部をウェッジツ
ール5により押圧し、この状態でワイヤの先端部に20
g〜50gの圧力を加えつつ、周波数60kHz〜20
0kHzで出力5mW〜50mWの超音波を10m秒〜
50m秒加えて、基板温度は常温〜250℃に加熱しワ
イヤ先端(第2のバンプ8となる部分)を電極パッド8
に圧着する。
が25μmのワイヤ6を用いてその先端部をウェッジツ
ール5により押圧し、この状態でワイヤの先端部に20
g〜50gの圧力を加えつつ、周波数60kHz〜20
0kHzで出力5mW〜50mWの超音波を10m秒〜
50m秒加えて、基板温度は常温〜250℃に加熱しワ
イヤ先端(第2のバンプ8となる部分)を電極パッド8
に圧着する。
【0017】また、ワイヤ先端の圧着に際しては、先ず
図3(a)に示すように、ウェッジツール5を下降させ
ながら、ワイヤ6の先端を電極パッド8に押し付ける。
また、ウェッジツール5の先端に突起部5a(図2参
照)を設け、この突起部5aによってワイヤ6の一部が
押し潰されるようにしてもよい。
図3(a)に示すように、ウェッジツール5を下降させ
ながら、ワイヤ6の先端を電極パッド8に押し付ける。
また、ウェッジツール5の先端に突起部5a(図2参
照)を設け、この突起部5aによってワイヤ6の一部が
押し潰されるようにしてもよい。
【0018】次いで、図3(b)に示すように、ウェッ
ジツール5によりワイヤ6の先端を押圧した状態で、上
記形成条件(超音波、熱またはこれらの併用)により、
電極パッド8にワイヤ6の先端を接合(圧着)する。そ
の後、ウエッジツール5に付属するクランパ10は、そ
のクランプ状態を解除した状態(開いた状態)で矢印方
向に移動する。
ジツール5によりワイヤ6の先端を押圧した状態で、上
記形成条件(超音波、熱またはこれらの併用)により、
電極パッド8にワイヤ6の先端を接合(圧着)する。そ
の後、ウエッジツール5に付属するクランパ10は、そ
のクランプ状態を解除した状態(開いた状態)で矢印方
向に移動する。
【0019】その後、一定量動いた後、図3(c)に示
すように、クランパ10がクランプ状態(閉じた状態)
となり、この状態でさらにウェッジツール5とクランパ
10がワイヤ6の長さ方向に移動する。この移動により
ワイヤ6がカットされる。また、ウェッジツール5に突
起部5aがある場合は、その突起部5aでワイヤ6の一
部が押し潰された部分に引っ張り力が作用することによ
り、ワイヤ6は電極パッド8との接合部(第2のバンプ
9となる部分)から分離される。
すように、クランパ10がクランプ状態(閉じた状態)
となり、この状態でさらにウェッジツール5とクランパ
10がワイヤ6の長さ方向に移動する。この移動により
ワイヤ6がカットされる。また、ウェッジツール5に突
起部5aがある場合は、その突起部5aでワイヤ6の一
部が押し潰された部分に引っ張り力が作用することによ
り、ワイヤ6は電極パッド8との接合部(第2のバンプ
9となる部分)から分離される。
【0020】続いて、図3(d)に示すように、ウェッ
ジツール5が上方に退避した後、次の接合点に向けて移
動する。
ジツール5が上方に退避した後、次の接合点に向けて移
動する。
【0021】以上の手順により、配線基板7の電極パッ
ド8上には、例えば70μm径の低融点金属(500℃
以下で溶融する金属)からなる第2のバンプ9が形成さ
れる。この後、バンプ付きの配線基板7を高温炉に投入
してバンプ形状を球状または半球状にしてもよい。
ド8上には、例えば70μm径の低融点金属(500℃
以下で溶融する金属)からなる第2のバンプ9が形成さ
れる。この後、バンプ付きの配線基板7を高温炉に投入
してバンプ形状を球状または半球状にしてもよい。
【0022】このようにしてバンプ付きの半導体チップ
1とバンプ付きの配線基板7を用意したら、その後は、
互いに対応する第1,第2のバンプ3,9を介して配線
基板7上に半導体チップ1を実装する。
1とバンプ付きの配線基板7を用意したら、その後は、
互いに対応する第1,第2のバンプ3,9を介して配線
基板7上に半導体チップ1を実装する。
【0023】さらに詳述すると、先ずは、配線基板7上
に形成された第2のバンプ9にフラックスを塗布してか
ら、バンプ付きの半導体チップ1を裏返して(すなわち
フェースダウンで)、配線基板7の上にマウントする。
このとき、半導体チップ1の裏面(バンプ形成面と反対
側の面)をマウントツールで真空吸着した後、そのマウ
ントツールのアライメント操作により、配線基板7に半
導体チップ1を位置合わせする。
に形成された第2のバンプ9にフラックスを塗布してか
ら、バンプ付きの半導体チップ1を裏返して(すなわち
フェースダウンで)、配線基板7の上にマウントする。
このとき、半導体チップ1の裏面(バンプ形成面と反対
側の面)をマウントツールで真空吸着した後、そのマウ
ントツールのアライメント操作により、配線基板7に半
導体チップ1を位置合わせする。
【0024】これにより、図4に示すように、半導体チ
ップ1側に形成された第1のバンプ3と、これに対応し
て配線基板7側に形成された第2のバンプ9とが互いに
対向した状態となるため、この状態のもとで、第1,第
2のバンプ3,9を互いに加熱しながら接触させること
により、これらを熱溶融によって接合する。なお、接合
のための加熱方法としては、半導体チップ1と配線基板
7とを共に加熱した状態で、配線基板7上に半導体チッ
プ1を位置合わせてしてマウントすることにより、互い
に対応するバンプ同士を接合させることも可能である。
また、図5に示すように、第1のバンプ3の上部先端が
尖っている場合は、第2のバンプ9に突き刺さるため、
位置合わせ時は常温〜150℃程度に加熱し、その後、
リフロー炉等で全体加熱することも可能である。
ップ1側に形成された第1のバンプ3と、これに対応し
て配線基板7側に形成された第2のバンプ9とが互いに
対向した状態となるため、この状態のもとで、第1,第
2のバンプ3,9を互いに加熱しながら接触させること
により、これらを熱溶融によって接合する。なお、接合
のための加熱方法としては、半導体チップ1と配線基板
7とを共に加熱した状態で、配線基板7上に半導体チッ
プ1を位置合わせてしてマウントすることにより、互い
に対応するバンプ同士を接合させることも可能である。
また、図5に示すように、第1のバンプ3の上部先端が
尖っている場合は、第2のバンプ9に突き刺さるため、
位置合わせ時は常温〜150℃程度に加熱し、その後、
リフロー炉等で全体加熱することも可能である。
【0025】こうした半導体チップ1の実装(バンプ接
合)に際しては、その前のバンプ形成過程で配線基板7
の電極パッド8に第2のバンプ9を十分に接合させてい
ることから、第2のバンプ9材料(本形態例ではSn−
In合金)の殆どが第1のバンプ3に吸い取られること
はなく、また第2のバンプ9材料の一部が第1のバンプ
3側に吸い取られることでバンプ間のブリッジも発生し
にくくなる。
合)に際しては、その前のバンプ形成過程で配線基板7
の電極パッド8に第2のバンプ9を十分に接合させてい
ることから、第2のバンプ9材料(本形態例ではSn−
In合金)の殆どが第1のバンプ3に吸い取られること
はなく、また第2のバンプ9材料の一部が第1のバンプ
3側に吸い取られることでバンプ間のブリッジも発生し
にくくなる。
【0026】これにより、配線基板7の電極パッド8と
第2のバンプ9との接合状態を保持しつつ、第2のバン
プ9の溶融によってバンプ同士を電気的かつ機械的に接
続させることができる。また、バッドピッチが130μ
mでも、バンプ間でのブリッジの発生を防止することが
できる。その結果、バッドピッチが150μm以下の条
件において、半導体チップ1と配線基板7との電気的接
続を確実に行うことが可能となる。また、バンプ形状を
球状または半球状としない場合は、配線基板7の電極パ
ッド8上にバンプを形成する際に、はんだペーストにフ
ラックスを塗布したり、配線基板7をリフロー炉に通す
必要がなくなるため、バンプ形成のための工程を簡略化
することもできる。
第2のバンプ9との接合状態を保持しつつ、第2のバン
プ9の溶融によってバンプ同士を電気的かつ機械的に接
続させることができる。また、バッドピッチが130μ
mでも、バンプ間でのブリッジの発生を防止することが
できる。その結果、バッドピッチが150μm以下の条
件において、半導体チップ1と配線基板7との電気的接
続を確実に行うことが可能となる。また、バンプ形状を
球状または半球状としない場合は、配線基板7の電極パ
ッド8上にバンプを形成する際に、はんだペーストにフ
ラックスを塗布したり、配線基板7をリフロー炉に通す
必要がなくなるため、バンプ形成のための工程を簡略化
することもできる。
【0027】
【発明の効果】以上説明したように、本発明に係る半導
体装置の製造方法によれば、半導体チップ側に形成した
第1のバンプと配線基板側に形成した第2のバンプとを
接合させるにあたって、配線基板の電極パッドと第2の
バンプとの接合状態を保持しつつ、バンプ同士を接合さ
せることができるとともに、バンプ間でのブリッジの発
生を防止できるため、バッドピッチが150μm以下の
条件であっても、半導体チップと配線基板との電気的接
続を確実に行うことが可能となる。また、第2のバンプ
を接合前にリフロー工程を経ない場合は、リフロー工程
なしで半導体チップと配線基板との電気的接続を確実に
行うことが可能となる。
体装置の製造方法によれば、半導体チップ側に形成した
第1のバンプと配線基板側に形成した第2のバンプとを
接合させるにあたって、配線基板の電極パッドと第2の
バンプとの接合状態を保持しつつ、バンプ同士を接合さ
せることができるとともに、バンプ間でのブリッジの発
生を防止できるため、バッドピッチが150μm以下の
条件であっても、半導体チップと配線基板との電気的接
続を確実に行うことが可能となる。また、第2のバンプ
を接合前にリフロー工程を経ない場合は、リフロー工程
なしで半導体チップと配線基板との電気的接続を確実に
行うことが可能となる。
【図1】本発明に係る半導体装置の製造方法の一実施形
態を説明する工程図(その1)である。
態を説明する工程図(その1)である。
【図2】本発明に係る半導体装置の製造方法の一実施形
態を説明する工程図(その2)である。
態を説明する工程図(その2)である。
【図3】本発明に係る半導体装置の製造方法の一実施形
態を説明する工程図(その3)である。
態を説明する工程図(その3)である。
【図4】本発明に係る半導体装置の製造方法の一実施形
態を説明する工程図(その4)である。
態を説明する工程図(その4)である。
【図5】本発明に係る半導体装置の製造方法の一実施形
態を説明する工程図(その5)である。
態を説明する工程図(その5)である。
1…半導体チップ、2,8…電極パッド、3…第1のバ
ンプ、7…配線基板、9…第2のバンプ
ンプ、7…配線基板、9…第2のバンプ
Claims (2)
- 【請求項1】 半導体チップもしくは基板上の電極パッ
ド上に第1のバンプを形成する工程と、 配線基板の電極パッド上に前記第1のバンプよりも融点
の低い金属からなる金属細線の端部を超音波圧着、熱圧
着または超音波併用熱圧着により接合した後、その接合
部から前記金属細線を分離して前記電極パッド上に第2
のバンプを形成する工程と、 前記半導体チップもしくは基板上の電極パッド上に形成
した第1のバンプと前記配線基板の電極パッド上に形成
した第2のバンプとを互いに加熱して接合させる工程と
を有することを特徴とする半導体装置の製造方法。 - 【請求項2】 前記第2のバンプを形成した後、リフロ
ー工程を経ることによりバンプ形状を球状もしくは半球
状にすることを特徴とする請求項1記載の半導体装置の
製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10321575A JP2000150573A (ja) | 1998-11-12 | 1998-11-12 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10321575A JP2000150573A (ja) | 1998-11-12 | 1998-11-12 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2000150573A true JP2000150573A (ja) | 2000-05-30 |
Family
ID=18134101
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10321575A Pending JP2000150573A (ja) | 1998-11-12 | 1998-11-12 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2000150573A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008028236A (ja) * | 2006-07-24 | 2008-02-07 | Shinko Electric Ind Co Ltd | ボンディングツールおよびバンプ形成方法 |
US7470996B2 (en) | 2005-07-27 | 2008-12-30 | Denso Corporation | Packaging method |
US20180082973A1 (en) * | 2015-03-06 | 2018-03-22 | Mitsubishi Heavy Industries, Ltd. | Bonding method and bonded body |
-
1998
- 1998-11-12 JP JP10321575A patent/JP2000150573A/ja active Pending
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7470996B2 (en) | 2005-07-27 | 2008-12-30 | Denso Corporation | Packaging method |
JP2008028236A (ja) * | 2006-07-24 | 2008-02-07 | Shinko Electric Ind Co Ltd | ボンディングツールおよびバンプ形成方法 |
US20180082973A1 (en) * | 2015-03-06 | 2018-03-22 | Mitsubishi Heavy Industries, Ltd. | Bonding method and bonded body |
EP3255659A4 (en) * | 2015-03-06 | 2018-04-11 | Mitsubishi Heavy Industries, Ltd. | Bonding method and bonded body |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JPH06338504A (ja) | 半導体装置およびその製造方法 | |
JPH02123685A (ja) | 金を含むワイヤを半田に接着する方法 | |
JP3830125B2 (ja) | 半導体装置の製造方法及び半導体装置 | |
US5877079A (en) | Method for manufacturing a semiconductor device and a method for mounting a semiconductor device for eliminating a void | |
JP2002158257A (ja) | フリップチップボンディング方法 | |
US6350632B1 (en) | Semiconductor chip assembly with ball bond connection joint | |
JPH063820B2 (ja) | 半導体装置の実装方法 | |
JPH08264540A (ja) | バンプ構造、バンプ製造用キャピラリ及びバンプ製造方 法 | |
JP2002222832A (ja) | 半導体装置及び半導体素子の実装方法 | |
JP2000150573A (ja) | 半導体装置の製造方法 | |
JP3022151B2 (ja) | ワイヤボンディング装置用のキャピラリー及びそのキャピラリーを用いた電気的接続バンプの形成方法 | |
JPH05109820A (ja) | 半導体装置の実装方法 | |
JPH0350736A (ja) | 半導体チップのバンプ製造方法 | |
JP2821777B2 (ja) | フリップチップ用ic及びその製造方法 | |
JP2000183091A (ja) | 半導体装置の実装方法 | |
JPH02312240A (ja) | バンプ形成方法およびバンプ形成装置およびバンプ | |
JPH11288975A (ja) | ボンディング方法及びボンディング装置 | |
JPH098046A (ja) | 半導体チップの突起電極形成方法 | |
JP2000323515A (ja) | Icチップと回路基板との接続方法 | |
JPH07122562A (ja) | バンプ形成方法及びワイヤボンディング方法並びにバンプ構造及びワイヤボンディング構造 | |
JP2000357700A (ja) | ボールボンディング方法および電子部品の接続方法 | |
JP2000106381A (ja) | 半導体装置の製造方法 | |
JP2780511B2 (ja) | 導電性ペーストと半導体装置の実装方法 | |
KR100237177B1 (ko) | 반도체 칩의 금속볼 접점 및 그 형성 방법 | |
KR100546001B1 (ko) | 종방향 초음파를 이용한 전자부품의 솔더링 방법 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20050826 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20060306 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20070123 |
|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20070529 |