JP2000125319A - ディジタル信号処理回路 - Google Patents
ディジタル信号処理回路Info
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Abstract
(57)【要約】
【課題】 ノイズ低減効果、または垂直フィルタ効果を
維持しつつ、回路規模や消費電力を低減するノイズ低減
回路、垂直フィルタ処理回路を得る。 【解決手段】 Ｒ信号とＢ信号をそれぞれ１ＨＤ．Ｌ．
（ディレイライン）１０１と１ＨＤ．Ｌ．１０２に入力
する。１ＨＤ．Ｌ．１０１の出力信号と１ＨＤ．Ｌ．１
０２の出力信号は、マイクロコンピュータからの制御信
号によりセレクタ１０３で選択して１ＨＤ．Ｌ．１０４
に入力する。マイクロコンピュータにより値が設定され
るｎビットの信号と１ＨＤ．Ｌ．１０４の出力信号をセ
レクタ１０５とセレクタ１０６でマイクロコンピュータ
からの制御信号によりそれぞれ選択する。１ＨＤ．Ｌ．
１０１の入出力信号とセレクタ１０５の出力信号をＮＲ
部１０７に入力し、１ＨＤ．Ｌ．１０２の入出力信号と
セレクタ１０６の出力信号をＮＲ部１０８に入力する。
入力されるＲ信号、Ｂ信号のレベルやゲインアップと連
動してマイクロコンピュータにより設定できる信号を変
化させ、ＮＲを動作させる。
維持しつつ、回路規模や消費電力を低減するノイズ低減
回路、垂直フィルタ処理回路を得る。 【解決手段】 Ｒ信号とＢ信号をそれぞれ１ＨＤ．Ｌ．
（ディレイライン）１０１と１ＨＤ．Ｌ．１０２に入力
する。１ＨＤ．Ｌ．１０１の出力信号と１ＨＤ．Ｌ．１
０２の出力信号は、マイクロコンピュータからの制御信
号によりセレクタ１０３で選択して１ＨＤ．Ｌ．１０４
に入力する。マイクロコンピュータにより値が設定され
るｎビットの信号と１ＨＤ．Ｌ．１０４の出力信号をセ
レクタ１０５とセレクタ１０６でマイクロコンピュータ
からの制御信号によりそれぞれ選択する。１ＨＤ．Ｌ．
１０１の入出力信号とセレクタ１０５の出力信号をＮＲ
部１０７に入力し、１ＨＤ．Ｌ．１０２の入出力信号と
セレクタ１０６の出力信号をＮＲ部１０８に入力する。
入力されるＲ信号、Ｂ信号のレベルやゲインアップと連
動してマイクロコンピュータにより設定できる信号を変
化させ、ＮＲを動作させる。
Description
【０００１】
【発明の属する技術分野】本発明は、１水平期間（以
下、１Ｈと略記する）ディレイラインを含み、ノイズ低
減回路や垂直フィルタ処理回路を構成するディジタル信
号処理回路に関するものである。
下、１Ｈと略記する）ディレイラインを含み、ノイズ低
減回路や垂直フィルタ処理回路を構成するディジタル信
号処理回路に関するものである。
【０００２】
【従来の技術】１Ｈディレイラインを含む映像信号のデ
ィジタル信号処理回路の代表的なものとして、ノイズ低
減回路と垂直フィルタ処理回路とがある。
ィジタル信号処理回路の代表的なものとして、ノイズ低
減回路と垂直フィルタ処理回路とがある。
【０００３】まず、ノイズ低減回路においては、回路規
模とＳ／Ｎ性能向上の効果の点から２次元のノイズ低減
回路が広く用いられている。このノイズ低減回路はノイ
ズリデューサとも呼ばれており、その代表的な従来の２
次元ノイズリデューサ（以下、２次元ＮＲと記す）につ
いて、図３により説明する。
模とＳ／Ｎ性能向上の効果の点から２次元のノイズ低減
回路が広く用いられている。このノイズ低減回路はノイ
ズリデューサとも呼ばれており、その代表的な従来の２
次元ノイズリデューサ（以下、２次元ＮＲと記す）につ
いて、図３により説明する。
【０００４】２次元ＮＲは、ノイズを低減する信号系
（ここでは、ＲＧＢそれぞれの信号）に対して、２つの
１Ｈディレイライン（１ＨＤ．Ｌ．）１０９，１１０
と、２次元ＮＲ部１１１から構成される。１Ｈディレイ
ライン１０９の入力信号は０Ｈ遅れの信号であり、１Ｈ
ディレイライン１０９の出力信号は１Ｈ遅れの信号、１
Ｈディレイライン１１０の出力信号は２Ｈ遅れの信号と
なる。１Ｈディレイライン１０９の入力信号と共に、１
Ｈディレイライン１０９，１１０の各出力信号が２次元
ＮＲ部１１１に入力される。２次元ＮＲ部１１１は３ラ
イン分の信号を入力して、２次元のノイズ低減処理され
た信号として出力する。なお、２次元ＮＲ部１１１は、
入力信号の相関を利用して、いわゆるフィルタリング処
理などを行うものであり、一般的に良く知られているの
で、詳細な説明は省略する。
（ここでは、ＲＧＢそれぞれの信号）に対して、２つの
１Ｈディレイライン（１ＨＤ．Ｌ．）１０９，１１０
と、２次元ＮＲ部１１１から構成される。１Ｈディレイ
ライン１０９の入力信号は０Ｈ遅れの信号であり、１Ｈ
ディレイライン１０９の出力信号は１Ｈ遅れの信号、１
Ｈディレイライン１１０の出力信号は２Ｈ遅れの信号と
なる。１Ｈディレイライン１０９の入力信号と共に、１
Ｈディレイライン１０９，１１０の各出力信号が２次元
ＮＲ部１１１に入力される。２次元ＮＲ部１１１は３ラ
イン分の信号を入力して、２次元のノイズ低減処理され
た信号として出力する。なお、２次元ＮＲ部１１１は、
入力信号の相関を利用して、いわゆるフィルタリング処
理などを行うものであり、一般的に良く知られているの
で、詳細な説明は省略する。
【０００５】次に、垂直フィルタ処理回路について、そ
の代表的な回路構成を図４に示す。垂直フィルタ処理回
路は、処理をかける信号系（ここでは、ＲＧＢ信号）に
対して、６つの１Ｈディレイライン（１ＨＤ．Ｌ．）１
０１，１０２，１０４，１０９，１１０，４０１と信号
生成部４０２から構成される。１Ｈディレイライン１０
１の入力信号はＲの０Ｈ遅れの信号であり、１Ｈディレ
イライン１０１の出力信号はＲの１Ｈ遅れの信号、１Ｈ
ディレイライン１０４の出力信号はＲの２Ｈ遅れの信号
となって、３ライン分の各信号は信号生成部４０２に入
力される。同様に、１Ｈディレイライン１０２の入力信
号はＢの０Ｈ遅れの信号であり、１Ｈディレイライン１
０２の出力信号はＢの１Ｈ遅れの信号、１Ｈディレイラ
イン４０１の出力信号はＢの２Ｈ遅れの信号となって、
３ライン分の各信号は信号生成部４０２に入力される。
また、１Ｈディレイライン１０９の入力信号はＧの０Ｈ
遅れの信号であり、１Ｈディレイライン１０９の出力信
号はＧの１Ｈ遅れの信号、１Ｈディレイライン１１０の
出力信号はＧの２Ｈ遅れの信号となって、３ライン分の
各信号は信号生成部４０２に入力される。信号生成部４
０２はＲ，Ｇ，Ｂ信号のそれぞれ３ライン分の信号を入
力して、垂直高域信号や垂直低域信号を出力する。
の代表的な回路構成を図４に示す。垂直フィルタ処理回
路は、処理をかける信号系（ここでは、ＲＧＢ信号）に
対して、６つの１Ｈディレイライン（１ＨＤ．Ｌ．）１
０１，１０２，１０４，１０９，１１０，４０１と信号
生成部４０２から構成される。１Ｈディレイライン１０
１の入力信号はＲの０Ｈ遅れの信号であり、１Ｈディレ
イライン１０１の出力信号はＲの１Ｈ遅れの信号、１Ｈ
ディレイライン１０４の出力信号はＲの２Ｈ遅れの信号
となって、３ライン分の各信号は信号生成部４０２に入
力される。同様に、１Ｈディレイライン１０２の入力信
号はＢの０Ｈ遅れの信号であり、１Ｈディレイライン１
０２の出力信号はＢの１Ｈ遅れの信号、１Ｈディレイラ
イン４０１の出力信号はＢの２Ｈ遅れの信号となって、
３ライン分の各信号は信号生成部４０２に入力される。
また、１Ｈディレイライン１０９の入力信号はＧの０Ｈ
遅れの信号であり、１Ｈディレイライン１０９の出力信
号はＧの１Ｈ遅れの信号、１Ｈディレイライン１１０の
出力信号はＧの２Ｈ遅れの信号となって、３ライン分の
各信号は信号生成部４０２に入力される。信号生成部４
０２はＲ，Ｇ，Ｂ信号のそれぞれ３ライン分の信号を入
力して、垂直高域信号や垂直低域信号を出力する。
【０００６】
【発明が解決しようとする課題】しかしながら、例え
ば、ＣＣＤ（Charge Coupled Device）ビデオカメラの
映像信号処理系に上記従来の構成の２次元ＮＲ処理部や
垂直フィルタ処理部を導入する場合には、Ｒ，Ｇ，Ｂの
３信号系統にそれぞれ２本ずつの１Ｈディレイライン、
即ち、合計６本の１Ｈディレイラインが必要になり、回
路規模や消費電力がその分だけ大きくなるという問題を
有していた。
ば、ＣＣＤ（Charge Coupled Device）ビデオカメラの
映像信号処理系に上記従来の構成の２次元ＮＲ処理部や
垂直フィルタ処理部を導入する場合には、Ｒ，Ｇ，Ｂの
３信号系統にそれぞれ２本ずつの１Ｈディレイライン、
即ち、合計６本の１Ｈディレイラインが必要になり、回
路規模や消費電力がその分だけ大きくなるという問題を
有していた。
【０００７】本発明は、上記従来技術の問題点を解決す
るもので、Ｒ，Ｇ，Ｂの３信号系統の映像信号処理にお
いて、２次元ＮＲ処理部や垂直フィルタ処理部の効果を
大きく減ずることなく、１Ｈディレイラインの数をでき
るだけ少なくして、回路規模や消費電力を減らすように
した、ノイズ低減回路や垂直フィルタ処理回路を構成す
るディジタル信号処理回路を提供することを目的とす
る。
るもので、Ｒ，Ｇ，Ｂの３信号系統の映像信号処理にお
いて、２次元ＮＲ処理部や垂直フィルタ処理部の効果を
大きく減ずることなく、１Ｈディレイラインの数をでき
るだけ少なくして、回路規模や消費電力を減らすように
した、ノイズ低減回路や垂直フィルタ処理回路を構成す
るディジタル信号処理回路を提供することを目的とす
る。
【０００８】
【課題を解決するための手段】上記目的を達成するため
の、本発明の基本的なディジタル信号処理回路は、輝度
信号に対する寄与率が最も大きいＧ信号の系以外のＲ，
Ｂ信号の系に対して、Ｒ信号を入力する第１の１Ｈディ
レイラインと、Ｂ信号を入力する第２の１Ｈディレイラ
インと、前記第１の１Ｈディレイラインの出力信号と前
記第２の１Ｈディレイラインの出力信号のいずれかを、
マイクロコンピュータからの制御信号により選択する第
１のセレクタと、前記第１のセレクタの出力信号を入力
する第３の１Ｈディレイラインとを備えていることを特
徴とするものである。
の、本発明の基本的なディジタル信号処理回路は、輝度
信号に対する寄与率が最も大きいＧ信号の系以外のＲ，
Ｂ信号の系に対して、Ｒ信号を入力する第１の１Ｈディ
レイラインと、Ｂ信号を入力する第２の１Ｈディレイラ
インと、前記第１の１Ｈディレイラインの出力信号と前
記第２の１Ｈディレイラインの出力信号のいずれかを、
マイクロコンピュータからの制御信号により選択する第
１のセレクタと、前記第１のセレクタの出力信号を入力
する第３の１Ｈディレイラインとを備えていることを特
徴とするものである。
【０００９】上記構成によれば、Ｒ，Ｂ信号の系に対す
る処理において、１Ｈディレイラインを、従来４本必要
としたのに対し、３本で済み、回路規模や消費電力を低
減することができる。
る処理において、１Ｈディレイラインを、従来４本必要
としたのに対し、３本で済み、回路規模や消費電力を低
減することができる。
【００１０】また、本発明の２次元ＮＲ処理回路として
のディジタル信号処理回路は、Ｒ信号を入力する第１の
１Ｈディレイラインと、Ｂ信号を入力する第２の１Ｈデ
ィレイラインと、前記第１の１Ｈディレイラインの出力
信号と前記第２の１Ｈディレイラインの出力信号のいず
れかを、マイクロコンピュータからの制御信号により選
択する第１のセレクタと、前記第１のセレクタの出力信
号を入力する第３の１Ｈディレイラインと、前記第１の
セレクタの出力信号を入力する第３の１Ｈディレイライ
ンと、前記第３の１Ｈディレイラインの出力信号と前記
マイクロコンピュータにより任意の値が設定されたｎビ
ットの信号のいずれかを、前記マイクロコンピュータか
らの制御信号により選択する第２及び第３のセレクタ
と、前記第１の１Ｈディレイラインの入出力信号と前記
第２のセレクタの出力信号とを入力する第１の２次元ノ
イズリデューサと、前記第２の１Ｈディレイラインの入
出力信号と前記第３のセレクタの出力信号とを入力する
第２の２次元ノイズリデューサと、Ｇ信号を入力する第
４の１Ｈディレイラインと、前記第４の１Ｈディレイラ
インの出力信号を入力する第５の１Ｈディレイライン
と、前記第４の１Ｈディレイラインの入出力信号と前記
第５の１Ｈディレイラインの出力信号とを入力する第３
の２次元ノイズリデューサとからなることを特徴とする
ものである。
のディジタル信号処理回路は、Ｒ信号を入力する第１の
１Ｈディレイラインと、Ｂ信号を入力する第２の１Ｈデ
ィレイラインと、前記第１の１Ｈディレイラインの出力
信号と前記第２の１Ｈディレイラインの出力信号のいず
れかを、マイクロコンピュータからの制御信号により選
択する第１のセレクタと、前記第１のセレクタの出力信
号を入力する第３の１Ｈディレイラインと、前記第１の
セレクタの出力信号を入力する第３の１Ｈディレイライ
ンと、前記第３の１Ｈディレイラインの出力信号と前記
マイクロコンピュータにより任意の値が設定されたｎビ
ットの信号のいずれかを、前記マイクロコンピュータか
らの制御信号により選択する第２及び第３のセレクタ
と、前記第１の１Ｈディレイラインの入出力信号と前記
第２のセレクタの出力信号とを入力する第１の２次元ノ
イズリデューサと、前記第２の１Ｈディレイラインの入
出力信号と前記第３のセレクタの出力信号とを入力する
第２の２次元ノイズリデューサと、Ｇ信号を入力する第
４の１Ｈディレイラインと、前記第４の１Ｈディレイラ
インの出力信号を入力する第５の１Ｈディレイライン
と、前記第４の１Ｈディレイラインの入出力信号と前記
第５の１Ｈディレイラインの出力信号とを入力する第３
の２次元ノイズリデューサとからなることを特徴とする
ものである。
【００１１】この構成によれば、従来のものに対して性
能劣化が少なく、かつ回路規模や消費電力の少ない映像
信号の２次元ＮＲ処理回路を得ることができる。
能劣化が少なく、かつ回路規模や消費電力の少ない映像
信号の２次元ＮＲ処理回路を得ることができる。
【００１２】さらに、本発明の垂直フィルタ処理回路と
してのディジタル信号処理回路は、Ｒ信号を入力する第
１の１Ｈディレイラインと、Ｂ信号を入力する第２の１
Ｈディレイラインと、前記第１の１Ｈディレイラインの
出力信号と前記第２の１Ｈディレイラインの出力信号の
いずれかを、マイクロコンピュータからの制御信号によ
り選択する第１のセレクタと、前記第１のセレクタの出
力信号を入力する第３の１Ｈディレイラインと、Ｇ信号
を入力する第４の１Ｈディレイラインと、前記第４の１
Ｈディレイラインの出力信号を入力する第５の１Ｈディ
レイラインと、前記第１の１Ｈディレイラインの入出力
信号，前記第２の１Ｈディレイラインの入出力信号，前
記第３の１Ｈディレイラインの出力信号，前記第４の１
Ｈディレイラインの入出力信号および前記第５の１Ｈデ
ィレイラインの出力信号をそれぞれ入力し、前記マイク
ロコンピュータからの制御信号により入力信号成分を選
択して垂直高域信号および垂直低域信号を生成する信号
生成部とからなることを特徴とするものである。
してのディジタル信号処理回路は、Ｒ信号を入力する第
１の１Ｈディレイラインと、Ｂ信号を入力する第２の１
Ｈディレイラインと、前記第１の１Ｈディレイラインの
出力信号と前記第２の１Ｈディレイラインの出力信号の
いずれかを、マイクロコンピュータからの制御信号によ
り選択する第１のセレクタと、前記第１のセレクタの出
力信号を入力する第３の１Ｈディレイラインと、Ｇ信号
を入力する第４の１Ｈディレイラインと、前記第４の１
Ｈディレイラインの出力信号を入力する第５の１Ｈディ
レイラインと、前記第１の１Ｈディレイラインの入出力
信号，前記第２の１Ｈディレイラインの入出力信号，前
記第３の１Ｈディレイラインの出力信号，前記第４の１
Ｈディレイラインの入出力信号および前記第５の１Ｈデ
ィレイラインの出力信号をそれぞれ入力し、前記マイク
ロコンピュータからの制御信号により入力信号成分を選
択して垂直高域信号および垂直低域信号を生成する信号
生成部とからなることを特徴とするものである。
【００１３】この構成によれば、従来のものに対して性
能劣化が少なく、かつ回路規模や消費電力の少ない映像
信号の垂直フィルタ処理回路を得ることができる。
能劣化が少なく、かつ回路規模や消費電力の少ない映像
信号の垂直フィルタ処理回路を得ることができる。
【００１４】
【発明の実施の形態】以下、本発明の実施の形態につい
て、図面を参照しながら詳細に説明する。
て、図面を参照しながら詳細に説明する。
【００１５】（実施の形態１）図１は、本発明の実施の
形態１における２次元ＮＲ処理回路を構成するディジタ
ル信号処理回路を示したものである。図１（ａ）は、Ｇ
信号系の処理部を示したもので、２本の１Ｈディレイラ
イン（１ＨＤ．Ｌ．）１０９，１１０と２次元ＮＲ部１
１１から構成されている。１Ｈディレイライン１０９と
１Ｈディレイライン１１０とで１Ｈ遅れの信号と２Ｈ遅
れの信号を生成し、１Ｈディレイライン１０９の入力信
号である０Ｈ遅れの信号と共に、２次元ＮＲ部１１１に
入力する。２次元ＮＲ部１１１のアルゴリズムに関する
パラメータの設定値は、一般にカメラのＲ，Ｇ，Ｂ入力
信号のレベルやゲインアップモードに連動してマイクロ
コンピュータにより設定される。これにより、カメラの
入力映像信号やゲインアップの各モードに適した２次元
ＮＲをかけることができる。２次元ＮＲ部１１１の出力
は、２次元のノイズ低減されたＧ信号として後段の回路
に送られる。
形態１における２次元ＮＲ処理回路を構成するディジタ
ル信号処理回路を示したものである。図１（ａ）は、Ｇ
信号系の処理部を示したもので、２本の１Ｈディレイラ
イン（１ＨＤ．Ｌ．）１０９，１１０と２次元ＮＲ部１
１１から構成されている。１Ｈディレイライン１０９と
１Ｈディレイライン１１０とで１Ｈ遅れの信号と２Ｈ遅
れの信号を生成し、１Ｈディレイライン１０９の入力信
号である０Ｈ遅れの信号と共に、２次元ＮＲ部１１１に
入力する。２次元ＮＲ部１１１のアルゴリズムに関する
パラメータの設定値は、一般にカメラのＲ，Ｇ，Ｂ入力
信号のレベルやゲインアップモードに連動してマイクロ
コンピュータにより設定される。これにより、カメラの
入力映像信号やゲインアップの各モードに適した２次元
ＮＲをかけることができる。２次元ＮＲ部１１１の出力
は、２次元のノイズ低減されたＧ信号として後段の回路
に送られる。
【００１６】一方、図１（ｂ）はＲ，Ｂ信号系の処理部
を示している。ここでは、本発明の基本的なディジタル
信号処理回路を用いてメモリ削減し、１Ｈディレイライ
ンは３本しか使用していない。Ｒ信号は１Ｈディレイラ
イン１０１に、Ｂ信号は１Ｈディレイライン１０２にそ
れぞれ入力される。セレクタ１０３は１Ｈディレイライ
ン１０１の出力信号と１Ｈディレイライン１０２の出力
信号のいずれかを、マイクロコンピュータからの制御信
号で選択し、１Ｈディレイライン１０４に出力する。セ
レクタ１０５とセレクタ１０６では、１Ｈディレイライ
ン１０４の出力とマイクロコンピュータにより任意の値
が設定されたｎビットの信号のいずれかをマイクロコン
ピュータからの制御信号で選択する。１Ｈディレイライ
ン１０１の入出力信号とセレクタ１０５の出力信号は２
次元ＮＲ部１０７に入力され、１Ｈディレイライン１０
２の入出力信号とセレクタ１０６の出力信号は２次元Ｎ
Ｒ部１０８に入力される。
を示している。ここでは、本発明の基本的なディジタル
信号処理回路を用いてメモリ削減し、１Ｈディレイライ
ンは３本しか使用していない。Ｒ信号は１Ｈディレイラ
イン１０１に、Ｂ信号は１Ｈディレイライン１０２にそ
れぞれ入力される。セレクタ１０３は１Ｈディレイライ
ン１０１の出力信号と１Ｈディレイライン１０２の出力
信号のいずれかを、マイクロコンピュータからの制御信
号で選択し、１Ｈディレイライン１０４に出力する。セ
レクタ１０５とセレクタ１０６では、１Ｈディレイライ
ン１０４の出力とマイクロコンピュータにより任意の値
が設定されたｎビットの信号のいずれかをマイクロコン
ピュータからの制御信号で選択する。１Ｈディレイライ
ン１０１の入出力信号とセレクタ１０５の出力信号は２
次元ＮＲ部１０７に入力され、１Ｈディレイライン１０
２の入出力信号とセレクタ１０６の出力信号は２次元Ｎ
Ｒ部１０８に入力される。
【００１７】セレクタ１０３とセレクタ１０５，セレク
タ１０６の制御信号と、任意の値が設定できるｎビット
の信号レベルは、例えば１フレームあるいは１フィール
ド画面内のＲ，Ｇ，Ｂ信号の成分比によって設定され
る。例えば、画面内にＢ信号成分がほとんどない場合に
は、ｎビットの信号レベルは２次元ＮＲ処理部のペデス
タルレベルに設定されると共に、セレクタ１０３で１Ｈ
ディレイライン１０１の出力信号を、セレクタ１０５で
１Ｈディレイライン１０４の出力信号を、セレクタ１０
６でマイクロコンピュータにより設定されたｎビットの
信号をそれぞれ選択するように設定される。これによ
り、画面内の信号成分として存在するＲ信号は２Ｈ遅れ
の真値の信号を用いて２次元ＮＲがかかり、画面内の信
号成分としてほとんど存在しないＢ信号はマイクロコン
ピュータにより設定されたペデスタルレベルを２Ｈ遅れ
の信号として２次元のＮＲがかかることになる。
タ１０６の制御信号と、任意の値が設定できるｎビット
の信号レベルは、例えば１フレームあるいは１フィール
ド画面内のＲ，Ｇ，Ｂ信号の成分比によって設定され
る。例えば、画面内にＢ信号成分がほとんどない場合に
は、ｎビットの信号レベルは２次元ＮＲ処理部のペデス
タルレベルに設定されると共に、セレクタ１０３で１Ｈ
ディレイライン１０１の出力信号を、セレクタ１０５で
１Ｈディレイライン１０４の出力信号を、セレクタ１０
６でマイクロコンピュータにより設定されたｎビットの
信号をそれぞれ選択するように設定される。これによ
り、画面内の信号成分として存在するＲ信号は２Ｈ遅れ
の真値の信号を用いて２次元ＮＲがかかり、画面内の信
号成分としてほとんど存在しないＢ信号はマイクロコン
ピュータにより設定されたペデスタルレベルを２Ｈ遅れ
の信号として２次元のＮＲがかかることになる。
【００１８】さらに、セレクタ１０３とセレクタ１０
５，セレクタ１０６の制御信号と、任意の値が設定でき
るｎビットの信号レベルは、カメラのゲインアップモー
ドに連動して変化させても良い。これにより、カメラの
ゲインアップの各モードに適した２次元ＮＲをかけるこ
とができる。例えば、ゲインアップモードでは一般にＳ
／Ｎ特性がより重視されるので、Ｒ，Ｇ信号に比較して
ノイズ成分の多いＢ信号のＳ／Ｎ特性が改善されるよう
に２次元ＮＲをかける。すなわち、ｎビットの信号レベ
ルは視感度補正特性上ノイズが最も目立つ３０〜４０Ｉ
ＲＥのレベルに設定すると共に、セレクタ１０３は１Ｈ
ディレイライン１０２の出力を、セレクタ１０５は設定
されたｎビットの信号を、セレクタ１０６は１Ｈディレ
イライン１０４の出力をそれぞれ選択するように設定す
る。これにより、Ｒ，Ｇ信号に比較してノイズ成分の多
いＢ信号は２Ｈ遅れの真値の信号を用いて２次元ＮＲが
かかり、Ｒ信号はマイクロコンピュータにより設定され
た３０〜４０ＩＲＥのレベルを２Ｈ遅れの信号として２
次元のＮＲがかかることになる。なお、Ｒ信号系の２次
元ＮＲ部１０７とＢ信号系の２次元ＮＲ部１０８のハー
ドウェア構成やアルゴリズムはＧ信号系の２次元ＮＲ部
１１１のそれらと同じである。２次元ＮＲ部１０７と２
次元ＮＲ部１０８の出力信号は、それぞれ２次元のノイ
ズ低減されたＲ信号、Ｂ信号として後段の回路に送られ
る。
５，セレクタ１０６の制御信号と、任意の値が設定でき
るｎビットの信号レベルは、カメラのゲインアップモー
ドに連動して変化させても良い。これにより、カメラの
ゲインアップの各モードに適した２次元ＮＲをかけるこ
とができる。例えば、ゲインアップモードでは一般にＳ
／Ｎ特性がより重視されるので、Ｒ，Ｇ信号に比較して
ノイズ成分の多いＢ信号のＳ／Ｎ特性が改善されるよう
に２次元ＮＲをかける。すなわち、ｎビットの信号レベ
ルは視感度補正特性上ノイズが最も目立つ３０〜４０Ｉ
ＲＥのレベルに設定すると共に、セレクタ１０３は１Ｈ
ディレイライン１０２の出力を、セレクタ１０５は設定
されたｎビットの信号を、セレクタ１０６は１Ｈディレ
イライン１０４の出力をそれぞれ選択するように設定す
る。これにより、Ｒ，Ｇ信号に比較してノイズ成分の多
いＢ信号は２Ｈ遅れの真値の信号を用いて２次元ＮＲが
かかり、Ｒ信号はマイクロコンピュータにより設定され
た３０〜４０ＩＲＥのレベルを２Ｈ遅れの信号として２
次元のＮＲがかかることになる。なお、Ｒ信号系の２次
元ＮＲ部１０７とＢ信号系の２次元ＮＲ部１０８のハー
ドウェア構成やアルゴリズムはＧ信号系の２次元ＮＲ部
１１１のそれらと同じである。２次元ＮＲ部１０７と２
次元ＮＲ部１０８の出力信号は、それぞれ２次元のノイ
ズ低減されたＲ信号、Ｂ信号として後段の回路に送られ
る。
【００１９】以上のように、本実施の形態１によれば、
ＲＧＢ信号から輝度信号へ変換する場合の係数が小さい
Ｒ信号とＢ信号のＮＲをマイクロコンピュータからの設
定値で行うので、１ライン分のディレイラインを削減で
きると共に、設定値をＲＧＢ信号の成分比やゲインアッ
プモードに連動させるので、回路削減による性能劣化も
少ない。
ＲＧＢ信号から輝度信号へ変換する場合の係数が小さい
Ｒ信号とＢ信号のＮＲをマイクロコンピュータからの設
定値で行うので、１ライン分のディレイラインを削減で
きると共に、設定値をＲＧＢ信号の成分比やゲインアッ
プモードに連動させるので、回路削減による性能劣化も
少ない。
【００２０】（実施の形態２）図２は、本発明の実施の
形態２における垂直フィルタ処理回路を構成するディジ
タル信号処理回路を示したものである。Ｇ信号系には２
本の１Ｈディレイライン（１ＨＤ．Ｌ．）１０９と１Ｈ
ディレイライン１１０とを備えており、１Ｈ遅れの信
号，２Ｈ遅れの信号がそれぞれ生成され、１Ｈディレイ
ライン１０９の入力信号である０Ｈ遅れの信号と共に、
信号生成部２０１に入力される。
形態２における垂直フィルタ処理回路を構成するディジ
タル信号処理回路を示したものである。Ｇ信号系には２
本の１Ｈディレイライン（１ＨＤ．Ｌ．）１０９と１Ｈ
ディレイライン１１０とを備えており、１Ｈ遅れの信
号，２Ｈ遅れの信号がそれぞれ生成され、１Ｈディレイ
ライン１０９の入力信号である０Ｈ遅れの信号と共に、
信号生成部２０１に入力される。
【００２１】一方、Ｒ，Ｂ信号系には、本発明の基本的
なディジタル信号処理回路を用いてメモリ削減し、１Ｈ
ディレイラインは３本しか備えていない。Ｒ信号は１Ｈ
ディレイライン１０１に、またＢ信号は１Ｈディレイラ
イン１０２にそれぞれ入力される。セレクタ１０３は１
Ｈディレイライン１０１の出力信号と１Ｈディレイライ
ン１０２の出力信号のいずれかを、マイクロコンピュー
タからの制御信号により選択し、１Ｈディレイライン１
０４に出力する。１Ｈディレイライン１０１の入出力信
号，１Ｈディレイライン１０２の入出力信号，１Ｈディ
レイライン１０４の出力信号およびマイクロコンピュー
タからの制御信号がそれぞれ信号生成部２０１に入力さ
れる。
なディジタル信号処理回路を用いてメモリ削減し、１Ｈ
ディレイラインは３本しか備えていない。Ｒ信号は１Ｈ
ディレイライン１０１に、またＢ信号は１Ｈディレイラ
イン１０２にそれぞれ入力される。セレクタ１０３は１
Ｈディレイライン１０１の出力信号と１Ｈディレイライ
ン１０２の出力信号のいずれかを、マイクロコンピュー
タからの制御信号により選択し、１Ｈディレイライン１
０４に出力する。１Ｈディレイライン１０１の入出力信
号，１Ｈディレイライン１０２の入出力信号，１Ｈディ
レイライン１０４の出力信号およびマイクロコンピュー
タからの制御信号がそれぞれ信号生成部２０１に入力さ
れる。
【００２２】マイクロコンピュータからの制御信号は、
例えばＲ，Ｇ，Ｂ入力信号の成分比によって設定され
る。例えば、画面内にＲ信号成分がほとんどない場合に
は、Ｇ信号とＢ信号の成分を用いて垂直フィルタ処理す
るようにセレクタ１０３と信号生成部２０１の動作が制
御される。すなわち、セレクタ１０３で１Ｈディレイラ
イン１０２の出力を選択させると共に、信号生成部２０
１でＧ信号系の０Ｈ遅れの信号Ｇ（０Ｈ）、１Ｈ遅れの
信号Ｇ（１Ｈ）、２Ｈ遅れの信号Ｇ（２Ｈ）と、Ｂ信号
系の０Ｈ遅れの信号Ｂ（０Ｈ）、１Ｈ遅れの信号Ｂ（１
Ｈ）、２Ｈ遅れの信号Ｂ（２Ｈ）の６つの信号から（数
１）および（数２）で示されるフィルタを用いてそれぞ
れ垂直高域信号および垂直低域信号を生成させる。
例えばＲ，Ｇ，Ｂ入力信号の成分比によって設定され
る。例えば、画面内にＲ信号成分がほとんどない場合に
は、Ｇ信号とＢ信号の成分を用いて垂直フィルタ処理す
るようにセレクタ１０３と信号生成部２０１の動作が制
御される。すなわち、セレクタ１０３で１Ｈディレイラ
イン１０２の出力を選択させると共に、信号生成部２０
１でＧ信号系の０Ｈ遅れの信号Ｇ（０Ｈ）、１Ｈ遅れの
信号Ｇ（１Ｈ）、２Ｈ遅れの信号Ｇ（２Ｈ）と、Ｂ信号
系の０Ｈ遅れの信号Ｂ（０Ｈ）、１Ｈ遅れの信号Ｂ（１
Ｈ）、２Ｈ遅れの信号Ｂ（２Ｈ）の６つの信号から（数
１）および（数２）で示されるフィルタを用いてそれぞ
れ垂直高域信号および垂直低域信号を生成させる。
【００２３】
【数１】(−(Ｇ(0H)＋Ｂ(0H))＋２(Ｇ(1H)＋Ｂ(1H))−
(Ｇ(2H)＋Ｂ(2H))）／８
(Ｇ(2H)＋Ｂ(2H))）／８
【００２４】
【数２】(Ｇ(0H)＋Ｂ(0H)＋２(Ｇ(1H)＋Ｂ(1H))＋Ｇ(2
H)＋Ｂ(2H)）／８ さらに、マイクロコンピュータにより設定できる制御信
号は、カメラのゲインアップモードに連動して変化させ
ても良い。例えば、ゲインアップモードでは一般に解像
度特性よりもＳ／Ｎ特性を優先されるので、ノイズ成分
の多いＢ信号は用いずに、Ｒ信号とＧ信号の成分を用い
て垂直フィルタ処理するようにセレクタ１０３と信号生
成部２０１の動作を制御する。すなわち、セレクタ１０
３で１Ｈディレイライン１０１の出力を選択させると共
に、信号生成部２０１でＲ信号系の０Ｈ遅れの信号Ｒ
（０Ｈ）、１Ｈ遅れの信号Ｒ（１Ｈ）、２Ｈ遅れの信号
Ｒ（２Ｈ）と、Ｇ信号系の０Ｈ遅れの信号Ｇ（０Ｈ）、
１Ｈ遅れの信号Ｇ（１Ｈ）、２Ｈ遅れの信号Ｇ（２Ｈ）
の６つの信号から（数３）および（数４）で示されるフ
ィルタを用いてそれぞれ垂直高域信号および垂直低域信
号を生成させる。
H)＋Ｂ(2H)）／８ さらに、マイクロコンピュータにより設定できる制御信
号は、カメラのゲインアップモードに連動して変化させ
ても良い。例えば、ゲインアップモードでは一般に解像
度特性よりもＳ／Ｎ特性を優先されるので、ノイズ成分
の多いＢ信号は用いずに、Ｒ信号とＧ信号の成分を用い
て垂直フィルタ処理するようにセレクタ１０３と信号生
成部２０１の動作を制御する。すなわち、セレクタ１０
３で１Ｈディレイライン１０１の出力を選択させると共
に、信号生成部２０１でＲ信号系の０Ｈ遅れの信号Ｒ
（０Ｈ）、１Ｈ遅れの信号Ｒ（１Ｈ）、２Ｈ遅れの信号
Ｒ（２Ｈ）と、Ｇ信号系の０Ｈ遅れの信号Ｇ（０Ｈ）、
１Ｈ遅れの信号Ｇ（１Ｈ）、２Ｈ遅れの信号Ｇ（２Ｈ）
の６つの信号から（数３）および（数４）で示されるフ
ィルタを用いてそれぞれ垂直高域信号および垂直低域信
号を生成させる。
【００２５】
【数３】(−(Ｒ(0H)＋Ｇ(0H))＋２(Ｒ(1H)＋Ｇ(1H))−
(Ｒ(2H)＋Ｇ(2H))）／８
(Ｒ(2H)＋Ｇ(2H))）／８
【００２６】
【数４】(Ｒ(0H)＋Ｇ(0H)＋２(Ｒ(1H)＋Ｇ(1H))＋Ｒ(2
H)＋Ｇ(2H)）／８ これにより、Ｒ，Ｇ信号に比べてノイズ成分の多いＢ信
号の成分を用いずに垂直フィルタ処理することになり、
解像度特性の劣化、及びＳ／Ｎ特性の劣化は少なくでき
る。
H)＋Ｇ(2H)）／８ これにより、Ｒ，Ｇ信号に比べてノイズ成分の多いＢ信
号の成分を用いずに垂直フィルタ処理することになり、
解像度特性の劣化、及びＳ／Ｎ特性の劣化は少なくでき
る。
【００２７】以上のように、本実施の形態２によれば、
画面内のＲ，Ｇ，Ｂ信号成分比やゲインアップモードに
連動して制御信号の設定値を変化させ、垂直フィルタ処
理を行う信号成分を選択するので、１ライン分のディレ
イラインを削減できると共に、回路削減による性能劣化
も少ない。
画面内のＲ，Ｇ，Ｂ信号成分比やゲインアップモードに
連動して制御信号の設定値を変化させ、垂直フィルタ処
理を行う信号成分を選択するので、１ライン分のディレ
イラインを削減できると共に、回路削減による性能劣化
も少ない。
【００２８】なお、実施の形態１の２次元ＮＲ処理部
と、実施の形態２の垂直フィルタ処理部の５本の１Ｈデ
ィレイライン１０１，１０２，１０４，１０９，１１０
とセレクタ１０３およびマイクロコンピュータにより設
定できる制御信号を共用して、２次元ＮＲ処理部と垂直
フィルタ処理部を動作させることもできる。この形態に
おいても、画面内のＲ，Ｇ，Ｂ信号成分比やゲインアッ
プモードに連動して設定値を変化させ、２次元ＮＲ処理
と垂直フィルタ処理を行うので、１ライン分のディレイ
ラインを削減できると共に、回路削減による２次元ＮＲ
処理や垂直フィルタ処理の性能劣化も少ない。
と、実施の形態２の垂直フィルタ処理部の５本の１Ｈデ
ィレイライン１０１，１０２，１０４，１０９，１１０
とセレクタ１０３およびマイクロコンピュータにより設
定できる制御信号を共用して、２次元ＮＲ処理部と垂直
フィルタ処理部を動作させることもできる。この形態に
おいても、画面内のＲ，Ｇ，Ｂ信号成分比やゲインアッ
プモードに連動して設定値を変化させ、２次元ＮＲ処理
と垂直フィルタ処理を行うので、１ライン分のディレイ
ラインを削減できると共に、回路削減による２次元ＮＲ
処理や垂直フィルタ処理の性能劣化も少ない。
【００２９】
【発明の効果】以上説明したように、本発明によれば、
従来と比較して１本の１Ｈディレイラインを削減するこ
とができ、さらに、入力映像信号のＲＧＢ成分比やゲイ
ンアップと連動して、Ｒ信号、またはＢ信号の２Ｈ遅れ
の信号をマイクロコンピュータで任意のレベル値に設定
し、その信号をＲ信号系の２次元ＮＲ部、またはＢ信号
系の２次元ＮＲ部に入力することで、２次元ＮＲの効果
の減少をできるだけ少なくすることができる。同様に、
入力映像信号のＲＧＢ成分比やゲインアップと連動し
て、Ｒ信号、またはＢ信号の２Ｈ遅れの信号をマイクロ
コンピュータで選択設定し、垂直フィルタ処理を行う信
号成分を選択することで、垂直フィルタ処理の効果の減
少をできるだけ少なくすることができる。その結果、回
路規模や消費電力を低減することが可能になる。
従来と比較して１本の１Ｈディレイラインを削減するこ
とができ、さらに、入力映像信号のＲＧＢ成分比やゲイ
ンアップと連動して、Ｒ信号、またはＢ信号の２Ｈ遅れ
の信号をマイクロコンピュータで任意のレベル値に設定
し、その信号をＲ信号系の２次元ＮＲ部、またはＢ信号
系の２次元ＮＲ部に入力することで、２次元ＮＲの効果
の減少をできるだけ少なくすることができる。同様に、
入力映像信号のＲＧＢ成分比やゲインアップと連動し
て、Ｒ信号、またはＢ信号の２Ｈ遅れの信号をマイクロ
コンピュータで選択設定し、垂直フィルタ処理を行う信
号成分を選択することで、垂直フィルタ処理の効果の減
少をできるだけ少なくすることができる。その結果、回
路規模や消費電力を低減することが可能になる。
【図１】本発明の実施の形態１におけるノイズ低減回路
の構成を示すブロック図
の構成を示すブロック図
【図２】本発明の実施の形態２における垂直フィルタ処
理回路の構成を示すブロック図
理回路の構成を示すブロック図
【図３】従来の２次元ノイズ低減回路の構成を示すブロ
ック図
ック図
【図４】従来の垂直フィルタ処理回路の構成を示すブロ
ック図
ック図
１０１，１０２，１０４，１０９，１１０ １Ｈディレ
イライン １０３，１０５，１０６ セレクタ １０７，１０８，１１１ ２次元ＮＲ部 ２０１ 信号生成部
イライン １０３，１０５，１０６ セレクタ １０７，１０８，１１１ ２次元ＮＲ部 ２０１ 信号生成部
Claims (5)
- 【請求項１】 Ｒ信号を入力する第１の１Ｈディレイラ
インと、Ｂ信号を入力する第２の１Ｈディレイライン
と、前記第１の１Ｈディレイラインの出力信号と前記第
２の１Ｈディレイラインの出力信号のいずれかを、マイ
クロコンピュータからの制御信号により選択する第１の
セレクタと、前記第１のセレクタの出力信号を入力する
第３の１Ｈディレイラインとを備えていることを特徴と
するディジタル信号処理回路。 - 【請求項２】 Ｒ信号を入力する第１の１Ｈディレイラ
インと、Ｂ信号を入力する第２の１Ｈディレイライン
と、前記第１の１Ｈディレイラインの出力信号と前記第
２の１Ｈディレイラインの出力信号のいずれかを、マイ
クロコンピュータからの制御信号により選択する第１の
セレクタと、前記第１のセレクタの出力信号を入力する
第３の１Ｈディレイラインと、前記第３の１Ｈディレイ
ラインの出力信号と前記マイクロコンピュータにより任
意の値が設定されたｎビットの信号のいずれかを、前記
マイクロコンピュータからの制御信号により選択する第
２及び第３のセレクタと、前記第１の１Ｈディレイライ
ンの入出力信号と前記第２のセレクタの出力信号とを入
力する第１の２次元ノイズリデューサと、前記第２の１
Ｈディレイラインの入出力信号と前記第３のセレクタの
出力信号とを入力する第２の２次元ノイズリデューサ
と、Ｇ信号を入力する第４の１Ｈディレイラインと、前
記第４の１Ｈディレイラインの出力信号を入力する第５
の１Ｈディレイラインと、前記第４の１Ｈディレイライ
ンの入出力信号と前記第５の１Ｈディレイラインの出力
信号とを入力する第３の２次元ノイズリデューサとから
なることを特徴とするノイズ低減回路としてのディジタ
ル信号処理回路。 - 【請求項３】 マイクロコンピュータからの制御信号お
よびｎビットの信号は、入力されるＲ信号，Ｇ信号，Ｂ
信号のそれぞれのレベルまたはゲインアップと連動して
設定値が変化することを特徴とする請求項２に記載のデ
ィジタル信号処理回路。 - 【請求項４】 Ｒ信号を入力する第１の１Ｈディレイラ
インと、Ｂ信号を入力する第２の１Ｈディレイライン
と、前記第１の１Ｈディレイラインの出力信号と前記第
２の１Ｈディレイラインの出力信号のいずれかを、マイ
クロコンピュータからの制御信号により選択する第１の
セレクタと、前記第１のセレクタの出力信号を入力する
第３の１Ｈディレイラインと、Ｇ信号を入力する第４の
１Ｈディレイラインと、前記第４の１Ｈディレイライン
の出力信号を入力する第５の１Ｈディレイラインと、前
記第１の１Ｈディレイラインの入出力信号，前記第２の
１Ｈディレイラインの入出力信号，前記第３の１Ｈディ
レイラインの出力信号，前記第４の１Ｈディレイライン
の入出力信号および前記第５の１Ｈディレイラインの出
力信号をそれぞれ入力し、前記マイクロコンピュータか
らの制御信号により入力信号成分を選択して垂直高域信
号および垂直低域信号を生成する信号生成部とからなる
ことを特徴とする垂直フィルタ処理回路としてのディジ
タル信号処理回路。 - 【請求項５】 マイクロコンピュータからの制御信号
は、入力されるＲ信号，Ｇ信号，Ｂ信号のそれぞれのレ
ベルまたはゲインアップと連動して設定値が変化するこ
とを特徴とする請求項４に記載のディジタル信号処理回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10293842A JP2000125319A (ja) | 1998-10-15 | 1998-10-15 | ディジタル信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10293842A JP2000125319A (ja) | 1998-10-15 | 1998-10-15 | ディジタル信号処理回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2000125319A true JP2000125319A (ja) | 2000-04-28 |
Family
ID=17799869
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10293842A Pending JP2000125319A (ja) | 1998-10-15 | 1998-10-15 | ディジタル信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2000125319A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US11328439B2 (en) * | 2018-03-09 | 2022-05-10 | Nec Corporation | Information processing device, object measurement system, object measurement method, and program storage medium |
-
1998
- 1998-10-15 JP JP10293842A patent/JP2000125319A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US11328439B2 (en) * | 2018-03-09 | 2022-05-10 | Nec Corporation | Information processing device, object measurement system, object measurement method, and program storage medium |
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