JP2000122489A - 画像形成装置 - Google Patents
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- JP2000122489A JP2000122489A JP10316864A JP31686498A JP2000122489A JP 2000122489 A JP2000122489 A JP 2000122489A JP 10316864 A JP10316864 A JP 10316864A JP 31686498 A JP31686498 A JP 31686498A JP 2000122489 A JP2000122489 A JP 2000122489A
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- Exposure Or Original Feeding In Electrophotography (AREA)
- Control Or Security For Electrophotography (AREA)
- Fixing For Electrophotography (AREA)
Abstract
(57)【要約】
【課題】ハードウェアによる複数の異常検知部による給
電停止のような異常対処措置が何の原因により発生した
かを容易に認識する。 【解決手段】複数のハードウェアによる異常検知部（３
１，３４；３２，３５；３７，３９；３８，４０）から
の任意の異常検知信号に応じてリレー４６の接点がオフ
され、原稿露光ランプ１９および定着ヒータ２１への給
電が停止される。各異常検知部の出力はエラーステータ
スレジスタ５０に逐次取り込まれる。このエラーステー
タスレジスタ５０の内容は表示部１５で確認することが
できる。エラーステータスレジスタ５０に１つの異常検
知信号が取り込まれた直後に、新たな異常検知信号の取
り込みが抑止される。これにより、先の異常による給電
停止に伴って２次的に発生した異常検知信号を無視する
ことができる。
電停止のような異常対処措置が何の原因により発生した
かを容易に認識する。 【解決手段】複数のハードウェアによる異常検知部（３
１，３４；３２，３５；３７，３９；３８，４０）から
の任意の異常検知信号に応じてリレー４６の接点がオフ
され、原稿露光ランプ１９および定着ヒータ２１への給
電が停止される。各異常検知部の出力はエラーステータ
スレジスタ５０に逐次取り込まれる。このエラーステー
タスレジスタ５０の内容は表示部１５で確認することが
できる。エラーステータスレジスタ５０に１つの異常検
知信号が取り込まれた直後に、新たな異常検知信号の取
り込みが抑止される。これにより、先の異常による給電
停止に伴って２次的に発生した異常検知信号を無視する
ことができる。
Description
【０００１】
【発明の属する技術分野】本発明は、複写機、プリン
タ、プロッタ等の画像形成装置に関する。
タ、プロッタ等の画像形成装置に関する。
【０００２】
【従来の技術】一般に、このような画像形成装置におい
ては、ソフトウェアに依存することなく、ハードウェア
により装置の異常（エラー）を検知する異常検知部を備
えている。これは、ソフトウェアによる異常検知で信頼
性は確保できているが、さらに信頼性を高めるために必
要となるからである。
ては、ソフトウェアに依存することなく、ハードウェア
により装置の異常（エラー）を検知する異常検知部を備
えている。これは、ソフトウェアによる異常検知で信頼
性は確保できているが、さらに信頼性を高めるために必
要となるからである。
【０００３】複写機には、異常検知部として、例えば、
定着器や原稿露光ランプの異常状態を検知するハードウ
ェア回路が備えられている。複数の異常状態のいずれが
発生しても、定着器および原稿露光ランプの給電を停止
する異常措置が採られる。
定着器や原稿露光ランプの異常状態を検知するハードウ
ェア回路が備えられている。複数の異常状態のいずれが
発生しても、定着器および原稿露光ランプの給電を停止
する異常措置が採られる。
【０００４】
【発明が解決しようとする課題】このように、ハードウ
ェアの異常検知部が複数の異常発生要因に対応して複数
設けられ、それらのいずれの検知出力によっても異常対
処措置がとられるような場合、何が原因で当該異常措置
がとられたのかが直ちに分からないという問題があっ
た。そのため、異常発生時にはサービスマン等がすべて
の異常検知状態に対応する箇所をチェックしなければな
らず、異常発生要因を究明するのに時間が掛かった。
ェアの異常検知部が複数の異常発生要因に対応して複数
設けられ、それらのいずれの検知出力によっても異常対
処措置がとられるような場合、何が原因で当該異常措置
がとられたのかが直ちに分からないという問題があっ
た。そのため、異常発生時にはサービスマン等がすべて
の異常検知状態に対応する箇所をチェックしなければな
らず、異常発生要因を究明するのに時間が掛かった。
【０００５】本発明は、このような背景においてなされ
たものであり、その目的は、ハードウェアによる複数の
異常検知部による給電停止のような異常対処措置が何の
原因により発生したかを容易に認識することができる画
像形成装置を提供することにある。
たものであり、その目的は、ハードウェアによる複数の
異常検知部による給電停止のような異常対処措置が何の
原因により発生したかを容易に認識することができる画
像形成装置を提供することにある。
【０００６】本発明の他の目的は、ハードウェアによる
複数の異常検知部による２次的な異常の検知を防止する
ことができる画像形成装置を提供することにある。
複数の異常検知部による２次的な異常の検知を防止する
ことができる画像形成装置を提供することにある。
【０００７】
【課題を解決するための手段】本発明による画像形成装
置は、複数の異常発生要因に対応した、ハードウェアに
よる複数の異常検知部を有する画像形成装置において、
前記複数の異常検知部の各々の出力信号を一時的に保持
するレジスタを設けたことを特徴とする。
置は、複数の異常発生要因に対応した、ハードウェアに
よる複数の異常検知部を有する画像形成装置において、
前記複数の異常検知部の各々の出力信号を一時的に保持
するレジスタを設けたことを特徴とする。
【０００８】好ましくは、前記レジスタの内容を表示す
る表示部を設ける。この表示部から、どのような異常が
発生したかを認識することが可能になる。
る表示部を設ける。この表示部から、どのような異常が
発生したかを認識することが可能になる。
【０００９】また、好ましくは、前記レジスタに１つの
異常検知部の異常検知信号が保持された後、前記レジス
タへの新たな異常検知信号の取り込みを抑止する手段を
設ける。これにより、本来は異常ではない２次的な異常
の検知を防止することができる。
異常検知部の異常検知信号が保持された後、前記レジス
タへの新たな異常検知信号の取り込みを抑止する手段を
設ける。これにより、本来は異常ではない２次的な異常
の検知を防止することができる。
【００１０】前記異常検知部は、例えば、検知対象の特
定の状態を検出するハードウェア検知回路と、この検知
回路の検知出力が予め定められた時間経過したことを検
出するハードウェアタイマとにより構成することができ
る。
定の状態を検出するハードウェア検知回路と、この検知
回路の検知出力が予め定められた時間経過したことを検
出するハードウェアタイマとにより構成することができ
る。
【００１１】異常検知時にとられる異常対処措置として
は、例えば、複数の前記異常検知信号の任意の１つに基
づいて、特定の構成要素への給電を停止する。
は、例えば、複数の前記異常検知信号の任意の１つに基
づいて、特定の構成要素への給電を停止する。
【００１２】
【発明の実施の形態】以下、本発明の好適な実施の形態
について、図面を参照しながら詳細に説明する。以下で
は、画像形成装置の一例として電子写真式複写機を例と
して説明するが、本発明はこれに限定されるものではな
い。
について、図面を参照しながら詳細に説明する。以下で
は、画像形成装置の一例として電子写真式複写機を例と
して説明するが、本発明はこれに限定されるものではな
い。
【００１３】図１に、複写機における定着器および原稿
露光ランプの異常状態（エラー）を検知するハードウェ
ア回路（異常検知部）を有する制御装置のブロック図を
示す。
露光ランプの異常状態（エラー）を検知するハードウェ
ア回路（異常検知部）を有する制御装置のブロック図を
示す。
【００１４】この異常検知部は、定着器もしくは原稿露
光ランプが異常状態になった場合に、ハードウェア回路
のみで定着ヒータおよび原稿露光ランプへの給電経路に
挿入されたリレーをオフし、定着ヒータおよび原稿露光
ランプへの給電を停止するためのものである。
光ランプが異常状態になった場合に、ハードウェア回路
のみで定着ヒータおよび原稿露光ランプへの給電経路に
挿入されたリレーをオフし、定着ヒータおよび原稿露光
ランプへの給電を停止するためのものである。
【００１５】図１に示すように、複写機の全体の動作
は、ＲＯＭ１３に格納された制御プログラムをＣＰＵ１
１が実行することにより実現される。ＲＡＭ１３は、そ
の際、ＣＰＵ１１のための作業領域および一時保存領域
として機能する。表示部１５は、ＣＰＵ１１からユーザ
やサービスマン向けに情報を提供するための表示を行
う。Ａ／Ｄ変換器１４は、後述する定着器からのサーミ
スタ出力をデジタル信号に変換してＣＰＵ１１へ入力す
るためのものである。ＰＩＯ(Parallel Input Output)
インタフェース部１６は、ＣＰＵ１１の並列入出力イン
タフェースを提供するものである。エラーステイタスレ
ジスタ５０は、後述する各種の異常検知部の出力を一時
的に保持するためのものである。
は、ＲＯＭ１３に格納された制御プログラムをＣＰＵ１
１が実行することにより実現される。ＲＡＭ１３は、そ
の際、ＣＰＵ１１のための作業領域および一時保存領域
として機能する。表示部１５は、ＣＰＵ１１からユーザ
やサービスマン向けに情報を提供するための表示を行
う。Ａ／Ｄ変換器１４は、後述する定着器からのサーミ
スタ出力をデジタル信号に変換してＣＰＵ１１へ入力す
るためのものである。ＰＩＯ(Parallel Input Output)
インタフェース部１６は、ＣＰＵ１１の並列入出力イン
タフェースを提供するものである。エラーステイタスレ
ジスタ５０は、後述する各種の異常検知部の出力を一時
的に保持するためのものである。
【００１６】ＣＰＵ１１、ＲＡＭ１２、ＲＯＭ１３、Ａ
／Ｄ変換器１４、表示部１５、ＰＩＯインタフェース部
１６、エラーステータスレジスタ５０は、バス１０で相
互に接続されている。
／Ｄ変換器１４、表示部１５、ＰＩＯインタフェース部
１６、エラーステータスレジスタ５０は、バス１０で相
互に接続されている。
【００１７】原稿露光ランプ１９は、原稿を露光して、
感光体ドラム（図示せず）上に静電潜像を形成するため
のものである。この原稿露光ランプ１９には、ＡＣ電源
からランプ制御部（ＣＬＲ）１８を介して給電が行われ
る。ランプ制御部１８は、ＣＰＵ１１の制御下で原稿露
光ランプ１９を制御するとともに、ランプの点灯の有無
を示す信号４４を、後述する検知回路３８へ供給する。
感光体ドラム（図示せず）上に静電潜像を形成するため
のものである。この原稿露光ランプ１９には、ＡＣ電源
からランプ制御部（ＣＬＲ）１８を介して給電が行われ
る。ランプ制御部１８は、ＣＰＵ１１の制御下で原稿露
光ランプ１９を制御するとともに、ランプの点灯の有無
を示す信号４４を、後述する検知回路３８へ供給する。
【００１８】一方、定着器は、原稿の露光、トナーによ
る現像の後に、当該トナー像を用紙上に定着させるため
の部位であり、定着ローラ２２に内蔵された定着ヒータ
２１を有する。定着ヒータ２１には、ＡＣ電源から、サ
イリスタ２０を介して給電される。サイリスタ２０は、
ＣＰＵ１１からＰＩＯインタフェース部１６を介して制
御される。定着ローラ２３，２４の表面近傍には、メイ
ンサーミスタ２３とサブサーミスタ２４の２つの温度検
出素子が配置されている。
る現像の後に、当該トナー像を用紙上に定着させるため
の部位であり、定着ローラ２２に内蔵された定着ヒータ
２１を有する。定着ヒータ２１には、ＡＣ電源から、サ
イリスタ２０を介して給電される。サイリスタ２０は、
ＣＰＵ１１からＰＩＯインタフェース部１６を介して制
御される。定着ローラ２３，２４の表面近傍には、メイ
ンサーミスタ２３とサブサーミスタ２４の２つの温度検
出素子が配置されている。
【００１９】定着ヒータ２１と原稿露光ランプ１９の共
通の電源供給経路内には、リレー４６が挿入されてい
る。このリレー４６がどのように制御されるかについて
は後述する。
通の電源供給経路内には、リレー４６が挿入されてい
る。このリレー４６がどのように制御されるかについて
は後述する。
【００２０】本実施の形態におけるハードウェアによる
複数の異常検知部は、メインサーミスタ過昇温検知回路
３１、サブサーミスタ過昇温検知回路３２、ヒータ駆動
トライアックショート検知回路３７、原稿露光ランプ点
灯検知回路３８と、これらに対応するハードウェアタイ
マ３４、３５、３６、３９、４０の５組存在する。各ハ
ードウェアタイマは、前段の検知回路が検知出力を発生
したときに直ちに異常発生と判断するのではなく、その
検知出力が所定時間継続して発生した場合に異常発生と
みなすためのものである。「所定時間」は各検知回路に
よって異なりうる。
複数の異常検知部は、メインサーミスタ過昇温検知回路
３１、サブサーミスタ過昇温検知回路３２、ヒータ駆動
トライアックショート検知回路３７、原稿露光ランプ点
灯検知回路３８と、これらに対応するハードウェアタイ
マ３４、３５、３６、３９、４０の５組存在する。各ハ
ードウェアタイマは、前段の検知回路が検知出力を発生
したときに直ちに異常発生と判断するのではなく、その
検知出力が所定時間継続して発生した場合に異常発生と
みなすためのものである。「所定時間」は各検知回路に
よって異なりうる。
【００２１】メインサーミスタ過昇温検知回路３１は、
メインサーミスタ２３の出力を常時監視し、それが予め
定めた出力値（所定の温度に対応）以上となったときに
検知出力を発生する。この検知出力によりハードウェア
タイマ３４が駆動される。ハードウェアタイマ３４は、
メインサーミスタ過昇温検知回路３１の出力で時間計測
を開始し、所定の時間経過時にタイムアウト信号を発生
する。当該所定の時間の経過前にメインサーミスタ過昇
温検知回路３１の検知出力がなくなれば、ハードウェア
タイマ３４はリセットされる。
メインサーミスタ２３の出力を常時監視し、それが予め
定めた出力値（所定の温度に対応）以上となったときに
検知出力を発生する。この検知出力によりハードウェア
タイマ３４が駆動される。ハードウェアタイマ３４は、
メインサーミスタ過昇温検知回路３１の出力で時間計測
を開始し、所定の時間経過時にタイムアウト信号を発生
する。当該所定の時間の経過前にメインサーミスタ過昇
温検知回路３１の検知出力がなくなれば、ハードウェア
タイマ３４はリセットされる。
【００２２】サブサーミスタ過昇温検知回路３２は、サ
ブサーミスタ２４の出力を受ける以外、メインサーミス
タ過昇温検知回路３２と同様である。サブサーミスタ過
昇温検知回路３２の検知出力が与えられるハードウェア
タイマ３５も、ハードウェアタイマ３４と同様である。
ブサーミスタ２４の出力を受ける以外、メインサーミス
タ過昇温検知回路３２と同様である。サブサーミスタ過
昇温検知回路３２の検知出力が与えられるハードウェア
タイマ３５も、ハードウェアタイマ３４と同様である。
【００２３】いずれかの過昇温検知回路において、所定
時間以上過昇温状態が継続した場合、そのハードウェア
タイマがタイムアウト信号を出力する。このタイムアウ
ト信号は、ＯＲゲート４１を介して、ラッチ４２にラッ
チされる。このラッチ４２のＱバー出力（”Ｌ”）は、
リレードライブ信号４５となり、トランジスタ４３をオ
ンさせてリレー４６に電流を流し、リレー接点をオフさ
せる。これにより、定着ヒータ２１および原稿露光ラン
プ１９への給電が停止される。
時間以上過昇温状態が継続した場合、そのハードウェア
タイマがタイムアウト信号を出力する。このタイムアウ
ト信号は、ＯＲゲート４１を介して、ラッチ４２にラッ
チされる。このラッチ４２のＱバー出力（”Ｌ”）は、
リレードライブ信号４５となり、トランジスタ４３をオ
ンさせてリレー４６に電流を流し、リレー接点をオフさ
せる。これにより、定着ヒータ２１および原稿露光ラン
プ１９への給電が停止される。
【００２４】ヒータ駆動トライアックショート検知回路
３７は、定着ヒータ２１を駆動するトライアック２０の
ドライブ信号１７（以下、ヒータドライブ信号ともい
う）とトライアックの両端の電圧３０とを比較すること
により、トライアック２０のショートを検出している。
トライアック２０がオン状態のときには、その両端の電
圧３０がほぼ０Ｖとなる。また、オフ状態のときには、
ほぼ電源電圧と等しい電圧となる。したがって、ドライ
ブ信号１７がオンのときには、トライアック両端の電圧
はほぼ０Ｖ、オフのときには電源電圧となる筈である。
しかし、トライアック２０がショートまたはオープン状
態で破壊されているとすると、この論理が一致しなくな
る。このときは、異常状態であるため、上記と同様、ハ
ードウェアタイマ３９により、所定時間以上の論理不一
致の継続を検出したときタイムアウト信号が発生する。
このタイムアウト信号により、ＯＲゲート４１、ラッチ
４２およびトランジスタ４３を介して、リレー接点をオ
フさせる。
３７は、定着ヒータ２１を駆動するトライアック２０の
ドライブ信号１７（以下、ヒータドライブ信号ともい
う）とトライアックの両端の電圧３０とを比較すること
により、トライアック２０のショートを検出している。
トライアック２０がオン状態のときには、その両端の電
圧３０がほぼ０Ｖとなる。また、オフ状態のときには、
ほぼ電源電圧と等しい電圧となる。したがって、ドライ
ブ信号１７がオンのときには、トライアック両端の電圧
はほぼ０Ｖ、オフのときには電源電圧となる筈である。
しかし、トライアック２０がショートまたはオープン状
態で破壊されているとすると、この論理が一致しなくな
る。このときは、異常状態であるため、上記と同様、ハ
ードウェアタイマ３９により、所定時間以上の論理不一
致の継続を検出したときタイムアウト信号が発生する。
このタイムアウト信号により、ＯＲゲート４１、ラッチ
４２およびトランジスタ４３を介して、リレー接点をオ
フさせる。
【００２５】原稿露光ランプ点灯検知回路３８は、ラン
プ制御部１８からの信号４４に基づき、原稿露光ランプ
１９の点灯を検知する。この検知信号を前記と同様にハ
ードウェアタイマ４０で検知することにより、連続して
所定時間（ここでは、２１秒）以上点灯し続けた場合を
異常状態として、タイムアウト信号を発生する。原稿露
光ランプ１９は、原稿に対して１スキャンした後、バッ
クスキャン中にオフするので、通常、所定時間以上連続
点灯することがない。このため、このような方式を採っ
ている。このタイムアウト信号により、ＯＲゲート４
１、ラッチ４２およびトランジスタ４３を介して、リレ
ー接点をオフさせる。
プ制御部１８からの信号４４に基づき、原稿露光ランプ
１９の点灯を検知する。この検知信号を前記と同様にハ
ードウェアタイマ４０で検知することにより、連続して
所定時間（ここでは、２１秒）以上点灯し続けた場合を
異常状態として、タイムアウト信号を発生する。原稿露
光ランプ１９は、原稿に対して１スキャンした後、バッ
クスキャン中にオフするので、通常、所定時間以上連続
点灯することがない。このため、このような方式を採っ
ている。このタイムアウト信号により、ＯＲゲート４
１、ラッチ４２およびトランジスタ４３を介して、リレ
ー接点をオフさせる。
【００２６】このように、ソフトウェアに依存すること
なく、ハードウェア回路にて複数の異常状態を検知し、
定着ヒータ２１および原稿露光ランプ１９への給電を停
止している。
なく、ハードウェア回路にて複数の異常状態を検知し、
定着ヒータ２１および原稿露光ランプ１９への給電を停
止している。
【００２７】以上説明した各ハードウェアタイマ３４、
３５、３９、４０の各出力は、上記ＯＲゲート４１に入
力される他、エラーステータスレジスタ５０にも入力さ
れ、ここに一時的に取り込まれる。この実施の形態で
は、エラーステータスレジスタ５０には、所定周波数
（ここでは１０ＭＨｚ）のクロック信号が入力され、常
時、各検知回路からの入力を取り込んでいる。各検知回
路に対しては、エラーステータスレジスタ５０の中で、
対応するビット位置が予め定められている。この様子を
図２に示す。
３５、３９、４０の各出力は、上記ＯＲゲート４１に入
力される他、エラーステータスレジスタ５０にも入力さ
れ、ここに一時的に取り込まれる。この実施の形態で
は、エラーステータスレジスタ５０には、所定周波数
（ここでは１０ＭＨｚ）のクロック信号が入力され、常
時、各検知回路からの入力を取り込んでいる。各検知回
路に対しては、エラーステータスレジスタ５０の中で、
対応するビット位置が予め定められている。この様子を
図２に示す。
【００２８】図２の例では、エラーステータスレジスタ
５０は８ビットのレジスタであり、そのビット０〜３の
４ビットが利用されている。すなわち、これらのビット
０〜３は、それぞれ原稿露光ランプ点灯検知回路３８、
メインサーミスタ過昇温検知回路３１、サブサーミスタ
過昇温検知回路３２、ヒータ駆動トライアックショート
検知回路３７にそれぞれ割り当てられている。
５０は８ビットのレジスタであり、そのビット０〜３の
４ビットが利用されている。すなわち、これらのビット
０〜３は、それぞれ原稿露光ランプ点灯検知回路３８、
メインサーミスタ過昇温検知回路３１、サブサーミスタ
過昇温検知回路３２、ヒータ駆動トライアックショート
検知回路３７にそれぞれ割り当てられている。
【００２９】図１に戻り、ラッチ４２の出力であるリレ
ードライブ信号４５はＰＩＯ１６を経由し、ＣＰＵ１１
へと入力される。ＣＰＵ１１は、これに応答して、異常
が発生したことを表示部１５に表示する。例えば、ユー
ザに対して、サービスマンを呼ぶことを要求するエラー
メッセージを表示する。また、ＣＰＵ１１は、レジスタ
５０の内容をＲＡＭ１２のバッテリバックアップされた
領域に待避しておく。サービスマンは、複写機をサービ
スモードにして、エラーステータスレジスタ５０の待避
された内容を表示部１５に表示させる。これにより、サ
ービスマンが異常箇所をより容易に特定することが可能
になる。
ードライブ信号４５はＰＩＯ１６を経由し、ＣＰＵ１１
へと入力される。ＣＰＵ１１は、これに応答して、異常
が発生したことを表示部１５に表示する。例えば、ユー
ザに対して、サービスマンを呼ぶことを要求するエラー
メッセージを表示する。また、ＣＰＵ１１は、レジスタ
５０の内容をＲＡＭ１２のバッテリバックアップされた
領域に待避しておく。サービスマンは、複写機をサービ
スモードにして、エラーステータスレジスタ５０の待避
された内容を表示部１５に表示させる。これにより、サ
ービスマンが異常箇所をより容易に特定することが可能
になる。
【００３０】以上の各検知回路３１、３２、３７、３８
は、前述した機能を達成できるハードウェア回路であれ
ば、任意の回路構成のもので足りるが、ヒータ駆動トラ
イアックショート検知回路３７のみ他の検知回路と動作
が若干異なるので、その回路例を図３に示す。この検知
回路３７は、トライアック２０の両端の電圧３０をフォ
トカプラ３７２の入力側に受ける。フォトカプラ３７２
の出力は、コンパレータ３７７の一方の入力端に入力さ
れる。コンパレータ３７７の他方の入力端には、固定電
位が与えられている。ヒータドライブ信号１７に応じて
トライアック２０の両端電圧３０が前述したように電源
電圧と０Ｖとの間で切り替わり、これに応じてフォトカ
プラ３７２がオン、オフし、コンパレータ３７７の出力
もオン、オフする。コンパレータ３７７の出力とヒータ
ドライブ信号１７とはＥＸＯＲゲート３７８で比較さ
れ、一致／不一致信号がハードウェアタイマ３９へ出力
される。
は、前述した機能を達成できるハードウェア回路であれ
ば、任意の回路構成のもので足りるが、ヒータ駆動トラ
イアックショート検知回路３７のみ他の検知回路と動作
が若干異なるので、その回路例を図３に示す。この検知
回路３７は、トライアック２０の両端の電圧３０をフォ
トカプラ３７２の入力側に受ける。フォトカプラ３７２
の出力は、コンパレータ３７７の一方の入力端に入力さ
れる。コンパレータ３７７の他方の入力端には、固定電
位が与えられている。ヒータドライブ信号１７に応じて
トライアック２０の両端電圧３０が前述したように電源
電圧と０Ｖとの間で切り替わり、これに応じてフォトカ
プラ３７２がオン、オフし、コンパレータ３７７の出力
もオン、オフする。コンパレータ３７７の出力とヒータ
ドライブ信号１７とはＥＸＯＲゲート３７８で比較さ
れ、一致／不一致信号がハードウェアタイマ３９へ出力
される。
【００３１】ところで、リレードライブ信号４５により
定着ヒータ２１および原稿露光ランプ１９への給電を停
止した場合、ヒータドライブ信号１７の如何によらずト
ライアック両端の電圧３０がほぼ０Ｖとなり、トライア
ックオン状態と同一になってしまう。つまり、実際には
定着ヒータ２１をオンしていないのに、検知結果はオン
していることになる。このため、ハードウェアタイマ３
９が動作し、エラーステータスレジスタ５０内の対応ビ
ットが立ってしまう。
定着ヒータ２１および原稿露光ランプ１９への給電を停
止した場合、ヒータドライブ信号１７の如何によらずト
ライアック両端の電圧３０がほぼ０Ｖとなり、トライア
ックオン状態と同一になってしまう。つまり、実際には
定着ヒータ２１をオンしていないのに、検知結果はオン
していることになる。このため、ハードウェアタイマ３
９が動作し、エラーステータスレジスタ５０内の対応ビ
ットが立ってしまう。
【００３２】このように、一つの異常が発生時に給電を
停止することで二次的な異常（本来は異常ではないも
の）が発生し、エラーステータスレジスタ５０の中で連
続して２つのビットが立ってしまうことがある。このよ
うな状態を避けるため、リレードライブ信号４５が”
Ｌ”となった状態（どれか一つの異常が発生したとき）
においては、エラーステータスレジスタ５０のイネーブ
ル端子に対して、インバータ５２を介してＨ信号を出力
することにより、レジスタ５０をディスエーブルする。
これにより、以後の検知信号のレジスタ５０への取り込
みが抑止されることになる。この代わりに、すべてのハ
ードウェアタイマ３４〜３６、３９、４０のカウントを
ディスエーブルすることにより、２次的な異常の発生を
防止するようにしてもよい。さらには、いずれかのハー
ドウェアタイマがタイムアウト信号を出力したときに、
この出力で他のハードウェアタイマをディスエーブルす
るようにしてもよい。このように、結果的にエラーステ
ータスレジスタ５０への検知信号の追加取り込みを抑止
する方法は種々考えられ、そのいずれを採用してもよ
い。
停止することで二次的な異常（本来は異常ではないも
の）が発生し、エラーステータスレジスタ５０の中で連
続して２つのビットが立ってしまうことがある。このよ
うな状態を避けるため、リレードライブ信号４５が”
Ｌ”となった状態（どれか一つの異常が発生したとき）
においては、エラーステータスレジスタ５０のイネーブ
ル端子に対して、インバータ５２を介してＨ信号を出力
することにより、レジスタ５０をディスエーブルする。
これにより、以後の検知信号のレジスタ５０への取り込
みが抑止されることになる。この代わりに、すべてのハ
ードウェアタイマ３４〜３６、３９、４０のカウントを
ディスエーブルすることにより、２次的な異常の発生を
防止するようにしてもよい。さらには、いずれかのハー
ドウェアタイマがタイムアウト信号を出力したときに、
この出力で他のハードウェアタイマをディスエーブルす
るようにしてもよい。このように、結果的にエラーステ
ータスレジスタ５０への検知信号の追加取り込みを抑止
する方法は種々考えられ、そのいずれを採用してもよ
い。
【００３３】
【発明の効果】本発明によれば、画像形成装置におい
て、異常発生時にエラーステータスレジスタに異常発生
要因を特定するための情報が保持されるので、ハードウ
ェアによる複数の異常検知部による給電停止のような異
常対処措置が何の原因により発生したかを容易に認識す
ることができる。
て、異常発生時にエラーステータスレジスタに異常発生
要因を特定するための情報が保持されるので、ハードウ
ェアによる複数の異常検知部による給電停止のような異
常対処措置が何の原因により発生したかを容易に認識す
ることができる。
【００３４】また、１つの異常発生要因情報の取り込み
直後に、エラーステータスレジスタのさらなる異常発生
要因情報の取り込みを抑止することにより、ハードウェ
アによる複数の異常検知部による２次的な異常の検知を
防止することができる。
直後に、エラーステータスレジスタのさらなる異常発生
要因情報の取り込みを抑止することにより、ハードウェ
アによる複数の異常検知部による２次的な異常の検知を
防止することができる。
【００３５】よって、異常発生時にサービスマンが異常
発生要因特定に要する時間を大幅に短縮することが可能
になる。
発生要因特定に要する時間を大幅に短縮することが可能
になる。
【００３６】
【図１】本発明の一実施の形態による複写機における定
着器および原稿露光ランプの異常状態（エラー）を検知
するハードウェア回路を有する制御装置のブロック図で
ある。
着器および原稿露光ランプの異常状態（エラー）を検知
するハードウェア回路を有する制御装置のブロック図で
ある。
【図２】図１のブロック図内に示したエラーステータス
レジスタの内部構成を示す説明図である。
レジスタの内部構成を示す説明図である。
【図３】図１のブロック図内にに示したヒータ駆動トラ
イアックショート検知回路の内部構成例を示す回路図で
ある。
イアックショート検知回路の内部構成例を示す回路図で
ある。
１１…ＣＰＵ、１２…ＲＡＭ、１３…ＲＯＭ、１４…Ａ
／Ｄ変換器、１５…表示部、１６…ＰＩＯインタフェー
ス部、１７…ヒータドライブ信号、１８…ランプ制御
部、１９…原稿露光ランプ、２０…トライアック、２１
…定着ヒータ、２２…定着ローラ、２３…メインサーミ
スタ、２４…サブサーミスタ、３１…メインサーミスタ
過昇温検知回路、３２…サブサーミスタ過昇温検知回
路、３７…ヒータ駆動トライアックショート検知回路、
３８…原稿露光ランプ点灯検知回路、３４，３５，３
９，４０…ハードウェアタイマ、４１…ＯＲゲート、４
２…ラッチ、４３…トランジスタ、４５…リレードライ
ブ信号、４６…リレー、５０…エラーステータスレジス
タ、５２…インバータ。
／Ｄ変換器、１５…表示部、１６…ＰＩＯインタフェー
ス部、１７…ヒータドライブ信号、１８…ランプ制御
部、１９…原稿露光ランプ、２０…トライアック、２１
…定着ヒータ、２２…定着ローラ、２３…メインサーミ
スタ、２４…サブサーミスタ、３１…メインサーミスタ
過昇温検知回路、３２…サブサーミスタ過昇温検知回
路、３７…ヒータ駆動トライアックショート検知回路、
３８…原稿露光ランプ点灯検知回路、３４，３５，３
９，４０…ハードウェアタイマ、４１…ＯＲゲート、４
２…ラッチ、４３…トランジスタ、４５…リレードライ
ブ信号、４６…リレー、５０…エラーステータスレジス
タ、５２…インバータ。
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考） Ｇ０３Ｇ 21/14 Ｇ０３Ｇ 21/00 ３７２ (72)発明者 田辺 雅俊 東京都大田区下丸子３丁目30番２号 キヤ ノン株式会社内 Ｆターム(参考） 2H027 DA11 DA12 DA38 EA20 EC06 EC20 ED06 ED25 ED30 EE02 EE07 EF09 EK01 EK03 EK06 GA32 GB02 GB07 GB08 HA02 2H033 AA42 BA30 BA34 CA06 CA07 CA34 CA38 2H076 AA70 AB85 BA67 EA22 9A001 BZ06 KZ42 LZ09
Claims (5)
- 【請求項１】複数の異常発生要因に対応した、ハードウ
ェアによる複数の異常検知部を有する画像形成装置にお
いて、 前記複数の異常検知部の各々の出力信号を一時的に保持
するレジスタを設けたことを特徴とする画像形成装置。 - 【請求項２】前記レジスタの内容を表示する表示部を有
する請求項１記載の画像形成装置。 - 【請求項３】前記レジスタに１つの異常検知部の異常検
知信号が保持された後、前記レジスタへの新たな異常検
知信号の取り込みを抑止する手段を有する請求項１記載
の画像形成装置。 - 【請求項４】前記異常検知部は、検知対象の特定の状態
を検出するハードウェア検知回路と、この検知回路の検
知出力が予め定められた時間経過したことを検出するハ
ードウェアタイマとにより構成される請求項１記載の画
像形成装置。 - 【請求項５】複数の前記異常検知信号の任意の１つに基
づいて、特定の構成要素への給電を停止する手段を有す
る請求項１記載の画像形成装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10316864A JP2000122489A (ja) | 1998-10-20 | 1998-10-20 | 画像形成装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10316864A JP2000122489A (ja) | 1998-10-20 | 1998-10-20 | 画像形成装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2000122489A true JP2000122489A (ja) | 2000-04-28 |
Family
ID=18081771
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10316864A Withdrawn JP2000122489A (ja) | 1998-10-20 | 1998-10-20 | 画像形成装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2000122489A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US10585379B2 (en) | 2017-11-20 | 2020-03-10 | Canon Kabushiki Kaisha | Image forming apparatus that detects an abnormality in a heater based on temperatures detected by temperature detection portions |
| JP2021140073A (ja) * | 2020-03-06 | 2021-09-16 | キヤノン株式会社 | 加熱装置及び画像形成装置 |
-
1998
- 1998-10-20 JP JP10316864A patent/JP2000122489A/ja not_active Withdrawn
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US10585379B2 (en) | 2017-11-20 | 2020-03-10 | Canon Kabushiki Kaisha | Image forming apparatus that detects an abnormality in a heater based on temperatures detected by temperature detection portions |
| US10955778B2 (en) | 2017-11-20 | 2021-03-23 | Canon Kabushiki Kaisha | Image forming apparatus having plurality of temperature detection portions and a plurality of abnormality detection circuit portions |
| JP2021140073A (ja) * | 2020-03-06 | 2021-09-16 | キヤノン株式会社 | 加熱装置及び画像形成装置 |
| JP7471869B2 (ja) | 2020-03-06 | 2024-04-22 | キヤノン株式会社 | 加熱装置及び画像形成装置 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20060110 |