JP2000068968A - 多重化装置 - Google Patents
多重化装置Info
- Publication number
- JP2000068968A JP2000068968A JP10237720A JP23772098A JP2000068968A JP 2000068968 A JP2000068968 A JP 2000068968A JP 10237720 A JP10237720 A JP 10237720A JP 23772098 A JP23772098 A JP 23772098A JP 2000068968 A JP2000068968 A JP 2000068968A
- Authority
- JP
- Japan
- Prior art keywords
- cpu
- speed line
- cpus
- low
- line termination
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
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- Hardware Redundancy (AREA)
- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】
【課題】 低速回線終端部に現用系と非常系の２つのＣ
ＰＵを備え、現用のＣＰＵに障害が発生した場合、自動
的に非常系のＣＰＵに切り替えて、低速回線終端部のＣ
ＰＵに障害が発生しても通信障害を起こさない多重化装
置を提供すること。 【解決手段】 低速回線を収容する低速回線終端手段
に、通常の状態で使用される現用系ＣＰＵと、現用系Ｃ
ＰＵに障害が発生した時に処理を代行する非常用ＣＰＵ
を具備する。各ＣＰＵは自身に障害が発生したことを検
出する自己診断機能を備え、更に制御部にも各ＣＰＵの
障害の有無を検出する手段を備える。いずれかの手段に
より障害が検出された場合、制御部は非常用ＣＰＵに切
り替える。
ＰＵを備え、現用のＣＰＵに障害が発生した場合、自動
的に非常系のＣＰＵに切り替えて、低速回線終端部のＣ
ＰＵに障害が発生しても通信障害を起こさない多重化装
置を提供すること。 【解決手段】 低速回線を収容する低速回線終端手段
に、通常の状態で使用される現用系ＣＰＵと、現用系Ｃ
ＰＵに障害が発生した時に処理を代行する非常用ＣＰＵ
を具備する。各ＣＰＵは自身に障害が発生したことを検
出する自己診断機能を備え、更に制御部にも各ＣＰＵの
障害の有無を検出する手段を備える。いずれかの手段に
より障害が検出された場合、制御部は非常用ＣＰＵに切
り替える。
Description
【０００１】
【発明の属する技術分野】本発明は、低速回線と高速デ
ィジタル回線に接続して各種メディアを伝送する多重化
装置に関し、特に、データ送受信を司る低速回線終端部
の二重化機能に関する。
ィジタル回線に接続して各種メディアを伝送する多重化
装置に関し、特に、データ送受信を司る低速回線終端部
の二重化機能に関する。
【０００２】
【従来の技術】多重化装置は大きく４つの部分に分けら
れる。即ち、データ端末あるいは電子交換機から送られ
た信号を収容する低速回線終端部と、高速ディジタル回
線を収容する高速回線終端部と、低速回線終端部を高速
回線終端部へ多重化／分離する多重変換部と、それらを
制御する制御部の４つである。
れる。即ち、データ端末あるいは電子交換機から送られ
た信号を収容する低速回線終端部と、高速ディジタル回
線を収容する高速回線終端部と、低速回線終端部を高速
回線終端部へ多重化／分離する多重変換部と、それらを
制御する制御部の４つである。
【０００３】図３は従来の多重化装置３０の構成を表す
機能ブロック図である。多重化装置３０の低速回線終端
部３１は１つのＣＰＵ３１１と１つのコネクタ３１２か
らなり、両部は一体となっている。データ端末または電
子交換機１５から送られた信号は１つのコネクタ３１２
とＣＰＵ３１１を介して多重変換部１２へ送られてい
る。
機能ブロック図である。多重化装置３０の低速回線終端
部３１は１つのＣＰＵ３１１と１つのコネクタ３１２か
らなり、両部は一体となっている。データ端末または電
子交換機１５から送られた信号は１つのコネクタ３１２
とＣＰＵ３１１を介して多重変換部１２へ送られてい
る。
【０００４】
【発明が解決しようとする課題】従来の多重化装置３０
では、多重変換部１２、高速回線終端部１３、及び制御
部３４はそれぞれ二重化してバックアップしていたが、
低速回線終端部３１の障害時のバックアップ機能がなか
った。このため、低速回線終端部３１のＣＰＵ３１２に
障害が発生すると通信障害を起こしていた。
では、多重変換部１２、高速回線終端部１３、及び制御
部３４はそれぞれ二重化してバックアップしていたが、
低速回線終端部３１の障害時のバックアップ機能がなか
った。このため、低速回線終端部３１のＣＰＵ３１２に
障害が発生すると通信障害を起こしていた。
【０００５】また、従来の多重化装置３０では、低速回
線終端部３１を構成するコネクタ３１１とＣＰＵ３１２
が一体型になっている。このため、ＣＰＵ３１１を現用
系から非常系に自動的に切り替えたとしても、コネクタ
３１２を手動で切り替える必要があった。
線終端部３１を構成するコネクタ３１１とＣＰＵ３１２
が一体型になっている。このため、ＣＰＵ３１１を現用
系から非常系に自動的に切り替えたとしても、コネクタ
３１２を手動で切り替える必要があった。
【０００６】本発明が解決しようとする課題は、低速回
線終端部のＣＰＵに障害が発生しても通信障害を起こさ
ない多重化装置を提供することである。
線終端部のＣＰＵに障害が発生しても通信障害を起こさ
ない多重化装置を提供することである。
【０００７】また、本発明が解決しようとする他の課題
は、低速回線終端部に現用系と非常系の２つのＣＰＵを
備え、現用のＣＰＵに障害が発生した場合、自動的に非
常系のＣＰＵに切り替える多重化装置を提供することで
ある。
は、低速回線終端部に現用系と非常系の２つのＣＰＵを
備え、現用のＣＰＵに障害が発生した場合、自動的に非
常系のＣＰＵに切り替える多重化装置を提供することで
ある。
【０００８】
【課題を解決するための手段】以上のような課題を解決
する為、本発明は、低速回線を収容する低速回線終端手
段と、高速ディジタル回線を収容する高速回線終端手段
と、低速回線を高速ディジタル回線に多重化すると共に
高速ディジタル回線を低速回線に分離する多重変換手段
と、低速回線終端手段、高速回線終端手段、及び多重変
換手段を制御する制御手段とを備える多重化装置におい
て、低速回線終端手段は、通常の状態で使用される現用
系ＣＰＵと、現用系ＣＰＵに障害が発生した時に処理を
代行する非常用ＣＰＵとして機能する複数のＣＰＵを備
えることを特徴とする多重化装置を提供する。
する為、本発明は、低速回線を収容する低速回線終端手
段と、高速ディジタル回線を収容する高速回線終端手段
と、低速回線を高速ディジタル回線に多重化すると共に
高速ディジタル回線を低速回線に分離する多重変換手段
と、低速回線終端手段、高速回線終端手段、及び多重変
換手段を制御する制御手段とを備える多重化装置におい
て、低速回線終端手段は、通常の状態で使用される現用
系ＣＰＵと、現用系ＣＰＵに障害が発生した時に処理を
代行する非常用ＣＰＵとして機能する複数のＣＰＵを備
えることを特徴とする多重化装置を提供する。
【０００９】低速回線終端手段は低速回線と接続される
コネクタを備え、該コネクタは複数のＣＰＵと内部バス
によって接続される。
コネクタを備え、該コネクタは複数のＣＰＵと内部バス
によって接続される。
【００１０】複数のＣＰＵはそれぞれ該ＣＰＵ自身の動
作に障害があるか否かを検出し、障害を検出すると制御
手段に通知する自己診断手段を備える。
作に障害があるか否かを検出し、障害を検出すると制御
手段に通知する自己診断手段を備える。
【００１１】制御手段は複数のＣＰＵの動作に障害があ
るか否かを検出するＣＰＵ診断手段を備える。
るか否かを検出するＣＰＵ診断手段を備える。
【００１２】制御手段は、自己診断手段及びＣＰＵ診断
手段のいずれかにより障害が検出されると現用系ＣＰＵ
を当該他のＣＰＵに切り替える。
手段のいずれかにより障害が検出されると現用系ＣＰＵ
を当該他のＣＰＵに切り替える。
【００１３】
【発明の実施の形態】本発明の一実施の形態である多重
化装置１０について図１を参照して説明する。尚、既に
説明した図３と同一の機能を有する構成要素については
同一の参照符号を付してある。
化装置１０について図１を参照して説明する。尚、既に
説明した図３と同一の機能を有する構成要素については
同一の参照符号を付してある。
【００１４】低速回線終端部１１はデータ端末あるいは
電子交換機から送られた信号を収容する。多重変換部１
２は低速回線終端部を高速回線終端部へ多重化／分離す
る。高速回線終端部１３は高速ディジタル回線を収容す
る。制御部１４は上記の各部を制御する。
電子交換機から送られた信号を収容する。多重変換部１
２は低速回線終端部を高速回線終端部へ多重化／分離す
る。高速回線終端部１３は高速ディジタル回線を収容す
る。制御部１４は上記の各部を制御する。
【００１５】低速回線終端部１１は互いに独立したコネ
クタ１１１、ＣＰＵ１１２、１１３からなり、コネクタ
１１１とＣＰＵ１１２、１１３は内部バスを通じて接続
されている。
クタ１１１、ＣＰＵ１１２、１１３からなり、コネクタ
１１１とＣＰＵ１１２、１１３は内部バスを通じて接続
されている。
【００１６】ＣＰＵ１１２、１１３はそれぞれ自己診断
機能（ウォッチドックタイマー）を有する。これによ
り、ＣＰＵの内部で障害が発生した時、「障害発生」を
制御部１４に伝達する（この「障害発生情報」をＣＰＵ
１１２及び１１３の間の切替のトリガとする）。
機能（ウォッチドックタイマー）を有する。これによ
り、ＣＰＵの内部で障害が発生した時、「障害発生」を
制御部１４に伝達する（この「障害発生情報」をＣＰＵ
１１２及び１１３の間の切替のトリガとする）。
【００１７】更に、ＣＰＵの自己診断機能に障害が発生
した場合の対応として、制御部１４はＣＰＵを診断する
機能を有する。即ち、制御部１４はＣＰＵを定期的にポ
ーリングしてＣＰＵの状態を監視する。
した場合の対応として、制御部１４はＣＰＵを診断する
機能を有する。即ち、制御部１４はＣＰＵを定期的にポ
ーリングしてＣＰＵの状態を監視する。
【００１８】これらＣＰＵ１１２、１１３又は制御部１
４で検出された障害情報を元に、制御部１４は、予め設
定しておいたネットワークパターンに従ってＣＰＵを現
用系から非常系または非常系から現用系に切り替えるも
のとする。
４で検出された障害情報を元に、制御部１４は、予め設
定しておいたネットワークパターンに従ってＣＰＵを現
用系から非常系または非常系から現用系に切り替えるも
のとする。
【００１９】次に、多重化装置１０の現用系ＣＰＵにお
ける障害検出から非常系ＣＰＵへの切替までの動作を図
２を参照して説明する。
ける障害検出から非常系ＣＰＵへの切替までの動作を図
２を参照して説明する。
【００２０】現用系のＣＰＵにて障害が発生したとき
（Ｓ１）、該ＣＰＵの自己診断が正常に動作している場
合（Ｓ２）、自己診断により障害が検出されて制御部１
４に障害情報が通知される（Ｓ４）。自己診断機能にも
障害が及んでいる場合、制御部１４がＣＰＵに対して定
期的に実行するポーリングによって障害が検出される
（Ｓ５）。いずれの場合も制御部１４はネットワークパ
ターンを切り替えて（Ｓ６）ＣＰＵを非常系に切り替え
る。
（Ｓ１）、該ＣＰＵの自己診断が正常に動作している場
合（Ｓ２）、自己診断により障害が検出されて制御部１
４に障害情報が通知される（Ｓ４）。自己診断機能にも
障害が及んでいる場合、制御部１４がＣＰＵに対して定
期的に実行するポーリングによって障害が検出される
（Ｓ５）。いずれの場合も制御部１４はネットワークパ
ターンを切り替えて（Ｓ６）ＣＰＵを非常系に切り替え
る。
【００２１】
【発明の効果】本発明の多重化装置によれば、低速回線
終端部のバックアップが可能となり、信頼性を向上する
ことができるという効果がある。
終端部のバックアップが可能となり、信頼性を向上する
ことができるという効果がある。
【００２２】以上、本発明を実施の形態に基づいて説明
したが、本発明はこれに限定されるものではなく、当業
者の通常の知識の範囲内でその変更や改良が可能である
ことは勿論である。
したが、本発明はこれに限定されるものではなく、当業
者の通常の知識の範囲内でその変更や改良が可能である
ことは勿論である。
【図１】本発明の一実施の形態である多重化装置１０の
構成を表す機能ブロック図である。
構成を表す機能ブロック図である。
【図２】多重化装置１０の動作を表すフローチャートで
ある。
ある。
【図３】従来の多重化装置３０の構成を表す機能ブロッ
ク図である。
ク図である。
１０、３０ 多重化装置 １１、３１ 低速回線終端部 １２ 多重変換部 １３ 高速回線終端部 １４、３４ 制御部 １１１、３１１ コネクタ １１２、１１３、３１２ ＣＰＵ
Claims (5)
- 【請求項１】 低速回線を収容する低速回線終端手段
と、高速ディジタル回線を収容する高速回線終端手段
と、低速回線を高速ディジタル回線に多重化すると共に
高速ディジタル回線を低速回線に分離する多重変換手段
と、前記低速回線終端手段、高速回線終端手段、及び多
重変換手段を制御する制御手段とを備える多重化装置に
おいて、 前記低速回線終端手段は、通常の状態で使用される現用
系ＣＰＵと、前記現用系ＣＰＵに障害が発生した時に処
理を代行する非常用ＣＰＵとして機能する複数のＣＰＵ
を備えることを特徴とする多重化装置。 - 【請求項２】 請求項１記載の多重化装置において、前
記低速回線終端手段は前記低速回線と接続されるコネク
タを備え、該コネクタは前記複数のＣＰＵと内部バスに
よって接続されることを特徴とする多重化装置。 - 【請求項３】 請求項１及び２のいずれかに記載の多重
化装置において、前記複数のＣＰＵはそれぞれ該ＣＰＵ
自身の動作に障害があるか否かを検出し、障害を検出す
ると前記制御手段に通知する自己診断手段を備えること
を特徴とする多重化装置。 - 【請求項４】 請求項１乃至３のいずれかに記載の多重
化装置において、前記制御手段は前記複数のＣＰＵの動
作に障害があるか否かを検出するＣＰＵ診断手段を備え
ることを特徴とする多重化装置。 - 【請求項５】 請求項３及び４のいずれかに記載の多重
化装置において、前記制御手段は、前記自己診断手段及
びＣＰＵ診断手段のいずれかにより障害が検出されると
現用系ＣＰＵを当該他のＣＰＵに切り替えることを特徴
とする多重化装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10237720A JP2000068968A (ja) | 1998-08-24 | 1998-08-24 | 多重化装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10237720A JP2000068968A (ja) | 1998-08-24 | 1998-08-24 | 多重化装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2000068968A true JP2000068968A (ja) | 2000-03-03 |
Family
ID=17019506
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10237720A Withdrawn JP2000068968A (ja) | 1998-08-24 | 1998-08-24 | 多重化装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2000068968A (ja) |
-
1998
- 1998-08-24 JP JP10237720A patent/JP2000068968A/ja not_active Withdrawn
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20051101 |