EP0346664A1 - Phasenregelkreis - Google Patents

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EP0346664A1
EP0346664A1 EP89109547A EP89109547A EP0346664A1 EP 0346664 A1 EP0346664 A1 EP 0346664A1 EP 89109547 A EP89109547 A EP 89109547A EP 89109547 A EP89109547 A EP 89109547A EP 0346664 A1 EP0346664 A1 EP 0346664A1
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EP
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locked loop
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controller
adjustment
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EP89109547A
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English (en)
French (fr)
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Dieter Storz
Dieter Baas
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Deutsche Thomson Brandt GmbH
Original Assignee
Deutsche Thomson Brandt GmbH
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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03LAUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00Automatic control of frequency or phase; Synchronisation
    • H03L7/06Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08Details of the phase-locked loop
    • H03L7/14Details of the phase-locked loop for assuring constant frequency when supply or correction voltages fail
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03LAUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L1/00Stabilisation of generator output against variations of physical values, e.g. power supply
    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11BINFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B19/00Driving, starting, stopping record carriers not specifically of filamentary or web form, or of supports therefor; Control thereof; Control of operating function ; Driving both disc and head
    • G11B19/20Driving; Starting; Stopping; Control thereof
    • G11B19/28Speed controlling, regulating, or indicating
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03LAUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00Automatic control of frequency or phase; Synchronisation
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    • H03L7/08Details of the phase-locked loop
    • H03L7/085Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
    • H03L7/087Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal using at least two phase detectors or a frequency and phase detector in the loop
    • HELECTRICITY
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    • H03L7/00Automatic control of frequency or phase; Synchronisation
    • H03L7/06Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08Details of the phase-locked loop
    • H03L7/10Details of the phase-locked loop for assuring initial synchronisation or for broadening the capture range
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10STECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10S388/00Electricity: motor control systems
    • Y10S388/907Specific control circuit element or device
    • Y10S388/911Phase locked loop

Definitions

  • the invention relates to a phase-locked loop in which the output of a first phase comparator, in which the actual frequency is compared with the reference frequency, is connected to the input of a first controller, the output of which is connected to the input of a tracking oscillator.
  • phase locked loop a so-called phase-locked loop, is described on pages 683-684 in U.Tietze, Ch. Schenk, Semiconductor Circuit Technology, 4th Edition, Springer-Verlag, 1978.
  • Phase locked loops serve e.g. in CD players to obtain the synchronous signal for regulating the speed of the disk drive from the EFM signal, the data signal coded according to the eight-to-fourteen code and optically read from the CD disk. It is necessary to regulate the speed of the disk drive in order to ensure a constant bit rate in the data flow.
  • a first disadvantage is that in the production of a CD player, the tracking oscillator of the phase-locked loop has to be adjusted to the reference frequency by manual adjustment, since manual adjustment work is always time-consuming and expensive.
  • a second disadvantage only becomes apparent during the operation of a CD player, if the parameters of the individual components change over time due to temperature drift or aging of the components of the PLL and lead to a gradual deterioration in the sound reproduction that is initially barely perceptible.
  • the invention solves this problem in that the output of a second controller is connected to the input of the tracking oscillator, that the output of the tracking oscillator is connected to the first input of a second phase comparator, the second input of which is supplied with the reference frequency and the output of which is connected to the input of the second controller is connected, that for automatic adjustment of the phase-locked loop the first controller is separated from the tracking oscillator, that the second controller changes the value at its output until the frequency at the output of the tracking oscillator matches the reference frequency, that after the adjustment the second Regulator maintains this value regardless of the value at the output of the second phase comparator and the first regulator is connected again to the input of the tracking oscillator.
  • the EFM signal is fed to the first input of a phase comparator P1, the output of which is connected to the input of a first regulator R.
  • the output of a quartz oscillator OZ which generates the reference frequency BF, is connected to the second input of the phase comparator P1 and a further phase comparator P2, the first input of which is connected to the output of a tracking oscillator VCO.
  • the input of the tracking oscillator VCO for example a voltage-controlled oscillator, is connected to the first input A1 of a microprocessor MP provided as a second controller and via a controllable switch S to the output of the first controller R.
  • the input E of the microprocessor MP is connected to the output of the phase comparator P2.
  • the control input of the controllable switch S is connected to the second output A2 of the microprocessor MP.
  • the microprocessor MP opens the controllable switch S, so that the output of the first regulator (R) is separated from the input of the tracking oscillator OZ, and now changes the voltage at its output A1 until the frequency at the output of the voltage-controlled one Oscillator VCO matches the reference frequency BF of the crystal oscillator OZ.
  • the microprocessor MP then maintains this voltage at its output A1 and closes the controllable switch S.
  • the phase-locked loop is now balanced and ready for operation.
  • the automatic adjustment of the phase-locked loop can be carried out, for example, each time the CD player is switched on, according to subclaim 5. However, as stated in subclaims 6 and 7, it can also be carried out each time before playing a new CD or when no data is being played back, for example in a pause between two pieces of music will. Even if the scanning device of the CD player is in a waiting position because the operator enters a program into the CD player, for example, the adjustment can take place. In two further exemplary embodiments, the adjustment takes place when the error rate in the data signal exceeds a predefinable threshold value or when the CD player fails completely. The adjustment can also be carried out for track jumping.
  • the speed of the disk drive last set before the adjustment is maintained for the duration of the adjustment in a further exemplary embodiment.
  • This measure has the advantage in a system that works with a constant web speed - a so-called constant velocity system - that the speed of the disk drive after the adjustment is close to the setpoint.
  • a CD player is equipped with the phase-locked loop according to the invention, not only is the annoying adjustment by hand omitted in production, but also because of the frequent adjustment, the sound reproduction is ensured because changes in the parameters of individual components due to aging or as a result Temperature fluctuations are compensated for with each new adjustment.
  • controllable switch S can be provided in front of the first input of the phase comparator P1 or, as shown in FIG. 3, between the phase comparator P1 and the controller R.
  • switch S When switch S is closed, the output of controller R is low-resistance, when switch S is open on the other hand, high impedance. Therefore, the controller R is only effective in the first case; in the second case, however, it is deactivated.
  • the first input of the phase comparator P1 is connected to reference potential via the collector-emitter path of a transistor T, the base of which is connected to the output A2 of the microprocessor MP.
  • the input of the phase comparator P2 is pulled to the reference potential by the transistor T. Because this makes the output of controller R high-impedance, controller R no longer acts on the PLL. It is deactivated. In contrast, when the transistor T is blocked, the regulator R is effective because its output has a low resistance in this case.

Landscapes

  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Networks Using Active Elements (AREA)
  • Rotational Drive Of Disk (AREA)
  • Stereo-Broadcasting Methods (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)

Abstract

Um den lästigen Abgleich von Hand bei der Produktion und um Schwankungen der Drehzahl sowie eine damit verbundene Verschlechterung der Tonwiedergabe infolge Alterung der Bauteile und infolge Temperaturdrift zu vermeiden, wird ein automatischer Abgleich durchgeführt. Hierzu wird der Regler (R) des Phasenregelkreises vom Nachlaufoszillator (VCO) getrennt. Der Ausgang des Nachlaufoszillators (VCO) ist mit dem ersten Eingang eines Phasenvergleichers (P2) verbunden, dessen zweitem Eingang die Bezugsfrequenz (BF) zugeführt wird. Ein Mikroprozessor (MP), dessen Eingang (E) mit dem Ausgang des Phasenvergleichers (P2) und dessen Ausgang (A1) mit dem Eingang des Nachlaufoszillators (VCO) verbunden ist, ändert die Spannung an seinem Ausgang (A1) so lange, bis die Frequenz am Ausgang des Nachlaufoszillators (VCO) mit der Bezugsfrequenz (BF) übereinstimmt. Diese Spannung behält der Mikroprozessor (MP) bei. Der Regler (R) wird nun wieder mit dem Nachlaufoszillator (VCO) verbunden. Der Phasenregelkreis ist jetzt abgeglichen und betriebsbereit. Bei einem CD-Spieler kann der Abgleich beispielsweise jedesmal beim Einschalten, beim Wechsel einer CD-Platte oder während einer Pause zwischen zwei Musikstücken erfolgen.

Description

  • Die Erfindung betrifft einen Phasenregelkreis, bei dem der Aus­gang eines ersten Phasenvergleichers, in dem die Istfrequenz mit der Bezugsfrequenz verglichen wird, mit dem Eingang eines ersten Reglers verbunden ist, dessen Ausgang mit dem Eingang eines Nachlaufoszillators verbunden ist.
  • In U.Tietze, Ch. Schenk, Halbleiter-Schaltungstechnik, 4. Aufla­ge, Springer-Verlag, 1978 ist auf Seite 683 - 684 ein Phasenre­gelkreis, eine sogenannte phase-locked-loop beschrieben.
  • Phasenregelkreise, häufig mit PLL abgekürzt, dienen z.B. in CD-Spielern dazu, aus dem EFM-Signal, dem nach dem ei­ght-to-fourteen-Code codierten und optisch von der CD-Platte gelesenen Datensignal, das Synchronsignal zur Regelung der Drehzahl des Plattenantriebs zu gewinnen. Die Regelung der Drehzahl des Plattenantriebs ist nötig, um eine gleichbleibende Bitrate im Datenfluß zu gewährleisten.
  • Ein erster Nachteil besteht nun darin, daß bei der Produktion eines CD-Spielers der Nachlaufoszillator des Phasenregelkreises durch Abgleich von Hand auf die Bezugsfrequenz eingestellt werden muß, denn Einstellarbeiten von Hand sind stets zeitauf­wendig und teuer.
  • Ein zweiter Nachteil zeigt sich jedoch erst während des Be­triebs eines CD-Spielers, wenn sich durch Temperaturdrift oder durch Alterung der Bauteile der PLL im Laufe der Zeit bedingt die Parameter der einzelnen Bauteile ändern und zu einer allmäh­lichen zunächst kaum wahrnehmbaren Verschlechterung der Tonwie­dergabe führen.
  • Es ist daher Aufgabe der Erfindung, bei einem Phasenregelkreis den nachteiligen Abgleich von Hand zu vermeiden und für einen von Alterung der Bauteile und von Temperaturdrift weitestgehend unabhängigen störungsfreien Betrieb zu sorgen.
  • Die Erfindung löst diese Aufgabe dadurch, daß der Ausgang eines zweiten Reglers mit dem Eingang des Nachlaufoszillators verbun­den ist, daß der Ausgang des Nachlaufoszillators mit dem ersten Eingang eines zweiten Phasenvergleichers verbunden ist, dessen zweitem Eingang die Bezugsfrequenz zugeführt wird und dessen Ausgang mit dem Eingang des zweiten Reglers verbunden ist, daß zum automatischen Abgleich des Phasenregelkreises der erste Regler vom Nachlaufoszillator getrennt wird, daß der zweite Regler den Wert an seinem Ausgang so lange ändert, bis die Frequenz am Ausgang des Nachlaufoszillators mit der Bezugsfre­quenz übereinstimmt, daß nach dem Abgleich der zweite Regler diesen Wert unabhängig vom Wert am Ausgang des zweiten Phasen­vergleichers beibehält und der erste Regler wieder mit dem Eingang des Nachlaufoszillators verbunden wird.
  • Es zeigen
    • Figur 1 ein erstes Ausführungsbeispiel
    • Figur 2 ein zweites Ausführungsbeispiel
    • Figur 3 ein drittes Ausführungsbeispiel
    • Figur 4 ein viertes Ausführungsbeispiel der Erfindung.
  • Anhand des in Figur 1 gezeigten Ausführungsbeispieles wird die Erfindung nun zuerst beschrieben und anschließend erläutert.
  • In der Figur 1 wird das EFM-Signal dem ersten Eingang eines Phasenvergleichers P1 zugeführt, dessen Ausgang mit dem Eingang eines ersten Reglers R verbunden ist. Der Ausgang eines Quarzos­zillators OZ, der die Bezugsfrequenz BF erzeugt, ist mit dem zweiten Eingang des Phasenvergleichers P1 und eines weiteren Phasenvergleichers P2 verbunden, dessen erster Eingang mit dem Ausgang eines Nachlaufoszillators VCO verbunden ist. Der Ein­gang des Nachlaufoszillators VCO, beispielsweise ein spannungs­gesteuerter Oszillator, ist mit dem ersten Eingang A1 eines als zweiten Regler vorgesehenen Mikroprozessors MP und über einen steuerbaren Schalter S mit dem Ausgang des ersten Reglers R verbunden. Der Eingang E des Mikroprozessors MP ist mit dem Ausgang des Phasenvergleichers P2 verbunden. Der Steuereingang des steuerbaren Schalters S ist mit dem zweiten Ausgang A2 des Mikroprozessors MP verbunden.
  • Zum Abgleich des Phasenregelkreises öffnet der Mikroprozessor MP den steuerbaren Schalter S, so daß der Ausgang des ersten Reglers (R) vom Eingang des Nachlaufoszillators OZ getrennt wird, und ändert nun die Spannung an seinem Ausgang A1 so lan­ge, bis die Frequenz am Ausgang des spannungsgesteuerten Oszil­lators VCO mit der Bezugsfrequenz BF des Quarzoszillators OZ übereinstimmt. Anschließend behält der Mikroprozessor MP diese Spannung an seinem Ausgang A1 bei und schließt den steuerbaren Schalter S. Der Phasenregelkreis ist jetzt abgeglichen und betriebsbereit.
  • Der automatische Abgleich des Phasenregelkreises kann z.B. ge­mäß Unteranspruch 5 jedesmal beim Einschalten des CD-Spielers vorgenommen werden. Er kann aber auch, wie in den Unteransprü­chen 6 und 7 angegeben, jedesmal vor dem Abspielen einer neuen CD-Platte oder wenn keine Daten wiedergegeben werden, beispiels­weise in einer Pause zwischen zwei Musikstücken, durchgeführt werden. Auch wenn sich die Abtastvorrichtung des CD-Spielers in einer Warteposition befindet, weil die Bedienperson beispiels­weise ein Programm in den CD-Spieler eingibt,kann der Abgleich erfolgen. Bei zwei weiteren Ausführungsbeispielen erfolgt der Abgleich, wenn die Fehlerrate im Datensignal einen vorgebbaren Schwellwert übersteigt oder wenn der CD-Spieler vollkommen aus­fällt. Beim Spurspringen läßt sich der Abgleich ebenfalls durch­führen.
  • Wenn der Abgleich bei bereits laufendem Plattenantrieb, z.B. zwischen zwei Musikstücken, durchgeführt wird, wird bei einem weiteren Ausführungsbeispiel die zuletzt vor dem Abgleich einge­stellte Drehzahl des Plattenantriebs für die Dauer des Ab­gleichs beibehalten. Diese Maßnahme hat bei einem System, das mit einer konstanten Bahngeschwindigkeit arbeitet - ein soge­nanntes constant velocity system - den Vorteil, daß die Dreh­zahl des Plattenantriebs nach dem Abgleich in der Nähe des Sollwertes liegt.
  • Selbstverständlich ist eine Kombination aller in den Unteran­sprüchen 4 - 8 beschriebenen Merkmale möglich.
  • Wenn ein CD-Spieler mit dem erfindungsgemäßen Phasenregelkreis ausgerüstet ist, entfällt nicht nur der lästige Abgleich von Hand bei der Produktion, sondern es wird auch wegen des häufig vorgenommenen Neuabgleichs für eine gleichbleibend gute Tonwie­dergabe gesorgt, weil Änderungen der Parameter einzelner Bautei­le infolge Alterung oder infolge Temperaturschwankungen bei jedem Neuabgleich kompensiert werden.
  • Wie in Figur 2 gezeigt ist, kann der steuerbare Schalter S vor dem ersten Eingang des Phasenvergleichers P1 oder, wie in Figur 3 dargestellt ist, zwischen dem Phasenvergleicher P1 und dem Re­gler R vorgesehen sein. Bei geschlossenem Schalter S ist der Ausgang des Reglers R niederohmig, bei geöffnetem Schalter S dagegen hochohmig. Daher ist der Regler R nur im ersten Fall wirksam; im zweiten Fall ist er dagegen unwirksam geschaltet.
  • In Figur 4 ist der erste Eingang des Phasenvergleichers P1 über die Kollektor-Emitter-Strecke eines Transistors T, dessen Basis mit dem Ausgang A2 des Mikroprozessors MP verbunden ist, mit Be­zugspotential verbunden. Während des Abgleichs des Phasenregel­kreises wird der Eingang des Phasenvergleichers P2 vom Transi­stor T auf Bezugspotential gezogen. Weil dadurch der Ausgang des Reglers R hochohmig wird, wirkt der Regler R nicht mehr auf die PLL. Er ist unwirksam geschaltet. Bei gesperrtem Transistor T ist der Regler R dagegen wirksam, weil sein Ausgang in diesem Fall niederohmig ist.

Claims (12)

1. Phasenregelkreis, bei dem der Ausgang eines ersten Phasen­vergleichers (P1), in dem die Istfrequenz (IF) mit der Be­zugsfrequenz (BF) verglichen wird, mit dem Eingang eines ersten Reglers (R) verbunden ist, dessen Ausgang mit dem Eingang eines Nachlaufoszillators (VCO) verbunden ist, dadurch gekennzeichnet, daß der Aus­gang (A1) eines zweiten Reglers (MP) mit dem Eingang des Nachlaufoszillators (VCO) verbunden ist, daß der Ausgang des Nachlaufoszillators (VCO) mit dem ersten Eingang eines zweiten Phasenvergleichers (P2) verbunden ist, dessen zwei­tem Eingang die Bezugsfrequenz (BF) zugeführt wird und des­sen Ausgang mit dem Eingang (E) des zweiten Reglers (MP) verbunden ist, daß zum automatischen Abgleich des Phasenre­gelkreises der erste Regler (R) vom Nachlaufoszillator (VCO) getrennt wird, daß der zweite Regler (MP) den Wert an seinem Ausgang (A1) so lange ändert, bis die Frequenz am Ausgang des Nachlaufoszillators (VCO) mit der Bezugsfre­quenz (BF) übereinstimmt, daß nach dem Abgleich der zweite Regler (MP) diesen Wert unabhängig vom Wert am Ausgang des zweiten Phasenvergleichers (P2) beibehält und der erste Re­gler (R) wieder mit dem Eingang des Nachlaufoszillators (VCO) verbunden wird.
2. Phasenregelkreis nach Anspruch 1, dadurch ge­kennzeichnet, daß der Ausgang eines Quarzoszil­lators (OZ), der die Bezugsfrequenz (BF) erzeugt, mit dem zweiten Eingang des ersten und des zweiten Phasenverglei­chers (P1, P2) verbunden ist, daß der erste Ausgang (A1) des zweiten Reglers (MP) mit dem Eingang des Nachlaufoszil­lators (VCO) und der zweite Ausgang (A2) des zweiten Reg­lers (MP) mit dem Steuereingang eines steuerbaren Schal­ters (S) verbunden ist, der den ersten Regler (R) unwirk­sam schaltet.
3. Phasenregelkreis nach Anspruch 2, dadurch ge­kennzeichnet, daß der steuerbare Schalter (S) entweder vor dem ersten Eingang des ersten Phasenverglei­chers (P1) oder zwischen dem ersten Phasenvergleicher (P1) und dem ersten Regler (R) oder zwischen dem ersten Regler (R) und dem Nachlaufoszillator (VCO) liegt, daß der zweite Regler (MP) zum Abgleich des Phasenregelkreises den steuer­baren Schalter (S) öffnet und nach dem Abgleich wieder schließt.
4. Phasenregelkreis nach Anspruch 1, 2 oder 3, da­durch gekennzeichnet, daß der Phasenre­gelkreis in einem CD-Spieler aus dem EFM-Signal, das dem ersten Eingang des ersten Phasenvergleichers (P1) zuge­führt wird, das Synchronsignal zur Regelung des Plattenan­triebs erzeugt.
5. Phasenregelkreis nach Anspruch 4, dadurch ge­kennzeichnet, daß der Abgleich jedesmal nach dem Einschalten des CD-Spielers erfolgt.
6. Phasenregelkreis nach Anspruch 4 oder 5, dadurch gekennzeichnet, daß der Abgleich jedesmal vor dem Abspielen einer neuen CD-Platte erfolgt.
7. Phasenregelkreis nach Anspruch 4, 5 oder 6, da­durch gekennzeichnet, daß der Abgleich erfolgt, wenn keine Datensignale wiedergegeben werden.
8. Phasenregelkreis nach Anspruch 4, 5, 6 oder 7, da­durch gekennzeichnet, daß der Abgleich durchgeführt wird, wenn die Fehlerrate im Datensignal ei­nen vorgebbaren Schwellwert überschreitet.
9. Phasenregelkreis nach Anspruch 4, 5, 6, 7 oder 8, da­durch gekennzeichnet, daß der Abgleich bei Ausfall der Datenwiedergabe erfolgt.
10. Phasenregelkreis nach Anspruch 4, 5, 6, 7, 8 oder 9, da­durch gekennzeichnet, daß der Abgleich während des Spurspringens erfolgt.
11. Phasenregelkreis nach Anspruch 4, 5, 6, 7, 8, 9 oder 10, dadurch gekennzeichnet, daß der Ab­gleich in der Pause zwischen zwei Musikstücken erfolgt.
12. Phasenregelkreis nach Anspruch 4, 5, 6, 7, 8, 9, 10 oder 11, dadurch gekennzeichnet, daß die zuletzt vor dem Abgleich eingestellte Drehzahl des Platten­antriebs für die Dauer des Abgleichs beibehalten wird.
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