EP0021062A2 - Verfahren zur Vornahme einer Plausibilitätsprüfung bezüglich aufeinanderfolgend auftretender Zeitinformationen in Verkehrssignalanlagen - Google Patents

Verfahren zur Vornahme einer Plausibilitätsprüfung bezüglich aufeinanderfolgend auftretender Zeitinformationen in Verkehrssignalanlagen Download PDF

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EP0021062A2
EP0021062A2 EP80102905A EP80102905A EP0021062A2 EP 0021062 A2 EP0021062 A2 EP 0021062A2 EP 80102905 A EP80102905 A EP 80102905A EP 80102905 A EP80102905 A EP 80102905A EP 0021062 A2 EP0021062 A2 EP 0021062A2
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EP
European Patent Office
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time information
memory
output
store
traffic signal
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EP80102905A
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EP0021062B1 (de
EP0021062A3 (en
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Horst Ing.-Grad. Schnippert
Heinrich Dipl.-Ing. Brunner
Bálint Dipl.-Ing. Kéry
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Siemens AG
Original Assignee
Siemens AG
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Publication of EP0021062A3 publication Critical patent/EP0021062A3/de
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    • G04G—ELECTRONIC TIME-PIECES
    • G04G9/00—Visual time or date indication means
    • G04G9/0005—Transmission of control signals
    • G04G9/0011—Transmission of control signals using coded signals
    • G—PHYSICS
    • G04—HOROLOGY
    • G04R—RADIO-CONTROLLED TIME-PIECES
    • G04R20/00—Setting the time according to the time information carried or implied by the radio signal
    • G04R20/08—Setting the time according to the time information carried or implied by the radio signal the radio signal being broadcast from a long-wave call sign, e.g. DCF77, JJY40, JJY60, MSF60 or WWVB
    • G04R20/12—Decoding time data; Circuits therefor
    • G—PHYSICS
    • G08—SIGNALLING
    • G08G—TRAFFIC CONTROL SYSTEMS
    • G08G1/00—Traffic control systems for road vehicles
    • G08G1/07—Controlling traffic signals

Definitions

  • the invention relates to a method and a circuit arrangement for carrying out a plausibility check with regard to successively occurring time information, which is carried out by a central location; in particular a radio transmitter, and which are recorded in locally separated traffic signal systems for controlling the timely processing of individual traffic signal programs.
  • the time information provided by a central point for example a transmitter, is to be delivered in coded form to the relevant clock .
  • This time information may include minute, hour, calendar day, weekday, calendar month, year, and other information.
  • the Time information arriving at the centrally controlled clock at parallel or serial intervals is checked for the presence of errors. If errors occur, a switching measure is triggered. In the known method concerned, the error check is repeated cyclically at least until complete and error-free time information is received.
  • the parts of the complete time information which have already been assessed as correct before the fault occurs are stored and / or displayed. However, the parts of this time information that have not yet been evaluated are discarded.
  • a disadvantage of the known method considered above is the fact that a falsification of the respective time information by an interference pulse cannot be easily recognized. This means that in the known method there is no plausibility check of the respective time information.
  • each newly determined time information is compared with at least one other time information previously transmitted and / or with time information determined with an additional device, in order to determine deviations to trigger a fault and error detection of the respective actual values from specified target values.
  • the overall effort required is relatively high.
  • the invention has for its object to show a way, as in a method of the aforementioned A plausibility check of the successively occurring time information can be carried out in a relatively simple manner.
  • time information recorded and stored by the respective traffic signal system is increased by a fixed time value each time further information is recorded, in that the time information recorded in each case is increased by the time information recorded In each case, the time value which is increased and which is stored in the traffic signal system in question is compared and that the time information recorded last is used only to determine the correspondence between the time information compared with one another for controlling the timely processing of the respectively required traffic signal program.
  • the invention has the advantage that a plausibility check of successively occurring time information is possible in a relatively simple manner, which are issued by a central point to traffic signal systems that are spatially separated from one another in order to control the timely processing of individual traffic signal programs in these traffic signal systems.
  • the time value of the time information already stored in the respective traffic signal system is preferably increased by means of a control pulse which occurs together with the respective further time information.
  • the time information recorded last is expediently used for the corresponding correction of the time information previously recorded. This advantageously ensures that the time information recorded last can be used in the respective traffic signal system, the underlying idea being that an error with regard to the storage and change of the time information occurs more in the individual road traffic signal system than in the course of Transmission of the additional time information.
  • the frequency of the occurrence of differences between the time information compared with one another is expediently counted, and an error signal is generated when a specific number of differences between the time information compared with each other are determined.
  • a circuit arrangement which is characterized in that a first memory is connected on the input side to the output of a time information receiver, and that the first memory is connected on the output side to the input side of a second memory via a first logic circuit is connected that the first memory and the second memory on the output side are each connected to the input side of a comparator, that the comparator with its.
  • the first memory is preferably connected with a release input to a separate output of the time information reception device, to which a pulse occurs in a defined time pattern, which signals the acceptance of the time information present at at least one further output of the time information reception device causes the first memory.
  • the pulse mentioned is used to increase the memory content in said second memory by a certain amount. In this case, one does not need any special additional circuits in order to increase the memory content of the relevant second memory in the desired manner.
  • the pulse mentioned is also for Control of the release of the comparator exploited. This brings with it the advantage that the comparator for carrying out comparison processes can be effectively controlled at defined times with particularly low circuit complexity.
  • a counter with its input side is preferably connected to the output of the comparator which emits a certain output signal in the event of inequality. After reaching a certain counter position, the counter emits an error signal at a separate output.
  • the circuit arrangement shown in the drawing comprises a time information receiving device consisting of a receiver Rec and a decoder Dec connected downstream of this receiver Rec.
  • the receiver Rec may be a radio receiver that is connected on the input side to an antenna Ant, which can be a ferrite antenna, for example.
  • the receiver Rec may be designed so that it receives, for example, the time information respectively transmitted by the time stamp and normal frequency transmitter DCF 77. This time information occurs serially; they include second, minute, hour, calendar day, weekday, calendar month and year information.
  • the present invention is not limited to the serial reception of time information of the type under consideration. Rather, the present invention can also occur in other ways Process below in more detail.
  • the receiver Rec could also be designed in such a way that it records time information supplied to it in parallel on the input side.
  • the decoder Dec which converts the time information received from the receiver Rec into a form suitable for subsequent further processing, has two outputs a1 and a2.
  • the output a1 comprises a plurality of individual outputs which are connected via a corresponding multi-core line Lz to a corresponding number of individual inputs of a memory input ez1 of a first memory M1.
  • the actual time information that is to say the complete time information contained in the time information received by the receiver Rec, appears at the output a1 of the decoder Dec.
  • pulses may occur in a certain rhythm, which are passed on via a line Lm. If one starts from the reception of the time information transmitted by the transmitter DCF 77, the pulses occurring at the output a2 of the decoder Dec will be so-called minute pulses, which thus occur at the end of each minute of transmission of the transmitter concerned.
  • the line Lm connected to the output a2 of the decoder Dec is connected to an enable input en1 of the said first memory M1.
  • This memory M1 - which will have such a storage capacity that it can store the time information supplied to its memory input ez1 - is released for storing the time information present at its just mentioned memory input ez1 when its release input en1 has a corresponding pulse as an enable pulse is fed.
  • the logic circuits Vs1, Vs2 and the comparator Com are each connected to the output side az1 of the memory M1 via a plurality of connecting lines with their input sides mentioned. This is indicated by slashes crossing the connecting lines in question.
  • the logic circuits Vs1, Vs2 it should also be noted that they contain a plurality of logic elements which, as indicated in the drawing, may be formed by AND gates, for example.
  • the logic circuit Vs1 is connected on the output side to the input side ez2 of a second memory M2 via a corresponding plurality of connecting lines.
  • This memory M2 which has a corresponding memory capacity as the memory M1, is connected to the line Lm already mentioned with a separate control input ec.
  • a pulse supplied to this control input ec of the memory M2 has the effect that the memory content of the memory M2 - ie the time information contained in this memory M2 - is increased by a fixed time value, for example by one minute.
  • the memory M2 is connected on the output side via a plurality of lines to an input ev2 of the comparator Com having a corresponding number of individual inputs.
  • the comparator Com is connected with a release input em to the line Lm already mentioned above.
  • This control input em of the comparator Com is designed in such a way that the comparator Com is able to carry out a comparison process with respect to the time information at its inputs ev1 and ev2 only when the trailing edge of a pulse occurring on the line Lm occurs.
  • the comparator Com has two outputs av1 and av2.
  • the comparator Com then outputs a specific output signal (binary signal "H") from the output av1 when it determines a match between the time information supplied to it on the input side for a comparison. For this reason, an equal sign is also indicated at the output av1 of the comparator Com.
  • the comparator Com then outputs a specific output signal (binary signal "H") from its output av2 when it detects an inequality between the time information supplied to it on the input side for a comparison. For this reason, an inequality sign is also indicated at the output av2 of the comparator Com.
  • the comparator Com is connected with its output av1 to an input of the logic circuit Vs2. With its other output av2, the comparator Com is connected to an input of the logic circuit Vs1. In response to the output of a specific output signal (binary signal "H") from the respective output av1 or av2 of the comparator Com, either the logic circuit Vs2 or the logic circuit Vs1 is made capable of being transmitted for the transmission of time information supplied to it on the input side.
  • the logic circuit Vs2 is connected on the output side via a plurality of lines to the memory input side ez3 of a third memory M3.
  • this memory M3 contains the current time information for the circuit arrangement under consideration.
  • the memory M3 is connected to an enable input en3 in the present case at the output of a counter Cnt, which is connected on the input side to the output av2 of the comparator Com.
  • the memory M3 is on the output side at a control input ed connected to a control device Con, which controls the handling of traffic signal programs in a traffic signal system to which it belongs. From this traffic signal system, only two signal generators Sg1 and Sg2 are indicated, to which corresponding control signals are supplied by the control device Con. These signal transmitters may each contain, for example, a green signal lamp (indicated by a circle with a vertical line in the drawing) and a red signal lamp (indicated by a circle with a horizontal line in the drawing).
  • the control device Con is connected with an input / output eam to a program memory PROM, which contains the traffic signal programs to be used in each case, which are selected in accordance with the time information supplied by the memory M3 and processed in the control device Con.
  • the programs in question can be permanently stored in the program memory PROM, or they can be supplied to the program memory PROM from time to time by a traffic control center superordinate to several traffic signal systems. It is important for the present case, however, that the program memory PROM contains different traffic signal programs, which have to be processed at different times for the traffic signal system in question.
  • the program memory PROM can contain, for example, a holiday traffic signal program and a weekday traffic signal program in order to do justice to the different traffic conditions in the area of the associated traffic signal system on public holidays and weekdays.
  • this output signal causes the logic circuit Vs1 to be transferable for the time information output by the memory M1.
  • the relevant time information thus enters the memory M2, which then has the same memory content as the memory M1.
  • the comparator Com is no longer effective at this point in time in order to compare the corrected memory content of the memory M2 with the memory content of the memory M1.
  • the comparator Com carries out a corresponding comparison if a further pulse has been emitted from the output a2 of the decoder Dec via the line Lm. This is the case after the receiver Rec has received further time information which has also been decoded accordingly by the decoder Dec. In this case, the occurrence of a pulse on the line Lm causes the new time information now present to be stored in the memory M1.
  • the pulse occurring on the line Lm causes the "old" time information still contained in the memory M2 to be increased by a fixed time value, for example by one minute.
  • the ratios are chosen so that the specified time value equal to the difference between is two time information recorded successively by the receiver Rec.
  • the comparator Com will now determine a match between the signals or time information it has compared with one another as a result of the last considered processes in the memories M1 and M2.
  • the logic circuit Vs2 then becomes capable of being transmitted, as a result of which the "new" time information still contained in the memory M1 is stored in the memory M3 as current time information.
  • the time information required for the selection and processing of a traffic signal program from the program memory PROM is available for the control device Con of the traffic signal system. This time information has been subjected to a plausibility check.
  • the time information stored in the memory M1 is only stored in the memory M3 as current time information if it has a fixed relationship to the time information previously recorded and stored in the memory M2.
  • the comparator Com determines in the course of carrying out a comparison between two pieces of time information that these are not in the previously mentioned fixed relationship to one another - that is, they are unequal - it in turn causes the logic circuit Vs1 to be made transferable.
  • the time information contained in the memory M1 is thus stored in the memory M2, so that both memories M1 and M2 then again contain the same time information stored.
  • the counter Cnt connected to the output av2 of the comparator Com counts the occurrence of any inequality between the time information compared with each other.
  • the arrangement may be so be that when a certain counter position is reached, for example at counter position 2, the counter Cnt emits an error signal which is used, for example, to block or erase the memory M3.
  • the counter Cnt can be connected to the output 'av1 of the comparator Com with a reset input.

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Abstract

Die Erfindung betrifft ein Verfahren und eine Schaltungsanordnung zur Vornahme einer Pausibilitätsprüfung bezüglich aufeinanderfolgend auftretender Zeitinformationen, die von einer zentralen Stelle, insbesondere einem Funksender, abgegeben und die in örtlich voneinander getrennten Verkehrssignalanlagen zur Steuerung der zeitgerechten Abwickelung von einzelnen Verkehrssignalprogrammen aufgenommen werden. Zur möglichst einfachen und dennoch sicheren Plausibilitätsprüfung ist gemäß der Erfindung vorgesehen, eine von der jeweiligen Verkehrssignalanlage aufgenommene und gespeicherte Zeitinformation mit der Aufnahme jeder weiteren Zeitinformation jeweils um einen festgelegten Zeitwert zu erhöhen und die jeweils aufgenommene weitere Zeitinformation mit der in ihrem Zeitwert jeweils erhöhten, in der betreffenden Verkehrssignalanlage gespeicherten Zeitinformation zu vergleichen. Bei Ermittelung einer Übereinstimmung zwischen den miteinander verglichenen Zeitinformationen wird dann die jeweils zuletzt aufgenommene Zeitinformation für die Steuerung der zeitgerechten Abwickelung des jeweils erforderlichen Verkehrssignalprogramms herangezogen.

Description

  • Die Erfindung bezieht sich auf ein Verfahren und eine Schaltungsanordnung zur Vornahme einer Plausibilitätsprüfung bezüglich aufeinanderfolgend auftretender Zeitinformationen, die von einer zentralen Stelle; insbesondere einem Funksender, abgegeben und die in örtlich voneinander getrennten Verkehrssignalanlagen zur Steuerung der zeitgerechten Abwickelung von einzelnen Verkehrssignalprogrammen aufgenommen werden.
  • Im Zusammenhang mit dem Erkennen und Eliminieren von Störungen in den Zeitinformationen bei einer zentral gesteuerten Uhr ist es bereits bekannt (DE-AS 27 01 609), die von einer zentralen Stelle, z.B. einem Sender, abgegebenen Zeitinformationen in codierter Form an die betreffende Uhr abzugeben. Diese Zeitinformationen können Minuten-, Stunden-, Kalendertags-, Wochentags-, Kalendermonats-, Jahres- und andere Informationen enthalten. Die in bestimmten Zeitabständen parallel oder seriell bei der zentral gesteuerten Uhr ankommenden Zeitinformationen werden auf das Vorliegen von Fehlern überprüft. Beim Auftreten von Fehlern wird eine Schaltmaßnahme bewirkt. Die Fehlerprüfung wird bei dem betreffenden bekannten Verfahren mindestens bis zum Empfang von kompletten und fehlerfreien Zeitinformationen zyklisch wiederholt. Beim Erkennen eines Fehlers innerhalb eines Prüfungszyklus werden die bis zum Auftreten dieses Fehlers bereits als richtig bewertenden Teile der kompletten Zeitinformation abgespeichert und/oder angezeigt. Die dabei noch nicht ausgewerteten Teile dieser Zeitinformationen werden hingegen verworfen. Beim Empfang der nächsten kompletten Zeitinformationen werden die während des vorangegangenen Prüfungszyklus bereits als richtig bewerteten Teile dieser Zeit- . informationen mit verwertet.
  • Von Nachteil bei dem vorstehend betrachteten bekannten Verfahren ist die Tatsache, daß eine Verfälschung der jeweiligen Zeitinformation durch einen Störimpuls nicht ohne weiteres erkannt werden kann. Dies bedeutet, daß bei dem bekannten Verfahren keine Plausibilitätsprüfung der jeweiligen Zeitinformationen erfolgt.
  • Es ist zwar bereits eine Fehlerkorrektur für Funkuhren vorgeschlagen worden (DE-AS 16 73 796), wobei jede neu ermittelte Zeitinformation mit wenigstens einer anderen, zuvor übertragenen und/oder mit einer mit einer zusätzlichen Vorrichtung ermittelten Zeitinformation verglichen wird, um bei Ermittelung von Abweichungen der jeweiligen Istwerte von vorgegebenen Sollwerten eine Störungs- und Fehlererkennung auszulösen. Der dabei insgesamt erforderliche Aufwand ist jedoch relativ hoch.
  • Der Erfindung liegt die Aufgabe zugrunde, einen Weg zu zeigen, wie bei einem Verfahren der eingangs genannten Art auf relativ einfache Weise eine Plausibilitätsprüfung der aufeinanderfolgend auftretenden Zeitinformationen vorgenommen werden kann.
  • Gelöst wird die vorstehend aufgezeigte Aufgabe bei einem Verfahren der eingangs genannten Art erfindungsgemäß dadurch, daß eine von der jeweiligen Verkehrssignalanlage aufgenommene und gespeicherte Zeitinformation mit der Aufnahme jeder weiteren Zeitinformation jeweils um einen festgelegten Zeitwert erhöht wird, daß die jeweils aufgenommene weitere Zeitinformation mit der in ihrem Zeitwert jeweils erhöhten, in der betreffenden Verkehrssignalanlage gespeicherten Zeitinformation verglichen wird und daß lediglich bei Ermittelung einer Übereinstimmung zwischen den miteinander verglichenen Zeitinformationen die jeweils zuletzt aufgenommene Zeitinformation für die Steuerung der zeitgerechten Abwickelung des jeweils erforderlichen Verkehrssignalprogramms herangezogen wird.'
  • Die Erfindung bringt den Vorteil mit sich, daß auf relativ einfache Weise eine Plausibilitätsprüfung von aufeinanderfolgend auftretenden Zeitinformationen möglich ist, die von einer zentralen Stelle an örtlich voneinander getrennte Verkehrssignalanlagen abgegeben werden, um in diesen Verkehrssignalanlagen die zeitgerechte Abwickelung von einzelnen Verkehrssignalprogrammen zu steuern.
  • Vorzugsweise wird die Erhöhung des Zeitwertes der in der jeweiligen Verkehrssignalanlage bereits gespeicherten Zeitinformation mittels eines Steuerimpulses vorgenommen, der zusammen mit der jeweiligen weiteren Zeitinformation auftritt. Hierdurch ergibt sich der Vorteil einer besonders einfachen Möglichkeit der Änderung des Zeitwertes der in der jeweiligen Straßenverkehrssignalanlage bereits gespeicherten Zeitinformation.-Zweckmäßigerweise wird bei der Ermittelung eines Unterschiedes zwischen den jeweils miteinander verglichenen Zeitinformationen die jeweils zuletzt aufgenommene Zeitinformation zur entsprechenden Korrektur der zuvor aufgenommenen Zeitinformation herangezogen. Dadurch ist in vorteilhafter Weise sichergestellt, daß in der jeweiligen Verkehrssignalanlage mit der jeweils zuletzt aufgenommenen Zeitinformation gearbeitet werden kann, wobei dabei der Gedanke zugrundeliegt, daß das Auftreten eines Fehlers bezüglich der Speicherung und Veränderung der Zeitinformation eher in der einzelnen Straßenverkehrssignalanlage erfolgt als im Zuge der Übertragung der jeweils weiteren Zeitinformation.
  • Zweckmäßigerweise wird die Häufigkeit des Auftretens von Unterschieden zwischen den jeweils miteinander verglichenen Zeitinformationen gezählt, und bei Ermittelung einer bestimmten Anzahl von Unterschieden zwischen den jeweils miteinander verglichenen Zeitinformationen wird ein Fehlermeldesignal erzeugt. Diese Maßnahme bringt den Vorteil mit sich, daß relativ schnell Dauerfehler ermittelt werden können, die im Zuge der Speicherung und Veränderung der jeweiligen Zeitinformation auftreten.
  • Zur Durchführung des Verfahrens gemäß der Erfindung ist es zweckmäßig, eine Schaltungsanordnung zu verwenden, die dadurch gekennzeichnet ist, daß am Ausgang einer Zeitinformations-Empfangseinrichtung ein erster Speicher eingangsseitig angeschlossen ist, daß der erste Speicher ausgangsseitig über eine erste Verknüpfungsschaltung mit der Eingangsseite eines zweiten Speichers verbunden ist, daß der erste Speicher und der zweite Speicher ausgangsseitig jeweils an der Eingangsseite eines Vergleichers angeschlossen sind, daß der Vergleicher mit seinem bei. Ungleichheit der miteinander verglichenen Signale ein bestimmtes Ausgangssignal führenden Ausgang mit einem Steuereingang der genannten ersten Verknüpfungsschaltung verbunden ist, daß der Vergleicher mit einem bei Gleichheit der miteinander verglichenen Signale ein bestimmtes Ausgangssignal führenden Ausgang an einem Steuereingang einer zweiten Verknüpfungsschaltung angeschlossen ist und daß die zweite Verknüpfungsschaltung eingangsseitig am Ausgang des genannten ersten Speichers und ausgangsseitig an der Eingangsseite eines dritten Speichers angeschlossen ist. Hierdurch ergibt sich der Vorteil eines relativ geringen schaltungstechnischen Aufwands für die Vornahme einer Plausibilitätsprüfung von aufeinanderfolgend auftretenden Zeitinformationen, die von einer zentralen Stelle ausgesendet werden.
  • Vorzugsweise ist bei der vorstehend bezeichneten Schaltungsanordnung der erste Speicher mit einem Freigabeeingang an einem gesonderten Ausgang der Zeitinformations-Empfangseinrichtung angeschlossen, an dem in einem festgelegten Zeitraster jeweils ein Impuls auftritt, der die Übernahme der an wenigstens einem weiteren Ausgang der Zeitinformations-Empfangseinrichtung vorhandenen Zeitinformation in den ersten Speicher bewirkt. Hierdurch ergibt sich der Vorteil, daß mit besonders geringem schaltungstechnischen Aufwand ausgekommen werden kann, um die jeweilige aktuelle Zeitinformation in der jeweiligen Straßenverkehrssignalanlage aufnehmen und festhalten zu können.
  • Von Vorteil ist dabei ferner, wenn der genannte Impuls zur Erhöhung des Speicherinhalts in dem genannten zweiten Speicher um jeweils einen bestimmten Betrag mit ausgenutzt ist. In diesem Fall kommt man ohne besondere Zusatzschaltungen aus, um den Speicherinhalt des betreffenden zweiten Speichers in der gewünschten Weise zu erhöhen.
  • Zweckmäßigerweise ist der genannte Impuls ferner zur Steuerung der Freigabe des Vergleichers ausgenutzt. Dies -bringt den Vorteil mit sich, daß mit besonders geringem schaltungstechnischen Aufwand der Vergleicher zur Durchführung von Vergleichsvorgängen zu definierten Zeitpunkten wirksam steuerbar ist.'
  • Vorzugsweise ist an dem bei Ungleichheit ein bestimmtes Ausgangssignal abgebenden Ausgang des-Vergleichers ein Zähler mit seiner Eingangsseite angeschlossen. Der Zähler gibt nach Erreichen einer bestimmten Zählerstellung an einem gesonderten Ausgang ein Fehlermeldesignal ab. Hierdurch ergibt sich der Vorteil, daß mit relativ geringem schaltungstechnischen Aufwand ausgekommen werden kann, um eine fehlerhafte Arbeitsweise der Schaltungsanordnung gemäß der Erfindung ermitteln zu können.
  • Anhand einer Zeichnung wird die Erfindung nachstehend von einem Ausführungsbeispiel näher erläutert.
  • Die in der Zeichnung dargestellte Schaltungsanordnung umfaßt eine Zeitinformations-Empfangseinrichtung, bestehend aus einem Empfänger Rec und einem diesem Empfänger Rec nachgeschalteten Decoder Dec. Der Empfänger Rec mag ein Funkempfänger sein, der eingangsseitig mit einer Antenne Ant verbunden ist, die beispielsweise eine Ferritantenne sein kann. Der Empfänger Rec mag so ausgelegt sein, daß er beispielsweise die von dem Zeitmarken- und Normalfrequenzsender DCF 77 jeweils ausgesendeten Zeitinformationen empfängt. Diese Zeitinformationen treten seriell auf; sie umfassen Sekunden-, Minuten-, Stunden-, Kalendertags-, Wochentags-, Kalendermonats-und Jahres-Informationen. An dieser Stelle sei angemerkt, daß die vorliegende Erfindung nicht auf den seriellen Empfang von Zeitinformationen der gerade betrachteten Art beschränkt ist. Vielmehr kann die vorliegende Erfindung auch in anderer Art und Weise auftretende Zeitinformationen in der nachstehend noch näher zu betrachtenden Weise verarbeiten. So könnte der Empfänger Rec auch derart ausgelegt sein, daß er jeweils parallel ihm eingangsseitig zugeführte Zeitinformationen aufnimmt.
  • Der Decoder Dec, der die von dem Empfänger Rec jeweils empfangenen Zeitinformationen in für eine anschließende Weiterverarbeitung geeignete Form umsetzt, weist zwei Ausgänge a1 und a2 auf. Der Ausgang a1 umfaßt dabei eine Mehrzahl von Einzelausgängen, die über eine entsprechende mehradrige Leitung Lz mit einer entsprechenden Anzahl von Einzeleingängen eines Speichereingangs ez1 eines ersten Speichers M1 verbunden sind. An dem Ausgang a1 des Decoders Dec treten die eigentlichen Zeitinformationen auf, also die vollständigen Zeitangaben, die in den von dem Empfänger Rec jeweils empfangenen Zeitinformationen enthalten sind. An dem anderen Ausgang a2 des Decoders Dec mögen in einem bestimmten Rhythmus Impulse auftreten, die über eine Leitung Lm weitergeleitet werden. Geht man vom Empfang der von dem Sender DCF 77 ausgesendeten Zeitinformationen aus, so werden die am Ausgang a2 des Decoders Dec auftretenden Impulse sogenannte Minutenimpulse sein, die also am Ende jeder Sendeminute des betreffenden Senders auftreten.
  • Die am Ausgang a2 des Decoders Dec angeschlossene Leitung Lm ist an einem Freigabeeingang en1 des genannten ersten Speichers M1 angeschlossen. Dieser Speicher M1 - der eine solche Speicherkapazität haben wird, daß er die seinem Speichereingang ez1 jeweils zugeführte Zeitinformation zu speichern vermag - wird für eine Einspeicherung der an seinem gerade erwähnten Speichereingang ez1 jeweils anliegenden Zeitinformation dann freigegeben, wenn seinem Freigabeeingang en1 ein entsprechender Impuls als Freigabeimpuls zugeführt wird. An der mit az1 bezeichneten Ausgangsseite des Speichers M1 sind zwei Verknüpfungsschaltungen Vsl, Vs2 mit ihrer jeweils einen Eingangsseite und ein Vergleicher Com mit seiner einen Eingangsseite ev1 angeschlossen. Die Verknüpfungsschaltungen Vs1, Vs2 und der Vergleicher Com sind mit ihren erwähnten Eingangsseiten jeweils über eine Mehrzahl von Verbindungsleitungen mit der Ausgangsseite az1 des Speichers M1 verbunden. Dies ist durch die betreffende Verbindungsleitungen kreuzende Schrägstriche angedeutet. Bezüglich der Verknüpfungsschaltungen Vs1, Vs2 sei noch angemerkt, daß diese eine Mehrzahl von Verknüpfungsgliedern enthalten, welche - wie in der Zeichnung angedeutet - beispielsweise durch UND-Glieder gebildet sein mögen.
  • Die Verknüpfungsschaltung Vs1 ist ausgangsseitig über eine entsprechende Mehrzahl von Verbindungsleitungen mit der Eingangsseite ez2 eines zweiten Speichers M2 verbunden. Dieser Speicher M2, der eine entsprechende Speicherkapazität aufweist wie der Speicher M1, ist mit einem gesonderten Steuereingang ec mit der bereits erwähnten Leitung Lm verbunden. Ein diesem Steuereingang ec des Speichers M2 zugeführter Impuls bewirkt, daß der Speicherinhalt des Speichers M2.- also die in diesem Speicher M2 enthaltene Zeitinformation - um einen festgelegten Zeitwert, beispielsweise um eine Minute, erhöht wird.
  • Der Speicher M2 ist ausgangsseitig über eine Mehrzahl von Leitungen mit einem eine entsprechende Anzahl von Einzeleingängen aufweisenden Eingang ev2 des Vergleichers Com verbunden. Der Vergleicher Com ist mit einem Freigabeeingang em an der oben bereits erwähnten Leitung Lm angeschlossen. Dieser Steuereingang em des Vergleichers Com ist so ausgelegt, daß der Vergleicher Com erst mit Auftreten der Rückflanke eines auf der Leitung Lm auftretenden Impulses hin einen Vergleichsvorgang bezüglich der an seinen Eingängen ev1 und ev2 liegenden Zeitinformationen vorzunehmen vermag.
  • Der Vergleicher Com weist zwei Ausgänge av1 und av2 auf. Von dem Ausgang av1 gibt der Vergleicher Com dann ein bestimmtes Ausgangssignal (Binärsignal "H") ab, wenn er eine Übereinstimmung zwischen den ihm eingangsseitig jeweils für einen Vergleich zugeführten Zeitinformationen feststellt. Aus diesem Grunde ist an dem-Ausgang av1 des Vergleichers Com auch ein Gleichheitszeichen angedeutet. Von seinem Ausgang av2 gibt der Vergleicher Com dann ein bestimmtes Ausgangssignal (Binärsignal "H") ab, wenn er eine Ungleichheit zwischen den ihm eingangsseitig für einen Vergleich jeweils zugeführten Zeitinformationen feststellt. Aus diesem Grunde ist an dem Ausgang av2 des Vergleichers Com auch ein Ungleichheitszeichen angedeutet.
  • Der Vergleicher Com ist mit seinem Ausgang av1 mit einem Eingang der Verknüpfungsschaltung Vs2 verbunden. Mit seinem-anderen Ausgang av2 ist der Vergleicher Com mit einem Eingang der Verknüpfungsschaltung Vs1 verbunden. Auf die Abgabe eines bestimmten Ausgangssignals (Binärsignal "H") von dem jeweiligen Ausgang av1 bzw. av2 des Vergleichers Com hin ist entweder die Verknüpfungsschaltung Vs2 oder die Verknüpfungsschaltung Vs1 für die Übertragung von ihr eingangsseitig zugeführten Zeitinformationen übertragungsfähig gemacht.
  • Die Verknüpfungsschaltung Vs2 ist ausgangsseitig über eine Mehrzahl von Leitungen mit der Speichereingangsseite ez3 eines dritten Speichers M3 verbunden. Dieser Speicher M3 enthält, wie noch ersichtlich werden wird, die für die betrachtete Schaltungsanordnung jeweils aktuelle Zeitinformation. Der Speicher M3 ist mit einem Freigabeeingang en3 im vorliegenden Fall am Ausgang eines Zählers Cnt angeschlossen, der eingangsseitig an dem Ausgang av2 des Vergleichers Com angeschlossen ist.
  • Der Speicher M3 ist ausgangsseitig an einem Steuereingang ed einer Steuereinrichtung Con angeschlossen, die die Abwicklung von Verkehrssignalprogrammen in einer Verkehrssignalanlage steuert, der sie zugehörig ist. Von dieser Verkehrssignalanlage sind im übrigen lediglich zwei Signalgeber Sg1 und Sg2 angedeutet, denen entsprechende Steuersignale von der Steuereinrichtung Con zugeführt werden. Diese Signalgeber mögen beispielsweise jeweils eine grüne Signallampe (in der Zeichnung durch einen Kreis mit einem senkrechten Strich angedeutet) und eine rote Signallampe (in der Zeichnung durch einen Kreis mit einem waagrechten Strich angedeutet) enthalten. Die Steuereinrichtung Con ist mit einem Eingang/Ausgang eam mit einem Programmspeicher PROM verbunden, der die jeweils zu benutzenden Verkehrssignalprogramme enthält, die nach Maßgabe der von dem Speicher M3 jeweils zugeführten Zeitinformationen ausgewählt und in der Steuereinrichtung Con verarbeitet werden. Die betreffenden Programme können in dem Programmspeicher PROM fest eingespeichert sein, oder aber sie können dem Programmspeicher PROM von einer mehreren Verkehrssignalanlagen übergeordneten Verkehrszentrale von Zeit zu Zeit zugeführt werden. Von Bedeutung für den vorliegenden Fall ist dabei jedoch, daß der Programmspeicher PROM jeweils unterschiedliche Verkehrssignalprogramme enthält, die zu verschiedenen Zeiten für die betreffende Verkehrssignalanlage abzuwickeln sind. Im einfachsten Fall kann der Programmspeicher PROM beispielsweise ein Feiertags-Verkehrssignalprogramm und ein Werktags-Verkehrssignalprogramm enthalten, um den an Feiertagen und Werktagen vorliegenden unterschiedlichen Verkehrsbedingungen im Bereich der zugehörigen Verkehrssignalanlage gerecht zu werden.
  • Im folgenden wird die Arbeitsweise der in der Zeichnung dargestellten Anordnung näher erläutert. Zu diesem Zweck sei angenommen, daß sich in den Speichern M1, M2 und M3 zunächst keinerlei Zeitinformation befindet. Wird nunmehr durch den Empfänger Rec eine Zeitinformation empfangen, so wird diese Zeitinformation in den Speicher M1 eingespeichert. Zugleich damit wird der Inhalt des Speichers M2 um einen bestimmten festgelegten Zeitwert erhöht. Da der Speicherinhalt des Speichers M2 zunächst Null war, wird sich in diesem Speicher M2 sodann lediglich der für eine Erhöhung vorgesehene Zeitwert befinden. Dieser Zeitwert wird am Ende des auf der Leitung Lm auftretenden Impulses in dem Vergleicher Com mit der in dem Speicher M1 enthaltenen Zeitinformation verglichen. Da anzunehmen ist, daß der Vergleicher Com dabei eine Ungleichheit zwischen den miteinander verglichenen Signalen feststellt, gibt er an seinem Ausgang av2 ein bestimmtes Ausgangssignal (Bi= närsignal "H") ab. Das Auftreten dieses Ausgangssignals bewirkt, daß die Verknüpfungsschaltung Vs1 für die vom Speicher M1 abgegebene Zeitinformation übertragungsfähig ist. Die betreffende-Zeitinformation gelangt somit in den Speicher M2 hinein, der daraufhin den gleichen Speicherinhalt besitzt wie der Speicher M1. Der Vergleicher Com ist zu diesem Zeitpunkt jedoch nicht mehr wirksam, um den korrigierten Speicherinhalt des Speichers M2 mit dem Speicherinhalt des Speichers M1 zu vergleichen. Einen entsprechenden Vergleich führt der Vergleicher Com jedoch aus, wenn vom Ausgang a2 des Decoders Dec ein weiterer Impuls über die Leitung Lm abgegeben worden ist. Dies ist der Fall, nachdem der Empfänger Rec eine weitere Zeitinformation empfangen hat, die auch von dem Decoder Dec entsprechend decodiert worden ist. In diesem Fall bewirkt das Auftreten eines Impulses auf der Leitung Lm, daß die nunmehr vorliegende neue Zeitinformation in den Speicher M1 eingespeichert wird. Außerdem bewirkt der auf der Leitung Lm auftretende Impulse, daß die in dem Speicher M2 noch enthaltene "alte" Zeitinformation um einen festgelegten Zeitwert, beispielsweise um eine Minute, erhöht wird. Dabei seien die Verhältnisse so gewählt, daß der erwähnte festgelegte Zeitwert gleich der Differenz zwischen zwei von dem Empfänger Rec aufeinanderfolgend aufgenommenen Zeitinformationen ist.
  • Durch die zuletzt betrachteten Vorgänge in den Speichern M1 und M2 wird der Vergleicher Com nunmehr eine Übereinstimmung zwischen den durch ihn miteinander verglichenen Signalen bzw. Zeitinformationen feststellen. Dies.hat zur Folge, daß daraufhin die Verknüpfungsschaltung Vs2 übertragungsfähigwird, wodurch die in dem Speicher M1 noch enthaltene "neue" Zeitinformation als aktuelle Zeitinformation in den Speicher M3 eingespeichert wird. Damit steht also für die Steuereinrichtung Con der Verkehrssignalanlage die für die Auswahl und Verarbeitung eines Verkehrssignalprogramms aus dem Programmspeicher PROM erforderliche Zeitinformation zur Verfügung. Diese Zeitinformation ist dabei einer Plausibilitätsprüfung unterzogen worden. Wie erläutert, wird die in dem Speicher M1 eingespeicherte Zeitinformation nur dann als aktuelle Zeitinformation in den Speicher M3 eingespeichert, wenn sie zu der zuvor aufgenommenen und in dem Speicher M2 gespeicherten Zeitinformation in einer festgelegten Beziehung steht.
  • Stellt der Vergleicher Com im Zuge der Durchführung eines Vergleichs zwischen zwei Zeitinformationen fest, daß diese nicht in der zuvor erwähnten festgelegten Beziehung zueinander stehen - also ungleich sind - so bewirkt er wiederum, daß die Verknüpfungsschaltung Vs1 übertragungsfähig gemacht wird. Damit wird die in dem Speicher M1 enthaltene Zeitinformation in den Speicher M2 eingespeichert, so daß dann wieder beide Speicher M1 und M2 dieselbe Zeitinformation gespeichert enthalten.
  • Durch den am Ausgang av2 des Vergleichers Com angeschlossenen Zähler Cnt wird das Auftreten jeder Ungleichheit zwischen den jeweils miteinander verglichenen Zeitinformationen gezählt. Die Anordnung mag dabei so getroffen sein, daß der Zähler Cnt bei Erreichen einer bestimmten Zählerstellung, beispielsweise bei der Zählerstellung 2, ein Fehlermeldesignal abgibt, welches beispielsweise zur Sperrung oder Löschung des Speichers M3 herangezogen wird. Der Zähler Cnt kann mit einem Rückstelleingang am Ausgang' av1 des Vergleichers Com angeschlossen sein.
  • Durch die vorstehend erläuterte Verfahrensweise bei der in der Zeichnung dargestellten Schaltungsanordnung ist also sichergestellt, daß nur solche Zeitinformationen für die Steuereinrichtung Con der Verkehrssignalanlage bereitgestellt werden, bezüglich derer eine Plausibilität dafür vorliegt, daß sie auch richtig sind. Auf diese Weise können entweder in der betrachteten Schaltungsanordnung auftretende Fehler oder im Zuge der Übertragung der jeweiligen Zeitinformation auftretende Störungen erkannt werden, die nicht nur eine einmalige Verfälschung einer Zeitinformation bewirken, sondern die eine mehrmalige Zeitinformationsverfälschung hervorrufen.
  • Abschließend sei noch bemerkt, daß für die Realisierung der erläuterten Schaltungsanordnung ein Mikroprozessor bzw. ein Mikrocomputer verwendet werden kann.

Claims (9)

1. Verfahren zur Vornahme einer Plausibilitätsprüfung bezüglich aufeinanderfolgend auftretenderZeitinformationen, die von einer zentralen Stelle, insbesondere einem Funksender, abgegeben und die in örtlich voneinander getrennten Verkehrssignalanlagen zur Steuerung der zeitgerechten Abwickelung von einzelnen Verkehrssignalprogrammen aufgenommen werden, dadurch gekennzeichnet , daß eine von der jeweiligen Verkehrssignalanlage aufgenommene und gespeicherte Zeitinformation mit der Aufnahme jeder weiteren Zeitinformation jeweils um einen festgelegten Zeitwert erhöht wird, daß die jeweils aufgenommene weitere Zeitinformation mit der in ihrem Zeitwert jeweils erhöhten, in der betreffenden Verkehrssignalanlage gespeicherten Zeitinformation verglichen wird und daß bei Ermittelung einer Übereinstimmung zwischen den miteinander verglichenen Zeitinformationen die jeweils zuletzt aufgenommene Zeitinformation für die Steuerung der zeitgerechten Abwickelung des jeweils erforderlichen Verkehrssignalprogramms herangezogen wird.
2. Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß die Erhöhung des Zeit- .wertes der in der jeweiligen Verkehrssignalanlage bereits gespeicherten Zeitinformation mittels eines Steuerimpulses vorgenommen wird, der zusammen mit der jeweiligen weiteren Zeitinformation auftritt.
3. Verfahren nach Anspruch 1 oder 2, dadurch gekennzeichnet , daß bei Ermittelung eines Unterschiedes zwischen den jeweils miteinander verglichenen Zeitinformationen die jeweils zuletzt aufgenommene Zeitinformation zur entsprechenden Korrektur der zuvor aufgenommenen Zeitinformation herangezogen wird.
4. Verfahren nach einem der Ansprüche 1 bis 3, dadurch gekennzeichnet, daß die Häufigkeit des Auftretens von Unterschieden zwischen den jeweils miteinander verglichenen Zeitinformationen gezählt wird und daß bei Ermittelung einer bestimmten Anzahl von Unterschieden zwischen den jeweils miteinander verglichenen Zeitinformationen ein Fehlermeldesignal erzeugt wird.
5. Schaltungsanordnung zur Durchiührung des Verfahrens nach einem der Ansprüche 1 bis 4, dadurch gekennzeichnet , daß-am Ausgang einer Zeitinformations-Empfangseinrichtung (Rec, Dec) ein erster Speicher (M1) eingangsseitig angeschlossen ist, daß der erste Speicher (M1) ausgangsseitig über eine erste Verknüpfungsschaltung (Vs1) mit der Eingangsseite eines zweiten Speichers (M2) verbunden ist, daß der erste Speicher (M1) und der zweite Speicher (M2) ausgangsseitig jeweils an der Eingangsseite (ev1, ev2) eines Vergleichers (Com) angeschlossen sind, daß der Vergleicher (Com) mit seinem bei Ungleichheit der miteinander verglichenen Signale ein bestimmtes Ausgangssignal ("H") führenden Ausgang (av2) mit einem Steuereingang der genannten ersten Verknüpfungsschaltung (Vs1) verbunden ist, daß der Vergleicher (Com) mit einem bei Gleichheit der miteinander verglichenen Signale ein bestimmtes Ausgangssignal ("H") führenden Ausgang (av1) an einem Steuereingang einer zweiten Verknüpfungsschaltung (Vs2) angeschlossen ist und daß die zweite Verknüpfungsschaltung (Vs2) eingangsseitig am Ausgang (az1) des genannten ersten Speichers (M1) und ausgangsseitig an der Eingangsseite (ez3) eines dritten Speichers (M3) angeschlossen ist.
6. Schaltungsanordnung nach Anspruch 5, dadurch gekennzeichnet , daß der erste Speicher (M1) mit einem Freigabeeingang (en1) an einem gesonderten.Ausgang (a2) der Zeitinformations-Empfangseinrichtung (Rec, Dec) angeschlossen ist, an dem in einem festgelegten Zeitraster jeweils ein Impuls auftritt, der die Übernahme der an wenigstens einem weiteren Ausgang (a1) der Zeitinformations-Empfangseinrichtung (Rec, Dec) vorhandenen Zeitinformation in den ersten Speicher (M1) bewirkt.
7. Schaltungsanordnung nach Anspruch 6, dadurch gekennzeichnet, daß der betreffende Impuls zur Erhöhung des Speicherinhalts in dem genannten zweiten Speicher (M2) um jeweils einen bestimmten Betrag ausgenutzt ist.
8. Schaltungsanordnung nach Anspruch 6 oder 7, dadurch gekennzeichnet, daß der genannte Impuls zur Steuerung der Freigabe des Vergleichers (Com) ausgenutzt ist.
9. Schaltungsanordnung nach einem der Ansprüche 5 bis 8, dadurch gekennzeichnet, daß an dem bei Ungleichheit ein bestimmtes Ausgangssignal ("H") abgebenden Ausgang (av2) des Vergleichers (Com) ein Zähler (Cnt) mit seiner Eingangsseite angeschlossen ist und daß der Zähler (Cnt) nach Erreichen einer bestimmten Zählerstellung an einem gesonderten Ausgang ein Fehlermeldesignal ("H") abgibt.
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