DE4202824C2 - Chip-Bauelement und Verfahren zu dessen Herstellung - Google Patents
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- 238000000034 method Methods 0.000 title claims description 10
- 238000004519 manufacturing process Methods 0.000 title claims description 9
- 239000010410 layer Substances 0.000 claims description 42
- 239000002346 layers by function Substances 0.000 claims description 12
- 239000000919 ceramic Substances 0.000 claims description 6
- 239000000463 material Substances 0.000 claims description 6
- 229910052751 metal Inorganic materials 0.000 claims description 5
- 239000002184 metal Substances 0.000 claims description 5
- 229910052802 copper Inorganic materials 0.000 claims description 4
- 238000001771 vacuum deposition Methods 0.000 claims description 4
- 239000000853 adhesive Substances 0.000 claims description 2
- 230000001070 adhesive effect Effects 0.000 claims description 2
- 239000012790 adhesive layer Substances 0.000 claims description 2
- PNEYBMLMFCGWSK-UHFFFAOYSA-N aluminium oxide Inorganic materials [O-2].[O-2].[O-2].[Al+3].[Al+3] PNEYBMLMFCGWSK-UHFFFAOYSA-N 0.000 claims description 2
- VNNRSPGTAMTISX-UHFFFAOYSA-N chromium nickel Chemical compound [Cr].[Ni] VNNRSPGTAMTISX-UHFFFAOYSA-N 0.000 claims description 2
- 229910052593 corundum Inorganic materials 0.000 claims description 2
- 239000012777 electrically insulating material Substances 0.000 claims description 2
- 229910001120 nichrome Inorganic materials 0.000 claims description 2
- 229910052759 nickel Inorganic materials 0.000 claims description 2
- 229910000679 solder Inorganic materials 0.000 claims description 2
- 238000005476 soldering Methods 0.000 claims description 2
- 229910001845 yogo sapphire Inorganic materials 0.000 claims description 2
- 239000011241 protective layer Substances 0.000 claims 4
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims 2
- VYZAMTAEIAYCRO-UHFFFAOYSA-N Chromium Chemical compound [Cr] VYZAMTAEIAYCRO-UHFFFAOYSA-N 0.000 claims 1
- 229910019974 CrSi Inorganic materials 0.000 claims 1
- 229910001128 Sn alloy Inorganic materials 0.000 claims 1
- 229910052804 chromium Inorganic materials 0.000 claims 1
- 239000011651 chromium Substances 0.000 claims 1
- 229910052681 coesite Inorganic materials 0.000 claims 1
- 229910052906 cristobalite Inorganic materials 0.000 claims 1
- LQBJWKCYZGMFEV-UHFFFAOYSA-N lead tin Chemical compound [Sn].[Pb] LQBJWKCYZGMFEV-UHFFFAOYSA-N 0.000 claims 1
- 229920000620 organic polymer Polymers 0.000 claims 1
- 239000002861 polymer material Substances 0.000 claims 1
- 238000000926 separation method Methods 0.000 claims 1
- 239000000377 silicon dioxide Substances 0.000 claims 1
- 235000012239 silicon dioxide Nutrition 0.000 claims 1
- 229910052682 stishovite Inorganic materials 0.000 claims 1
- 229910052905 tridymite Inorganic materials 0.000 claims 1
- 239000010408 film Substances 0.000 description 7
- 238000005516 engineering process Methods 0.000 description 6
- 239000004020 conductor Substances 0.000 description 4
- 239000004033 plastic Substances 0.000 description 3
- 229920001721 polyimide Polymers 0.000 description 3
- 239000000758 substrate Substances 0.000 description 3
- 239000004642 Polyimide Substances 0.000 description 2
- 239000012876 carrier material Substances 0.000 description 2
- 239000011248 coating agent Substances 0.000 description 2
- 238000000576 coating method Methods 0.000 description 2
- 238000001816 cooling Methods 0.000 description 2
- 239000013039 cover film Substances 0.000 description 2
- 238000010894 electron beam technology Methods 0.000 description 2
- 239000004922 lacquer Substances 0.000 description 2
- 239000010970 precious metal Substances 0.000 description 2
- 229910003336 CuNi Inorganic materials 0.000 description 1
- 238000005452 bending Methods 0.000 description 1
- 239000000969 carrier Substances 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 238000010924 continuous production Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 230000032798 delamination Effects 0.000 description 1
- 230000009189 diving Effects 0.000 description 1
- 239000003822 epoxy resin Substances 0.000 description 1
- 239000011888 foil Substances 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 239000003365 glass fiber Substances 0.000 description 1
- 239000002241 glass-ceramic Substances 0.000 description 1
- 239000003292 glue Substances 0.000 description 1
- 239000011810 insulating material Substances 0.000 description 1
- 230000007774 longterm Effects 0.000 description 1
- 150000002739 metals Chemical class 0.000 description 1
- 239000011224 oxide ceramic Substances 0.000 description 1
- 229910052574 oxide ceramic Inorganic materials 0.000 description 1
- 238000001259 photo etching Methods 0.000 description 1
- 229920000647 polyepoxide Polymers 0.000 description 1
- 229920006254 polymer film Polymers 0.000 description 1
- 230000002787 reinforcement Effects 0.000 description 1
- 238000010025 steaming Methods 0.000 description 1
- 239000010409 thin film Substances 0.000 description 1
- 238000011144 upstream manufacturing Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01G—CAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
- H01G4/00—Fixed capacitors; Processes of their manufacture
- H01G4/002—Details
- H01G4/005—Electrodes
- H01G4/015—Special provisions for self-healing
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01C—RESISTORS
- H01C17/00—Apparatus or processes specially adapted for manufacturing resistors
- H01C17/006—Apparatus or processes specially adapted for manufacturing resistors adapted for manufacturing resistor chips
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01C—RESISTORS
- H01C17/00—Apparatus or processes specially adapted for manufacturing resistors
- H01C17/06—Apparatus or processes specially adapted for manufacturing resistors adapted for coating resistive material on a base
- H01C17/075—Apparatus or processes specially adapted for manufacturing resistors adapted for coating resistive material on a base by thin film techniques
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01G—CAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
- H01G2/00—Details of capacitors not covered by a single one of groups H01G4/00-H01G11/00
- H01G2/02—Mountings
- H01G2/06—Mountings specially adapted for mounting on a printed-circuit support
- H01G2/065—Mountings specially adapted for mounting on a printed-circuit support for surface mounting, e.g. chip capacitors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01G—CAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
- H01G2/00—Details of capacitors not covered by a single one of groups H01G4/00-H01G11/00
- H01G2/08—Cooling arrangements; Heating arrangements; Ventilating arrangements
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01G—CAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
- H01G2/00—Details of capacitors not covered by a single one of groups H01G4/00-H01G11/00
- H01G2/12—Protection against corrosion
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Manufacturing & Machinery (AREA)
- Apparatuses And Processes For Manufacturing Resistors (AREA)
- Fixed Capacitors And Capacitor Manufacturing Machines (AREA)
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Description
Die Erfindung betrifft ein elektrisches Chip-Bauelement
und das Verfahren zu dessen Herstellung. Auf einem
Träger aus elektrisch isolierendem Material sind entsprechend der
vorgesehenen Funktion Schichten aufgebracht. Die Chip-Bauelemente
werden in Dick- und Dünnschichttechnik hergestellt und sind
unbedrahtet. Sie werden in Aufsetztechnik (SMT), d. h. oberflä
chenmontierbar, in einfacher Weise mit den Leiterbahnen der
Leiterplatten durch Tauch- oder Schwall-Lötung verbunden. Diese
Technik gewährleistet bei der Montage einen hohen Automatisie
rungsgrad.
Die Chip-Bauelemente sind von ihrer elektrischen Funktion her
entweder Widerstände oder Kurzschlußbrücken (Nullwiderstände).
Sie werden im allgemeinen auf keramischen Trägern mittels Vakuum
beschichtung hergestellt. Sie besitzen neben der bzw. den Funk
tionsschichten Kontaktschichten, die vorzugsweise als wrap
around-Kontakt ausgebildet sind. Das sind Kontakte, die von der
Vorderseite über die Stirnseite auf die Rückseite der Bauelemente
reichen.
Es ist auch bekannt, als Träger plättchenförmige Kunststoffträger
zu verwenden, auf welche die Funktionsschichten aufgedampft oder
aufgesputtert sind (DE 30 27 159 A1). An den gegenüberliegenden
Randseiten sind elektrisch leitende Kontaktschichten aufgebracht,
die mit der mindestens auf einer Seite auf den Kunststoffträger
aufgebrachten Widerstandsschicht, die auf den gewünschten Wider
standswert abgeglichen wird, elektrisch leitend verbunden ist.
Anstelle von Kunststoff als Trägermaterial ist auch die Verwen
dung von Glas, Keramik, oberflächlich oxidierten Metallen oder
glasfaserverstärktem Epoxidharz bekannt. Letztere zeichnen sich
durch ihre relativ geringen und reproduzierbaren Ausdehnungskoef
fizienten aus. Sie sind kurzzeitig bis 300°C erwärmbar und haben
eine Dauerbeständigkeit von 230°C.
Die Kontaktschichten bestehen entweder vollständig aus einem
Edelmetall oder einem sonstigen gut leitenden Metall, das ggf.
dünn mit Edelmetall überzogen ist. Die Widerstandsschicht wird
meist mit dem Elektronenstrahl, aber auch mit dem Laserstrahl
abgeglichen.
Diese bekannten Lösungen haben den Nachteil, daß oft als Substratma
terialien spröde Werkstoffe auf der Basis von
Keramiken, Oxidkeramiken, Glaskeramiken und Einkristallen einge
setzt werden. Daraus resultiert der Nachteil, daß keine kontinu
ierliche Produktion bei hohen Stückzahlen möglich ist. Die
Trägermaterialien liegen vielmehr als diskrete runde oder recht
eckige, begrenzte Substrate vor, die anschließend vereinzelt und
an den Bruchkanten nachträglich in aufwendiger Weise mit wrap
around-Kontakten versehen werden müssen. Es handelt sich um eine
Chargentechnologie mit Kontaktierung am Einzel-Bauelement; das
bedeutet geringe Produktivität und relativ hohe Kosten.
Es ist auch bekannt, Chip-Widerstände aus einer Isolierstoffolie,
auf der eine metallische Widerstandsschicht aufgebracht ist,
herzustellen. Die Isolierstoffolie ist durch eine elektrische
Kontaktschicht verstärkt und die beiden gegenüberliegenden Enden
sind jeweils um 180° um einen Träger geklappt. Die geklappten
Enden sind im Abstand zueinander angeordnet und der dazwischen
liegende freie Raum ist mit dem Kleber, der auch die umgeklappten
Enden verklebt, ausgefüllt (DE 30 27 122 A1). Dieser Abstand
zwischen den Enden ist auch erforderlich, damit sich die beidsei
tigen Kontaktschichten, die sich um die Faltung herum erstrecken,
nicht berühren. Die Widerstandsschicht als Funktionsschicht
befindet sich auf der Oberseite zwischen den Kontaktschichten,
von denen sie überlappt wird. Diese Ausführung hat den Nachteil,
daß die Gefahr besteht, daß der Kleber zum Verbinden der
umgeklappten Enden im Bereich des Spaltes zwischen den Enden
heraustritt und damit weitere Prozeßschritte und bei der Montage
des fertigen Chips stört und aufwendig entfernt werden muß.
Der Aufwand des doppelseitigen Faltens der Folie kann in bekann
ter Weise in Wegfall kommen, indem auf einer Trägerfolie eine
abgeglichene Widerstandsschicht aufgebracht ist, die mit Kontakt
schichten verstärkt ist. Auf der Widerstands- und Kontaktschicht
ist eine Deckfolie aufgeklebt, die an den Kontaktierungsstellen
durchbrochen ist und in den Durchbrüchen eine lötfähige Kontakt
schicht trägt. In bestimmten Anwendungsfällen, z. B. bei beider
seitiger Kontaktierbarkeit der Chipwiderstände, können auch in
dieser Ausführung die beiden Enden um 180° zueinander umgeklappt
und mit ihren so aneinanderstoßenden Stirnflächen miteinander
verklebt sein. Die Herstellung der Chipwiderstände erfolgt
derart, daß bandförmige Polyimidfolie im Bereich der Leiterbahn-
und Kontaktschichten mit einer Widerstandsschicht galvanisch
verstärkt wird und danach die Kontakt- und Widerstandsschicht
durch Fotoätztechnik strukturiert wird. Auf die Schichten wird
noch eine Polyimiddeckfolie aufgeklebt, die im Kontaktschichtbe
reich durchbrochen ist. In diesem durchbrochenen Bereich werden
dann löt- und leitfähige Schichten zur Verstärkung aufgebracht
(DE 30 23 133 A1). Diese Chips haben den Nachteil, daß der
Aufwand zur Herstellung sehr hoch ist. Die Stabilität der Chips
ist allein von der Dicke der Folien und Schichten bestimmt und
nicht optimal. Desweiteren besteht die Gefahr, daß bei der
gefalteten Ausführung durch den engen Biegeradius bedingt die
Schichten im Bereich der Biegung reißen oder sogar abplatzen.
Andererseits erfordert das Einbringen der Durchbrüche im Bereich
der Kontakte eine sehr hohe Präzision, was die Fertigungskosten
wesentlich erhöht.
Es sind weiterhin Kurzschlußbrücken bekannt, auch Chipleiter
brücken genannt, die aus einem Träger aus Isoliermaterial beste
hen, auf welchem eine Funktionsschicht aus Ni oder Cu als Kanten
metallkontaktschicht und Leitschicht chemisch-reduktiv abgeschie
den ist. Auf der Oberseite ist zentrisch eine Lackschicht als
Insel aufgebracht (EP 0 386 709). Das Herstellungsverfahren ist
sehr aufwendig, insbesondere das Aufbringen der Lackschicht.
Der Erfindung liegt die Aufgabe zugrunde, ein Chip-Bauelement zu
schaffen, welches durchgängig bis zum Vereinzeln als Strang
mittels bekannter Technologien herstellbar ist und alle Herstel
lungsprozesse in Folge durchläuft. Die Chip-Bauelemente sollen
hoch belastbar sein, d. h. eine gute Kühlung aufweisen. Elektrolytisch
wirkende Hilfsstoffe sind bei der Herstellung im Interesse einer hohen
Langzeitstabilität der Chips zu vermeiden.
Erfindungsgemäß wird die Aufgabe hinsichtlich des Bauelements nach Anspruch 1
und hinsichtlich des Verfahrens nach Anspruch 10 gelöst.
Weitere Ausgestaltungen des Chip-Bauelements sind in den
Ansprüchen 2 bis 9 beschrieben.
Der übrige Aufbau des Chip-Bauelementes, das sowohl ein Wider
stand als auch ein Nullwiderstand sein kann, ist bekannt. Der
Abgleich des strukturierten Widerstandes erfolgt mit dem Elektro
nen- oder Laserstrahl.
Die Polymerfolie für den Träger ist zweckmäßigerweise ein Mate
rial aus der Gruppe der Polythermide, wie z. B. Polyimid, die
hohe Temperaturbeständigkeit aufweisen.
Der in der Faltung angeordnete Steg ist ein gut wärmeleitendes
Material wie Al₂O₃, vorzugsweise ein Metall (Al, Cu). Die Dicke
des Steges ist so groß, daß die durch die Faltung eintretende
Dehnung bzw. Stauchung an den Stirnseiten des Bauelementes nicht
zu Rissen oder Schichtablösungen führt.
Das Chip-Bauelement hat den Vorteil, daß es aus sehr dünnem
Trägermaterial hergestellt werden kann und trotzdem durch die
Faltung und den zwischengelegten Steg eine hohe Stabilität bei
guter Kühlung aufweist. Die Ausführung ermöglicht eine hochpro
duktive Fertigung mit umweltfreundlichen Verfahrensschritten.
An einem Ausführungsbeispiel wird die Erfindung näher erläutert.
Es zeigen
Fig. 1a einen Schnitt durch einen einfach gefalteten Chip-Wider
stand,
Fig. 1b eine Beschichtung des ungefalteten Trägers,
Die Fig. 1a und 1b zeigen einen Chip-Widerstand in einfacher Faltung, der eine Größe von 3×1,5 mm hat. Der Träger 1 von 0,3 mm Dicke ist vor dem Falten in einer Vakuumbeschichtungsanlage mit der Widerstandsschicht 2 aus NiCr strukturiert beschichtet. Danach sind die Kontaktschichten 3 aus einer Haftschicht aus Cr und aus CuNi, z. T. die Widerstandsschicht 2 überlappend, strei fenförmig strukturiert aufgebracht.
Die Fig. 1a und 1b zeigen einen Chip-Widerstand in einfacher Faltung, der eine Größe von 3×1,5 mm hat. Der Träger 1 von 0,3 mm Dicke ist vor dem Falten in einer Vakuumbeschichtungsanlage mit der Widerstandsschicht 2 aus NiCr strukturiert beschichtet. Danach sind die Kontaktschichten 3 aus einer Haftschicht aus Cr und aus CuNi, z. T. die Widerstandsschicht 2 überlappend, strei fenförmig strukturiert aufgebracht.
Das erfindungsgemäße Verfahren zur Herstellung eines Chip-Wider
standes wird wie folgt ausgeführt:
Auf einer Folienbahn von 0,3 mm Dicke und einer Breite der
vielfachen Länge eines ungefalteten Trägers 1 werden in einer
Vakuum-Bandbedampfungsanlage gleichzeitig durch vorgeschaltete
Blenden streifenförmig und strukturiert die Widerstandsschichten
2 nebeneinander, entsprechend der Anzahl der auf der Folienbahn
herzustellenden Bauelemente, aufgedampft. In einem weiteren
Durchlauf werden in Vakuumfolge auf gleiche Weise die Kontakt
schichten 3, die Widerstandsschicht 2 überlappend aufgedampft.
Danach wird die Folienbahn in Streifen getrennt und unter Zwi
schenlegen des streifenförmigen Steges 4 von 0,4 mm Dicke in der
Mitte gefaltet, und gleichzeitig werden die dabei übereinander
liegenden Seiten adhäsiv verbunden.
In einem anschließenden Prozeßschritt erfolgt in bekannter Weise
das Abgleichen des Widerstandes mit dem Elektronenstrahl auf
einen vorgegebenen Sollwert. Die strukturiert aufgedampften
Kontaktschichten werden durch Tauchen belotet, und danach werden
die in einer Bahn hergestellten Bauelemente mechanisch getrennt.
Claims (11)
1. Chip-Bauelement mit der Funktion als Widerstand oder Kurzschlußbrücke, bestehend
aus einem gefalteten Träger aus Isolierstoffolie aus einem
organischen Polymermaterial mit darauf aufgebrachten Funktionsschichten,
und mit
den Funktionsschichten verbundenen Kontaktschichten, dadurch
gekennzeichnet, daß der Träger (1) durch Falten gedoppelt ist und
die Faltung in der Mitte des ungefalteten Trägers (1)
ausgeführt ist, so daß die Seiten bündig übereinanderliegen und daß
in der Doppelung des Trägers (1) ein Steg (4) aus
Material mit mindestens der Wärmeleitfähigkeit von Keramik angeordnet ist, und
daß die übereinander zu liegen
kommenden Seiten des Trägers adhäsiv
miteinander verbunden sind.
2. Chip-Bauelement nach Anspruch 1, dadurch gekennzeichnet, daß
der Steg (4) aus
Metall, vorzugsweise Al oder Cu, besteht.
3. Chip-Bauelement nach Anspruch 1, dadurch gekennzeichnet, daß
der Steg (4) aus
Keramik, vorzugsweise Al₂O₃ besteht.
4. Chip-Bauelement nach Anspruch 1 bis 3, dadurch gekennzeich
net, daß die Funktionsschicht zur Ausbildung des Chips als
Widerstand aus NiCr, Ta, CrSi besteht.
5. Chip-Bauelement nach Anspruch 1 bis 3, dadurch gekennzeich
net, daß die Funktionsschicht zur Ausbildung des Chips als
Nullwiderstand aus Cu besteht.
6. Chip-Bauelement nach einem der
Ansprüche 1 bis 5, dadurch gekennzeichnet, daß die Kontaktschich
ten (3) aus Cu und Ni auf einer chromhaltigen Haftschicht beste
hen.
7. Chip-Bauelement nach einem der Ansprüche 1 bis 6, dadurch gekennzeichnet, daß die Funktionsschichten
(2; 6) mit einer Schutzschicht überzogen sind.
8. Chip-Bauelement nach Anspruch 7, dadurch gekennzeichnet,
daß die Schutzschicht aus
SiO₂ besteht.
9. Chip-Bauelement nach Anspruch 7, dadurch gekennzeichnet, daß
die Schutzschicht eine Resistfolie ist, die adhäsiv aufge
bracht ist.
10. Verfahren zur Herstellung von Chip-Bauelementen nach einem der Ansprüche 1 bis 9 durch Vakuum
beschichten eines Trägers aus elektrisch isolierendem Material
mit Funktions- und Kontaktschichten und Abgleich der Funktions
schichten mittels Elektronen- oder Laserstrahl
gekennzeichnet durch folgende Prozeßschritte:
- - Vakuumbeschichten des als bandförmige Folie vorliegenden Trägers in mehreren Bahnen, die nebeneinanderliegen mit jeweils einer Breite, die der doppelten Länge eines Chip-Bauelements entspricht, mit Funktionsschichten als durchgehende strukturierte Streifen, die dem Schichtaufbau, der Schichtgeometrie und der jeweiligen Funktion des Chip-Bauelements entsprechen,
- - Aufbringen der Kontaktschichten in Vakuumfolge auf die Funk tionsschichten oder neben diese, jedoch diese überlappend,
- - Trennen der Bahnen voneinander und Falten derselben in der Mitte unter Zwischenlegen eines Steges aus Material mit mindestens der Wärmeleitfähigkeit von Keramik in die Doppelung und Verbinden des übereinander zu liegen kommenden Seiten des Trägers auf adhäsiven Wege,
- - Abgleich der strukturierten Funktionsschichten mit einem Elektronen- oder Laserstrahl,
- - Beloten der Kontaktschichten mit einem Lot, vorzugsweise aus einer Blei-Zinn-Legierung,
- - mechanisches Trennen der Bahnen in die einzelnen Chip-Bauele mente.
11. Verfahren nach Anspruch 10, dadurch gekennzeichnet, daß die Schutzschicht
einem weiteren Vakuumbeschichtungsprozeß aufgebracht wird.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19924202824 DE4202824C2 (de) | 1992-01-31 | 1992-01-31 | Chip-Bauelement und Verfahren zu dessen Herstellung |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE19924202824 DE4202824C2 (de) | 1992-01-31 | 1992-01-31 | Chip-Bauelement und Verfahren zu dessen Herstellung |
Publications (2)
Publication Number | Publication Date |
---|---|
DE4202824A1 DE4202824A1 (de) | 1993-08-05 |
DE4202824C2 true DE4202824C2 (de) | 1995-01-05 |
Family
ID=6450722
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19924202824 Expired - Fee Related DE4202824C2 (de) | 1992-01-31 | 1992-01-31 | Chip-Bauelement und Verfahren zu dessen Herstellung |
Country Status (1)
Country | Link |
---|---|
DE (1) | DE4202824C2 (de) |
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Publication number | Publication date |
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DE4202824A1 (de) | 1993-08-05 |
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